KR960018601A - 자동 테스트 회로 - Google Patents
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Abstract
본 발명의 자동 테스트 회로는, 메모리 장치에 포함되어 한번의 테스트 명령에 의하여 일괄적으로 어드레스 신호를 발생하여 라이트(WRITE) 및 리드(READ) 동작을 수행한다. 이를 위하여 상기 자동 테스트 회로는 외부로 부터의 로우 어드레스 스트로브 신호 및 칼럼 어드레스 스트로브 신호 및 라이트 신호 및 리드 신호를 입력하여 테스트 명령신호를 발생하는 테스트 명령신호 발생수단과, 상기 테스트 명령발생수단으로 부터의 테스트 명령신호 및 외부로 부터의 로우 어드레스 신호에 의하여 일정주기의 클럭신호를 발생하는 제1클럭발생수단과, 상기 제1클럭발생수단으로 부터의 클럭신호에 의하여 로우 어드레스 신호를 생성하는 로우 어드레스 신호발생수단과, 상기 제1클럭발생수단으로 부터의 신호 및 상기 테스트 명령신호 발생수단으로 부터의 테스트 명령신호에 의하여 일정주기의 클럭신호를 발생하는 제2클럭발생수단과, 상기 제2클럭발생수단으로 부터의 클럭신호에 의하여 칼럼 어드레스 신호를 생성하는 칼럼 어드레스 신호발생수단을 구비한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시예에 따른 자동 테스트 회로의 블럭도.
Claims (4)
- 외부로 부터의 로우 어드레스 스트로브 신호 및 칼럼 어드레스 스트로브 신호 및 라이트 신호 및 리드 신호를 입력하여 테스트 명령신호를 발생하는 테스트 명령신호 발생수단과, 상기 테스트 명령발생 수단으로 부터의 테스트 명령신호 및 외부로 부터의 로우 어드레스 신호에 의하여 일정주기의 클럭신호를 발생하는 제1클럭발생수단과, 상기 제1클럭발생수단으로 부터의 클럭신호에 의하여 로우 어드레스 신호를 생성하는 로우 어드레스 신호발생수단과, 상기 제1클럭발생수단으로 부터의 신호 및 상기 테스트 명령신호 발생수단으로 부터의 테스트 명령신호에 의하여 일정주기의 클럭신호를 발생하는 제2클럭발생수단과, 상기 제2클럭발생수단으로 부터의 클럭신호에 의하여 칼럼 어드레스 신호를 생성하는 칼럼 어드레스 신호발생수단을 구비한 것을 특징으로 하는 자동 테스트 회로.
- 제1항에 있어서, 상기 테스트 명령신호 발생수단으로 부터의 신호 및 외부로 부터의 로우 어드레스 스트로브 신호를 입력하여 상기 제1클럭발생수단쪽으로 공급하는 제1감지수단과, 상기 테스트 명령신호 발생수단으로 부터의 신호 및 상기 제1클럭발생수단으로 부터의 신호를 입력하여 상기 제2클럭발생수단쪽으로 공급하는 제2감지수단과, 외부로 부터의 로우 어드레스 스트로브 신호를 완충하여 상기 제1감지수단쪽으로 전송하는 제1 완충수단과, 상기 제1클럭발생수단과 상기 제2감지수단 사이에 접속되어 상기 제1클럭발생수단으로 부터의 신호를 완충하여 상기 제2감지수단쪽으로 전송하는 동시에 로우 어드레스 스트로브 신호를 생성하는 제2완충수단과, 상기 제2클럭발생수단으로 부터의 신호를 완충하여 컬럼 어드레스 스트로브 신호를 생성하는 제3완충수단을 추가로 구비한 것을 특징으로 하는 자동 테스트 회로.
- 제1항에 있어서, 상기 제2클럭발생수단의 클럭신호의 주기가 상기 제1클럭발생수단의 클럭신호의 주기보다 일정배수 짧은 것을 특징으로 하는 자동 테스트 회로.
- 제1항에 있어서, 상기 제1클럭발생수단 및 상기 제2클럭발생수단이 타이머를 포함한 것을 특징으로 하는 자동 테스트 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (4)
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---|---|---|---|
KR1019940029344A KR970011583B1 (ko) | 1994-11-09 | 1994-11-09 | 자동 테스트 회로 |
US08/554,698 US5579271A (en) | 1994-11-09 | 1995-11-07 | Automatic test circuit for a semiconductor memory device capable of generating internal ras and cas signals, and row and column address signals |
GB9522877A GB2295038B (en) | 1994-11-09 | 1995-11-08 | Test circuit for a semiconductor device |
JP7291409A JP3014632B2 (ja) | 1994-11-09 | 1995-11-09 | 半導体メモリ装置の自動テスト回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019940029344A KR970011583B1 (ko) | 1994-11-09 | 1994-11-09 | 자동 테스트 회로 |
Publications (2)
Publication Number | Publication Date |
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KR960018601A true KR960018601A (ko) | 1996-06-17 |
KR970011583B1 KR970011583B1 (ko) | 1997-07-12 |
Family
ID=19397482
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019940029344A KR970011583B1 (ko) | 1994-11-09 | 1994-11-09 | 자동 테스트 회로 |
Country Status (1)
Country | Link |
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KR (1) | KR970011583B1 (ko) |
-
1994
- 1994-11-09 KR KR1019940029344A patent/KR970011583B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
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KR970011583B1 (ko) | 1997-07-12 |
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