KR960015768A - 마스크패턴 제거방법 - Google Patents
마스크패턴 제거방법 Download PDFInfo
- Publication number
- KR960015768A KR960015768A KR1019940026831A KR19940026831A KR960015768A KR 960015768 A KR960015768 A KR 960015768A KR 1019940026831 A KR1019940026831 A KR 1019940026831A KR 19940026831 A KR19940026831 A KR 19940026831A KR 960015768 A KR960015768 A KR 960015768A
- Authority
- KR
- South Korea
- Prior art keywords
- mask pattern
- layer
- resist
- etched
- oxide film
- Prior art date
Links
- 238000000034 method Methods 0.000 claims abstract description 31
- 239000010410 layer Substances 0.000 claims abstract 36
- 239000012044 organic layer Substances 0.000 claims abstract 10
- 238000005530 etching Methods 0.000 claims abstract 8
- 239000004065 semiconductor Substances 0.000 claims abstract 3
- 239000000758 substrate Substances 0.000 claims abstract 3
- 239000005380 borophosphosilicate glass Substances 0.000 claims 4
- 239000002184 metal Substances 0.000 claims 4
- 150000004767 nitrides Chemical class 0.000 claims 4
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims 4
- 229920005591 polysilicon Polymers 0.000 claims 4
- 239000000463 material Substances 0.000 claims 2
- 239000011368 organic material Substances 0.000 claims 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/0271—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers
- H01L21/0273—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers characterised by the treatment of photoresist layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31144—Etching the insulating layers by chemical or physical means using masks
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/3213—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
- H01L21/32139—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer using masks
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Photosensitive Polymer And Photoresist Processing (AREA)
- Drying Of Semiconductors (AREA)
Abstract
본 발명은 마스크패턴 제거방법에 관한 것으로, 피식각층에 가해지는 손상없이 마스크패턴을 제거하기 위한 것이다.
본 발명은 반도체기판상에 형성된 피식각층을 패터닝하기 위해 형성된 유기질층과 이 유기질층 상부에 형성된 무기질층으로 이루어진 마스크패턴을 제거하는 방법에 있어서, 상기 마스크패턴이 형성된 피식각층 전면에 상기 마스크패턴을 완전히 덮을 수 있는 두께로 레지스트를 도포하는 단계와, 상기 레지스트에 선택적으로 시릴레이션공정을 행하고, O2플라즈마를 이용하여 식각공정을 행하여 상기 마스크패턴 상부의 레지스트부분을 제거함과 동시에 상기 마스크패턴이 형성되어 있지 않은 노출된 상기 피식각층 상부의 상기 레지스트 표면에 산화막을 형성하는 단계, 상기 마스크패턴 상부의 무기질층과 상기 산화막을 식각하는 단계, 상기 마스크패턴의 유기질층과 상기 남아 있는 레지스트층을 제거하는 단계로 이루어지는 마스크패턴 제거방법을 제공함으로써 피식각층에 손상을 가하지 않으면서 마스크패턴을 효과적으로 제거할 수 있도록 한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 일실시예에 의한 마스크패턴 제거방법을 도시한 공정순서도.
Claims (16)
- 반도체기판상에 형성된 피식각층을 패터닝하기 위해 형성된 유기질층과 이 유기질층 상부에 형성된 무기질층으로 이루어진 마스크패턴을 제거하는 방법에 있어서, 상기 마스크패턴이 형성된 피식각층 전면에 상기 마스크패턴을 완전히 덮을 수 있는 두께로 레지스트를 도포하는 단계와, 상기 레지스트에 선택적으로 시릴레이션공정을 행하고 O2플라즈마를 이용하여 식각공정을 행하여 상기 마스크패턴 상부의 레지스트부분을 제거함과 동시에 상기 마스크패턴이 형성되어 있지 않은 노출된 상기 피식각층 상부의 상기 레지스트 표면에 산화막을 형성하는 단계, 상기 마스크패턴 상부의 무기질층과 상기 산화막을 식각하는 단계, 상기 마스크패턴의 유기질층과 상기 남아 있는 레지스트층을 제거하는 단계로 이루어지는 것을 특징으로 하는 마스크패턴 제거방법.
- 제1항에 있어서, 상기 피식각층과 상기 마스크패턴을 이루는 무기질층이 동일하거나 유사한 물질로 이루어진 것임을 특징으로 하는 마스크패턴 제거방법.
- 제1항에 있어서, 상기 마스크패턴을 이루는 유기질층은 레지스트로 이루어진 것을 특징으로 하는 마스크 패턴 제거방법.
- 제1항에 있어서, 상기 마스크패턴은 시릴레이션공정에 의해 형성된 것임을 특징으로 하는 마스크패턴 제거방법.
- 제1항에 있어서, 상기 마스크패턴은 다층레지스트공정에 의해 형성된 하층레지스트와 중간층으로 이루어진 구조임을 특징으로 하는 마스크패턴 제거방법.
- 제1항에 있어서, 상기 피식각층은 산화막, 폴리실리콘, 질화막, 금속 및 BPSG중에서 선택된 어느 하나로 이루어짐을 특징으로 하는 마스크패턴 제거방법.
- 제1항에 있어서, 상기 마스크패턴을 이루는 무기질층은 산화막, 폴리실리콘, 질화막, 금속 및 BPSG중에서 선택된 어느 하나로 이루어짐을 특징으로 하는 마스크패턴 제거방법.
- 반도체기판상에 형성된 피식각층을 패터닝하기 위해 형성된 유기질층과 이 유기질층 상부에 형성된 무기질층으로 이루어진 마스크패턴을 제거하는 방법에 있어서, 상기 마스크패턴이 형성된 피식각층 전면에 상기 마스크패턴을 완전히 덮을 수 있는 두께로 레지스트를 도포하는 단계와, 상기 레지스트를 상기 마스크패턴이 형성되어 있지 않은 노출된 상기 피식각층 상부에만 선택적으로 남기는 단계, 상기 마스크패턴 상부의 무기질층을 제거하는 단계, 상기 마스크패턴의 유기질층과 상기 남아 있는 레지스트층을 제거하는 단계로 이루어지는 것을 특징으로 하는 마스크패턴 제거방법.
- 제8항에 있어서, 상기 피식각층과 상기 마스크패턴을 이루는 무기질층이 동일하거나 유사한 물질로 이루어진 것임을 특징으로 하는 마스크패턴 제거방법.
- 제8항에 있어서, 상기 마스크패턴을 이루는 유기질층은 레지스트로 이루어진 것을 특징으로 하는 마스크패턴 제거방법.
- 제8항에 있어서, 상기 마스크패턴을 시릴레이션공정에 의해 형성된 것임을 특징으로 하는 마스크패턴 제거방법.
- 제8항에 있어서, 상기 마스크패턴을 다층레지스트공정에 의해 형성된 하층레지스트와 중간층으로 이루어진 것임을 특징으로 하는 마스크패턴 제거방법.
- 제8항에 있어서, 상기 피식각층은 산화막, 폴리실리콘, 질화막, 금속 및 BPSG중에서 선택된 어느 하나로 이루어짐을 특징으로 하는 마스크패턴 제거방법.
- 제8항에 있어서, 상기 마스크패턴을 이루는 무기질층은 산화막, 폴리실리콘, 질화막, 금속 및 BPSG중에서 선택된 어느 하나로 이루어짐을 특징으로 하는 마스크 패턴 제거방법.
- 제8항에 있어서, 상기 레지스트를 상기 마스크패턴이 형성되어 있지 않은 노출된 상기 피식각층 상부에만 선택적으로 남기는 단계는 상기 레지스트를 선택적으로 노광 및 현상하는 공정에 의해 행해짐을 특징으로 하는 마스크패턴 제거방법.
- 제8항에 있어서, 상기 레지스트를 상기 마스크패턴이 형성되어 있지 않은 노출된 상기 피식각층 상부에만 선택적을 남기는 단계는 상기 레지스트와 상기 마스크 패턴을 이루는 무기질층과의 식각선택비를 조절하여 블러드식각하는 공정에 의해 행해짐을 특징으로 하는 마스크패턴 제거방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940026831A KR0156121B1 (ko) | 1994-10-20 | 1994-10-20 | 마스크패턴 제거방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940026831A KR0156121B1 (ko) | 1994-10-20 | 1994-10-20 | 마스크패턴 제거방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR960015768A true KR960015768A (ko) | 1996-05-22 |
KR0156121B1 KR0156121B1 (ko) | 1998-12-01 |
Family
ID=19395498
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940026831A KR0156121B1 (ko) | 1994-10-20 | 1994-10-20 | 마스크패턴 제거방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR0156121B1 (ko) |
-
1994
- 1994-10-20 KR KR1019940026831A patent/KR0156121B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR0156121B1 (ko) | 1998-12-01 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR960012328A (ko) | 반도체 장치에 밀접하게 이격 배치된 금속 전극을 형성하는 방법 | |
KR960015768A (ko) | 마스크패턴 제거방법 | |
KR980005543A (ko) | 반도체 소자의 금속 배선 형성방법 | |
KR960006564B1 (ko) | 반도체 소자의 미세 패턴 형성방법 | |
KR970052570A (ko) | 반도체 장치의 평탄화방법 | |
KR960002582A (ko) | 반도체소자의 제조방법 | |
KR980003891A (ko) | 노광용 정렬 키 제조방법 | |
KR970030667A (ko) | 비아 홀 형성 방법 | |
KR950009360A (ko) | 반도체 소자의 미세 패턴 형성방법 | |
KR980003884A (ko) | 레지스트 패턴 형성방법 | |
KR960026304A (ko) | 반도체 소자의 패턴 형성방법 | |
KR960005791A (ko) | 반도체소자의 콘택홀 형성방법 | |
KR970003854A (ko) | 다층 금속배선 형성방법 | |
KR940002664A (ko) | 감광막 패턴 형성방법 | |
KR970077715A (ko) | 메탈 배선 형성방법 | |
KR970051897A (ko) | 반도체장치의 제조방법 | |
KR960026635A (ko) | 금속배선 형성방법 | |
KR940016671A (ko) | 실리레이션용 레지스트패턴 형성방법 | |
KR960026282A (ko) | 반도체 소자의 패턴 형성방법 | |
KR980005486A (ko) | 반도체 소자의 콘택홀 형성방법 | |
KR970053580A (ko) | 반도체 소자의 금속배선 형성방법 | |
KR970052354A (ko) | 반도체 소자의 콘택 홀 형성방법 | |
KR970023705A (ko) | 반도체장치의 개구부형성방법 | |
KR940016629A (ko) | 삼층감광막 패턴 형성방법 | |
KR950014970A (ko) | 반도체 소자의 층간 절연막 평탄화 방법 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20060619 Year of fee payment: 9 |
|
LAPS | Lapse due to unpaid annual fee |