KR980005543A - 반도체 소자의 금속 배선 형성방법 - Google Patents
반도체 소자의 금속 배선 형성방법 Download PDFInfo
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Abstract
본 발명은 평탄화막에 의한 결함 및 접촉 특성이 개선된 반도체 소자의 금속 배선 방법이 개시된다. 본 발명은 반도체 기판의 비아홀 예정 영역에 더미 패턴이 형성되고, 구조를 상부에 제1금속막이 증착된다. 그런다음 제1금속막의 소정 부분이 식각되어 더미 패턴 상부 및 반도체 기판상의 소정 부분에 제1금속 패턴이 형성된 다음, 전체 구조상부에 제1층간 절연막과, 평탄화막 및 제2층간 절연막이 증착되고, 더미 패턴 상부의 제1금속 패턴 표면이 노출되고, 그외의 구조를 상부에는 미세한 두께의 제2층간 절연막이 존재하도록 제1층간 절연막과, 평탄화막 및 제2층간절연막이 식각된 후, 제2금속 배선이 형성되어, 소자의 콘택 특성을 증대시키고, 금속 배선 공정시 평탄화막이 노출되지 아니하여, 평탄화막에 의한 제2금속 배선의 부식이 방지된다. 또한, 비아홀을 형성하기 위한 마스크 형성 공정이 배제되어, 공정의 단순화를 이룩할 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2a도 내지 제2i도는 본 발명의 반도체 소자의 금속 배선 형성 방법을 공정순서적으로 설명하기 위한 단면도.
Claims (6)
- 트랜지스터 및 절연막이 형성된 반도체 기판을 제공하는 단계; 상기 반도체 기판의 비아홀 예정 영역에 더미패턴을 형성하는 단계; 반도체 기판의 결과물 상부에 제1금속막을 증착하는 단계; 상기 제1금속막의 소정 부분을 식각하여, 더미 패턴 상부 및 반도체 기판상의 소정 부분에 제1금속 패턴을 형성하는 단계; 전체 구조 상부에 제1층간 절연막과, 평탄화막 및 제2층간 절연막을 증착하는 단계; 상기 더미 패턴 상부의 제1금속 패턴 표면이 노출되고, 그외의 구조를 상부에는 미세한 두께의 제2층간 절연막이 존재하도록, 제1층간 절연막과, 평탄화막 및 제2층간 절연막을 식각하는 단계; 및 반도체 기판의 결과를 상부에 제2금속 배선을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 금속 배선 형성방법.
- 제1항에 있어서, 상기 제1금속 패턴을 형성하기 위하여는, 금속막을 증착하는 단계와, 금속 패턴을 형성하는 단계 사이에, 표면 단차를 줄이기 위한 포토레지스트막을 도포하는 단계; 상기 포토레지스트막 상부에 불투명층을 증착하는 단계; 상기 불투명층 상부에 제1금속막 패터닝용 포토레지스트 패턴을 형성하는 단계; 상기 포토레지스트 패턴에 의하여 상기 불투명층의 소정 부분을 패터닝하는 단계; 포토레지스트 패턴을 제거하는 단계; 상기 패터닝된 불투명층의 형태로 하부의 포토레지스트막을 노광 및 현상하여 제2의 포토레지스트 패턴을 형성하는 단계; 제2의 포토레지스트 패턴을 이용하여 제1금속막을 식각하는 단계를 부가적으로 포함하는 것을 특징으로 하는 반도체 소자의 금속 배선 형성방법.
- 제1항에 있어서, 상기 제2층간 절연막은 평탄화막에 대하여 식각 선택비가 큰 물질인 것을 특징으로 하는 반도체 소자의 금속 배선 형성방법.
- 제1항 또는 제3항에 있어서, 상기 평탄화막은 SOG막인 것을 특징으로 하는 반도체 소자의 금속 배선 형성방법.
- 제4항에 있어서, 상기 제2층간 절연막은 오존 PSG막인 것을 특징으로 하는 반도체 소자의 금속 배선 형성방법.
- 제1항에 있어서, 상기 제1층간 절연막과, 평탄화막 및 제2층간 절연막은, 습식 식각 방식으로 식각하는 것을 특징으로 하는 반도체 소자의 금속 배선 형성방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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Cited By (2)
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KR20020092118A (ko) * | 2001-06-02 | 2002-12-11 | 삼성전자 주식회사 | 균일하게 평탄한 금속간 유전막을 구비하는 반도체 소자의제조 방법 |
KR100499396B1 (ko) * | 2002-10-31 | 2005-07-05 | 매그나칩 반도체 유한회사 | 반도체 소자의 제조 방법 |
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