KR950702736A - 방해없이 임의로 주소가능한 메모리 시스템 - Google Patents

방해없이 임의로 주소가능한 메모리 시스템

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KR950702736A
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Abstract

재구성 가능한 논리배열을 재프로그램하기 위한 장치 및 방법이 제공되며, 이에 의해 전체배열의 작동을 방해하지 않고 배열(15)의 한 부분이 재구성될 수 있다. 배열작동의 전체적인 방해를 피하는 것은 배열의 구성을 결정하는 구성 제어신호가 재프로그래밍 작업중에 방해를 받지않도록 유지됨을 필요로 한다. 한 실시예에서, 재프로그래밍은 재프로그램되고 있는 특정 기억요소들 사이에서만 전기적 경로(12)가 설정되는 유일한 해독에 의해 동작하며, 이에 의해서 다른 기억요소들에 의해 제공되는 궉 제어신호의 방해를 피한다. 다른 실시예에서, 버퍼 및/또는 판독-수정-기록 기술은 프로그램되고 있지 않은 기억요소들의 구성제어 신호의 방해를 최소화하도록 사용된다.

Description

방해없이 임의로 주소가능한 메모리 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제5도는 다수의 제어 기억장치 요소들과 이들을 동적으로 프로그래밍 및 재프로그래밍하기 위한 수단을 포함하는 구성가능 논리배열의 제어 기억장치 섹션에 대한 도면.
제6도는 제5도에서 도시된 바와 같은 구성가능 논리배열의 제어 기억장치 섹션내에서 사용하도록된 본 발명에 따른 제어 기억장치 요소의 첫번째 실시예를 도시한 도면.
제7도는 제9a도에서 도시된 바와 같은 구성가능 논리배열의 제어 기억장치 섹션내에서 사용하도록된 본 발명에 따른 제어 기억장치 요소의 두번째 실시예를 도시한 도면.
제8도는 제7도에서 도시된 타입의 제어 기억장치 요소의 배열과 조화하여 사용하기 위한 칼럼 해독회로도.
제9도는 제5도에 도시된 구성가능 논리배열의 제어 기억장치 섹션이되 칼럼 해독 단어라인과 분리된 판독 및 기록 단어라인들을 포함하는 변형된 섹션을 도시한 도면.
제9a도는 제5도에 도시된 구성가능 논리배열의 제어 기억장치 섹션이되 분리된 판독 및 기록 단어라인들을 포함하는 변형된 섹션을 도시한 도면.

Claims (19)

  1. 각각이 적어도 하나의 기억노드를 가지며, 기억요소가 적어도 두개의 상태로 프로그램될 수 있고, 각 기억요소가 또한 상기 기억노드의 상태에 따른 한 신호를 제공하기 위한 수단을 갖는 다수의 기억요소, 그리고 상기 기억노드들의 상태를 프로그램하기 위한 수단으로서, 이같은 프로그램을 위한 수단이 한 부분집합의 상기 기억노드들을 직접 어드레스하기 위한 수단을 포함하여 상기 부분집합 이외의 기억노드들의 상태에 따라 신호들을 크게 방해하지 않고도 상기 부분집합의 기억노드들에 대한 프로그램을 용이하게 하기 위한 프로그래밍 수단을 포함하는 방해없이 임의로 주소가능한 메모리 시스템.
  2. 제1항에 있어서, 각 기억요소가 한 쌍안정래치를 포함함을 특징으로 하는 메모리 시스템.
  3. 제1항에 있어서, 상기 기억요소들이 규칙적인 2차원적 배열로 배치되어 각 기억요소가 배열의 특정행과 열과 관련되도록 함을 특징으로 하는 메모리 시스템.
  4. 제3항에 있어서, 상기 프로그래밍 수단이 한 특정 행내 기억요소로 전기적 신호를 선택적으로 결합시키기 위한 행 프로그래밍수단, 그리고 한 확정열내 기억요소로 전기적 신호를 선택적으로 결합시키기 위한 열 프로그래밍 수단을 포함함을 특징으로 하는 메모리 시스템.
  5. 제4항에 있어서, 상기 행 또는 열 프로그래밍 수단중 적어도 하나가 재프로그래밍 작업중에 상기 부분집합의 직업 어드레스된 기억노드중 몇몇 기억노드의 상태를 일시적으로 저장하기 위한 수단을 포함함을 특징으로 하는 메모리 시스템.
  6. 적어도 두개의 구성상태를 갖는 다수의 구성가능 논리요소, 상기 구성가능 논리요소의 구성상태를 선택하기 위해 상기 구성가능 논리요소로 구성 제어신호를 제공하는 다수의 제어 기억 장치 요소, 그리고 제어 기억장치 요소의 부분집합 이와의 요소들에 의해 제공된 구성 제어신호를 크게 방해하지 않고 상기 제어 기억장치 요소부분집합을 직접 프로그래밍할 수 있는 상기 제어 기억장치 요소를 프로그램하기 위한 프로그래밍 수단을 포함하는 구성가능 논리배열.
  7. 제6항에 있어서, 제어 기억장치요소들이 이차원적 배열내에 배치되어 각 요소가 배열의 특정행과 열에 관련됨을 특징으로 하는 구성가능 논리배열.
  8. 제7항에 있어서, 프로그래밍 수단이, 각 단어라인이 상기 이차원적 배열의 단일행내 제어기억장치 요소로 연결되는 다수의 단어 라인을 포함하는 행 해독 수단 그리고 각 비트라인이 상기 이차원적 배열의 단일열내 제어 기억장치 요소로 연결되는 다수의 비트라인을 포함하는 열 해독수단을 포함함을 특징으로 하는 구성가능 논리배열.
  9. 제8항 있어서, 각 제어 기억장치 요소가 두 상태를 갖는 쌍안정 래치, 상기 쌍안정 래치로부터 입력을 수신하고, 구성가능 논리요소로 구성 제어신호를 제공하는 제어신호 버퍼, 그리고 상기 쌍안정 래치를 상기 비트 라인중 한 라인으로 연결시키기 위해 상기 단어라인들중 한 라인으로부터의 신호에 응답하는 스위치를 포함함을 특징으로 하는 구성가능 논리배열.
  10. 제8항에 있어서, 각 제어 기억장치 요소가 두상태를 가지며 한 구성제어신호를 재공하는 쌍안정래치, 상기 쌍안정래치를 상기 비트라인중 하나로 연결시키기 위해 상기 단어라인들중 하나에 응답하는 기록스위치, 상기 쌍안정 래치를 상기 비트라인중 하나로 연결시키기 위해 상기 단어라인들중 하나에 응답하는 판독스위치, 그리고 상기 판독스위치를 통해 연결된 상기 비트라인들중 한 라인으로부터의 신호가 상기 쌍안정 래치의 상태를 크게 방해하지 않도록 하기 위해 상기 쌍안정 래치와 상기 판독 스위치 사이에 배치대는 판독버퍼를 포함함을 특징으로 하는 구성가능 논리배열.
  11. 제10항에 있어서, 열해독 수단이 상기 비트라인들중 한 라인을 한 자료라인으로 연결시키기 위한 수단, 그리고 상기 비트라인들중 다른 라인들을 통해 신호를 일시직으로 저장하고 유지시키기 위한 수단을 포함하는 구성가능 논리 배열.
  12. 제8항에 있어서, 열해독수단이 다수의 열 해독단어라인들을 더욱 포함하고, 상기 열 해독 단어라인들이 열해독 수단과 상기 이차원 배열의 단일열내 제어기억장치 요소 사이를 연결시킴을 특징으로 하는 구성가능 논리배열.
  13. 제12항에 있어서. 각 제어기억장치 요소가 두 상태를 가지며 한 구성제어 신호를 제공하는 쌍안정 래치, 첫번째와 두번째 단자 사이의 전도를 제어하기 위해 열 해독단어 라인으로부터 제공된 한 신호에 응답하는 열 해독스위치(상기 첫번째 단자는 상기 쌍안정 래치로 연결된다), 상기 두번째단자와 상기 비트라인들중 한 라인 사이의 전도를 제어하기 위해 한 단어라인으로부터 제공된 신호에 응답하는 기록 스위치, 그리고 상기 두번째 단자의 상기 비트라인들중 한 라인 사이의 전도를 제어하기 위해 상기 단어라인들중 한 라인으로부터 제공된 신호에 응답하는 판독스위치를 포함하며, 상기 판독스위치가 전도되는때 상기 두번째 단자와 상기 비트 라인들중 한 라인 사이의 저항이 상기 기록 스위치가 전도되는때 상기 두번째 단자와 상기 비트라인들증 한 라인 사이의 저항보다 높음을 특징으로 하는 구성가능 논리배열.
  14. 제12항에 있어서, 각 제어기억장치 요소가 두 상태를 가지며 한 구성제어신호를 제공하는 쌍안정래치, 첫번째 단자와 두 번째 단자 사이의 전도를 제어하기 위해 상기열 해독단어 라인들중 한 라인에 의해 제공된 신호에 응답하는 열해독 스위치(상기 첫번째 단자는 상기 쌍안정 래치에 연결된다).
  15. 프로그래밍 수단과 다수의 제어 기억장치 요소 한 부분집합 사이에 전기적 연결을 설정하고, 그리고 상기 다수의 제어기억장치 요소 부분집합 이외의 요소들에 의해 제공된 구성제어 신호를 크게 방해하지 않고 상기 기억장치 요소 부분집합의 상태를 재 프로그램하기 위해 상기 기억장치요소 부분집합으로의 전기적 연결을 통하여 상기 프로그래밍 수단으로부터 프로그래밍 신호를 받아들이는 단계를 포함하는 구성가능 논리 배열의 프로그래밍 및 재프로그래밍 방법.
  16. 제15항에 있어서, 상기 프로그래밍 수단파 상기 제어 기억장치 요소 부분집합 사이의 전기적 연결이 유일한 해독에 의해 설정됨을 특징으로 하는 구성가능 논리배열의 프로그래밍 및 재프로그래밍 방법.
  17. 제15항의 방법에 따른 프로그램 및 재프로그램된 구성가능 논리배열.
  18. 제16항의 방법에 따라 프로그램 및 재프로그램된 구성가능 논리배열.
  19. ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950700002A 1992-07-02 1993-07-01 방해없이임의로주소지정가능한메모리시스템 KR100320605B1 (ko)

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