KR950020695A - 고전위 전달회로 - Google Patents

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KR950020695A
KR950020695A KR1019930030468A KR930030468A KR950020695A KR 950020695 A KR950020695 A KR 950020695A KR 1019930030468 A KR1019930030468 A KR 1019930030468A KR 930030468 A KR930030468 A KR 930030468A KR 950020695 A KR950020695 A KR 950020695A
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KR
South Korea
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high potential
potential
gate
drain
transfer circuit
Prior art date
Application number
KR1019930030468A
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English (en)
Inventor
이재진
Original Assignee
김주용
현대전자산업 주식회사
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Publication date
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Abstract

본 발명은 고전위 전달회로의 출력단에 고전위(Vpp)를 출력하는 초기에는 우선 전원전위(Vdd)를 인가하고 그 이후에 고전위(Vpp)를 전달하도록함으로써 출력단의 부하를 구도하는데 소모되는 전력을 감소시키기 위하여, 전원전위(Vdd)와 출력단 사이에 접속되며 게이트가 고전위 전달부와 풀-다운 트랜지스터의 게이트로 인가되는 신호에 의해 제어되는 NMOS형 트랜지스터를 포함시켜 고전위 전달회로를 구현한 것이다.

Description

고전위 전달회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 고전위 전달회로를 도시한 회로도.

Claims (1)

  1. 전원전위 보다 전위가 높은 고전위를 전원으로 하여 크로스 커플드(cross coupled)된 제1 및 제2PMOS형 트랜지스터와, 드레인이 상기 제1PMOS형 트랜지스터와 드레인과 제2PMOS형 트랜지스터의 게이트가 접속된 풀-업 장치 제어노드와 접지전위 사이에 접속되며 게이트로 입력신호가 반전된 신호가 인가되는 제1NMOS형 트랜지스터와, 드레인이 상기 제1PMOS형 트랜지스터의 게이트와 제2PMOS형 트랜지스터의 드레인이 접속된 고전위 출력노드와 접지전위 사이에 접속되며 게이트로 입력신호가 지연된 신호가 인가되는 제 2NMOS형 트랜지스터와, 상기 고전위 출력노드에 접속되며 고전위 출력노드의 전위를 버퍼링하여 출력하는 반전 게이트와, 전원 전위가 상기 반전 게이트의 출력단 사이에 접속되며 게이트가 상기 제2NMOS형 트랜지스터의 게이트에 연결된 제3NMOS형 트랜지스터를 포함하는 것을 특징으로 하는 고전위 전달회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930030468A 1993-12-28 1993-12-28 고전위 전달회로 KR950020695A (ko)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100642910B1 (ko) * 2002-07-15 2006-11-03 주식회사 하이닉스반도체 반도체 소자의 고전압 입력 장치

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* Cited by examiner, † Cited by third party
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