KR950010119A - 박막트랜지스터 및 그의 제조방법 - Google Patents

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    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
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Abstract

본 발명은 박막트랜지스터 및 그의 제조방법에 관한 것으로, 종래 박막트랜지스터는 게이트전극패트부위의 게이트절연막과 데이타전극패드부위의 보호막을 각기 따로 식각을 수행함으로써 공정수가 증가하게 되어 먼지나 기타공정에 사용되는 화학용액에 의해 소자의 특성이 저하될 수 있고, 또한 소요시간과 원자제가 증가하는 문제점이 있었다.
본 발명은 이러한 문제점을 해결하기 위한 것으로, 게이트전극패드부의 게이트절연막과 데이타전극패드부위의 보호막을 보호막 증착후 동시에 식각함으로써 2회의 공정을 1회로 단순화할 수 있어 소요시간과 원자제를 줄일 수 있고, 먼지나 화학용액으로부터 오염을 방지하여 소자의 특성이 저하되는 것을 방지할 수있게 된다.

Description

박막트랜지스터 및 그의 제조방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명 박막트랜지스터의 구성도.
제2도의 (가) 내지 (라)는 제1도에 대한 제조공정도.
제3도의 (가)는 제2도에 따른 게이트전극패드부의 구조도, (나)는 제2도에 다른 데이타전극패드부의 구조도.

Claims (4)

  1. 액정표시소자용 박막트랜지스터에 있어서 전기적 접촉을 위해 노출된 데이타전극패드부의 하부에 게이트절연막이 형성되는 것을 특징으로 하는 박막트랜지스터.
  2. 기판상부에 게이트전극과 게이트전극패드부를 형성하는 공정과, 기판전면에 게이트절연막을 증착하는 공정과, 활성층, 화소전극, 소오스/드레인전극을 순차적으로 형성하는 공정과 기판전면에 보호막을 증착하는 공정과, 게이트전극패드부위의 게이트절연막과 데이타전극패드부의 보호막을 동시에 식각하는 공정으로 이루어지는 것을 특징으로 하는 박막트랜지스터 제조방법.
  3. 제2항에 있어서, 상기 게이트절연막을 SiN, SiO2, Ta2O 등의 절연물질로 형성하는 것을 특징으로 하는 박막트랜지스터 제조방법.
  4. 제2항에 있어서, 상기 보호막을 SiN, SiO2, Ta2O 등의 절연물질로 형성하는 것을 특징으로 하는 박막트랜지스터 제조방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930018565A 1993-09-15 1993-09-15 박막트랜지스터의제조방법 KR100303000B1 (ko)

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