KR910021017A - BiCMOS용 출력회로 - Google Patents
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- H03K19/094—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using semiconductor devices using field-effect transistors
- H03K19/0944—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using semiconductor devices using field-effect transistors using MOSFET or insulated gate field-effect transistors, i.e. IGFET
- H03K19/09448—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using semiconductor devices using field-effect transistors using MOSFET or insulated gate field-effect transistors, i.e. IGFET in combination with bipolar transistors [BIMOS]
Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본발명의 회로도, 제3도는 본 발명의 다른 실시예를 나타낸 회로도.
Claims (2)
- 입력노드 (N1)는 P채널 MOS트랜지스터 (M1)와 N채널 MOS트랜지스터 (M2), (M7)의 게이트단과 연결하고, 제1전원 노드 (N2)는 P채널 MOS트랜지스터 (M1), (M3), (M5)의 드레인단과 바이폴라 트랜지스터 (Q1)의 콜렉터단과 연결하고, 제2전원 노드 (N3)는 N채널 MOS트랜지스터 (M7), (M8)의 소오스단과, 바이폴라 트랜지스터 (Q2)의 에미터 및 콘덴서(Co)의 타측과 연결하고, 출력노드 (N4)는 P채널 MOS트랜지스터 (M5)의 소오스단, N채널 MOS트랜지스터 (M2), (M6)의 드레인과 두 바이폴라 트랜지스터 (Q1), (Q2)의 에미터단 콜렉터단 및 콘덴서 (Co)의 일측과 연결하고, N채널 MOS트랜지스터 (M7)의 드레인단과 연결된 P채널 NOS트랜지스터 (M1)의 소오스단은 P채널 MOS트랜지스터 (M3)의 게이드단과 N채널 MOS트랜지스터 (M4), (M8)의 게이드단 및 바이폴라트랜지스터(Q1)의 게이트단과 연결하고, 소오스단이 접지된 N채널 MOS트랜지스터(M4)의 드레인단과 연결된 P채널 MOS트랜지스터 (M3)의 소오스단은 P채널 MOS트랜지스터 (M5)의 게이트단과 N채널 MOS트랜지스터 (M6)의 게이트단과 연결하고, N채널 MOS트랜지스터 (M8)의 드레인단과 연결된 N채널 MOS트랜지스터 (M2)의 소오스만은 바이폴라 트랜지스터 (Q2)의 베이스단과 연결하여서 구성됨을 특징으로 하는 BiCMOS용 출력회로.
- 제1항에 있어서, 입력노드 (N1)는 P채널 MOS트랜지스터 (M1), (M5)와 N채널 MOS트랜지스터 (M2), (M6), (M7)의 게이트단과 연결하고, 제1전원노드 (N2)는 P채널 MOS트랜지스터 (M1), (M5)의 드레인다나과 바이폴라트랜지스터 (Q1)의 콜렉터단과 연결하고, 제2전원노드 (N3)는 N채널 MOS트랜지스터 (M6), (M7), (M8)의 소오스단과 바이폴라 트랜지스터 (Q2)의 에미터 및 콘덴서 (Co)의 타측과 연결하고, 출력노드 (N4)는 P채널 MOS트랜지스터(M5)의 소오스단과 N채널 MOS트랜지스터 (M2), (M6)의 드레인단과 바이폴라 트랜지스터 (Q2)의 콜렉터단과 바이폴라 트랜지스터 (Q1)의 에미터단 및 콘덴서 (Co)의 일측과 연결하고, N채널 MOS트랜지스터 (M7)의 드레인단과 접속된 P채널 MOS트랜지스터 (M1)의 소오스단은 바이폴라 트랜지스터 (Q1)의 베이스단과 N채널 MOS트랜지스터 (M8)의 게이트단과 연결하고, N채널 MOS트랜지스터 (M8)의 드레인단과 접속된 N채널 MOS트랜지스터 (M2)의 소오스단은 바이폴라 트랜지스터 (Q2)의 베이스단과 연결하여 소자의 수를 줄이도록한 BiCMOS용 출력회로.※ 참고사항 : 최초출원 내용에 의하여 공개되는 것임.
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1991
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