KR880011996A - 차동증폭기 - Google Patents
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Abstract
내용없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 본발명의 제 1 실시예에 따른 차동증폭기의 구성을 도시한 회로도
제 2 도는 제 1 도 및 제 3 도 에 도시한 차동증폭기의 동작파형도
제 3 도는 본 발명의 제 2 실시예에 따른 차동증폭기의 구성을 도시한 회로도.
Claims (2)
- 각각의 게이트 단자 사이에 차동입력 신호가 공급되고, 각각의 소오스 단자가 서로 접속되어 그 접속점이 정전류원을 통해서 제 1 전원에 접속되며, 각각의 드레인 단자가 각각 대응한 저항 또는 정전류원을 통해서 제 2 전원에 접속되어 차동쌍을 이루는 한세트의 제 1 도전형인 입력 FET(N1,N2또는 P1,P2;전계효과 트랜지스터)와;각각의 베이스 단자가 바이어스 전원에 접속되고, 각각의 에미터 단자가 각각 대응해서 상기 입력 FET의 드레인 단자에 접속되며, 한쪽의 컬렉터 단자가 출력 단자에 접속된 한세트의 바이폴라트랜지스터(Q5,Q6또는 Q7,Q8) 및 제 1 도전형인 FET로 이루어지며, 상기 바이폴라트랜지스터의 각 켈렉터단자와 상기 제 1 전원 사이에 접속된 전류미러회로(N5,N6)를 구비한 것을 특징으로 하는 차동증폭기.
- 각각의 게이트 단자 사이에 차동입력신호가 공급되고, 각각의 소오스 단자가 서로 접속되어 그 접속점이 정전류원을 통해서 제 1 전원에 접속되며, 차동쌍을 이룬 한세트의 제 1 도 전형인 입력 FET(N1,N2또는 P1,P2;전계효과트랜지스터)와;각각의 베이스 단자가 제 1 바이어스전원(VB1)에 접속되고, 각각의 에미터 단자가 각각 대응해서 상기 입력 FET의 드레인 단자에 접속되며, 각각의 컬렉터 단자가 각각 대응한 저항 또는 정전류원을 통해서 제 2 전원에 접속된 한세트의 바이폴라트랜지스터(Q11,Q12또는 Q13,Q14);각각의 게이트 단자가 제 2 바이어스전원(VB2)에 접속되고 각각의 소오스 단자가 각각 대응한 상기 바이폴라트랜지스터의 컬렉터 단자에 접속되며, 한쪽의 드레인 단자가 출력 단자에 접속된 한세트의 제 2 도전형인 FET(P5,P6또는 N7,N8) 및 제 1 전형인 FET로 이루어지며, 상기 제 2 도 전형인 FET의 각 드레인 단자와 상기 제 1 전원 사이에 접속된 전류미러회로(N5,N6또는 P7, P8)를 구비한 것을 특징으로 하는 차동증폭기.※참고사항:최초출원 내용에 의하여 공개하는 것임.
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