KR890015555A - 디지탈 음성 전송용 코덱 - Google Patents

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Abstract

내용 없음

Description

디지탈 음성 전송용 코덱
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 본 발명에 따라 예시적으로 만들어진 전용 통신망의 개관도. 제 2 도는 제 1 도에 도시된 구내 교환기(PBX) 및 전환기와 일체화된 두개의 코덱(codec)에 관한 기능적 블럭 다이어그램. 제 3 도는 제 1 도의 회로망에 사용되는 신호 형태도.

Claims (20)

  1. 전송로를 통해 통신 목적 지점까지 접속되어 있고, 디지탈 입력신호에 응답하여 상기 통신 목적지점으로 향하는 출력 디지탈신호를 발생하는데 적합하고, 상기 출력신호는 상기 목적 지점까지 통신할 정보를 나타내며, 상기 입력신호는 코드 형태로 상기 정보를 나타내는 시스템에서 사용되는 코덱에 있어서, 상기 출력신호를 디코딩하기 위한 수단을 상기 전송로가 포함할 것인지의 여부에 관하여 결정화하는 제 1 수단과, 상기 결정사항이, 상기 전송로가 상기 출력신호로서 상기 정보의 디코드 변화를 발생시키기 위해, 상기 출력신호를 디코딩하는 수단을 포함하지 않는 것일때 작동하게 되는 제 2 수단과, 상기 결정 사항이, 상기 전송로가 상기 출력신호로서, 상기 입력신호가 첨가된 신호를 발생하기 위해 상기 출력신호를 디코딩하는 수단을 포함하고 있을때 작동하게 되는 제 3 수단을 구비하는 것을 특징으로하는 코덱.
  2. 제 1 항에 있어서, 상기 코덱은 전송로로부터 상기 목적 지점에서 발생한 정보를 나타내는 제 2 입력신호를 수신하는 수단과, 설정 관리신호인 제 2 입력신호의 존재에 응답하여, 상기 전송로가 상기 제 1 출력신호를 디코딩하기 위한 수단을 포함할 것을 결정화하는 수단을 부가적으로 구비하는 것을 특징으로하는 코덱.
  3. 제 2 항에 있어서, 상기 코덱은 상기 출력신호내에서 상기 코덱의 존재를 나타내는 관리신호를 포함하는 수단을 부가적으로 구비하는 것을 특징으로하는 코덱.
  4. 제 2 항에 있어서, 상기 출력 및 입력신호는 제 2 비트율과, 제 2 비트율보다 작은 제 1 비트율이고, 상기 제 3 수단은 플레이스-호울더 비트를 상기 입력신호에 가산함으로서 상기 출력신호를 발생하는 것을 특징으로하는 코덱.
  5. 제 4 항에 있어서, 상기 플레이스-호울더 비트의 각각은 상기 코덱의 존재를 나타내는 관리신호를 포함하는 것을 특징으로하는 코덱.
  6. 전송로를 통해 통신 목적 지점까지 접속되어 있고, 디지탈 입력신호에 응답하여 상기 통신 목적 지점으로 향하는 출력 디지탈신호를 발생하는데 적합하고, 상기 출력신호는 상기 목적 지점까지 통신할 정보를 나타내며, 상기 입력신호는 코드 형태로 상기 정보를 나타내는 시스템에서 사용되는 코덱에 있어서, 상기 입력신호는, 이 신호속에 코드 변형된 정보신호가 재개되었는지의 여부에 관하여 결정화하는 제 1 수단과, 상기 결정사항이, 상기 입력신호가 상기 출력신호로서 상기 정보의 코드변형을 발생하기 위해, 입력신호에 코드변형 정보가 개재되지 않았을때 작동하는 제 2 수단과, 상기 결정사항이 상기 입력신호가 상기 출력신호로서 상기 개재된 코드 변형이 포함된 상기 입력신호부분을 발생시키기 위해, 상기 입력신호에 코드 변형된 정보가 개재되었을때 작동하는 제 3 수단을 구비한 것을 특징으로 하는 코덱.
  7. 제 6 항에 있어서, 상기 입력신호가 설정 관리신호인 입력신호에서의 존재에 응답하여, 코드 변형의 상기 정보가 입력신호에 개재되어 있음을 결정화하는 수단을 구비하는 것을 특징으로하는 코덱.
  8. 제 1, 제 2 전송로를 통해 제 1, 제 2 통신 목적 지점까지 접속되고, 제 1, 제 2 디지탈 입력신호에 응답하여 각각 제 1, 제 2 디지탈 출력신호를 발생시키는데 적합하고 상기 제 1, 제 2 입력신호는 각각 제 1, 제 2통신 목적 지점으로부터 발생한 정보를 나타내며, 상기 제1, 제2 출력신호는 각각 제 2, 제 1통신 목적 지점까지 향하는 정보를 나타내며, 제 1 입력신호와 제2 출력신호는 각각 코드 형태로 하여, 상기 제 1 출력신호 및 제 2 출력신호에 의해 나타내는 정보를 나타내는 시스템에서 사용되는 코덱에 있어서, 상기 제 1 전송로가, 상기 제 1 출력신호를 디코딩하는 수단 및 상기 제 2 입력신호내에 상기 제 2 목적 지점으로부터 발생한 코드 변형 정보를 개재시키는 수단 모두를 포함하고 있는지의 여부를 결정화하는 제 1 수단과, 상기 제 1 출력신호로서 제 1 입력신호에 의해 나타나는 디코드 변형 정보를 발생하고, 상기 제 2 입력신호로서 상기 제 2 입력신호에 의해 나타나는 코드 변형 정보를 발생시키는 결정화에 부정적으로 응답하여 작동하는 제 2 수단과, 상기 제 1 출력신호로서 제 1 입력신호가 개재된 신호를 발생시키고, 상기 제 2 출력신호로서, 상기 제 2 목적 지점으로부터 발생한 상기 개재된 코드 변형 정보를 포함한 상기 입력신호 부분을 발생시키는 결정화에 대해 긍적적으로 응답하여 작동하는 제 3 수단을 구비하는 것을 특징으로하는 코덱.
  9. 제 8 항에 있어서, 상기 제1, 제2 입력신호는 제 1 비트율에서 있고, 상기 제1, 제2 출력신호는 상기 제 1 비트율보다 큰 제 2 비트율에서 있으며, 상기 제 3 수단은 플레이스-호울더 비트를 상기 제 1 입력신호에 가산함으로써 상기 제 1 출력신호를 발생하고, 상기 제 2 입력신호로부터 플레이스-호울더 비트를 제거함으로써 상기 제2 출력신호를 발생하는 것을 특징으로 하는 코덱.
  10. 제 8 항에 있어서, 상기 수단은 설정 관리신호의 상기 제 2 입력신호내에 존재, 비존재의 함수로서 결정되는 것을 특징으로 하는 코덱.
  11. 제 1, 제 2 디지탈 신호에 응답하여 각각 제1, 제 2 디지탈 출력신호를 발생시키는데 적합하고, 상기 제 1 입력신호는 통신 목적 지점으로부터 발생한 인코드 음성을 나타내는 제 1 비트율 상태에서의 비트를 포함하고, 상기 제 2 출력 신호는 통신 목적 지점으로 향하는 인코드 음성을 나타내는 상기 제 1 비트율 상태에서 제 2 연속 비트를 갖고, 상기 제 1 출력신호 및 제 2 출력신호는 상기 제 1 비트율보다 큰 제 2 비트율을 발생하는 각 연속 멀티 비트 워드를 포함하는 코댁에 있어서, 상기 제1출력신호로서, 제1 동기 패턴을 포함하는 티코드 변형의 상기 제1 입력신호를 발생시키고, 상기 제 2출력신호로서 인코드 변형된 상기 제2입력신호를발생기시키도록 초기에 작동하는 수단과, 상기 제 1 출력신호로서, 상기 제1 입력신호로 부터의 비트와 제2 동기화 패턴을 나타내는 비트를 포함하는 신호를 발생시키는 수단을 구비하고, 상기 수단의 작동은 a) 상기 제 1 동기화 패턴의 제1,제2소정 간격 및, b) 제 2 동기화 패턴으로 연속되는 상기 제 1 동기화 패턴의 상기 제 1 소정 간격의 첫번째 발생의 상기 제 2 입력신호내에 존재 하는 것에 응답하여 시작되며, 상기 제 2 출력신호로서, 상기 제 2 입력신호의 각 연속 워드내에서 소정 비트 위치내의 비트를 포함하는 신호를 발생하기위해, 상기 제 2 입력신호내의 상기 제 2 동기화 패턴의 존재에 응답하여 작동하는 수단을 구비하는 것을 특징으로하는 코덱.
  12. 제 1 코덱과, 제 2 코덱의 전신 접속되어, 상기 제 1, 제 2 코덱 각각은 제 제 1, 제 2 디지탈 입력신호에 응답하여, 제 1, 제 2 디지탈 출력신호를 발생시키는데 적합하고, 상기 제 1, 제 2 코덱의 제 1 입력신호는 제 1, 제 2 통신 목적 지점으로부터 발생한 코드형 정보를 나타내고, 상기 제 1, 제 2 코덱의 제 1 출력신호는 상기 제 2 코덱 및 제1코텍의 제 2 입력신호가 되는 상기 각각의 제1, 제2 코덱에 있어서 , 관리신호를 상기 각 코텍의 제 1 코덱에삽입되는 수단과, 상기 각 코댁의 제 2입력신호내에서 상기 관리신호를 검출하는 수단과, 상기 관리신호가, 상기 각 코덱의 제 1 출력신호로서 ,상기 각 코덱의 제 1 출력신호가 개재된 소정 형태의 신호를 발생할 경우와, 상기 제2 출력신호로서, 코드형 정보가 개재된 상기 각 코드의 제 2 출력신호부분을 발생한 경우에만 작동하는 수단을 구비하는 것을 특징으로 하는 제1 , 제2코덱.
  13. 전송로를 통해 통신 목적 지점까지 접속되어 있고, 디지탈 입력신호에 응답하여 상기 통신 목적 지점으로 향하는 출력 디지탈 신호를 발생하는데 적합하고, 상기 출력신호는 상기 통신 목적 지점과 통신할 정보를 나타내고, 상기 입력신호는 코드형태로 상기 정보를 나타내는 시스템내에서의 코덱 사용 방법에 있어서, 상기 전송로가 상기 출력신호를 디코딩하는 수단을 포함할 것인지의 여부를 결정화하는 단계와, 상기 출력신호로서, 상기 전송로가 상기 출력신호를 디코딩하는 수단을 포함하지 않는 것으로 결정되었을때, 디코드 변형된 상기 정보를 발생하는 단계와, 상기 출력신호로서, 상기 전송로가 상기 출력신호를 디코딩하는 수단을 포함하지 않는 것으로 결정하였을때, 상기 입력신호가 개재된 신호를 발생하는 단계를 구비한 것을 특징으로 하는 코덱 사용방법.
  14. 제13항에 있어서, 상기 코덱은 상기 전송로로부터 상기 통신 목적 지점으로부터 발생한 정보를 나타내는 제 2 입력신호를 수신하기 위한 단계를 부가적으로 포함하고, 상기 결정화 단계에 있어서, 상기 전송로는 설정 관리신호내의 상기 제 2 입력신호의 존재에 응답하여, 상기 제 1 출력신호를 디코딩하는 수단을 포함할 것을 설정하는 것을 특징으로 하는 코덱 사용방법.
  15. 제14항에 있어서, 상기의 각 발생단계에서 , 상기 코덱의 존재를 표시하는 관리신호는 상기 출력신호에 포함되어 있는 것을 특징으로 하는 코덱 사용방법.
  16. 제14항에 있어서, 상기 입력 및 출력신호는 제 1, 제 2 비트율로 있고, 상기 제 1 비트율은 제 2 비트율보다 작으며, 상기 발생단계의 두번째에서, 상기 출력신호는 플레이스-호울더를 상기 입력신호에 가산함으로서 발생되는 것을 특징으로 하는 코덱 사용방법.
  17. 제16항에 있어서, 상기 플레이스-호울더 비트 각각 상기 코덱의 존재를 표시하는 관리신호를 포함하는 것을 특징으로 하는 코덱 사용방법.
  18. 전송로를 통해 통신 목적 지점까지 접속되어 있고, 디지탈 입력신호에 응답하여 상기 통신 목적 지점으로 향하는 출력 디지탈 신호를 발생하는데 적합하고, 상기 출력신호는 상기 통신 목적 지점과 통신할 정보를 나타내고, 상기 입력신호는 코드 형태로 상기 정보를 나타내는 시스템내에서의 코덱 사용방법에 있어서, 상기 입력신호는, 이 신호속에 코드 변형된 정보가 개재되어 있는지의 여부를 결정화하는 단계와, 상기 출력신호로서, 상기 입력신호가 이 신호속에 코드 변형된 정보가 개재되어 있지 않는 것으로 결정될때에, 코드 변형된 상기 정보를 발생시키는 단계와, 상기 출력신호로서, 상기 입력신호가 이 신호속에 코드 변형된 상기 정보가 개재되어 있을때에, 상기 정보가 개재된 코드 변형을 포함하는 상기 입력신호부분을 발생하는 단계를 특징으로 하는 코덱 사용방법.
  19. 제18항에 있어서, 상기 결정화 단계에서, 코드 변형된 상기 정보가 상기 입력에 개재되었음을 결정하는 것은 설정관리신호인 입력신호내에 존재하는 것을 응답하여 결정하는 것을 특징으로 하는 코덱 사용방법.
  20. 제 1, 제 2 디지탈 입력신호에 응답하여, 제 1, 제 2 디지탈 출력신호를 발생하는데 적합하고, 상기 제 1 입력신호는 통신 목적 지점으로부터 발생한 인코드 음성을 나타내는 제 1 비트율에서 비트를 포함하고, 상기 제 2 출력신호는, 상기 통신 목적 지점으로 향하는 인코드 음성을 나타내는 제 1 비트율에서, 제 2 연속 비트를 포함하며, 상기 제 1 출력신호, 제 2 입력신호는 상기 제 1 비트율보다 큰 제 2 비트율을 발생하는 각각의 연속 멀티 비트 워드를 구비한 코덱 사용 방법에 있어서, 상기 제 1 출력신호로서, 디코드 변형된 상기 제 1 입력신호를 처음으로 발생하고 ,또한 상기 제 2 출력신호로서, 제 1 동기화 패턴을 포함하는 인코드 병형된 상기 제2 입력신호를 처음으로 발생하는 단계와, 그 후에 상기 제1 출력신호로서, 상기 제 1 입력신호로부터의 비트와 , 상기 제 2 동기화 패턴을 나타내는 비트를 포함하는 신호를 발생하는 단계와, 상기 단계에서는 a) 상기 제 1 동기화 패턴의 제 1, 제 2 소정 및 b) 재 2 동기화 패턴으로 연속으로 상기 제 1 동기화 패턴의 제 1 소정 간격의 제 1 발생에 대한 제 2 입력신호에서 존재에 응답하여 시작되며, 그 후 상기 제 2 출력신호로서 상기 제 1 출력신호의 소정 비트 위치에 대응하는 제 2 입력신호의 각 연속 위드에서 비트 위치에 있는 비트를 포함하는 신호를 발생하고, 상기 제 2 입력신호의 제 2 동기화 패턴의 응답하여 시작되는 단계를 구비한 코덱 사용방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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