KR890005992A - 상보신호 출력회로 - Google Patents

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KR890005992A
KR890005992A KR1019880010532A KR880010532A KR890005992A KR 890005992 A KR890005992 A KR 890005992A KR 1019880010532 A KR1019880010532 A KR 1019880010532A KR 880010532 A KR880010532 A KR 880010532A KR 890005992 A KR890005992 A KR 890005992A
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히로유키 하라
마사지 우에노
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아오이 죠이치
가부시키가이샤 도시바
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    • H03—ELECTRONIC CIRCUITRY
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    • H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
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    • H03K5/15—Arrangements in which pulses are delivered at different times at several outputs, i.e. pulse distributors
    • H03K5/151—Arrangements in which pulses are delivered at different times at several outputs, i.e. pulse distributors with two complementary outputs
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    • H03K19/01—Modifications for accelerating switching
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Abstract

내용 없음

Description

상보신호 출력회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 1실시예에 따른 상보신호 출력회로의 구성도.
제4도 및 제5도는 제3도에 도시된 상보신호 출력회로의 구체적인 구성예를 나타낸 회로도.

Claims (12)

  1. 입력신호(IN)에 응답하여 2개의 출력신호중 소정위상의 한 출력신호를 출력하게 되는 제1인버터수단(I7, I8＆I9)과, 입력신호(IN)에 응답하여 상기 소정위상과 역위상인 다른 출력신호를 출력하게 되는 제2인버터수단(I6, I10) 및, 상기 다른 출력신호가 하이레벨상태로부터 로우레벨상태로 변화되는 것과 실질적으로 동일하게 상기 제1인버터수단(I7, I8＆I9)의 한 출력신호가 로우레벨 상태로부터 하이레벨상태로 변화하도록 만들어주는 트랜지스터수단(Q1, Q2, N6)을 구비하여, 소정의 위상으로 하이레벨상태로 로우레벨상태간에 변동하는 상기 입력신호(IN)와 전원전압에 응답해서 서로 위상이 반대인 2개의 출력신호를 공급하도록 되어 있는 상보신호 출력회로.
  2. 제1항에 있어서, 상기 제1, 제2인버터수단(I7, I8＆I9, I6, I10)이 입력신호(IN)에 대해 종속접속되어 있는 것을 특징으로 하는 상보신호 출력회로.
  3. 제1항에 있어서, 상기 트랜지스터수단(Q1, Q2)이 입력신호(IN)를 공급받는 베이스전극을 갖춘 바이폴러트랜지스터로 구성된 것을 특징으로 하는 상보신호 출력회로.
  4. 제1항에 있어서, 상기 제1, 제2인버터수단(I7, I8＆I9, I6, I10)은 각각 전원전압이 공급되는 제1단자와 접지전위가 제공되는 제2단자 및 상기 제1, 제2단자간에 접속된 CMOS인버터회로로 구성된 것을 특징으로 하는 상보신호 출력회로.
  5. 제4항에 있어서, 상기 제1인버터수단(I7, I8＆I9)이 CMOS인버터회로와 제2단자간에 접속되어 상기 트랜지스터수단(Q1, Q2)이 도통상태에 있을대 비도통상태로 변화하게 되는 MOS트랜지스터(N4, M17)를 더 구비하여 구성된 것을 특징으로 하는 상보신호 출력회로.
  6. 제1항에 있어서, 상기 제1인버터수단(I8＆I9)과 제2인버터수단(I10)이 입력신호(IN)에 대해 병렬로 접속되어 있는 것을 특징으로 하는 상보신호 출력회로.
  7. 제6항에 있어서, 상기 제1인버터수단(I8＆I9)이 입력신호(IN)에 대해 종속접속되는 제1인버터회로(I8)와 제2인버터회로(I9)로 구성된 것을 특징으로 하는 상보신호 출력회로.
  8. 제7항에 있어서, 상기 제2인버터회로(I9)가 COMS인버터회로, 제2단자간에 접속되어 트랜지스터수단(Q2)이 도통상태에 있을때 비도통상태로 변화하게 되는 MOS 트랜지스터(N17)를 더 구비하여 구성된 것을 특징으로 하는 상보신호 출력회로.
  9. 제6항에 있어서, 트랜지스터수단(Q2)이 입력신호(IN)를 공급받는 베이스전극을 갖춘 바이폴러트랜지스터로 구성된 것을 특징으로 하는 상보신호 출력회로.
  10. 입력신호(IN)에 응답하여 동위상 출력신호를 출력하게 되는 제1회로수단(I8＆I9)과 입력신호(IN)에 응답하여 역위상 출력번호를 출력하게 되는 제2회로수단(I10) 및, 입력신호(IN)의 상승엣지에 응답하여 동위상 출력신호의 상승을 제어하는 제어수단(Q2)을 구비하며, 상승엣지를 갖추고 있는 상기 입력신호(IN)와 전원전압에 응답해서 상기 동위상 출력신호와 역위상 출력신호를 공급하도록 되어 있는 상보신호 출력회로.
  11. 제10항에 있어서, 상기 제1회로수단(I8＆I9)이 입력신호(IN)에 대해 종속접속된, 제1, 제2인버터회로로 구성되고, 상기 제2회로수단(I10)인 제3인버터회로로 구성된 것을 특징으로 하는 상보신호 출력신호.
  12. 제11항에 있어서, 상기 제1, 제2, 제3인버터회로가 전원전압이 공급되는 제1단자와 접지전위가 제공되는 CMOS인버터회로로 구성된 것을 특징으로 하는 상보신호 출력회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019880010532A 1987-09-30 1988-08-19 상보신호출력회로 KR920000837B1 (ko)

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JP87-246767 1987-09-30

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