KR100533383B1 - 출력 드라이버 회로 - Google Patents
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Abstract
Description
최소치 | 대표치(typical) | 최대치 | |
업-슬루레이트 | 1.5[V/ns] | 3.1[V/ns] | 5.1[V/ns] |
다운-슬루레이트 | 1.65[V/ns] | 3.1[V/ns] | 5.7[V/ns] |
Claims (9)
- 메모리 장치의 내부 데이터를 외부로 출력하기 위한 출력 드라이버 회로에 있어서,상기 내부 데이터에 대응하는 복수의 데이터 신호를 발생시키는 프리 드라이버와,상기 복수의 데이터 신호 중 제 1 데이터 신호 및 제 2 데이터 신호를 상기 프리 드라이버로부터 입력받음과 아울러, 메모리 장치의 제어부로부터 소정의 제어 신호를 입력받아, 업-드라이빙 임피던스를 제어하기 위한 복수의 업-드라이빙 제어신호 및 다운-드라이빙 임피던스를 제어하기 위한 복수의 다운-드라이빙 제어신호를 발생시키는 OCD 프리 드라이버와,상기 복수의 데이터 신호 중 제 3 데이터 신호 및 제 4 데이터 신호를 상기 프리드라이버로부터 수신함과 아울러, 상기 OCD 프리 드라이버로부터 상기 복수의 업-드라이빙 제어신호 및 상기 복수의 다운-드라이빙 제어신호를 수신하여 출력신호를 발생시키는 푸쉬-풀 드라이버와,상기 출력신호의 슬루-레이트를 조절하기 위하여 상기 프리 드라이버로 입력되는 상기 내부 데이터를 제어하는 슬루-레이트 제어수단을포함하여 구성되는 것을 특징으로 하는 출력 드라이버 회로.
- 제 1항에 있어서, 상기 메모리 장치는 DDR(double data rate) II SDRAM인 것을 특징으로 하는 출력 드라이버 회로.
- 제 1 항에 있어서,상기 푸쉬-풀 드라이버는상기 제 3 데이터신호에 따라 상기 출력신호의 전압레벨을 제 1 출력 전압레벨로 구동하되, 상기 복수의 업-드라이빙 제어신호에 따라 개별적, 선택적으로 구동하는 복수의 풀-업수단과;상기 제 4 데이터신호에 따라 상기 출력신호의 전압레벨을 제 2 출력 전압레벨로 구동하되, 상기 복수의 다운-드라이빙 제어신호에 따라 개별적, 선택적으로 구동하는 복수의 풀-다운수단을 포함하는 것을특징으로 하는 출력 드라이버 회로.
- 제 3항에 있어서, 상기 메모리 장치는 DDR II SDRAM인 것을 특징으로 하는 출력 드라이버 회로.
- 제 1항 내지 제 4항 중 어느 한 항에 있어서,상기 슬루-레이트 제어수단은 저항 소자인 것을 특징으로 하는 출력 드라이버 회로.
- 제 5항에 있어서, 상기 저항 소자의 저항값은 300~400[Ω]인 것을 특징으로 하는 출력드라이버 회로.
- 제 5항에 있어서, 상기 저항 소자는 50[Ω/㎛2] 내지 150[Ω/㎛2]의 면저항율을 가지는 물질을 이용한 플레이트(plate)형 저항 소자인 것을 특징으로 하는 출력드라이버 회로.
- 제 5항에 있어서, 상기 저항 소자는 능동저항 또는 게이트 저항인 것을 특징으로 하는 출력 드라이버 회로.
- 제 5항에 있어서, 상기 저항 소자는 비트 라인 상의 저항성분을 이용하여 구성되는 것을 특징으로 하는 출력드라이버 회로.
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