JPS648382B2 - - Google Patents
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- JPS648382B2 JPS648382B2 JP58114608A JP11460883A JPS648382B2 JP S648382 B2 JPS648382 B2 JP S648382B2 JP 58114608 A JP58114608 A JP 58114608A JP 11460883 A JP11460883 A JP 11460883A JP S648382 B2 JPS648382 B2 JP S648382B2
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
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-
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- G06F11/073—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment in a memory management context, e.g. virtual memory or cache management
-
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- G06F11/0745—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment in an input/output transactions management context
-
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- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/08—Error detection or correction by redundancy in data representation, e.g. by using checking codes
- G06F11/10—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's
- G06F11/1008—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's in individual solid state devices
- G06F11/1048—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's in individual solid state devices using arrangements adapted for a specific error detection or correction feature
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Description
【発明の詳細な説明】
この発明は故障診断装置に関し、特にトレース
用記憶装置を備えた故障診断装置に関するもので
ある。
用記憶装置を備えた故障診断装置に関するもので
ある。
従来は、制御系や制御対象の各パラメータのう
ち故障診断に必要と考えられる情報を、あらかじ
めトレース情報として定め、このトレース情報
を、最新の数周期にわたつて、トレース用記憶装
置に記憶しておき、この記憶を再生して異常解析
を行つていた。そして、パリテイ検査の結果のエ
ラー信号(この明細書ではパリテイエラー信号と
いう)はトレース用記憶装置には記憶されなかつ
た。
ち故障診断に必要と考えられる情報を、あらかじ
めトレース情報として定め、このトレース情報
を、最新の数周期にわたつて、トレース用記憶装
置に記憶しておき、この記憶を再生して異常解析
を行つていた。そして、パリテイ検査の結果のエ
ラー信号(この明細書ではパリテイエラー信号と
いう)はトレース用記憶装置には記憶されなかつ
た。
パリテイ検査の1つの目的はデータの転送系に
おいて発生するエラーをチエツクすることにある
が、パリテイエラー信号がトレース用記憶装置に
記憶されてない場合は、データ転送系のエラーの
記録が残つてないので、トレースするデータが正
確に転送されたかどうかは不明であり、トレース
されたデータに対する信頼性が不確かであるとい
う欠点があつた。
おいて発生するエラーをチエツクすることにある
が、パリテイエラー信号がトレース用記憶装置に
記憶されてない場合は、データ転送系のエラーの
記録が残つてないので、トレースするデータが正
確に転送されたかどうかは不明であり、トレース
されたデータに対する信頼性が不確かであるとい
う欠点があつた。
この発明は上記のような従来のものの欠点を除
去するためになされたもので、パリテイエラー信
号をもトレース用記憶装置に記憶することによつ
て、トレースされたデータの信頼性を向上できる
故障診断装置を提供することを目的としている。
去するためになされたもので、パリテイエラー信
号をもトレース用記憶装置に記憶することによつ
て、トレースされたデータの信頼性を向上できる
故障診断装置を提供することを目的としている。
以下この発明の実施例を図面について説明す
る。第1図はこの発明の一実施例を示すブロツク
図で、図において、1は中央処理装置(以下
CPUと略記する)、2は主記憶装置、3は入出力
装置(以下I/Oと略記する)、4はトレース用
記憶装置、5はトレースメモリ再生装置、6は計
測器、7はアドレスバス、8はデータバスであ
る。
る。第1図はこの発明の一実施例を示すブロツク
図で、図において、1は中央処理装置(以下
CPUと略記する)、2は主記憶装置、3は入出力
装置(以下I/Oと略記する)、4はトレース用
記憶装置、5はトレースメモリ再生装置、6は計
測器、7はアドレスバス、8はデータバスであ
る。
CPU1はアドレスバス7によつて主記憶装置
2、I/O3の装置を選択し、データバス8を介
して、CPU1、主記憶装置2、I/O3の間で
データが転送される。データバス8を介してデー
タを転送する場合は転送中に発生する符号誤りを
検出することができるように当該データにパリテ
イ信号を付加して転送されるが、トレースされる
データについては当該データとそのパリテイ信号
とがトレース用記憶装置4に記憶される。この記
憶されたデータはトレースメモリ再生装置5によ
り再生され計測器6に記録される。
2、I/O3の装置を選択し、データバス8を介
して、CPU1、主記憶装置2、I/O3の間で
データが転送される。データバス8を介してデー
タを転送する場合は転送中に発生する符号誤りを
検出することができるように当該データにパリテ
イ信号を付加して転送されるが、トレースされる
データについては当該データとそのパリテイ信号
とがトレース用記憶装置4に記憶される。この記
憶されたデータはトレースメモリ再生装置5によ
り再生され計測器6に記録される。
第2図及び第3図は計測器6により記録された
データのチヤート図であり、これらの図におい
て、10はトレースされた信号、11は故障検出
信号、12はパリテイエラー信号を示す。第2図
の場合は故障が検出された後でパリテイエラーが
検出されており、第3図の場合はパリテイエラー
が検出された後で故障が検出されている場合を示
す。
データのチヤート図であり、これらの図におい
て、10はトレースされた信号、11は故障検出
信号、12はパリテイエラー信号を示す。第2図
の場合は故障が検出された後でパリテイエラーが
検出されており、第3図の場合はパリテイエラー
が検出された後で故障が検出されている場合を示
す。
すなわち、第2図の場合は、故障を検出した後
でパリテイエラーが検出されているので、故障検
出信号自体が誤検出されたものではないと言うこ
とができ、トレースされた信号自体にも信頼性が
あると言うことができる。
でパリテイエラーが検出されているので、故障検
出信号自体が誤検出されたものではないと言うこ
とができ、トレースされた信号自体にも信頼性が
あると言うことができる。
第3図の場合は、故障検出する前にパリテイエ
ラーが検出されているので、故障検出信号の誤検
出であるとも考えられるし、又、パリテイエラー
が検出された時点でのトレースされた信号は実際
の信号とは異なる可能性もあると考えられる。
ラーが検出されているので、故障検出信号の誤検
出であるとも考えられるし、又、パリテイエラー
が検出された時点でのトレースされた信号は実際
の信号とは異なる可能性もあると考えられる。
以上のような診断は、パリテイエラー信号がト
レース用記憶装置4に記憶されているために可能
となるのであつて、従来の装置においてはできな
かつた診断である。すなわち、この発明によつて
故障診断解析の信頼性を向上することができる。
レース用記憶装置4に記憶されているために可能
となるのであつて、従来の装置においてはできな
かつた診断である。すなわち、この発明によつて
故障診断解析の信頼性を向上することができる。
以上のようにこの発明によれば、トレースする
信号の中にパリテイエラー信号を加えたことによ
つて、故障診断機能の信頼性を向上することがで
きる。
信号の中にパリテイエラー信号を加えたことによ
つて、故障診断機能の信頼性を向上することがで
きる。
第1図はこの発明の一実施例を示すブロツク
図、第2図及び第3図はそれぞれ第1図の計測器
による記録例を示すチヤート図である。 1……CPU、2……主記憶回路、3……I/
O、4……トレース用記憶装置、5……トレース
メモリ再生装置、6……計測器、7……アドレス
バス、8……データバス、10……トレースされ
た信号、11……故障検出信号、12……パリテ
イエラー信号。尚、各図中同一符号は同一又は相
当部分を示す。
図、第2図及び第3図はそれぞれ第1図の計測器
による記録例を示すチヤート図である。 1……CPU、2……主記憶回路、3……I/
O、4……トレース用記憶装置、5……トレース
メモリ再生装置、6……計測器、7……アドレス
バス、8……データバス、10……トレースされ
た信号、11……故障検出信号、12……パリテ
イエラー信号。尚、各図中同一符号は同一又は相
当部分を示す。
Claims (1)
- 【特許請求の範囲】 1 主記憶装置及び各入出力装置と中央処理装置
との間で授受される情報のうちあらかじめ定める
特定の種類(単数又は複数)の情報であるトレー
ス情報と、故障検出信号の論理及びパリテイエラ
ー信号の論理の時間的経過とを、現時点から所定
時間前までの時間範囲にわたりトレース用記憶装
置に記憶させる手段と、 上記トレース用記憶装置の記憶を再生するトレ
ースメモリ再生装置と、このトレースメモリ再生
装置で再生された上記トレース情報と故障検出信
号及びパリテイエラー信号の時間的経過とから故
障診断を行う手段とを備えた故障診断装置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58114608A JPS607549A (ja) | 1983-06-24 | 1983-06-24 | 故障診断装置 |
US06/623,705 US4639917A (en) | 1983-06-24 | 1984-06-22 | Fault determining apparatus for data transmission system |
DE19843423090 DE3423090A1 (de) | 1983-06-24 | 1984-06-22 | Fehlerermittlungseinrichtung fuer ein datenuebertragungssystem |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58114608A JPS607549A (ja) | 1983-06-24 | 1983-06-24 | 故障診断装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS607549A JPS607549A (ja) | 1985-01-16 |
JPS648382B2 true JPS648382B2 (ja) | 1989-02-14 |
Family
ID=14642114
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58114608A Granted JPS607549A (ja) | 1983-06-24 | 1983-06-24 | 故障診断装置 |
Country Status (3)
Country | Link |
---|---|
US (1) | US4639917A (ja) |
JP (1) | JPS607549A (ja) |
DE (1) | DE3423090A1 (ja) |
Families Citing this family (31)
Publication number | Priority date | Publication date | Assignee | Title |
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EP0218979B1 (en) * | 1985-10-03 | 1991-04-24 | Mitsubishi Denki Kabushiki Kaisha | Computer program debugging system |
US4837683A (en) * | 1985-10-21 | 1989-06-06 | The United States Of America As Represented By The Secretary Of The Air Force | Hidden fault bit apparatus for a self-organizing digital processor system |
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CN103368686A (zh) * | 2012-04-09 | 2013-10-23 | 联咏科技股份有限公司 | 用于传送及接收数据的装置和方法 |
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---|---|---|---|---|
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FR2258668A1 (en) * | 1974-01-18 | 1975-08-18 | Labo Cent Telecommunicat | Data processor tracing unit - permits real time monitoring of system operation especially in telephone exchange systems |
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US4371930A (en) * | 1980-06-03 | 1983-02-01 | Burroughs Corporation | Apparatus for detecting, correcting and logging single bit memory read errors |
JPS57134756A (en) * | 1981-02-12 | 1982-08-20 | Hitachi Ltd | Information processor |
-
1983
- 1983-06-24 JP JP58114608A patent/JPS607549A/ja active Granted
-
1984
- 1984-06-22 US US06/623,705 patent/US4639917A/en not_active Expired - Fee Related
- 1984-06-22 DE DE19843423090 patent/DE3423090A1/de active Granted
Also Published As
Publication number | Publication date |
---|---|
US4639917A (en) | 1987-01-27 |
DE3423090A1 (de) | 1985-01-03 |
JPS607549A (ja) | 1985-01-16 |
DE3423090C2 (ja) | 1990-12-13 |
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