JPS647709B2 - - Google Patents

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Publication number
JPS647709B2
JPS647709B2 JP15637880A JP15637880A JPS647709B2 JP S647709 B2 JPS647709 B2 JP S647709B2 JP 15637880 A JP15637880 A JP 15637880A JP 15637880 A JP15637880 A JP 15637880A JP S647709 B2 JPS647709 B2 JP S647709B2
Authority
JP
Japan
Prior art keywords
loop
station
flag
circuit
control station
Prior art date
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Expired
Application number
JP15637880A
Other languages
English (en)
Other versions
JPS5780847A (en
Inventor
Yoshihisa Okamoto
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP15637880A priority Critical patent/JPS5780847A/ja
Publication of JPS5780847A publication Critical patent/JPS5780847A/ja
Publication of JPS647709B2 publication Critical patent/JPS647709B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L12/00Data switching networks
    • H04L12/28Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
    • H04L12/42Loop networks
    • H04L12/437Ring fault isolation or reconfiguration

Description

【発明の詳細な説明】 本発明は、一本の伝送路で複数個の端局を接続
して構成したループ式データ伝送方式に関する。
従来、この種のデータ伝送方式においては、ル
ープ状伝送路の同期を制御する1つのループ同期
制御局と複数の従属局とから構成されるシステム
のある従属局に障害が発生すると、この障害局の
他局への影響を回避するために、障害局の入出力
端を短絡して障害局を伝送路より切離すように制
御している。
しかし、システムに必須のループ同期制御局に
障害が発生した場合には、制御局を伝送路より切
離すと、システムそれ自身が機能しなくなり、切
離さないときには障害のある制御局によりシステ
ムが機能しなくなるという欠点がある。これを防
ぐためにループ同期制御局を二重化する方式が考
えられるが、この方式はハードウエアが増加する
という欠点がある。
本発明の目的は上述の欠点を除去しループ同期
制御局に障害が発生した場合に制御局を伝送路よ
り切離して、上記ループ同期制御局の機能を代行
する局が伝送路の同期制御を行うことによりデー
タ伝送を継続することが可能なループ式データ伝
送方式を提供することにある。
次に図面を参照して本発明を詳細に説明する。
第1図は、本発明の一実施例を説明するシステ
ム構成図である。図において、システムは、ルー
プ同期制御局1と、変復調装置などから構成され
た端局2および4と、ループ同期制御局1がバイ
パスされたときにループ状伝送路の同期制御を行
なう予備ループ同期制御局3とから構成されてい
る。
第2図は、本発明に使用されるデータフオーマ
ツトを示す。第2図において、Sは同期ビツト、
DAは相手局アドレス、SAは発信局アドレス、
Fはフラグビツト、Dはデータワードをそれぞれ
示す。このデータフオーマツト中のフラグビツト
Fは、ループ同期制御局1から全て「1」の状態
で送出される。他方、予備ループ同期制御局3は
受信したフラグビツトFの値を監視し、さらに受
信したフラグビツトFを「0」として伝送路に送
出する。
第3図は、ループ同期制御局1のブロツク図で
ある。第3図において、制御局1はループ伝送路
13からの信号を受信あるいは送信するための符
号変換回路15を有している。この符号変換回路
15は、データを受信再生するためのデータ再生
回路16および受信タイミングを再生するための
タイミング再生回路17にそれぞれ接続されてい
る。このタイミング再生回路17のタイミング信
号はデータ再生回路16に与えられる。データ再
生回路16はループ伝送路13の同期を制御する
ためのループ制御回路18に接続されている。こ
のループ制御回路18は第2図に示されるフラグ
ビツトFを全て「1」として送出するための第1
のフラグ送出回路19に接続されている。この送
出回路19は端末とのインターフエース回路20
と上記符号変換回路15にそれぞれ接続されてい
る。
第4図は、本発明に使用される予備ループ同期
制御局3のブロツク図である。予備制御局3は第
3図のループ同期制御局1の構成の他に、第2図
に示したフラグビツトの値を監視するフラグビツ
ト判定回路21と、その判定結果により切換える
切換回路22と、上記フラグビツトを全て「0」
として送出するための第2のフラグ送出回路23
を有している。
次に第1図のシステムの動作を説明する。ルー
プ同期制御局1の第1のフラグビツト送出回路1
9によりフラグビツトは全て「1」の状態で端局
2へ送出される。端局2はこれを中継して予備ル
ープ同期制御局3に送出する。予備ループ同期制
御局3のフラグビツト判定回路21はフラグビツ
ト「1」を判定し、切換回路22が第2のフリグ
送出回路23を選択するよう制御する。フラグビ
ツト送出回路23は受信フラグビツトを全て
「0」の状態に反転して端局4に送出する。端局
4では端局2と同様にフラグビツトを中継してル
ープ同期制御局1に送出する。ループ同期制御局
1では、フラグビツトを全て「0」の状態で受信
する。今、ループ同期制御局1がバイパス回路9
によりバイパスされたとするとバイパス回路9が
閉じた瞬間から端局2では端局4より送出される
全て「0」のフラグビツトを受信する。受信され
たフラグビツト「0」はそのまま端局2を介して
予備ループ同期制御局3に送られる。予備ループ
同期制御局3では、自局が送出するフラグビツト
「0」と同じフラグビツト「0」を受信する。フ
ラグビツト判定回路21はフラグビツト「0」を
検出し、これにより切換回路22を制御回路18
を選択するよう制御する。このようにして、予備
ループ同期制御局3は、ループ同期制御局1のバ
イパス(制御局1の障害)を検知して自局がルー
プ同期を制御するよう動作する。
以上のように、本発明では所定の値のフラグビ
ツトを送出しループ同期制御局の機能を代行する
予備ループ同期制御局で、受信したフラグビツト
の値を監視することによりループ同期制御局の障
害時に制御局を伝送路より切離してもデータ伝送
を継続することができる。これにより、ループ同
期制御局を二重化するような余分なハードウエア
を増加することもなくシステムの信頼性を向上す
ることができる。
【図面の簡単な説明】
第1図は、本発明の一実施例を説明するための
構成図、第2図は本発明に使用されるデータフオ
ーマツトを示す図、第3図および第4図は本発明
に使用されるループ同期制御局および予備ループ
同期制御局のブロツク図である。 第1図、第3図および第4図において、1……
ループ同期制御局、2,4……端局、3……予備
ループ同期制御局、5〜8……端末装置、9〜1
2……バイパス回路、13……ループ伝送路、1
5……符号変換回路、16……データ再生回路、
17……タイミング再生回路、18……ループ制
御回路、19……FLAG送出回路、20……イン
ターフエイス回路、21……FLAG検出回路、2
2……切換回路。

Claims (1)

  1. 【特許請求の範囲】 1 自局の障害発生により自局を伝送路から切離
    すときその入出力端を短絡するように構成された
    端局が少なくともも3個ループ状伝送路を介して
    結合されたループ式データ伝送方式において、 常時前記ループの同期制御を行い、かつ前記ル
    ープ状伝送路に少なくとも1ビツトのフラグを送
    出する機能を備えた第1の端局と、 受信した前記フラグの値を監視し、前記受信し
    たフラグの値が自局の送出したフラグの値と異な
    るとき前記フラグの値を反転して送出し、前記受
    信したフラグの値が自局の送出したフラグの値と
    等しいときには前記第1の端局が異常であると判
    定して前記同期制御を開始する第2の端局と、 受信した前記フラグを中継伝送する機能を備え
    た第3の端局とから構成されたことを特徴とする
    ループ式データ伝送方式。
JP15637880A 1980-11-06 1980-11-06 Loop data transmission system Granted JPS5780847A (en)

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JP15637880A JPS5780847A (en) 1980-11-06 1980-11-06 Loop data transmission system

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JP15637880A JPS5780847A (en) 1980-11-06 1980-11-06 Loop data transmission system

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Publication Number Publication Date
JPS5780847A JPS5780847A (en) 1982-05-20
JPS647709B2 true JPS647709B2 (ja) 1989-02-09

Family

ID=15626435

Family Applications (1)

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JP15637880A Granted JPS5780847A (en) 1980-11-06 1980-11-06 Loop data transmission system

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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5961249A (ja) * 1982-09-30 1984-04-07 Nec Corp ル−プ式デ−タ伝送方式
JPH0616629B2 (ja) * 1984-03-28 1994-03-02 日本電気株式会社 ル−プ式デ−タ伝送方式
JPS63102524A (ja) * 1986-10-20 1988-05-07 Fujitsu Ltd マスタクロツク源の二重化接続方法

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JPS5780847A (en) 1982-05-20

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