JPS6381855A - ヘテロ接合バイポ−ラトランジスタの製造方法 - Google Patents
ヘテロ接合バイポ−ラトランジスタの製造方法Info
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- JPS6381855A JPS6381855A JP61228724A JP22872486A JPS6381855A JP S6381855 A JPS6381855 A JP S6381855A JP 61228724 A JP61228724 A JP 61228724A JP 22872486 A JP22872486 A JP 22872486A JP S6381855 A JPS6381855 A JP S6381855A
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66234—Bipolar junction transistors [BJT]
- H01L29/6631—Bipolar junction transistors [BJT] with an active layer made of a group 13/15 material
- H01L29/66318—Heterojunction transistors
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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-
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-
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- Y10S148/05—Etch and refill
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明はへテロ接合バイポーラトランジスタ(以下、
HOTとも呼ぶ)の製造方法に関するものである。
HOTとも呼ぶ)の製造方法に関するものである。
(1984)310)に示された方法により製造された
HBTの断面構成を第2図に示す。
HBTの断面構成を第2図に示す。
すなわち、この第2図構成において、符号1は半絶縁性
基板、2はサブコレクタ層、3はコレクタ層、4は内部
ベース層、5はエミッタ層、6はキャップ層、7.7は
外部ベース層、8.8は外部ベース層の直下の半絶縁領
域、9.9は電極間分離用の半絶縁領域、10.10は
素子間分離用の半絶縁領域、11はエミッタ電極、12
.12はベース電極、13はコレクタ電極である。
基板、2はサブコレクタ層、3はコレクタ層、4は内部
ベース層、5はエミッタ層、6はキャップ層、7.7は
外部ベース層、8.8は外部ベース層の直下の半絶縁領
域、9.9は電極間分離用の半絶縁領域、10.10は
素子間分離用の半絶縁領域、11はエミッタ電極、12
.12はベース電極、13はコレクタ電極である。
しかして、このHBTの製造は、一般的に次のようにし
てなされる。
てなされる。
まず、半絶縁性基板!上に、サブコレクタ層2゜コレク
タ層3.内部ベース層4.エミッタ層5.およびギャッ
プ層6を、順次にエピタキシャル成長させる。
タ層3.内部ベース層4.エミッタ層5.およびギャッ
プ層6を、順次にエピタキシャル成長させる。
ついで、写真製版技術などにより外部ベース層形成のた
めのフォトレジストパターンを形成し、例えばBeイオ
ン注入により外部ベース層7.7を選択的に形成させ、
かつ、同じフォトレジストパターンを用いて、さらに深
い領域に酸素イオン注入をなし、外部ベース層7.7の
直下に半絶縁領域8゜8を選択的に形成する。
めのフォトレジストパターンを形成し、例えばBeイオ
ン注入により外部ベース層7.7を選択的に形成させ、
かつ、同じフォトレジストパターンを用いて、さらに深
い領域に酸素イオン注入をなし、外部ベース層7.7の
直下に半絶縁領域8゜8を選択的に形成する。
また、これらのイオン注入領域のアニール処理に引キk
itいて、外部ベース層7.7J−、には、ベース電極
12.12を、キャップ層6上には、エミッタ′市極1
1をそれぞれに形成してアロイし、さらに、コ1/クタ
電極形成のために、該当部分をサブコレクタ層2に達す
るまで、選択的にエツチング除去したトでフレフタ電極
13を形成する。
itいて、外部ベース層7.7J−、には、ベース電極
12.12を、キャップ層6上には、エミッタ′市極1
1をそれぞれに形成してアロイし、さらに、コ1/クタ
電極形成のために、該当部分をサブコレクタ層2に達す
るまで、選択的にエツチング除去したトでフレフタ電極
13を形成する。
最後に、例えばポロンイオン注入によって、′市場間分
離用の半絶縁領域3.および素子間分路用の゛r、、絶
縁領域10を、それぞれ選択的に形成するのである。
離用の半絶縁領域3.および素子間分路用の゛r、、絶
縁領域10を、それぞれ選択的に形成するのである。
しかしながら、この従来例方法によって製造されるHO
Tでは、その製造時にあって、外部ベース層7.7とそ
の直下の半絶縁領域8,8との選択的形成のために、そ
れぞれイオン注入、アニール処理を行なう必要があり、
このイオン注入に伴なうダメージとか、イオン注入後の
アニール処理による不純物の拡散などの好ましくない問
題点があり、さらには、外部ベース層7,7のイオン注
入と、エミッタ電極11.およびベース電極12 、1
2の形成とが、セルフアライメント的になされないため
に、素子寸法の微細化ができないなどの問題点があった
。
Tでは、その製造時にあって、外部ベース層7.7とそ
の直下の半絶縁領域8,8との選択的形成のために、そ
れぞれイオン注入、アニール処理を行なう必要があり、
このイオン注入に伴なうダメージとか、イオン注入後の
アニール処理による不純物の拡散などの好ましくない問
題点があり、さらには、外部ベース層7,7のイオン注
入と、エミッタ電極11.およびベース電極12 、1
2の形成とが、セルフアライメント的になされないため
に、素子寸法の微細化ができないなどの問題点があった
。
この発明は、従来のこのような問題へを改善するために
なされたものであって、その[二1的どするところは、
外部ベース層とその直下の半絶縁領域とを、イオン注入
、アニール処理手段によらずに選択的に形成させ、かつ
エミッタ電極をセルファライン的に形成し得るようにし
た。この種のへテロ接合バイポーラトランジスタの製造
方法を提供することである。
なされたものであって、その[二1的どするところは、
外部ベース層とその直下の半絶縁領域とを、イオン注入
、アニール処理手段によらずに選択的に形成させ、かつ
エミッタ電極をセルファライン的に形成し得るようにし
た。この種のへテロ接合バイポーラトランジスタの製造
方法を提供することである。
前記目的を達成するために、この発明に係るペテロ接合
バイポーラトランジスタの製造方法は、まず、コレクタ
層上にあって、半絶縁領域、外部ベース層を順次にエピ
タキシャル成長させ、ついで、パターン開口された絶縁
膜をマスクにして、コレクタ層に達するまで選択的にメ
サエッチングし、外部ベース層、半絶縁領域、コレクタ
層を露出させた後、同一絶縁膜をマスクにして、内部ベ
ース層、エミッタ層を11111次に選択的エピタキシ
ャル成長させ、かつ絶縁膜のパターン開[コを利用して
、セルフアライメント的にエミッタ電極を形成するよう
にしたものである。
バイポーラトランジスタの製造方法は、まず、コレクタ
層上にあって、半絶縁領域、外部ベース層を順次にエピ
タキシャル成長させ、ついで、パターン開口された絶縁
膜をマスクにして、コレクタ層に達するまで選択的にメ
サエッチングし、外部ベース層、半絶縁領域、コレクタ
層を露出させた後、同一絶縁膜をマスクにして、内部ベ
ース層、エミッタ層を11111次に選択的エピタキシ
ャル成長させ、かつ絶縁膜のパターン開[コを利用して
、セルフアライメント的にエミッタ電極を形成するよう
にしたものである。
すなわち、この発明方法においては、コレクタ層I−に
順次にエピタキシャル成長された老絶縁領域、および外
部ベース層を、選択的にメサニー2チングして、これら
の外部ベース層、半絶縁領域。
順次にエピタキシャル成長された老絶縁領域、および外
部ベース層を、選択的にメサニー2チングして、これら
の外部ベース層、半絶縁領域。
コレクタ層を露出させた後、内部ベース層、エミッタ層
を順次に選択的エピタキシャル成長させることで、コレ
クターベース接合、および内部ベース・外部ベース接合
を同時に形成でき、かつメサエッチングでの絶縁膜マス
クの利用で、エミッタ電極をセルファライン的に形成し
得る。
を順次に選択的エピタキシャル成長させることで、コレ
クターベース接合、および内部ベース・外部ベース接合
を同時に形成でき、かつメサエッチングでの絶縁膜マス
クの利用で、エミッタ電極をセルファライン的に形成し
得る。
以下、この発明に係るペテロ接合バイポーラトランジス
タの製造方法の一実施例につき、第1図(a)ないしく
d)を参照して詳細に説明する。
タの製造方法の一実施例につき、第1図(a)ないしく
d)を参照して詳細に説明する。
これらの第1図(a)ないしくd)に示す実施例方法に
おいて、前記第2図従来例と同一符号は同一または相当
部分を表わしている。
おいて、前記第2図従来例と同一符号は同一または相当
部分を表わしている。
この実施例方法においては、まず、半絶縁性基板l上に
、サブコレクタ層2.コレクタ層3.を絶縁領域8.お
よび外部ベース層7を、順次にエピタキシャル成長させ
る(第1図(a))。
、サブコレクタ層2.コレクタ層3.を絶縁領域8.お
よび外部ベース層7を、順次にエピタキシャル成長させ
る(第1図(a))。
ついで、前記外部ベース層7七に絶縁膜14を堆積させ
、写真製版技術などを利用して、この絶縁膜14の該当
個所を選択的に開口14a した[−、で、この絶縁膜
パターンをマスクに、前記外部ベース層7、および半絶
縁領域8をコレクタ層3に達するまでメサエッチングし
て除去する(同図(b))。
、写真製版技術などを利用して、この絶縁膜14の該当
個所を選択的に開口14a した[−、で、この絶縁膜
パターンをマスクに、前記外部ベース層7、および半絶
縁領域8をコレクタ層3に達するまでメサエッチングし
て除去する(同図(b))。
なお、この第4図(b)工程では、例えば基板としテ(
100)GaAs基板を用い、4H2S04/1H20
2/lH2O参照)。
100)GaAs基板を用い、4H2S04/1H20
2/lH2O参照)。
次に、例えば有機金属気相エピタキシー法によりエピタ
キシャル層を順次に成長させると、同層は絶縁膜14上
には成長されずに、メサエッチ部分にのみ選択的にエピ
タキシャル成長されて、内部ベース層4.エミッタ層5
.およびキャップ層6をそれぞれに形成でき、これによ
って、コレクタ・ベース接合、および内部ベース・外部
ベース接合を同時に形成し得る(同図(c))、なお、
このとき、内部ベース層4の厚さは、次に形成されるエ
ミッタ電極11と接触しないように、サイドエツチング
の巾よりも小さくする。
キシャル層を順次に成長させると、同層は絶縁膜14上
には成長されずに、メサエッチ部分にのみ選択的にエピ
タキシャル成長されて、内部ベース層4.エミッタ層5
.およびキャップ層6をそれぞれに形成でき、これによ
って、コレクタ・ベース接合、および内部ベース・外部
ベース接合を同時に形成し得る(同図(c))、なお、
このとき、内部ベース層4の厚さは、次に形成されるエ
ミッタ電極11と接触しないように、サイドエツチング
の巾よりも小さくする。
続いて、前記絶縁膜14の開口14aを利用することに
より、セルフアライメント的にエミッタ電極11を形成
して(同図(d))、所期の構成をI”lるのである。
より、セルフアライメント的にエミッタ電極11を形成
して(同図(d))、所期の構成をI”lるのである。
従って、この実施例方法の場合には、内部ベース層を選
択的エピタキシャル成長によって、外部ベース層とは別
に形成させるので、この内部ベース層に関係なしに、厚
い膜厚で高い不純物濃度の外部ベース層を形成できて、
外部ベース抵抗を小さくでき、かつこの外部ベース層に
対して、ベースコンタクトを容易にとり得るもので、イ
オン注入、アニール処理とか、エツチングなどの必要が
全くなく、また、メサエッチングおよび選択的エピタキ
シャル成長のための絶縁膜パターンを利用して、セルフ
アライメント的にエミッタ電極を形成できるのである。
択的エピタキシャル成長によって、外部ベース層とは別
に形成させるので、この内部ベース層に関係なしに、厚
い膜厚で高い不純物濃度の外部ベース層を形成できて、
外部ベース抵抗を小さくでき、かつこの外部ベース層に
対して、ベースコンタクトを容易にとり得るもので、イ
オン注入、アニール処理とか、エツチングなどの必要が
全くなく、また、メサエッチングおよび選択的エピタキ
シャル成長のための絶縁膜パターンを利用して、セルフ
アライメント的にエミッタ電極を形成できるのである。
以上詳述したようにこの発明方法によれば、半絶縁基板
のコレクタ層−ヒにあって、まず、半絶縁領域、外部ベ
ース層を順次にエピタキシャル成長させ、ついで、パタ
ーン開口された絶縁膜をマスクにして、コレクタ層に達
するまで選択的にメサエッチングし、外部ベース層、半
絶縁領域、コレクタ層を露出させた後、同一絶縁膜をマ
スクにして、内部ベース層、エミッタ層を順次に選択的
エピタキシャル成長させるようにしたから、内部ベース
層の厚さとか不純物濃度などに拘わりなく。
のコレクタ層−ヒにあって、まず、半絶縁領域、外部ベ
ース層を順次にエピタキシャル成長させ、ついで、パタ
ーン開口された絶縁膜をマスクにして、コレクタ層に達
するまで選択的にメサエッチングし、外部ベース層、半
絶縁領域、コレクタ層を露出させた後、同一絶縁膜をマ
スクにして、内部ベース層、エミッタ層を順次に選択的
エピタキシャル成長させるようにしたから、内部ベース
層の厚さとか不純物濃度などに拘わりなく。
外部ベース層を厚い膜厚、高い不純物濃度により形成し
得るもので、従って、外部ベース抵抗を小さくできると
共に、外部ベース層が最上部にあるために、ベースコン
タクトも容易にとれ、かつイオン注入、アニール処理な
どを必要としないために、アニール処理に伴なう不純物
の拡散などがなく、また、絶縁膜のパターン開口を利用
して、セルフアライメント的にエミッタ電極を形成する
ようにしたので、素子寸法の微細化を達成できるなどの
優れた特長がある。
得るもので、従って、外部ベース抵抗を小さくできると
共に、外部ベース層が最上部にあるために、ベースコン
タクトも容易にとれ、かつイオン注入、アニール処理な
どを必要としないために、アニール処理に伴なう不純物
の拡散などがなく、また、絶縁膜のパターン開口を利用
して、セルフアライメント的にエミッタ電極を形成する
ようにしたので、素子寸法の微細化を達成できるなどの
優れた特長がある。
第1図(a)ないしくd)はこの発明に係るペテロ接合
バイポーラトランジスタの製造方法の一実施例を工程順
に示すそれぞれ断面図であり、また第2図は従来例によ
る同一ヒヘテロ接合バイポーラトランジスタの構成を示
す断面図である。 !・・・・半絶縁基板、3・・・・コレクタ層、4・・
・・内部ベース層、5・・・・エミッタ層、7・・・・
外部ベース層、8・・・・外部ベース層直下の半絶縁領
域、11・・・・エミッタ電極、12・・・・ベース電
極、13・・・・コレクタ電極、14・・・・絶縁膜、
14a・・・・絶縁膜の開口。 代理人 大 岩 増 雄 トのn〜−寸トのnへ一 喋 −− 第2図 13;]Lクグ電Jル 手続補正書(自発ン 昭和 62年 3月11 日 特許庁長官殿 ℃仁\
l、事件の表示 特願昭67−222724居2、
発明の名称 へ〒1キ、全iへ゛イヤ、−ヲVランシパスー7.yx
x雀ヤ衣3、補正をする者 事件との関係 特許出願人 住 所 東京都千代田区丸の内二丁目2番3号4
、代理人 住 所 東京都千代田区丸の内二丁目2番3号5
、補正の対象 (1)明細書の特許請求の範囲の欄 (2)明細書の発明の詳細な説明の欄 6、補正の内容 (1)明細書の特許請求の範囲を別紙のとおり補正する
。 (2)同書8頁8〜11行の「かつこの外部ベース層〜
が全くなく、」を次の文のとおり補正する。 「かつ、イオン注入、アニール処理とかエツチングなど
の必要なしに、外部ベース層に対してベースコンタクト
を容易にとることができ、」以 L 特許請求の範囲 半絶縁性基板上に、ま゛、コレクタ、? 半絶縁領域、
外部ベース層を順次にエビタギシャル成長させる工程と
、ついで、選択的に開口された絶縁膜をマスクにして、
前記コレクタ層に達するまで選択的にメサエッチングし
、これらの外部ベース層、半絶縁領域、コレクタ層を露
出させる工程と、さらに、前記同一絶縁膜をマスクにし
て、内部ベース層、エミッタ層を順次に選択的エピタキ
シャル成長させる工程と、続いて、前記絶縁膜の開口を
利用して、セルフアライメント的にエミッタ電極を形成
する工程とを、少なくとも含むことを特徴とするヘテロ
接合バイポーラトランジスタの製造方法。
バイポーラトランジスタの製造方法の一実施例を工程順
に示すそれぞれ断面図であり、また第2図は従来例によ
る同一ヒヘテロ接合バイポーラトランジスタの構成を示
す断面図である。 !・・・・半絶縁基板、3・・・・コレクタ層、4・・
・・内部ベース層、5・・・・エミッタ層、7・・・・
外部ベース層、8・・・・外部ベース層直下の半絶縁領
域、11・・・・エミッタ電極、12・・・・ベース電
極、13・・・・コレクタ電極、14・・・・絶縁膜、
14a・・・・絶縁膜の開口。 代理人 大 岩 増 雄 トのn〜−寸トのnへ一 喋 −− 第2図 13;]Lクグ電Jル 手続補正書(自発ン 昭和 62年 3月11 日 特許庁長官殿 ℃仁\
l、事件の表示 特願昭67−222724居2、
発明の名称 へ〒1キ、全iへ゛イヤ、−ヲVランシパスー7.yx
x雀ヤ衣3、補正をする者 事件との関係 特許出願人 住 所 東京都千代田区丸の内二丁目2番3号4
、代理人 住 所 東京都千代田区丸の内二丁目2番3号5
、補正の対象 (1)明細書の特許請求の範囲の欄 (2)明細書の発明の詳細な説明の欄 6、補正の内容 (1)明細書の特許請求の範囲を別紙のとおり補正する
。 (2)同書8頁8〜11行の「かつこの外部ベース層〜
が全くなく、」を次の文のとおり補正する。 「かつ、イオン注入、アニール処理とかエツチングなど
の必要なしに、外部ベース層に対してベースコンタクト
を容易にとることができ、」以 L 特許請求の範囲 半絶縁性基板上に、ま゛、コレクタ、? 半絶縁領域、
外部ベース層を順次にエビタギシャル成長させる工程と
、ついで、選択的に開口された絶縁膜をマスクにして、
前記コレクタ層に達するまで選択的にメサエッチングし
、これらの外部ベース層、半絶縁領域、コレクタ層を露
出させる工程と、さらに、前記同一絶縁膜をマスクにし
て、内部ベース層、エミッタ層を順次に選択的エピタキ
シャル成長させる工程と、続いて、前記絶縁膜の開口を
利用して、セルフアライメント的にエミッタ電極を形成
する工程とを、少なくとも含むことを特徴とするヘテロ
接合バイポーラトランジスタの製造方法。
Claims (1)
- (1)半絶縁性基板のコレクタ層上に、まず、半絶縁領
域、外部ベース層を順次にエピタキシャル成長させる工
程と、ついで、選択的に開口された絶縁膜をマスクにし
て、前記コレクタ層に達するまで選択的にメサエッチン
グし、これらの外部ベース層、半絶縁領域、コレクタ層
を露出させる工程と、さらに、前記同一絶縁膜をマスク
にして、内部ベース層、エミッタ層を順次に選択的エピ
タキシャル成長させる工程と、続いて、前記絶縁膜の開
口を利用して、セルフアライメント的にエミッタ電極を
形成する工程とを、少なくとも含むことを特徴とするヘ
テロ接合バイポーラトランジスタの製造方法。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61228724A JPS6381855A (ja) | 1986-09-25 | 1986-09-25 | ヘテロ接合バイポ−ラトランジスタの製造方法 |
US07/097,165 US4789643A (en) | 1986-09-25 | 1987-09-16 | Method of manufacturing a heterojunction bipolar transistor involving etch and refill |
US07/235,277 US4896203A (en) | 1986-09-25 | 1988-08-23 | Heterojunction bipolar transistor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61228724A JPS6381855A (ja) | 1986-09-25 | 1986-09-25 | ヘテロ接合バイポ−ラトランジスタの製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6381855A true JPS6381855A (ja) | 1988-04-12 |
JPH0571173B2 JPH0571173B2 (ja) | 1993-10-06 |
Family
ID=16880820
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61228724A Granted JPS6381855A (ja) | 1986-09-25 | 1986-09-25 | ヘテロ接合バイポ−ラトランジスタの製造方法 |
Country Status (2)
Country | Link |
---|---|
US (2) | US4789643A (ja) |
JP (1) | JPS6381855A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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