JPS63299134A - ワイヤボンディング方法 - Google Patents
ワイヤボンディング方法Info
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- JPS63299134A JPS63299134A JP62131171A JP13117187A JPS63299134A JP S63299134 A JPS63299134 A JP S63299134A JP 62131171 A JP62131171 A JP 62131171A JP 13117187 A JP13117187 A JP 13117187A JP S63299134 A JPS63299134 A JP S63299134A
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- 238000000034 method Methods 0.000 claims abstract description 15
- 238000013461 design Methods 0.000 claims description 6
- 239000011159 matrix material Substances 0.000 claims description 5
- 238000012937 correction Methods 0.000 abstract description 27
- 239000000758 substrate Substances 0.000 abstract description 6
- 230000000007 visual effect Effects 0.000 abstract description 5
- 238000006073 displacement reaction Methods 0.000 abstract description 2
- 238000004364 calculation method Methods 0.000 description 9
- 238000001514 detection method Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 4
- 238000004458 analytical method Methods 0.000 description 3
- 238000005259 measurement Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
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- 239000000919 ceramic Substances 0.000 description 1
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- 238000012545 processing Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies
- H01L24/78—Apparatus for connecting with wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
- H01L2224/78—Apparatus for connecting with wire connectors
-
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- H01L2224/78—Apparatus for connecting with wire connectors
- H01L2224/7825—Means for applying energy, e.g. heating means
- H01L2224/783—Means for applying energy, e.g. heating means by means of pressure
- H01L2224/78301—Capillary
-
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- H01L2924/00014—Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
-
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- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/1015—Shape
- H01L2924/1016—Shape being a cuboid
- H01L2924/10162—Shape being a cuboid with a square active surface
Landscapes
- Engineering & Computer Science (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
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- Power Engineering (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、複数の半導体チップがマトリクス状に配列さ
れた論理回路基板の個々の半導体チップの周辺に並べら
れている多数のボンディングパッドへのワイヤボンディ
ング方法に関する。
れた論理回路基板の個々の半導体チップの周辺に並べら
れている多数のボンディングパッドへのワイヤボンディ
ング方法に関する。
近年、大型計算機等に使用される論理回路基板は、機能
の拡張性、および小形高密度化を図る目的から集積度の
高い半導体チップを多数使用する傾向にあ〕、これに伴
りて個々の半導体チップの周辺に並べられているボンデ
ィングパッドも増加、微小寸法化され、これらへのワイ
ヤボンディング作業は極めて高ffJ[のものが要求さ
れている。
の拡張性、および小形高密度化を図る目的から集積度の
高い半導体チップを多数使用する傾向にあ〕、これに伴
りて個々の半導体チップの周辺に並べられているボンデ
ィングパッドも増加、微小寸法化され、これらへのワイ
ヤボンディング作業は極めて高ffJ[のものが要求さ
れている。
ところで、この種のワイヤボンディング作業では、視覚
装置を利用して基板上に設けられたマーク位tIILt
−検出し、この検出信号和よりて基板上のボンディング
パッドの位置ずれ量を算出し、この算出結果に応じてボ
ンディング位置を補正してワイヤボンディングするとい
う方法が主流である。
装置を利用して基板上に設けられたマーク位tIILt
−検出し、この検出信号和よりて基板上のボンディング
パッドの位置ずれ量を算出し、この算出結果に応じてボ
ンディング位置を補正してワイヤボンディングするとい
う方法が主流である。
例えば、特開昭1−20344号公報に記載の方法は、
基板の一方側(始端部)のマーク位置と他方側(終端部
)のマーク位置をそれぞれ検出し、この検出信号を予め
設定された基本パターンと比較して複数の回路の位置ず
れ量を算出し、この算出値に応じてボンディング位置を
補正してワイヤボンディングを行なうようにしていた。
基板の一方側(始端部)のマーク位置と他方側(終端部
)のマーク位置をそれぞれ検出し、この検出信号を予め
設定された基本パターンと比較して複数の回路の位置ず
れ量を算出し、この算出値に応じてボンディング位置を
補正してワイヤボンディングを行なうようにしていた。
しかしながら、この方法は印刷回路基板のように複数の
回路が所定ピッチで等間隔に設けられている場合忙は有
効であるが、第5図(a)、および(b)K示すよう九
回路パターンが歪んでいる場合には、中央部分の回路に
おける位置ずれ量が大きくなるという欠点があった。こ
れを解決するため、始端部と終端部の他に、中間部の半
導体チップのボンディングパッドの位置も検出し、これ
ら測定座標値と予め設定している基準座標値とを比較し
て個々の位置の誤差が最少となる修正値を算出し、この
算出値によって基板上のボンディング位置を補正してワ
イヤボンディングを行なうという方法であった。
回路が所定ピッチで等間隔に設けられている場合忙は有
効であるが、第5図(a)、および(b)K示すよう九
回路パターンが歪んでいる場合には、中央部分の回路に
おける位置ずれ量が大きくなるという欠点があった。こ
れを解決するため、始端部と終端部の他に、中間部の半
導体チップのボンディングパッドの位置も検出し、これ
ら測定座標値と予め設定している基準座標値とを比較し
て個々の位置の誤差が最少となる修正値を算出し、この
算出値によって基板上のボンディング位置を補正してワ
イヤボンディングを行なうという方法であった。
−〔発明が解決しようとする問題点〕
上記従来技術は、論理回路基板の回路パターンの歪が極
端な非線形である場合には線形補間による歪補正方法で
あるため、位置ずれ誤差の小さい位置での位置ずれ菫が
大きくなるという問題があった0 本発明の目的は、複数の半導体チップがマトリクス状に
配列された論理回路基板の個々の半導体チップの周辺に
並べられている多数のボンディングパッドへのワイヤボ
ンディングとして、基板上の回路パターンに極端な非線
形歪を待った論理回路基板にも有効なワイヤボンティン
グ方法を提供することKある。
端な非線形である場合には線形補間による歪補正方法で
あるため、位置ずれ誤差の小さい位置での位置ずれ菫が
大きくなるという問題があった0 本発明の目的は、複数の半導体チップがマトリクス状に
配列された論理回路基板の個々の半導体チップの周辺に
並べられている多数のボンディングパッドへのワイヤボ
ンディングとして、基板上の回路パターンに極端な非線
形歪を待った論理回路基板にも有効なワイヤボンティン
グ方法を提供することKある。
上記目的は、複数の半導体チップがマトリクス状に配列
された論理回路基板において、半導体チップ毎にボンデ
ィングパッドの位置を検出し、最小二乗法によってボン
ディングパッドの測定座標値と予め設定しておいた設計
座標値とを比較して個々における誤差が最小となる修正
値を求め、この修正値によって個々のボンディングパッ
ドの位置を補正することにより、達成される。
された論理回路基板において、半導体チップ毎にボンデ
ィングパッドの位置を検出し、最小二乗法によってボン
ディングパッドの測定座標値と予め設定しておいた設計
座標値とを比較して個々における誤差が最小となる修正
値を求め、この修正値によって個々のボンディングパッ
ドの位置を補正することにより、達成される。
上記論理回路基板において、半導体チップ毎にボンディ
ングパッドの位置を検出することLυ、非線形歪がある
基板をミクロに見ることKなシ非線形の回路パターン歪
を線形の回路パターンとして扱うことができる。これに
よりて、線形補間による歪補正方法は、最小二乗法を用
いて直線近似を行なっても高い精度の修正値を得ること
ができるので、誤差の小さいボンディング位置補正がで
きる。
ングパッドの位置を検出することLυ、非線形歪がある
基板をミクロに見ることKなシ非線形の回路パターン歪
を線形の回路パターンとして扱うことができる。これに
よりて、線形補間による歪補正方法は、最小二乗法を用
いて直線近似を行なっても高い精度の修正値を得ること
ができるので、誤差の小さいボンディング位置補正がで
きる。
以下、本発明の一実施例を第1図〜第4図によシ説明す
る。
る。
第1図はワイヤボンディング装置全体の構成を示したも
のである。図中において、ワイヤボンディングヘッド2
は平面上をX、Y方向に駆動制御されるXYステージ3
の上に設置されている。このボンディングヘッド2には
先端にキャピラリ5を有し、Z方向に駆動制御されるボ
ンディングアーム4が取付けられている。また、これと
対向した位置に論理回路基板6を搬送するフィーダ7が
配置され、XYステージ3と共にベース1上に設置され
ている。このフィーダ7のボンディング位置の真上には
論理回路基板6を撮像する視覚装置8が設置され、検出
信号が制御装置9に、取込まれるようKなっている。制
御装置9ではこの検出信号に基づいた出力信号を生成し
、上記XYステージ3、およびボンディングヘッド2を
駆動制御するようKなっている。第2図は論理回路基板
の平面構成を模式的に示したものである。この論理回路
基板6は回路の高密度化を図るために回路パターンを施
した多層のセラミック基板が使用され、高温処理によっ
て基板の生成が行なわれている。
のである。図中において、ワイヤボンディングヘッド2
は平面上をX、Y方向に駆動制御されるXYステージ3
の上に設置されている。このボンディングヘッド2には
先端にキャピラリ5を有し、Z方向に駆動制御されるボ
ンディングアーム4が取付けられている。また、これと
対向した位置に論理回路基板6を搬送するフィーダ7が
配置され、XYステージ3と共にベース1上に設置され
ている。このフィーダ7のボンディング位置の真上には
論理回路基板6を撮像する視覚装置8が設置され、検出
信号が制御装置9に、取込まれるようKなっている。制
御装置9ではこの検出信号に基づいた出力信号を生成し
、上記XYステージ3、およびボンディングヘッド2を
駆動制御するようKなっている。第2図は論理回路基板
の平面構成を模式的に示したものである。この論理回路
基板6は回路の高密度化を図るために回路パターンを施
した多層のセラミック基板が使用され、高温処理によっ
て基板の生成が行なわれている。
また、この論理回路基板6の表面上忙は複数個の半導体
チップ10がマトリクス状に配置され、個々の半導体チ
ップ10の周辺には多数のボンディングパッド11が設
けられている。第3図はワイヤボンディング装置の処理
概要を示したものである。ボンディング予定の論m回路
基板6が所定のボンディング作業領域で位111決め固
定されると、検出対象の論理回路基板6を視覚装fjk
8によりて撮像する。視′jt、装置8では基板上のボ
ンディングパッド11の位置を検出して個々の測定座標
値を求め、これを比較演算部12に出力する。比較演算
部12ではこの測定座標値とメモリ部15からの個々の
位置に対応し予め2足された設計座標値とを比較し、個
々の位置における誤差を算出して誤差解析部14に出力
する。誤差解析部14では、比較演′JjL部12から
の個々の誤差を集計してこれらの各誤差が最小となるよ
うな修正値を求め、補正演算部15に出力する。補正演
算部15では、この修正値とメモリ15からの設計座標
値とを基にして論理回路基板6のボンディング位置の補
正を行ない、その演算結果をXYステージ制御駆動部1
6に出力する。ステージ制御駆動1!l$16で嫁、補
正演算により【得たボンディング位置データに従ってX
Yステージ3を位置決め制御し、ボンディング作業を実
行する。
チップ10がマトリクス状に配置され、個々の半導体チ
ップ10の周辺には多数のボンディングパッド11が設
けられている。第3図はワイヤボンディング装置の処理
概要を示したものである。ボンディング予定の論m回路
基板6が所定のボンディング作業領域で位111決め固
定されると、検出対象の論理回路基板6を視覚装fjk
8によりて撮像する。視′jt、装置8では基板上のボ
ンディングパッド11の位置を検出して個々の測定座標
値を求め、これを比較演算部12に出力する。比較演算
部12ではこの測定座標値とメモリ部15からの個々の
位置に対応し予め2足された設計座標値とを比較し、個
々の位置における誤差を算出して誤差解析部14に出力
する。誤差解析部14では、比較演′JjL部12から
の個々の誤差を集計してこれらの各誤差が最小となるよ
うな修正値を求め、補正演算部15に出力する。補正演
算部15では、この修正値とメモリ15からの設計座標
値とを基にして論理回路基板6のボンディング位置の補
正を行ない、その演算結果をXYステージ制御駆動部1
6に出力する。ステージ制御駆動1!l$16で嫁、補
正演算により【得たボンディング位置データに従ってX
Yステージ3を位置決め制御し、ボンディング作業を実
行する。
第4図は、線形補間による位置補正の原理を示したもの
である。半導体チップ1oの周辺に多数のボンディング
パッド11が並べられている状態において、視覚装置に
よ)検出したボンディングパッドの測定座標値を(a↓
、bA)、論理回路基板6の設計座標値を(zL、yL
)とする。
である。半導体チップ1oの周辺に多数のボンディング
パッド11が並べられている状態において、視覚装置に
よ)検出したボンディングパッドの測定座標値を(a↓
、bA)、論理回路基板6の設計座標値を(zL、yL
)とする。
ここで
とし、
A冨T−Xの関係を仮定する。
このとき、Tの値は最小二乗法によシ
T=AX’(XX’r’ とftル。
このTの値をボンディング位置補正の修正値として、
A′シT、Xの計算を行ない、測定されていない未知の
ポンプインクパッドの位置を演算によシ求める。
ポンプインクパッドの位置を演算によシ求める。
即ち、本発明は非線形歪の回路パターンを有する論理回
路基板において、位置補正を行なう回路パターンをミク
ロに見ることによシ、線形の回路、パターンとして扱□
い、これを利用して線形補間によるボンディング位置補
正を行なっている。従り【、少ない測定データ数で高精
度の修正値が求められ、これによって位置ずれ誤差の小
さいボンディング位置補正を実現することができる。
路基板において、位置補正を行なう回路パターンをミク
ロに見ることによシ、線形の回路、パターンとして扱□
い、これを利用して線形補間によるボンディング位置補
正を行なっている。従り【、少ない測定データ数で高精
度の修正値が求められ、これによって位置ずれ誤差の小
さいボンディング位置補正を実現することができる。
不発BAKよれば、最小二乗法忙よシ求めた修正値によ
って未知のボンディングパッドの位置を算出することが
できるので、ボンディング作業の能率向上を図ることが
できる。また、非線形歪の回路パターンを有する論理回
路基板をミクロ的に見ることによシ、少ない測定データ
数で精度の高い修正値が求められ、これによって位置ず
れ誤差の小さいボンディング位置補正を実現することが
できる。等の効果がある。
って未知のボンディングパッドの位置を算出することが
できるので、ボンディング作業の能率向上を図ることが
できる。また、非線形歪の回路パターンを有する論理回
路基板をミクロ的に見ることによシ、少ない測定データ
数で精度の高い修正値が求められ、これによって位置ず
れ誤差の小さいボンディング位置補正を実現することが
できる。等の効果がある。
第1図は本発明の一実施例のワイヤボンディング装置全
体の構成図、第2図は同じく論理回路基板の平面模式図
、第3図は第1図におけるボンディング位置補正の処理
概要を示すブロック図、第4図は線形補間による位置補
正の原理を示す説明図、l[5図は論理回路基板の回路
パターン歪例を示す説明図である。 2・・・ボンディングヘッド、3・・・XYステージ、
6・・・論理回路基板、8・・・視覚装置、9・・・制
1sui置、10・・・半導体チップ、11・・・ボン
ディングパット、12・・・比較演算部、13・・・メ
モリ部、14・・・誤差解析部、15・・・補正演算部
、16・・・XYステージ制御駆動部、晃 l 図 第 2 図 $3 図 晃 46 拓 5rA (a> ■ (b)
体の構成図、第2図は同じく論理回路基板の平面模式図
、第3図は第1図におけるボンディング位置補正の処理
概要を示すブロック図、第4図は線形補間による位置補
正の原理を示す説明図、l[5図は論理回路基板の回路
パターン歪例を示す説明図である。 2・・・ボンディングヘッド、3・・・XYステージ、
6・・・論理回路基板、8・・・視覚装置、9・・・制
1sui置、10・・・半導体チップ、11・・・ボン
ディングパット、12・・・比較演算部、13・・・メ
モリ部、14・・・誤差解析部、15・・・補正演算部
、16・・・XYステージ制御駆動部、晃 l 図 第 2 図 $3 図 晃 46 拓 5rA (a> ■ (b)
Claims (1)
- 【特許請求の範囲】 1、複数の半導体チップがマトリクス状に配列された論
理回路基板において、上記基板の半導体チップ毎に任意
のボンディングパッドの位置を検出し、上記検出した点
を測定座標値(ai、biとしてこれに対応する設計上
の点を設計座標値(xi、yi)として、 X=▲数式、化学式、表等があります▼ A=▲数式、化学式、表等があります▼ より、A=T・Xの関係式を仮定して、最小二乗法によ
り算出した修正値Tを求め、前記修正値と予め設定され
ている設計座標値とによって上記基板上の個々のボンデ
ィングパッドの位置を補正する手段を具備することを特
徴とするワイヤボンディング方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62131171A JPS63299134A (ja) | 1987-05-29 | 1987-05-29 | ワイヤボンディング方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62131171A JPS63299134A (ja) | 1987-05-29 | 1987-05-29 | ワイヤボンディング方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63299134A true JPS63299134A (ja) | 1988-12-06 |
Family
ID=15051669
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62131171A Pending JPS63299134A (ja) | 1987-05-29 | 1987-05-29 | ワイヤボンディング方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63299134A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011514673A (ja) * | 2008-02-29 | 2011-05-06 | クリック アンド ソッファ インダストリーズ、インク. | ワイヤーボンディング機械上でボンディング位置を教示し、ワイヤーループを検査する方法およびこの方法を実施する機器 |
-
1987
- 1987-05-29 JP JP62131171A patent/JPS63299134A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011514673A (ja) * | 2008-02-29 | 2011-05-06 | クリック アンド ソッファ インダストリーズ、インク. | ワイヤーボンディング機械上でボンディング位置を教示し、ワイヤーループを検査する方法およびこの方法を実施する機器 |
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