JPS6322744B2 - - Google Patents
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- Publication number
- JPS6322744B2 JPS6322744B2 JP15327282A JP15327282A JPS6322744B2 JP S6322744 B2 JPS6322744 B2 JP S6322744B2 JP 15327282 A JP15327282 A JP 15327282A JP 15327282 A JP15327282 A JP 15327282A JP S6322744 B2 JPS6322744 B2 JP S6322744B2
- Authority
- JP
- Japan
- Prior art keywords
- potential
- high frequency
- closed loop
- terminals
- operational amplifier
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 11
- 230000000694 effects Effects 0.000 description 3
- 238000000034 method Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Amplifiers (AREA)
- Noise Elimination (AREA)
Description
【発明の詳細な説明】
この発明は電子回路において能動素子にリード
線を通して高周波ノイズが侵入するのを防ぐ為の
対策に関するものである。
線を通して高周波ノイズが侵入するのを防ぐ為の
対策に関するものである。
従来この種の回路として第1図に示すものがあ
つた。図において101は多端子を有する能動素
子(例えば演算増巾器)、1〜8は演算増巾器の
端子で2と3は入力端子、6は出力端子、1と5
は零調端子、4は制御電源の負電位、7は制御電
源の正電位、8は空端子を示す。次に10は制御
電源の基準電位、記号Cは各端子に接続されたコ
ンデンサを示す。
つた。図において101は多端子を有する能動素
子(例えば演算増巾器)、1〜8は演算増巾器の
端子で2と3は入力端子、6は出力端子、1と5
は零調端子、4は制御電源の負電位、7は制御電
源の正電位、8は空端子を示す。次に10は制御
電源の基準電位、記号Cは各端子に接続されたコ
ンデンサを示す。
従来の高周波ノズル除去回路では、コンデンサ
に接続される基準電位は商用周波数域では同電位
であつても高周波域では基準電位の配置がプリン
ト配線基板上で夫々散在しているため夫々の基準
電位が異なつたものとなつている。この結果高周
波ノイズを除去する効果を大きく出来ない欠点が
あつた。
に接続される基準電位は商用周波数域では同電位
であつても高周波域では基準電位の配置がプリン
ト配線基板上で夫々散在しているため夫々の基準
電位が異なつたものとなつている。この結果高周
波ノイズを除去する効果を大きく出来ない欠点が
あつた。
この発明は上記のような従来のものの欠点を除
去するためになされたもので、演算増巾器の全端
子と制御電圧の基準電位で微小閉ループを構成し
た電位間にコンデンサを実装することにより高周
波ノイズの除去効果を大きくした高周波ノイズ除
去回路を提供することを目的としている。
去するためになされたもので、演算増巾器の全端
子と制御電圧の基準電位で微小閉ループを構成し
た電位間にコンデンサを実装することにより高周
波ノイズの除去効果を大きくした高周波ノイズ除
去回路を提供することを目的としている。
以下、この発明の一実施例を図について説明す
る。第2図において30は制御電圧の基準電位で
構成した微小閉ループで演算増巾器の全端子から
閉ループでコンデンサを接続したものである。な
お、第2図中の符号で第1図と同一符号は同一部
分を示す。
る。第2図において30は制御電圧の基準電位で
構成した微小閉ループで演算増巾器の全端子から
閉ループでコンデンサを接続したものである。な
お、第2図中の符号で第1図と同一符号は同一部
分を示す。
第3図は第2図の回路を具体的にプリント配線
基板に実装する方法を示したもので30は第2図
の30に相当する微小閉ループで導体パターンで
構成する。最内の1〜8の円周上の穴は演算増巾
器を実装する取付穴で端子記号を示す。中間の円
周上にある8個の穴を外周上の8個の穴はコンデ
ンサを実装する取付穴を示す。(但し、演算増巾
器への制御電圧の結線はプリント配線基板の裏面
で接続されるため図示は省略)記号Cはコンデン
サ、10は制御電圧の基準電位を示す。
基板に実装する方法を示したもので30は第2図
の30に相当する微小閉ループで導体パターンで
構成する。最内の1〜8の円周上の穴は演算増巾
器を実装する取付穴で端子記号を示す。中間の円
周上にある8個の穴を外周上の8個の穴はコンデ
ンサを実装する取付穴を示す。(但し、演算増巾
器への制御電圧の結線はプリント配線基板の裏面
で接続されるため図示は省略)記号Cはコンデン
サ、10は制御電圧の基準電位を示す。
このように制御電圧の基準電位を微小閉ループ
で構成することにより微小閉ループの電位は高周
波域でも同一視できるため、演算増巾器の全端子
に加わる基準電位は同一となることから高周波ノ
イズの影響を除去することが出来る。
で構成することにより微小閉ループの電位は高周
波域でも同一視できるため、演算増巾器の全端子
に加わる基準電位は同一となることから高周波ノ
イズの影響を除去することが出来る。
上記実施例では演算増巾器の外側にコンデンサ
を実装する場合について記述したが、厚膜コンデ
ンサ及びチツプコンデンサ等を使用して演算増巾
器の内側に実装してもよい。また上記実施例では
Tφ−5型ケースの場合についても説明したが
DIP型ケースの能動素子であつてもよいことは言
うまでもない。
を実装する場合について記述したが、厚膜コンデ
ンサ及びチツプコンデンサ等を使用して演算増巾
器の内側に実装してもよい。また上記実施例では
Tφ−5型ケースの場合についても説明したが
DIP型ケースの能動素子であつてもよいことは言
うまでもない。
以上のように、この発明によれば能動素子の全
端子と制御電圧の基準電位で微小閉ループを構成
した電位間にコンデンサを実装しているので高周
波ノイズの除去が大きく出来る効果がある。
端子と制御電圧の基準電位で微小閉ループを構成
した電位間にコンデンサを実装しているので高周
波ノイズの除去が大きく出来る効果がある。
第1図は従来の高周波ノイズ除去回路を示す。
第2図は本発明の高周波ノイズ除去回路を示す。
第3図は本発明の高周波ノイズ除去回路を具体的
にプリント配線基板に実装する方法を示した図を
示す。 101……演算増巾器、1〜8……演算増巾器
の入力端子、10……制御電圧の基準電位、30
……制御電圧の基準電位で構成した微小閉ルー
プ、C……コンデンサ、なお図中、同一符号は同
一、又は相当部分を示す。
第2図は本発明の高周波ノイズ除去回路を示す。
第3図は本発明の高周波ノイズ除去回路を具体的
にプリント配線基板に実装する方法を示した図を
示す。 101……演算増巾器、1〜8……演算増巾器
の入力端子、10……制御電圧の基準電位、30
……制御電圧の基準電位で構成した微小閉ルー
プ、C……コンデンサ、なお図中、同一符号は同
一、又は相当部分を示す。
Claims (1)
- 1 多端子を有する能動素子の各端子と微小閉ル
ープを構成した電位間に夫々コンデンサを全端子
について実装し、閉ループ電位を制御電圧の基準
電位に接続したことを特徴とする高周波ノイズ除
去回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15327282A JPS5941930A (ja) | 1982-08-31 | 1982-08-31 | 高周波ノイズ除去回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15327282A JPS5941930A (ja) | 1982-08-31 | 1982-08-31 | 高周波ノイズ除去回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5941930A JPS5941930A (ja) | 1984-03-08 |
JPS6322744B2 true JPS6322744B2 (ja) | 1988-05-13 |
Family
ID=15558829
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP15327282A Granted JPS5941930A (ja) | 1982-08-31 | 1982-08-31 | 高周波ノイズ除去回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5941930A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01220865A (ja) * | 1988-02-29 | 1989-09-04 | Nec Corp | 化合物半導体装置 |
US20210382971A1 (en) * | 2018-11-02 | 2021-12-09 | Panasonic Intellectual Property Managment Co., Ltd. | Battery management system and battery management method |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2891304B2 (ja) * | 1990-11-16 | 1999-05-17 | 三菱マテリアル株式会社 | 超高純度強誘電体薄膜 |
-
1982
- 1982-08-31 JP JP15327282A patent/JPS5941930A/ja active Granted
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01220865A (ja) * | 1988-02-29 | 1989-09-04 | Nec Corp | 化合物半導体装置 |
US20210382971A1 (en) * | 2018-11-02 | 2021-12-09 | Panasonic Intellectual Property Managment Co., Ltd. | Battery management system and battery management method |
Also Published As
Publication number | Publication date |
---|---|
JPS5941930A (ja) | 1984-03-08 |
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