JPS6316705A - 増幅器集積回路 - Google Patents

増幅器集積回路

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JPS6316705A
JPS6316705A JP61161324A JP16132486A JPS6316705A JP S6316705 A JPS6316705 A JP S6316705A JP 61161324 A JP61161324 A JP 61161324A JP 16132486 A JP16132486 A JP 16132486A JP S6316705 A JPS6316705 A JP S6316705A
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JP
Japan
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signal input
integrated circuit
amplifier integrated
diode
resistor
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JP61161324A
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Osamu Kato
修 加藤
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Matsushita Electric Industrial Co Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は通信受信器等に使用する増幅器集積回路に関す
る。
従来の技術 第2図は従来の増幅器集積回路の一例を示している。同
図で、lは信号入力部、2はバイアス設定部、3は差動
増幅器形成の初段増幅器、4は信号入力端子、5.6は
出力端子、7.8は初段増幅器3の第1、第2の入力端
子、VCCは+(正)電源、VEEは(負)電源、工。
は定電流源、几、〜R4は抵抗である。
上記構成で、初段増幅器3のバイアス条件は直線性が良
くなるよう信号入力部1、バイアス設定部2のそれぞれ
の出力電圧vB、、VBiが互に等しく選ぶ(vB、 
= vB、)。このためには、分割のための抵抗R1〜
R4の値をR,: R,= R,:几、に選べば良い。
信号入力端子4から見た入力インピーダンスZinは通
常50Ωないし75Ωに選ばれる。信号入力部1を流れ
る電流工は、I = (Vcc −VEEI/ (R+
+R2)で支えられる。例えばVcc=6V、vEE=
OvでZin = 50Ωにするには、R+ = R*
 =100Ωとして、I=30mAとなる。このように
上記従来の増幅器集積回路でも、所望の入力インピーダ
ンスを有し、しかも直線性の良い領域で使うことが出来
る。
発明が解決しようとする問題点 しかしながら、上記従来の増幅器集積回路では、所望の
バイアス設定値(vB l )および入力インピーダン
スZinを実現するためには、信号入力部1の消費電流
Iが大きくなるという問題点があった。
本発明は上記従来の問題点を解消し、低消費電流でかつ
入力インピーダンスが適当であり、まだ直線性の良い増
幅器集積回路を提供することを目的とするものである。
問題点を解決するための手段 本発明は上記目的を達成するために信号入力部のバイア
ス設定に抵抗だけでなくダイオードを順方向に挿入して
用いるようKしたものである。
作用 本発明は上記のように構成することによって、信号入力
部及びバイアス設定部の消費電力を大巾に減らし、かつ
入力インピーダンスを所望の値に出来、またバイアス条
件を直線性が良くなるように選べる効果を有する。
実施例 第1図は本発明の一実施例の構成を示すものである。第
1図において第2図と同一符号を付したものは第2図と
同一のものを示している。そしてQ、−Q、は信号入力
部を抵抗比1、抵抗比、とともに構、成する第1のダイ
オード列(ダイオードをトランジスタのコレクタ・ペー
ス間を短絡して作ったもの)、Q1〜Q +iはバイア
ス設定部を抵抗R3、抵抗R6とともに構成する第2の
ダイオード列である。
次に上記実施例の動作について説明する。上記実施例に
おいて互いに等しい値の初段増幅器3の入力バイアス電
圧VB、およびvB2=vBは第1、第2のダイオード
列の順方向電圧をvFとすると第1図の場合次式で表さ
れる。
一方信号入力端子4から見た入力インピーダンスZin
は抵抗R,とダイオード3個の直列接続と、抵抗R8と
ダイオード3個の直列接続の並列接続となるので次式で
表される。
ドの交流インピーダンスであり、通常数オームである。
例えばVcc= 6 V、 VEE= OVf、vB=
3v。
Zin = 50ΩとするためにはRt = Rt =
85Ωにすればよい。 (r=50としだ。)この時R
3、R2を流れる電流Iは次式で表され本例では11 
mAと人り従来例の約1/3になる。
I = (VCC−VEE −6VF)/ (R++ 
Rt)このように信号入力部1に抵抗だけでなくダイオ
ードを用いることによってダイオードの電圧降下によっ
て消費電流を小さくすることができるという効果を有す
る。
尚、第1図のバイアス設定部2の構成は、VB。
がvB、に等しくなる条件を満足すれば良く入力インピ
ーダンスに関する条件はないためR3、几、をR,: 
R,、=几、:R4を満たす比で大きくとシ、より低消
費電流化を図ることも可能であるが、温度特性、電源電
圧変動によってもvB、 = vB、となるために信号
入力部1の構成と全く同じにすることが望ましい。
また第1図ではVCCと信号入力端子4の間にトランジ
スタを3個、信号入力端子4とVEE 8の間のトラン
ジスタを3個と同数にしているが、これはvBの設定値
に応じて異なることもある。
またI = (Vcc−Vp:E−nVr)/ (Rt
 + R1); n =ダイオードの個数で表される電
流がダイオードの遮断周波数fTを最大にする電流より
も大きすぎる場合には、周波数特性を向上するためにダ
イオードを複数個並列にすればよい。
発明の効果 本発明は上記実施例より明らかなように信号入力部のバ
イアス設定に、抵抗の他にダイオードを用いたものであ
り、ダイオードの電圧降下分だけ抵抗に割当てられる電
圧降下分が小さくなり、かつダイオードの交流インピー
ダンスが数オームと小さいため信号入力部の入力インピ
ーダンスをある一定値に設計するだめの抵抗値が、ダイ
オードがない場合の抵抗値に比べて数オームしか小さく
ならないために、消費電流を小さくすることができると
いう効果を有する。
【図面の簡単な説明】
第1図は本発明の一実施例における増幅器集積回路の回
路図、第2図は従来の増幅器集積回路の回路図である。 1・・・信号入力部、2・・・バイアス設定部、3・・
・初段増幅器、4・・・信号入力端子、5.6・・・出
力端子、Q+ 〜Q H−ダイオード、Ro 〜R1c
m抵抗、vcc ”・本型源、VBB・・・−電源。 代理人の氏名 弁理士 中 尾 敏 男ほか1名菓 1
 図

Claims (1)

    【特許請求の範囲】
  1. 第1、第2の入力端子を有すると共に2電源により駆動
    される差動増幅器を備え、前記第1、第2の入力端子に
    は、それぞれ一対の順方向接続した複数のダイオードと
    抵抗の直列接続により前記2電源の間の電圧を分割して
    供給するようにして集積回路を構成した増幅器集積回路
JP61161324A 1986-07-09 1986-07-09 増幅器集積回路 Expired - Fee Related JPH07112139B2 (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01302148A (ja) * 1988-05-31 1989-12-06 Ube Ind Ltd 有機金属化合物中の含酸素化合物の定量法
JPH0220191A (ja) * 1988-05-12 1990-01-23 Rca Licensing Corp クロマ過負荷検知器
US4972159A (en) * 1988-08-29 1990-11-20 Sharp Kabushiki Kaisha Amplifier circuit more immune to fluctuation of reference voltage
JPH04227305A (ja) * 1990-04-20 1992-08-17 Internatl Business Mach Corp <Ibm> 増幅器

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4841653A (ja) * 1971-09-27 1973-06-18

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