JPS6298761A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPS6298761A JPS6298761A JP60239704A JP23970485A JPS6298761A JP S6298761 A JPS6298761 A JP S6298761A JP 60239704 A JP60239704 A JP 60239704A JP 23970485 A JP23970485 A JP 23970485A JP S6298761 A JPS6298761 A JP S6298761A
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- JP
- Japan
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- semiconductor device
- function
- shift register
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- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、半導体装置の構成に関し、特に一つの半導体
装置が様々な機能を実現するに、相互に結線されない独
立な機能を有する複数個の回路ブロックを含んだ半導体
装置（以下、多機能半導体装置と記す）の構成に関する
。
装置が様々な機能を実現するに、相互に結線されない独
立な機能を有する複数個の回路ブロックを含んだ半導体
装置（以下、多機能半導体装置と記す）の構成に関する
。
従来、多機能半導体装置を実現する技術としては、マイ
クロコンピュータの周辺用論理集積回路のようにデータ
バスを介してマイクロコンピュータから機能を選択する
情報を書込むか、別の技術としては、数本の外部入力端
子に直接、機能選択信号を入力し半導体装置の機能を選
択する方法がある。
クロコンピュータの周辺用論理集積回路のようにデータ
バスを介してマイクロコンピュータから機能を選択する
情報を書込むか、別の技術としては、数本の外部入力端
子に直接、機能選択信号を入力し半導体装置の機能を選
択する方法がある。
上述した多機能半導体装置を実現する従来の技術では、
機能を選択する手段としてマイクロコンピュータの周辺
用論理集積回路のようにマイクロコンピータからデータ
バスを介して機能選択情報を書込む方法を実施する場合
には、半導体装置カ直接マイクロコンピュータのデータ
バスに接続されていなければならないという欠点がある
。また、外部入力端子に直接機能選択信号を入力する方
法では、機能が多くなればなるほど機能選択に必要な外
部入力端子の数が増すという欠点がある。
機能を選択する手段としてマイクロコンピュータの周辺
用論理集積回路のようにマイクロコンピータからデータ
バスを介して機能選択情報を書込む方法を実施する場合
には、半導体装置カ直接マイクロコンピュータのデータ
バスに接続されていなければならないという欠点がある
。また、外部入力端子に直接機能選択信号を入力する方
法では、機能が多くなればなるほど機能選択に必要な外
部入力端子の数が増すという欠点がある。
本発明の目的は、上記欠点を解決し多機能半導体装置の
機能選択の為にマイクロコンピュータのデータバスに接
続することなく、また外部入力端子の数を増やすことも
不要とした半導体装置を提供することにある。
機能選択の為にマイクロコンピュータのデータバスに接
続することなく、また外部入力端子の数を増やすことも
不要とした半導体装置を提供することにある。
本発明の半導体装置は、相互に結線されない独立な機能
を有した複数個の回路ブロックと該回路ブロックのうち
一つを外部端子と接続する選択信号を発生する手段とし
て、外部入力端子を介して情報がシリアルに書込めるシ
フトレジスタとシフトレジスタのシリアル出力を外部に
出力するシフトレジスタと該シフトレジスタへの機能選
択情報書込み中に外部端子が出力端子の機能になること
を禁止する制御端子とを有している。
を有した複数個の回路ブロックと該回路ブロックのうち
一つを外部端子と接続する選択信号を発生する手段とし
て、外部入力端子を介して情報がシリアルに書込めるシ
フトレジスタとシフトレジスタのシリアル出力を外部に
出力するシフトレジスタと該シフトレジスタへの機能選
択情報書込み中に外部端子が出力端子の機能になること
を禁止する制御端子とを有している。
次に、本発明について図面を参照して説明する。
第１図は、本発明を実施した半導体装置の構成を示す図
である。・１０１は、シフトレジスタで１０８の機能選
択情報入力端子にデータを与えなから１０９のクロック
入力端子に転送りロックを入力することにより機能選択
情報が書込まれる。
である。・１０１は、シフトレジスタで１０８の機能選
択情報入力端子にデータを与えなから１０９のクロック
入力端子に転送りロックを入力することにより機能選択
情報が書込まれる。
１０１のシフトレジスタに書込まれた機能選択情報は、
１０２０機能選択信号発生器でデコードされ１０４〜１
０７で示される機能回路の一つが活性化される。機能選
択信号発生器１０２でデコードされた信号は、１０３の
外部端子機能回路にも入力され、１１２〜１２１で示さ
れる外部端子の機能が入力端子になるか、出力端子にな
るか、それとも入出力兼用端子になるかを決定する。外
部端子機能回路１０３には、１１１０機能選択情報書込
み中指示信号入力端子からの信号も入力されており、機
能選択情報書込み中は、外部端子が出力端子になること
を禁止している。また、１１０の機能選択情報出力端子
は、本発明を実施した半導体装置をカスケードするとき
に用いられ、この場合を示すのが第２図である。２０２
，２０３は、各々本発明を実施した半導体装置で、２０
１は、これらの半導体装置Ｋｍ能選択情報を曹込む機能
選択情報発生器である。機能選択信号発生器は、電源投
入時に、機能選択情報のパルス・トレインと転送りロッ
クを送出する。パルストレインには、始めに２０３の半
導体装置の為の機能選択情報が含まれており、これが２
０２の半導体装置のシフトレジスタを介して２０３０半
導体装置のシフトレジスタに転送される。このとき、２
０２の半導体装置には、パルス・トレインの次の情報、
即ち２０２の為の機能選択情報が転送され、２０２゜２
０３の半導体装置の両方の機能選択情報が転送完了とな
り、２０２，２０３の半導体装置が各々所望の機能が選
択されたことになる。
１０２０機能選択信号発生器でデコードされ１０４〜１
０７で示される機能回路の一つが活性化される。機能選
択信号発生器１０２でデコードされた信号は、１０３の
外部端子機能回路にも入力され、１１２〜１２１で示さ
れる外部端子の機能が入力端子になるか、出力端子にな
るか、それとも入出力兼用端子になるかを決定する。外
部端子機能回路１０３には、１１１０機能選択情報書込
み中指示信号入力端子からの信号も入力されており、機
能選択情報書込み中は、外部端子が出力端子になること
を禁止している。また、１１０の機能選択情報出力端子
は、本発明を実施した半導体装置をカスケードするとき
に用いられ、この場合を示すのが第２図である。２０２
，２０３は、各々本発明を実施した半導体装置で、２０
１は、これらの半導体装置Ｋｍ能選択情報を曹込む機能
選択情報発生器である。機能選択信号発生器は、電源投
入時に、機能選択情報のパルス・トレインと転送りロッ
クを送出する。パルストレインには、始めに２０３の半
導体装置の為の機能選択情報が含まれており、これが２
０２の半導体装置のシフトレジスタを介して２０３０半
導体装置のシフトレジスタに転送される。このとき、２
０２の半導体装置には、パルス・トレインの次の情報、
即ち２０２の為の機能選択情報が転送され、２０２゜２
０３の半導体装置の両方の機能選択情報が転送完了とな
り、２０２，２０３の半導体装置が各々所望の機能が選
択されたことになる。
以上説明したように本発明は、半導体装置にシフトレジ
スタを形成し、シフトレジスタに書込まれた内容により
半導体装置の機能を切換えることができるので、例えば
小量生産のシステムに一つだけしか使用しない回路を集
積回路として一つの半導体装置に作り込む場合、他の回
路の機能を同時に作り込みシステムの組立に必要となる
半導体装置の品種数を減らし部品の在庫管理を容易にす
るとともに、−品種の半導体装置の生産数を増ヤすとい
う効果がある。
スタを形成し、シフトレジスタに書込まれた内容により
半導体装置の機能を切換えることができるので、例えば
小量生産のシステムに一つだけしか使用しない回路を集
積回路として一つの半導体装置に作り込む場合、他の回
路の機能を同時に作り込みシステムの組立に必要となる
半導体装置の品種数を減らし部品の在庫管理を容易にす
るとともに、−品種の半導体装置の生産数を増ヤすとい
う効果がある。
第１図は、本発明を実施した半導体装置を示す図、第２
図は、本発明の半導体装置がシステム内でカスケードさ
れて使用される様を示す図である。 １００・・・・・・半導体装置のチップ、ｉｏｉ・・・
・・・シフトレジスタ、１０２・・・・・・機能選択信
号発生器、１０３・・・・・・外部端子機能回路、１０
４，１０５゜１０６，１０７・・・・・・機能回路、１
０８・・・・・・機能選択情報入力端子、１０９・・・
・・・クロック入力端子、１１０・・・・・・機能選択
情報出力端子、１１１・・・・・・機能選択情報伝送中
指示信号入力端子、１１２，１１３゜１１４．１１５．
１１（５，１１７，１１８，１１９，１２０゜１２１・
・・・・・外部端子、２０１・・・・・・機能選択情報
発生器、２０２，２０３・・・・・・本発明実施の半導
体装置。 ８ ｆ 図
図は、本発明の半導体装置がシステム内でカスケードさ
れて使用される様を示す図である。 １００・・・・・・半導体装置のチップ、ｉｏｉ・・・
・・・シフトレジスタ、１０２・・・・・・機能選択信
号発生器、１０３・・・・・・外部端子機能回路、１０
４，１０５゜１０６，１０７・・・・・・機能回路、１
０８・・・・・・機能選択情報入力端子、１０９・・・
・・・クロック入力端子、１１０・・・・・・機能選択
情報出力端子、１１１・・・・・・機能選択情報伝送中
指示信号入力端子、１１２，１１３゜１１４．１１５．
１１（５，１１７，１１８，１１９，１２０゜１２１・
・・・・・外部端子、２０１・・・・・・機能選択情報
発生器、２０２，２０３・・・・・・本発明実施の半導
体装置。 ８ ｆ 図
Claims (3)
- （１）相互に結線されない独立な機能を有した複数個の
回路ブロックと外部入力端子を介して情報がシリアルに
書込めるシフトレジスタを備え前記複数個の回路ブロッ
クのうち一つを前記シフト・レジスタに書込まれた情報
をデコードすることにより得られる機能選択信号により
選択して、外部端子に接続することで該半導体装置の外
部から見た機能を決定することを特徴とした半導体装置
。 - （２）機能選択情報書込み用シフト・レジスタのシリア
ル出力が外部出力端子を介して外部へ出力されることを
特徴とする特許請求の範囲第１項記載の半導体装置。 - （３）機能選択情報書込み用シフト・レジスタへの機能
選択情報の書込み中に外部端子が出力端子の機能になる
ことを禁止する制御端子を設けたことを特徴とする特許
請求の範囲第１項記載の半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60239704A JPS6298761A (ja) | 1985-10-25 | 1985-10-25 | 半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60239704A JPS6298761A (ja) | 1985-10-25 | 1985-10-25 | 半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6298761A true JPS6298761A (ja) | 1987-05-08 |
Family
ID=17048679
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60239704A Pending JPS6298761A (ja) | 1985-10-25 | 1985-10-25 | 半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6298761A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000216342A (ja) * | 1999-01-21 | 2000-08-04 | Mitsubishi Electric Corp | 集積回路チップおよびその未使用パッドの処理方法 |
| US7405980B1 (en) * | 2000-05-17 | 2008-07-29 | Marvell International Ltd. | Shared terminal memory interface |
-
1985
- 1985-10-25 JP JP60239704A patent/JPS6298761A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000216342A (ja) * | 1999-01-21 | 2000-08-04 | Mitsubishi Electric Corp | 集積回路チップおよびその未使用パッドの処理方法 |
| US7405980B1 (en) * | 2000-05-17 | 2008-07-29 | Marvell International Ltd. | Shared terminal memory interface |
| US8386735B1 (en) | 2000-05-17 | 2013-02-26 | Marvell International Ltd. | Memory architecture and system, and interface protocol |
| US8832364B1 (en) | 2000-05-17 | 2014-09-09 | Marvell International Ltd. | Memory architecture and system, and interface protocol |
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