JPS6288346A - 多層配線基板 - Google Patents
多層配線基板Info
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- JPS6288346A JPS6288346A JP60229296A JP22929685A JPS6288346A JP S6288346 A JPS6288346 A JP S6288346A JP 60229296 A JP60229296 A JP 60229296A JP 22929685 A JP22929685 A JP 22929685A JP S6288346 A JPS6288346 A JP S6288346A
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- Production Of Multi-Layered Print Wiring Board (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は多層配線基板に係り、特に、配線変更などの技
術変更に好適な多層配線基板に関する。
術変更に好適な多層配線基板に関する。
従来、半導体デバイス間の配線変更を行なう手段として
、多層セラミック基板の部品搭載面にECパッドを設け
、半導体デバイス間の配線は該ECパッドを経由して行
なうとともに、該ECパッドの中間セクションを切断可
能にし、配線変更は上記中間セレクションを切断し、デ
ィスクリート線をECパッドに接続する方式がある。(
特開昭56−7457号公報) また他の手段として、電気部品を搭載する第−主表面か
らスルーホールを介して第二主表面に接続を導き、ディ
スクリート線接続用ポンディングパッドを経て内部配線
パターン接続用スルーホールに接続するようにしておい
て、配線変更はポンディングパッドと内部配線パターン
接続用スルーホール間を切断し、ポンディングパッドに
ディスクリート線を接続する方式がある。(特開昭50
−77865号公報) しかしながら、上記の前者と後者とでは、前者がディス
クリート布線が電気部品搭載面であるのに対し、後者は
その反対面である差はあるが、いずれも単に配線変更が
可能である域を脱していなし)。
、多層セラミック基板の部品搭載面にECパッドを設け
、半導体デバイス間の配線は該ECパッドを経由して行
なうとともに、該ECパッドの中間セクションを切断可
能にし、配線変更は上記中間セレクションを切断し、デ
ィスクリート線をECパッドに接続する方式がある。(
特開昭56−7457号公報) また他の手段として、電気部品を搭載する第−主表面か
らスルーホールを介して第二主表面に接続を導き、ディ
スクリート線接続用ポンディングパッドを経て内部配線
パターン接続用スルーホールに接続するようにしておい
て、配線変更はポンディングパッドと内部配線パターン
接続用スルーホール間を切断し、ポンディングパッドに
ディスクリート線を接続する方式がある。(特開昭50
−77865号公報) しかしながら、上記の前者と後者とでは、前者がディス
クリート布線が電気部品搭載面であるのに対し、後者は
その反対面である差はあるが、いずれも単に配線変更が
可能である域を脱していなし)。
本発明の目的は、電気部品を第一主表面に搭載するとと
もに第二主表面に入出力パッド群を配置し、配線変更な
どの技術変更を、各電気部品間、電気部品と入出力パッ
ド間の全てにわたって可能にし、かつハイブリッドモジ
ュールとして互換性を失なわない多層配線基板を提供す
ることにある。
もに第二主表面に入出力パッド群を配置し、配線変更な
どの技術変更を、各電気部品間、電気部品と入出力パッ
ド間の全てにわたって可能にし、かつハイブリッドモジ
ュールとして互換性を失なわない多層配線基板を提供す
ることにある。
前記特開昭56−7457号公報に記載される発明にお
いては、入出力端子と接続する配線ネットを変更する場
合、考えられる手段として、予備の入出力パッドを利用
することが想定されるが、この結果、入出力パッドの位
置が変わり、このモジュールを搭載する高位の配線媒体
も、配線変更しなければならないことになる。そこで、
高位の配線媒体には何ら影響を与えることなく、モジュ
ール内で閉じた変更を可能とするため、入出力パッドの
ある第2主表面で、入出力パッドと内部配線とを結ぶパ
ターン間に、内部配線接続パッドを設けてこのパッドと
入出力パッド間をレーザー光等で電気的に切断する。切
断された入出力パッドに技術変更後の正規接続を行なう
ため、電気部品搭載の第1主面に第2主表面の入出力パ
ッドから引き出された入出力端子接続変更パッドにディ
スクリート線を接続する。電気部品間の接続変更は特開
昭59−96797号公報に記載された方法と組合せる
ことによりインターフェースが変わらない完全な技術変
更ができる。
いては、入出力端子と接続する配線ネットを変更する場
合、考えられる手段として、予備の入出力パッドを利用
することが想定されるが、この結果、入出力パッドの位
置が変わり、このモジュールを搭載する高位の配線媒体
も、配線変更しなければならないことになる。そこで、
高位の配線媒体には何ら影響を与えることなく、モジュ
ール内で閉じた変更を可能とするため、入出力パッドの
ある第2主表面で、入出力パッドと内部配線とを結ぶパ
ターン間に、内部配線接続パッドを設けてこのパッドと
入出力パッド間をレーザー光等で電気的に切断する。切
断された入出力パッドに技術変更後の正規接続を行なう
ため、電気部品搭載の第1主面に第2主表面の入出力パ
ッドから引き出された入出力端子接続変更パッドにディ
スクリート線を接続する。電気部品間の接続変更は特開
昭59−96797号公報に記載された方法と組合せる
ことによりインターフェースが変わらない完全な技術変
更ができる。
本発明の詳細な説明するに先立ち、その理解の一助とす
るために、予じめ、第3図により公知の多層セラミック
基板の概要を述べておく。
るために、予じめ、第3図により公知の多層セラミック
基板の概要を述べておく。
第3図において、多層セラミック基板1の第1の表面に
は、多数の電気部品6(図面では1個の=3− みを記載)がハンダ接続されており、また第2の主表面
には入出力ピン接続用パッド4が配設され、その上に入
出力ピン5が銀ロウ付されている。入出力ピン接続用パ
ッド4からセラミック基板1内の信号配線層へは、スル
ーホール3を介して電気的に接続される構成となってい
る。なお、2は電源供給用スルーホールである。
は、多数の電気部品6(図面では1個の=3− みを記載)がハンダ接続されており、また第2の主表面
には入出力ピン接続用パッド4が配設され、その上に入
出力ピン5が銀ロウ付されている。入出力ピン接続用パ
ッド4からセラミック基板1内の信号配線層へは、スル
ーホール3を介して電気的に接続される構成となってい
る。なお、2は電源供給用スルーホールである。
然して、本発明の一実施例を示す第1図及び第2図にお
いて、入出力ピン接続用パッド4は、内部配線接続用パ
ッド8を連結した構成とし、これらパッドはレーザー光
線などにより電気的に互に切断分割可能な配線パターン
形状で構成される。
いて、入出力ピン接続用パッド4は、内部配線接続用パ
ッド8を連結した構成とし、これらパッドはレーザー光
線などにより電気的に互に切断分割可能な配線パターン
形状で構成される。
第2図はかかる形状の一例を示している。セラミック基
板内の信号配線接続用スルーホール3は、内部配線接続
用パッド8から引き出す。また電気部品を搭載する第1
の主表面には入出力端子接続変更用パッド10を設け、
入出力ピン接続用パッド4に継がるスルーホール9を該
パッド10に接続しておく。
板内の信号配線接続用スルーホール3は、内部配線接続
用パッド8から引き出す。また電気部品を搭載する第1
の主表面には入出力端子接続変更用パッド10を設け、
入出力ピン接続用パッド4に継がるスルーホール9を該
パッド10に接続しておく。
かかる構成において、配線変更その他の技術変更が生じ
た場合には、入出力ピン接続用パッド4と内部配線接続
用パッド8の中間接続部をレーザにより切断し、入出力
ピン5を内部配線接続用スルーホールから切り離した後
、入出力端子接続変更用パッド10にディスクリート線
11をハンダ接続する。
た場合には、入出力ピン接続用パッド4と内部配線接続
用パッド8の中間接続部をレーザにより切断し、入出力
ピン5を内部配線接続用スルーホールから切り離した後
、入出力端子接続変更用パッド10にディスクリート線
11をハンダ接続する。
なお、7はレーザーカット部の様子を示すものである。
本発明によりば、入出力ピン接続用パッドに接続する配
線パターンの技術変更ができるので、多層配線基板の経
済性、生産性の向上を図ることができる。またディスク
リート線を電気部品搭載面で布線できるので、布線作業
の効率化を図ることができる。さらに上位のプリント配
線媒体に接続する場合、技術変更によって入出力ピン接
続用パッドの位置が変らないので、モジュールレベルで
互換性を保つことができる。
線パターンの技術変更ができるので、多層配線基板の経
済性、生産性の向上を図ることができる。またディスク
リート線を電気部品搭載面で布線できるので、布線作業
の効率化を図ることができる。さらに上位のプリント配
線媒体に接続する場合、技術変更によって入出力ピン接
続用パッドの位置が変らないので、モジュールレベルで
互換性を保つことができる。
第1図は本発明の多層配線基板の断面図、第2図は同基
板の第2の主表面の平面図、第3図は公知の多層配線基
板の断面図である。 1・・・多層セラミック基板、 2・・・電源供給用ス
ルーホール、 3・・・信号配線接続用スルーホール、
4・・・入出力ピン接続用パッド、 5・・・入出力
ピン、 6・・・電気部品、 7・・・技術変更による
レーザーカット部、 8・・・内部配線接続用パッド、
9・・・スルーホール、 10・・・入出力端子接
続変更用パッド、 11・・ディスクリート線。 第1図 第2図
板の第2の主表面の平面図、第3図は公知の多層配線基
板の断面図である。 1・・・多層セラミック基板、 2・・・電源供給用ス
ルーホール、 3・・・信号配線接続用スルーホール、
4・・・入出力ピン接続用パッド、 5・・・入出力
ピン、 6・・・電気部品、 7・・・技術変更による
レーザーカット部、 8・・・内部配線接続用パッド、
9・・・スルーホール、 10・・・入出力端子接
続変更用パッド、 11・・ディスクリート線。 第1図 第2図
Claims (1)
- (1)複数の電気部品を第1の主表面に、入出力ピンを
有する複数の入出力ピン接続用パッドを第2の主表面に
それぞれ配置し、これら両主表面間に前記電気部品間等
の接続のための配線ネットを備えた複数の配線層が形成
される多層配線基板において、前記第1の主表面にディ
スクリート線接続用の入出力端子接続変更用パッドを設
け、前記第2の主表面に内部配線接続用パッドを前記入
出力ピン接続用パッドに連結して且つ必要に応じて電気
的に切断可能状態に設け、前記入出力端子接続変更用パ
ッドと前記入出力ピン接続用パッドを多層配線基板内を
通して接続するとともに、前記内部配線接続用パッドか
ら多層配線基板内を通して前記配線ネットに接続がなさ
れることを特徴とする多層配線基板。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60229296A JPS6288346A (ja) | 1985-10-15 | 1985-10-15 | 多層配線基板 |
US06/918,918 US4706165A (en) | 1985-10-15 | 1986-10-15 | Multilayer circuit board |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60229296A JPS6288346A (ja) | 1985-10-15 | 1985-10-15 | 多層配線基板 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6288346A true JPS6288346A (ja) | 1987-04-22 |
Family
ID=16889909
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60229296A Pending JPS6288346A (ja) | 1985-10-15 | 1985-10-15 | 多層配線基板 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4706165A (ja) |
JP (1) | JPS6288346A (ja) |
Families Citing this family (25)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4922377A (en) * | 1987-11-16 | 1990-05-01 | Hitachi, Ltd. | Module and a substrate for the module |
US4858077A (en) * | 1987-11-25 | 1989-08-15 | Hitachi, Ltd. | Condenser-containing, ceramic multi-layer circuit board and semiconductor module and computer having the circuit board |
US4963697A (en) * | 1988-02-12 | 1990-10-16 | Texas Instruments Incorporated | Advanced polymers on metal printed wiring board |
US4943845A (en) * | 1988-08-02 | 1990-07-24 | Northern Telecom Limited | Thick film packages with common wafer aperture placement |
JP3090453B2 (ja) * | 1989-07-10 | 2000-09-18 | 株式会社日立製作所 | 厚膜薄膜積層基板およびそれを用いた電子回路装置 |
US5127986A (en) * | 1989-12-01 | 1992-07-07 | Cray Research, Inc. | High power, high density interconnect method and apparatus for integrated circuits |
US5185502A (en) * | 1989-12-01 | 1993-02-09 | Cray Research, Inc. | High power, high density interconnect apparatus for integrated circuits |
US5155577A (en) * | 1991-01-07 | 1992-10-13 | International Business Machines Corporation | Integrated circuit carriers and a method for making engineering changes in said carriers |
US5184284A (en) * | 1991-09-03 | 1993-02-02 | International Business Machines Corporation | Method and apparatus for implementing engineering changes for integrated circuit module |
US5243140A (en) * | 1991-10-04 | 1993-09-07 | International Business Machines Corporation | Direct distribution repair and engineering change system |
US5326643A (en) * | 1991-10-07 | 1994-07-05 | International Business Machines Corporation | Adhesive layer in multi-level packaging and organic material as a metal diffusion barrier |
US5923539A (en) * | 1992-01-16 | 1999-07-13 | Hitachi, Ltd. | Multilayer circuit substrate with circuit repairing function, and electronic circuit device |
US5354955A (en) * | 1992-12-02 | 1994-10-11 | International Business Machines Corporation | Direct jump engineering change system |
US5308926A (en) * | 1992-12-08 | 1994-05-03 | Premisys Communications, Inc. | Compact isolating backplane for routing electronic signals |
US5539186A (en) * | 1992-12-09 | 1996-07-23 | International Business Machines Corporation | Temperature controlled multi-layer module |
US5450290A (en) * | 1993-02-01 | 1995-09-12 | International Business Machines Corporation | Printed circuit board with aligned connections and method of making same |
US5331591A (en) * | 1993-02-01 | 1994-07-19 | At&T Bell Laboratories | Electronic module including a programmable memory |
JP3330468B2 (ja) * | 1995-06-30 | 2002-09-30 | 富士通株式会社 | 配線基板及び半導体装置 |
JP3491414B2 (ja) * | 1995-11-08 | 2004-01-26 | 三菱電機株式会社 | 回路基板 |
US5809641A (en) * | 1996-04-25 | 1998-09-22 | International Business Machines Corporation | Method for printed circuit board repair |
US6081026A (en) * | 1998-11-13 | 2000-06-27 | Fujitsu Limited | High density signal interposer with power and ground wrap |
US6239485B1 (en) | 1998-11-13 | 2001-05-29 | Fujitsu Limited | Reduced cross-talk noise high density signal interposer with power and ground wrap |
US6449170B1 (en) * | 2000-08-30 | 2002-09-10 | Advanced Micro Devices, Inc. | Integrated circuit package incorporating camouflaged programmable elements |
US7299102B2 (en) * | 2004-12-02 | 2007-11-20 | Norman Ken Ouchi | Method and system for engineering change implementation |
US8692136B2 (en) | 2010-07-13 | 2014-04-08 | Samsung Electro-Mechanics Co., Ltd. | Method of repairing probe card and probe board using the same |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3605063A (en) * | 1969-03-12 | 1971-09-14 | Marvin C Stewart | System for interconnecting electrical components |
FR2241946B1 (ja) * | 1973-08-24 | 1976-11-19 | Honeywell Bull Soc Ind | |
US4016463A (en) * | 1973-10-17 | 1977-04-05 | Amdahl Corporation | High density multilayer printed circuit card assembly and method |
JPS53129863A (en) * | 1977-04-19 | 1978-11-13 | Fujitsu Ltd | Multilayer printed board |
US4254445A (en) * | 1979-05-07 | 1981-03-03 | International Business Machines Corporation | Discretionary fly wire chip interconnection |
US4464704A (en) * | 1980-09-26 | 1984-08-07 | Sperry Corporation | Polyimide/glass-epoxy/glass hybrid printed circuit board |
US4434321A (en) * | 1981-02-09 | 1984-02-28 | International Computers Limited | Multilayer printed circuit boards |
US4546413A (en) * | 1984-06-29 | 1985-10-08 | International Business Machines Corporation | Engineering change facility on both major surfaces of chip module |
-
1985
- 1985-10-15 JP JP60229296A patent/JPS6288346A/ja active Pending
-
1986
- 1986-10-15 US US06/918,918 patent/US4706165A/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
US4706165A (en) | 1987-11-10 |
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