JPS62214662A - 縦型pnpトランジスタの製造方法 - Google Patents
縦型pnpトランジスタの製造方法Info
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- JPS62214662A JPS62214662A JP61057441A JP5744186A JPS62214662A JP S62214662 A JPS62214662 A JP S62214662A JP 61057441 A JP61057441 A JP 61057441A JP 5744186 A JP5744186 A JP 5744186A JP S62214662 A JPS62214662 A JP S62214662A
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- 238000004519 manufacturing process Methods 0.000 title claims description 7
- 238000009792 diffusion process Methods 0.000 claims abstract description 87
- 239000000758 substrate Substances 0.000 claims abstract description 18
- 238000000926 separation method Methods 0.000 claims description 12
- 238000005468 ion implantation Methods 0.000 claims description 9
- 239000012535 impurity Substances 0.000 claims description 7
- 239000004065 semiconductor Substances 0.000 claims description 5
- 238000000151 deposition Methods 0.000 claims 1
- 238000010030 laminating Methods 0.000 claims 1
- 230000010354 integration Effects 0.000 abstract description 5
- 238000000034 method Methods 0.000 description 5
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 4
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 4
- 229910052787 antimony Inorganic materials 0.000 description 4
- WATWJIUSRGPENY-UHFFFAOYSA-N antimony atom Chemical compound [Sb] WATWJIUSRGPENY-UHFFFAOYSA-N 0.000 description 4
- 229910052796 boron Inorganic materials 0.000 description 4
- 238000002955 isolation Methods 0.000 description 4
- 229910052698 phosphorus Inorganic materials 0.000 description 4
- 239000011574 phosphorus Substances 0.000 description 4
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 2
- 230000001133 acceleration Effects 0.000 description 2
- 239000013078 crystal Substances 0.000 description 2
- 230000007547 defect Effects 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 238000001947 vapour-phase growth Methods 0.000 description 2
- 239000003795 chemical substances by application Substances 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
Landscapes
- Bipolar Integrated Circuits (AREA)
- Bipolar Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(イ)産業上の利用分野
本発明は半導体集積回路に組み込まれる縦型PNP)−
ランジスタの改良に関する。
ランジスタの改良に関する。
(ロ)従来の技術
従来の縦型PNPトランジスタの製造方法を第3図(イ
)乃至第3図(*)を用いて説明する。
)乃至第3図(*)を用いて説明する。
先ず第2図(イ)に示す如く、半導体基板(1〉として
P型のシリコン基板を用い、基板(1)上に選択的にア
ンチモン(Sb)をデポジットしてN+型の埋込層(2
)を形成し、埋込層(2)上および埋込層(2)を囲む
基板(1)表面にはポロン(B)をデポジットしてコレ
クタ埋込層(3)と上下分離領域(4)の下拡散層(5
)を形成する。
P型のシリコン基板を用い、基板(1)上に選択的にア
ンチモン(Sb)をデポジットしてN+型の埋込層(2
)を形成し、埋込層(2)上および埋込層(2)を囲む
基板(1)表面にはポロン(B)をデポジットしてコレ
クタ埋込層(3)と上下分離領域(4)の下拡散層(5
)を形成する。
次に第2図(ロ)に示す如く、基板(1)全面に周知の
気相成長法によりN−型のエピタキシャル層(6)を所
定厚さに形成する。この時埋込層(2)、コレクタ埋込
層(3)および不拡散Wj(5)は上下方向に若干拡散
される。
気相成長法によりN−型のエピタキシャル層(6)を所
定厚さに形成する。この時埋込層(2)、コレクタ埋込
層(3)および不拡散Wj(5)は上下方向に若干拡散
される。
次に第2図(ハ)に示す如く、エピタキシャル層(6)
表面のコレクタ埋込層(3)上に対応する領域に選択的
にリン(P)をイオン注入してベース領域(7)を付着
する。このイオン注入はリン(P)をドーズ量10”
〜10目cm −”で加速電圧80〜100Keyで行
う。
表面のコレクタ埋込層(3)上に対応する領域に選択的
にリン(P)をイオン注入してベース領域(7)を付着
する。このイオン注入はリン(P)をドーズ量10”
〜10目cm −”で加速電圧80〜100Keyで行
う。
次に第2図(ニ)に示す如く、エピタキシャル層(6)
表面から上下分離領域(4)の上拡散層(8)とコレク
タ導出領域(9)を約1200°C13〜4時間で拡散
し、同時に埋込層(2)とコレクタ埋込層(3)及び下
拡散層り5〉をエピタキシャル層(6)内にはい上らせ
て拡散し、ベース領域(7)をドライブインする。この
工程で上拡散層(8)は下拡散層(5)と連結してエピ
タキシャル層(6)を接合分離し、コレクタ導出領域(
9〉はコレクタ埋込層(3〉まで達してベース領域(7
)全周を囲む。具体的には、エピタキシャル層(6〉の
厚みを13μmとすると上拡散層(8)は約9μmの深
さに拡散され、下拡散層(5)は約7μmの深さにはい
上げられる。またボロン(B)とアンチモン(Sb)の
拡散係数の差によりコレクタ埋込層(3)は約7μm1
埋込層(2〉は約3μmの深さにはい上げられ、ベース
領域(7)は不純物濃度の差により上拡散層(8)より
浅く約4μmの深さに拡散される。
表面から上下分離領域(4)の上拡散層(8)とコレク
タ導出領域(9)を約1200°C13〜4時間で拡散
し、同時に埋込層(2)とコレクタ埋込層(3)及び下
拡散層り5〉をエピタキシャル層(6)内にはい上らせ
て拡散し、ベース領域(7)をドライブインする。この
工程で上拡散層(8)は下拡散層(5)と連結してエピ
タキシャル層(6)を接合分離し、コレクタ導出領域(
9〉はコレクタ埋込層(3〉まで達してベース領域(7
)全周を囲む。具体的には、エピタキシャル層(6〉の
厚みを13μmとすると上拡散層(8)は約9μmの深
さに拡散され、下拡散層(5)は約7μmの深さにはい
上げられる。またボロン(B)とアンチモン(Sb)の
拡散係数の差によりコレクタ埋込層(3)は約7μm1
埋込層(2〉は約3μmの深さにはい上げられ、ベース
領域(7)は不純物濃度の差により上拡散層(8)より
浅く約4μmの深さに拡散される。
次に第2図(*)に示す如く、ベース領域(7)表面に
拡散深き約2μmのP型エミッタ領域(10)を形成し
、続いて拡散深さ約1.5μmのN+型ベースコンタク
ト領域(11)を形成する。尚エミッタ領域(10〉は
NPN)ランジスタのベース拡散工程で形成し、ベース
コンタクト領域(11)はNPN トランジスタのエミ
ッタ拡散工程で形成する。
拡散深き約2μmのP型エミッタ領域(10)を形成し
、続いて拡散深さ約1.5μmのN+型ベースコンタク
ト領域(11)を形成する。尚エミッタ領域(10〉は
NPN)ランジスタのベース拡散工程で形成し、ベース
コンタクト領域(11)はNPN トランジスタのエミ
ッタ拡散工程で形成する。
この様に形成した縦型PNP トランジスタにおいては
、活性ベースの大部分をイオン注入により形成したベー
ス領域(7)で形成するので、その不純物濃度が内部に
ドリフト電界を生じさせてエミッタから注入したホール
を加速する方向に働き、高い利得帯域幅積fアが得られ
る。また縦型PNP トランジスタのh□はほぼイオン
注入により形成したベース領域(7)で決定きれるので
、エピタキシャル層(6)の比抵抗や厚さがばらついて
もり、はあまりばらつかない。
、活性ベースの大部分をイオン注入により形成したベー
ス領域(7)で形成するので、その不純物濃度が内部に
ドリフト電界を生じさせてエミッタから注入したホール
を加速する方向に働き、高い利得帯域幅積fアが得られ
る。また縦型PNP トランジスタのh□はほぼイオン
注入により形成したベース領域(7)で決定きれるので
、エピタキシャル層(6)の比抵抗や厚さがばらついて
もり、はあまりばらつかない。
局所る縦型PNPトランジスタは、例えば特開昭59−
211270号公報に記載されている。
211270号公報に記載されている。
(ハ)発明が解決しようとする問題点
しかしながら、従来の製造方法では上下分離領域(4)
の上拡散層(8)と下拡散層(5)とを同時に拡散し且
つその工程でコレクタ埋込層(3)、コレクタ導出領域
(9)及びベース領域(7)をも同時に拡散形成してい
る。するとこの拡散工程では、イオン注入による低濃度
のベース領域(7)を十分に深く、しかもアンチモン(
Sb)とボロン(B)の拡散係数の差で形成するコレク
タ埋込層(3)を十分に深くはい上げるために上拡散層
(8)をかなり深く形成しなければならない。さらに上
拡散層(8)と不拡散R(5)とでは上拡散層(8)の
方が拡散に供給される不純物が多い状態、具体的に言え
ばボロン(B>を多量に含む拡散源膜を付着したままの
状態で拡散するため、上拡散層(8)の方が上拡散層(
5)よりかなり深く拡散きれてしまう。
の上拡散層(8)と下拡散層(5)とを同時に拡散し且
つその工程でコレクタ埋込層(3)、コレクタ導出領域
(9)及びベース領域(7)をも同時に拡散形成してい
る。するとこの拡散工程では、イオン注入による低濃度
のベース領域(7)を十分に深く、しかもアンチモン(
Sb)とボロン(B)の拡散係数の差で形成するコレク
タ埋込層(3)を十分に深くはい上げるために上拡散層
(8)をかなり深く形成しなければならない。さらに上
拡散層(8)と不拡散R(5)とでは上拡散層(8)の
方が拡散に供給される不純物が多い状態、具体的に言え
ばボロン(B>を多量に含む拡散源膜を付着したままの
状態で拡散するため、上拡散層(8)の方が上拡散層(
5)よりかなり深く拡散きれてしまう。
従って上拡散層(8)とコレクタ導出領域(9)の横方
向拡散が大きくエピタキシャル層(6)表面での占有面
積が大で集積度を向上できない欠点があった。
向拡散が大きくエピタキシャル層(6)表面での占有面
積が大で集積度を向上できない欠点があった。
(二〉問題点を解決するための手段
本発明は斯上したこれらの欠点に鑑みてなされ、上下分
離領域(4)の下拡散層(5)とコレクタ埋込Ji!!
(3)とをエピタキシャル層(6)の厚みの半分以上法
くはい上げて拡散し、同時にベース領域(7)をコレク
タ埋込層(3)に到達するか又は略到達するように形成
した後、上下分離領域(4)の上拡散層(8)とコレク
タ導出領域(9〉をそれぞれ下拡散層(5)とコレクタ
埋込Jl(3)に到達するように拡散することにより、
従来の欠点を大幅に改善した縦型PNPトランジスタの
製造方法を提供するものである。
離領域(4)の下拡散層(5)とコレクタ埋込Ji!!
(3)とをエピタキシャル層(6)の厚みの半分以上法
くはい上げて拡散し、同時にベース領域(7)をコレク
タ埋込層(3)に到達するか又は略到達するように形成
した後、上下分離領域(4)の上拡散層(8)とコレク
タ導出領域(9〉をそれぞれ下拡散層(5)とコレクタ
埋込Jl(3)に到達するように拡散することにより、
従来の欠点を大幅に改善した縦型PNPトランジスタの
製造方法を提供するものである。
(ホ)作用
本発明によれば、あらかじめ上拡散層(5)、コレクタ
埋込層(3)およびベース領域(7)を十分に深く拡散
してから上拡散層(8〉とコレクタ導出領域(9〉を浅
く形成するので、上拡散層(8)とコレクタ導出領域(
9)の横方向拡散を抑え、集積度を向上できる。
埋込層(3)およびベース領域(7)を十分に深く拡散
してから上拡散層(8〉とコレクタ導出領域(9〉を浅
く形成するので、上拡散層(8)とコレクタ導出領域(
9)の横方向拡散を抑え、集積度を向上できる。
(へ)実施例
以下、本発明による縦型PNP トランジスタの製造方
法を第1図(イ)乃至第1図(へ)を用いて詳細に説明
する。
法を第1図(イ)乃至第1図(へ)を用いて詳細に説明
する。
先ず第1図(イ)に示す如く、半導体基板(1)として
P型のシリコン基板を用い、基板(1)上に選択的にア
ンチモン(Sb)をデポジットしてN1型の埋込層(2
〉を形成し、埋込層(2)上および埋込層(2)を囲む
基板(1)表面にはボロン(B)をデポジットしてコレ
クタ埋込層(3)と上下分離領域(4)の上拡散層(5
〉を形成する。
P型のシリコン基板を用い、基板(1)上に選択的にア
ンチモン(Sb)をデポジットしてN1型の埋込層(2
〉を形成し、埋込層(2)上および埋込層(2)を囲む
基板(1)表面にはボロン(B)をデポジットしてコレ
クタ埋込層(3)と上下分離領域(4)の上拡散層(5
〉を形成する。
次に第1図(口〉に示す如く、基板(1)全面に周知の
気相成長法によりN−型のエピタキシャル層(6)を約
7μm厚に形成する。この時埋込層(2)、コレクタ埋
込層(3)及び上拡散層(5)は上下方向に若干拡散さ
れる。
気相成長法によりN−型のエピタキシャル層(6)を約
7μm厚に形成する。この時埋込層(2)、コレクタ埋
込層(3)及び上拡散層(5)は上下方向に若干拡散さ
れる。
次に第1図(ハ)に示す如く、エピタキシャル層(6)
表面のコレクタ埋込J!! (3)上に対応する領域に
選択的にリン(P)をイオン注入してベース領域(7)
を付着する。このイオン注入はリン(P)をドーズ量1
0 ” 〜10 ”cm−”で加速電圧80〜100K
eVで行う。
表面のコレクタ埋込J!! (3)上に対応する領域に
選択的にリン(P)をイオン注入してベース領域(7)
を付着する。このイオン注入はリン(P)をドーズ量1
0 ” 〜10 ”cm−”で加速電圧80〜100K
eVで行う。
次に第1図(ニ)に示す如く、基板(1)全体に約12
00℃、2時間の熱処理を加えることにより上下分離領
域(4)の上拡散層(5)とコレクタ埋込層(3)とを
エピタキシャルJ!t(6)の厚みの半分以上深くはい
上げて拡散し、同時にベース領域(7)を上拡散層(8
)と同程度かそれより深く拡散する。具体的には、上拡
散層(5)とコレクタ埋込層(3)は基板(1)表面か
ら約5μmはい上げて拡散し、ベース領域(7)はエピ
タキシャル層(6)表面から約3μm拡散する。従って
ベース領域(7)はコレクタ埋込層(3)まで完全に到
達する。尚埋込層(2)も基板(1〉表面から約2μm
はい上げて拡散する。
00℃、2時間の熱処理を加えることにより上下分離領
域(4)の上拡散層(5)とコレクタ埋込層(3)とを
エピタキシャルJ!t(6)の厚みの半分以上深くはい
上げて拡散し、同時にベース領域(7)を上拡散層(8
)と同程度かそれより深く拡散する。具体的には、上拡
散層(5)とコレクタ埋込層(3)は基板(1)表面か
ら約5μmはい上げて拡散し、ベース領域(7)はエピ
タキシャル層(6)表面から約3μm拡散する。従って
ベース領域(7)はコレクタ埋込層(3)まで完全に到
達する。尚埋込層(2)も基板(1〉表面から約2μm
はい上げて拡散する。
次に第1図(*)に示す如く、エピタキシャル層(6)
表面から上下分離領域(4)の上拡散層(8)とコレク
タ導出領域(9)とを同時に選択拡散し、上下分離領域
(4)をエピタキシャル層(6)の厚みの半分“より浅
い位置で連結させてこれを接合分離する。
表面から上下分離領域(4)の上拡散層(8)とコレク
タ導出領域(9)とを同時に選択拡散し、上下分離領域
(4)をエピタキシャル層(6)の厚みの半分“より浅
い位置で連結させてこれを接合分離する。
またコレクタ導出領域(9)はコレクタ埋込層(3)ま
で達し、ベース領域(7)を完全に囲む。
で達し、ベース領域(7)を完全に囲む。
本工程は本発明の特徴とする工程で、あらかじめコレク
タ埋込N!j (3)と上拡散層〈5)をエピタキシャ
ル層(6)の厚みの半分以上深くはい上げて拡散し、同
時にベース領域(7)を十分に深く拡散した後に上拡散
層(8)とコレクタ導出領域(9)を形成しているので
、上拡散層(8)とコレクタ導出領域(9)を約3μm
と浅くでき、その拡散時間を約1時間と短くできる。こ
のため上拡散層(8)とコレクタ導出領域(9)の横方
向拡散を約3μmに抑えることができ、それらの表面占
有面積を大幅に縮小できる。具体的には、拡散窓の幅が
4μmであれば、上拡散層(5〉の幅が約14μmに形
成されるのに対して上拡散層(8)とコレクタ導出領域
(9)の幅は約10μmに形成される。
タ埋込N!j (3)と上拡散層〈5)をエピタキシャ
ル層(6)の厚みの半分以上深くはい上げて拡散し、同
時にベース領域(7)を十分に深く拡散した後に上拡散
層(8)とコレクタ導出領域(9)を形成しているので
、上拡散層(8)とコレクタ導出領域(9)を約3μm
と浅くでき、その拡散時間を約1時間と短くできる。こ
のため上拡散層(8)とコレクタ導出領域(9)の横方
向拡散を約3μmに抑えることができ、それらの表面占
有面積を大幅に縮小できる。具体的には、拡散窓の幅が
4μmであれば、上拡散層(5〉の幅が約14μmに形
成されるのに対して上拡散層(8)とコレクタ導出領域
(9)の幅は約10μmに形成される。
次に第1図〈へ〉に示す如く、ベース領域(7)表面に
拡散深さ約1.5μmのP型エミッタ領域(10)を形
成し、続いて拡散深さ約1.0μmのN1型ベースコン
タクト領域(11)を形成する。尚エミッタ領域(10
)は通常のNPNトランジスタのベース拡散工程で形成
し:ベースコンタクト領域(11)は通常のNPN ト
ランジスタのエミッタ拡散工程で形成する。
拡散深さ約1.5μmのP型エミッタ領域(10)を形
成し、続いて拡散深さ約1.0μmのN1型ベースコン
タクト領域(11)を形成する。尚エミッタ領域(10
)は通常のNPNトランジスタのベース拡散工程で形成
し:ベースコンタクト領域(11)は通常のNPN ト
ランジスタのエミッタ拡散工程で形成する。
この様に形成した縦型PNP トランジスタは、上拡散
層(8)を浅くできるのでエピタキシャル層(6)を薄
くでき、上下分離領域(4〉がエピタキシャル層(6)
の厚みの半分より浅い位置で連結きれ且つ上拡散層(5
)は上拡散層(8)より幅広に形成きれる。またコレク
タ埋込層(3)は上拡散層(5)と同様に大きくはい上
げられ且つコレクタ導出領域(9)は上拡散層(8)と
同様に浅く形成される。そして、ベース領域(7)はコ
レクタ埋込層(3〉に達するまで十分に深く拡散きれ、
コレクタ埋込層(3)とコレクタ導出領域(9)とで完
全に囲まれる。
層(8)を浅くできるのでエピタキシャル層(6)を薄
くでき、上下分離領域(4〉がエピタキシャル層(6)
の厚みの半分より浅い位置で連結きれ且つ上拡散層(5
)は上拡散層(8)より幅広に形成きれる。またコレク
タ埋込層(3)は上拡散層(5)と同様に大きくはい上
げられ且つコレクタ導出領域(9)は上拡散層(8)と
同様に浅く形成される。そして、ベース領域(7)はコ
レクタ埋込層(3〉に達するまで十分に深く拡散きれ、
コレクタ埋込層(3)とコレクタ導出領域(9)とで完
全に囲まれる。
よって本発明によれば、コレクタ埋込層(3)とベース
領域(7〉を十分に深く拡散する一方で、上拡散層(8
)とコレクタ導出領域(9〉を浅くでき、それらの横方
向拡散を抑えて表面占有面積を大幅に縮小できる。しか
も上下分離領域(4)の下拡散層(5)は上拡散層(8
)より幅広に形成するものの、下拡散層(5)とコレク
タ導出領域(9)又は下拡散層(5)とコレクタ埋込層
(3)とはそれらの周端部が横方向拡散により湾曲して
おり、エピタキシャル層(6)深部においである程度の
離間距離が保たれているので、下拡散層(5〉はエピタ
キシャル層(6)表面での集積度の向上をあまり防げず
、上拡散層(8〉とコレクタ導出領域(9)とを十分に
近接して配置できる。よって縦型PNP トランジスタ
のパターンサイズを大幅に縮小できる。
領域(7〉を十分に深く拡散する一方で、上拡散層(8
)とコレクタ導出領域(9〉を浅くでき、それらの横方
向拡散を抑えて表面占有面積を大幅に縮小できる。しか
も上下分離領域(4)の下拡散層(5)は上拡散層(8
)より幅広に形成するものの、下拡散層(5)とコレク
タ導出領域(9)又は下拡散層(5)とコレクタ埋込層
(3)とはそれらの周端部が横方向拡散により湾曲して
おり、エピタキシャル層(6)深部においである程度の
離間距離が保たれているので、下拡散層(5〉はエピタ
キシャル層(6)表面での集積度の向上をあまり防げず
、上拡散層(8〉とコレクタ導出領域(9)とを十分に
近接して配置できる。よって縦型PNP トランジスタ
のパターンサイズを大幅に縮小できる。
また本発明によれば、上拡散層(8)の拡散時間が短い
ので熱拡散によるエピタキシャル層(6)表面の結晶欠
陥が少く、さらに下拡散層(5)を上拡散層り8)より
幅広に形成するので、多少のマスクずれがあっても完全
な接合分離が得られる。
ので熱拡散によるエピタキシャル層(6)表面の結晶欠
陥が少く、さらに下拡散層(5)を上拡散層り8)より
幅広に形成するので、多少のマスクずれがあっても完全
な接合分離が得られる。
そして本発明によれば、ベース領域(7)をコレクタ埋
込J!t(3)に完全に到達するように形成すると、活
性ベースの全てをイオン注入により形成した低濃度のベ
ース領域(7)のみで形成できるので、その一部をエピ
タキシャル層(6)で形成した従来のものよりrTを更
に向上でき、且つエピタキシャル層(6)のばらつきに
よるり2.のばらつきがほとんど無くなる。しかもコレ
クタ埋込層(3)が十分にはい上って拡散されるので、
所定の低いvc、g(sat)が得られる。
込J!t(3)に完全に到達するように形成すると、活
性ベースの全てをイオン注入により形成した低濃度のベ
ース領域(7)のみで形成できるので、その一部をエピ
タキシャル層(6)で形成した従来のものよりrTを更
に向上でき、且つエピタキシャル層(6)のばらつきに
よるり2.のばらつきがほとんど無くなる。しかもコレ
クタ埋込層(3)が十分にはい上って拡散されるので、
所定の低いvc、g(sat)が得られる。
尚本発明の他の実施例として、ベース領域(7)の不純
物濃度を調整することによりベース領域(7)をエミッ
タ領域(10)より深くコレクタ埋込層り3)の上部よ
り浅く形成しても、従来例と同程度の高いr7とhyt
のばらつきが少い縦型PNP トランジスタが得られる
。
物濃度を調整することによりベース領域(7)をエミッ
タ領域(10)より深くコレクタ埋込層り3)の上部よ
り浅く形成しても、従来例と同程度の高いr7とhyt
のばらつきが少い縦型PNP トランジスタが得られる
。
(ト)発明の詳細
な説明した如く、本発明によればコレクタ埋込層(3〉
とベース領域(7)を十分に深く拡散できる一方で、上
拡散Ji!(8)とコレクタ導出領域〈9〉を浅く形成
できる。従って上拡散層(8)とコレクタ導出領域(9
)の横方向拡散を抑え、それらの表面占有面積を大幅に
縮小して集積度を向上できる利点を有する。
とベース領域(7)を十分に深く拡散できる一方で、上
拡散Ji!(8)とコレクタ導出領域〈9〉を浅く形成
できる。従って上拡散層(8)とコレクタ導出領域(9
)の横方向拡散を抑え、それらの表面占有面積を大幅に
縮小して集積度を向上できる利点を有する。
また上拡散Ji<8)の拡散時間が短いので、熱拡散に
よるエピタキシャル層(6〉表面の結晶欠陥が少く、ト
ランジスタの雑音が低減し、さらに上拡散層(8)より
下拡散層(5)を幅広にするので、多少のマスクずれが
あっても完全な接合分離が得られるという利点を有する
。
よるエピタキシャル層(6〉表面の結晶欠陥が少く、ト
ランジスタの雑音が低減し、さらに上拡散層(8)より
下拡散層(5)を幅広にするので、多少のマスクずれが
あっても完全な接合分離が得られるという利点を有する
。
きらに本発明を用いればベース領域(7)をコレクタ埋
込層(3)に完全に到達させることもできるので、活性
ベースの全てをイオン注入により形成した低濃度のベー
ス領域<7)のみで形成できる。
込層(3)に完全に到達させることもできるので、活性
ベースの全てをイオン注入により形成した低濃度のベー
ス領域<7)のみで形成できる。
この結果、一部をエピタキシャル層(6)で形成してい
た従来のものよりfqを更に向上でき、且つエピタキシ
ャル層(6)のばらつきによるhFllのばらつきがほ
とんど無くなるという利点を有する。
た従来のものよりfqを更に向上でき、且つエピタキシ
ャル層(6)のばらつきによるhFllのばらつきがほ
とんど無くなるという利点を有する。
第1図(イ)乃至第1図(へ)は本発明を説明するため
の工程断面図、第2図(イ)乃至第2図(ネ)は従来の
縦型PNP トランジスタの製造方法を説明するための
工程断面図である。 (1)は半導体基板、 (3)はコレクタ埋込層、(5
)は上下分離領域(4)の上拡散層、 (6)はエピタ
キシャル層、(7)はベース領域、(8)は上下分離領
域(4)の上拡散層、 (9)はコレクタ導出領域であ
る。 出願人 三洋電機株式会社外1名 代理人 弁理士 西野卓嗣 外1名 第1図(イ2 第 11図 (口2 1 3 l 第1図(八〕 第1図(:l−J 第1図(4) 第1 図 (へ〕 第2図 1,41 tI2 図 (口] @2 図 (ハ) 第20!I (ニ) 1 ノ J第2rM鋒)
の工程断面図、第2図(イ)乃至第2図(ネ)は従来の
縦型PNP トランジスタの製造方法を説明するための
工程断面図である。 (1)は半導体基板、 (3)はコレクタ埋込層、(5
)は上下分離領域(4)の上拡散層、 (6)はエピタ
キシャル層、(7)はベース領域、(8)は上下分離領
域(4)の上拡散層、 (9)はコレクタ導出領域であ
る。 出願人 三洋電機株式会社外1名 代理人 弁理士 西野卓嗣 外1名 第1図(イ2 第 11図 (口2 1 3 l 第1図(八〕 第1図(:l−J 第1図(4) 第1 図 (へ〕 第2図 1,41 tI2 図 (口] @2 図 (ハ) 第20!I (ニ) 1 ノ J第2rM鋒)
Claims (1)
- (1)一導電型半導体基板表面に埋込層を形成する逆導
電型の不純物を付着し、該埋込層上および前記埋込層を
囲む前記基板表面にコレクタ埋込層および上下分離領域
の下拡散層を形成する一導電型の不純物を付着する工程
、 前記基板全面に逆導電型のエピタキシャル層を積層する
工程、 前記エピタキシャル層表面の前記コレクタ埋込層に対応
する部分にベース領域を形成する逆導電型の不純物をイ
オン注入により付着する工程、前記基板全体を加熱処理
して前記下拡散層を前記エピタキシャル層の厚みの半分
以上はい上らせて拡散し、同時に前記ベース領域を前記
コレクタ埋込層に到達するか又は略到達するように形成
する工程、 前記エピタキシャル層表面より前記上下分離領域を形成
する上拡散層を拡散して前記下拡散層に到達させ、同時
にコレクタ導出領域を拡散して前記コレクタ埋込層に到
達させる工程、 前記ベース領域表面に一導電型のエミッタ領域を形成す
る工程、 前記ベース領域表面に逆導電型のベースコンタクト領域
を形成する工程とを具備することを特徴とする縦型PN
Pトランジスタの製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61057441A JPH0618203B2 (ja) | 1986-03-14 | 1986-03-14 | 縦型pnpトランジスタの製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61057441A JPH0618203B2 (ja) | 1986-03-14 | 1986-03-14 | 縦型pnpトランジスタの製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS62214662A true JPS62214662A (ja) | 1987-09-21 |
JPH0618203B2 JPH0618203B2 (ja) | 1994-03-09 |
Family
ID=13055744
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61057441A Expired - Lifetime JPH0618203B2 (ja) | 1986-03-14 | 1986-03-14 | 縦型pnpトランジスタの製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0618203B2 (ja) |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS52104076A (en) * | 1976-02-27 | 1977-09-01 | Sony Corp | Semiconductor unit |
JPS586168A (ja) * | 1981-07-02 | 1983-01-13 | Matsushita Electronics Corp | 半導体集積回路 |
JPS5965465A (ja) * | 1982-10-06 | 1984-04-13 | Matsushita Electronics Corp | 半導体装置の製造方法 |
JPS59194465A (ja) * | 1983-04-19 | 1984-11-05 | Sanken Electric Co Ltd | 半導体集積回路の製造方法 |
JPS59211270A (ja) * | 1983-05-17 | 1984-11-30 | Sanyo Electric Co Ltd | 縦型pnpトランジスタ |
JPS60247968A (ja) * | 1984-05-23 | 1985-12-07 | Nec Corp | 半導体装置 |
JPS6167959A (ja) * | 1984-09-11 | 1986-04-08 | Nec Corp | 半導体装置の製造方法 |
-
1986
- 1986-03-14 JP JP61057441A patent/JPH0618203B2/ja not_active Expired - Lifetime
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS52104076A (en) * | 1976-02-27 | 1977-09-01 | Sony Corp | Semiconductor unit |
JPS586168A (ja) * | 1981-07-02 | 1983-01-13 | Matsushita Electronics Corp | 半導体集積回路 |
JPS5965465A (ja) * | 1982-10-06 | 1984-04-13 | Matsushita Electronics Corp | 半導体装置の製造方法 |
JPS59194465A (ja) * | 1983-04-19 | 1984-11-05 | Sanken Electric Co Ltd | 半導体集積回路の製造方法 |
JPS59211270A (ja) * | 1983-05-17 | 1984-11-30 | Sanyo Electric Co Ltd | 縦型pnpトランジスタ |
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JPS6167959A (ja) * | 1984-09-11 | 1986-04-08 | Nec Corp | 半導体装置の製造方法 |
Also Published As
Publication number | Publication date |
---|---|
JPH0618203B2 (ja) | 1994-03-09 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
EXPY | Cancellation because of completion of term |