JPS61148854A - リ−ドフレ−ム - Google Patents

リ−ドフレ−ム

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JPS61148854A
JPS61148854A JP59270818A JP27081884A JPS61148854A JP S61148854 A JPS61148854 A JP S61148854A JP 59270818 A JP59270818 A JP 59270818A JP 27081884 A JP27081884 A JP 27081884A JP S61148854 A JPS61148854 A JP S61148854A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明は半導体装置、特に大電流を流す必要のあるパワ
ーＩＣ，各種の駆動回路を構成した半導体集積回路に用
いて好適なリードフレームに関する。
〔背景技術〕
半導体集積回路に用いられるリードフレームには各種の
形状のものがあるが、その−例が特開昭５５−１０７２
５０公報に示されている。
ところで、通常はＩＣチップに設けられたパッドと各イ
ンナーリードとは個別にワイヤーボンディングされるの
であるが、例えばシリアル−パラレル変換ドライバー回
路、或いはパワー回路等を内蔵した半導体集積回路では
電源用、ＧＮＤ用に複数の外部接続端子を使用している
ものがある。
これは、電源回路、ひいてはアースラインに大電流が流
れるためであり、抵抗を低減させるために上記方法が採
用されている。
たとえば本発明者らは、３２ビツトの感熱ヘッドドライ
バーを開廃しているが、その半導体チップのポンディン
グパッド構成は、出力パッドに１個の割合でＧＮＤパッ
トが設けられている。すなわち、５６ピンのパッケージ
においてＧＮＤピンは大多数をしめてしまう。このこと
は、ビット容易が大きくなればそれだけＧＮＤピンも多
数になり、パッケージ本体も大きくなることを意味して
いる。
しかし、パッケージの技術的動向としては、小型化が実
装密度を向上させるうえで有利である。
さらに、小型のパッケージで大容量切半導体装置を実現
するのが、コス１−の低減につながる。
本発明は上記にかんがみてなされたものである。
〔発明の目的〕
本発明の目的は、半導体集積回路における同一の用途に
もちいられる外部接続端子の数を削減し。
信号の入出力ピンが多ピンにできるリードフレームを提
供することにある。
本発明の上記ならびにその他の目的と新規な特徴は、本
発明書の記述及び添付図面から明らかになるであろう。
〔発明の概要〕
本願において開示される発明の概要を簡単に述べれば、
下記の通りである。
すなわち、例えば、ＧＮＤ用のインナーリードを一体に
結合して形成し、ＩＣチップのパッドのうちＧＮＤ用パ
ッドを上記ＧＮＤインナーリードに共通にボンディング
して、少数の外部接続端子を介してＧＮＤすることによ
り、ＧＮＤ用の外部接続端子を削減し、他の信号入出力
ピンを増やすという本発明の目的を達成するものである
。
〔実施例〕
以下、本発明を適用したリードフレームの一実施例を第
１図を参照して説明する。
本実施例の特徴は、半導体集積回路におけるＧＮＤ用の
外部接続端子を削減し信号入出力ピンを増やしたことに
ある。
第１図に示すように、リードフレーム１００は４４ピン
の場合について示しである。同フレーム１００において
ＧＮＤ用のインナーリード２３゜２９．３９は、斜線で
示すように一体に結合されている。そして、ＩＣチップ
５１のＧＮＤ用パッドから９本もの接続がなされている
にも関わらず。
パッケージ（図示せず）外に設けられる端子（アウター
リード）は僅か３個でよいことになる。
すなわち、仮想線で示したインナーリード２５゜２７．
３１，３３，３５，３７が全て不要になり、その分イン
ナーリード間が空くことになる。したがって、実際には
、上記インナーリード２５〜３７を他の目的たとえば、
信号の入出力ピンに使用できる。これによりＩＣチップ
の集積度が上がり１個のＩＣチップに３２ビット以上の
容量が可能となっても、このリードフレームｌＯＯを使
用することが可能になる。
また、インナーリード２３から３９までの間隔を均等に
し、特に斜線部分の幅を拡げて、更に大電流を流し得る
ようにしてもよい。
さらに、ＧＮＤ用のインナーリードがタブの回りにある
ことより、チップのＧＮＤ用パッドからＧＮＤ用インナ
ーリードまでの距離が近くでき、金ワイヤの使用量も低
減できる。また、最短距離でボンディングもでき、コス
トの低減も可能となる。
なお、５２はタブ、５３ａ、５３ｂはタブ吊りリード、
５４はダムであり、これらについては当業者間において
知られたものである。
第２図は、第１図のリードフレームを用いたＩＣパッケ
ージの形態を示す。同図に示される如く、ＧＮＤピンは
２３，２９．３９の３本しかないため、他のピンは電源
用、信号入力、信号出力に有効に使用できる。
図示はしないが、電源用ピンが多数有る場合にも本発明
は有効である。
〔効果〕
（１）共通の目的で使用されるインナーリードを一体に
結合し、これに共通にワイヤーボンディングすることに
より、外部接続端子を削減、という効果が得られる。
以上に本発明者によってなされた発明を実施例にもとづ
き具体的に説明したが、本発明は上記実施例に限定され
るものではなく、その要旨を逸脱しない範囲で種々変更
可能であることは言うまでもない。
例えば、上記実施例では、ＧＮＤピンについて本発明が
適用されているが、電源回路に適用してもよい。また、
上記実施例ではＧＮＤピンを３本としたが、ワイヤボン
ディングが良好に行なえるようにインナーリード３４．
４４をも同一のＧＮＤインナーリードとして形成しても
よい。
〔利用分野〕
以上の説明では、主として本発明者によってなされた発
明をその背景となった利用分野であるリードフレームに
適用した場合について説明したが、それに限定されるも
のではなく、モータ駆動回路。
電力増幅回路等を内蔵するアナログ用ＩＣにも利用する
ことができる。
【図面の簡単な説明】
第１図は本発明を適用したリードフレームの一実施例を
示す平面図である。 第２図は本発明のリードフレームを使用したＩＣパッケ
ージの斜視図である。 １〜４４・・・インナーリード、５１・・・ＩＣチップ
、５２・・・タブ、５３ａ、５３ｂ・・・タブ吊りリー
ド、５４・・・ダム、１００・・・リードフレーム。

Claims (1)

    【特許請求の範囲】
  1. １、共通に使用される外部接続端子を半導体装置のパッ
    ケージ内において一体に結合したことを特徴とするリー
    ドフレーム。
JP59270818A 1984-12-24 1984-12-24 リ−ドフレ−ム Expired - Lifetime JPH061801B2 (ja)

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