JPS61148531A - 演算処理デ−タの入力装置 - Google Patents
演算処理デ−タの入力装置Info
- Publication number
- JPS61148531A JPS61148531A JP27263884A JP27263884A JPS61148531A JP S61148531 A JPS61148531 A JP S61148531A JP 27263884 A JP27263884 A JP 27263884A JP 27263884 A JP27263884 A JP 27263884A JP S61148531 A JPS61148531 A JP S61148531A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は演算処理装置の演算処理データを入力する入力
装置に関し、特に演算処理装置の処理動作中に別の演算
処理データを入力することができる演算処理データの入
力装置に関する。
装置に関し、特に演算処理装置の処理動作中に別の演算
処理データを入力することができる演算処理データの入
力装置に関する。
従来のこの種の装置として第４図に示すものがあった。
第４図に従来の演算処理データの入力装置の全体回路ブ
ロック図を示し、同図において演算処理データの入力装
置は、周辺装置の制御に必要な演算処理を行なう主演算
処理手段（１）と、該主演算処理手段（］）の演算処理
に必要な処理データであるプログラムを格納するプログ
ラム記憶手段（２）と、該プログラム記憶手段（２）に
格納するプログラムを上記主演算処理手段（１）の制御
丁番こ作成するプログラム作成手段（６）とを備えて構
成される。
ロック図を示し、同図において演算処理データの入力装
置は、周辺装置の制御に必要な演算処理を行なう主演算
処理手段（１）と、該主演算処理手段（］）の演算処理
に必要な処理データであるプログラムを格納するプログ
ラム記憶手段（２）と、該プログラム記憶手段（２）に
格納するプログラムを上記主演算処理手段（１）の制御
丁番こ作成するプログラム作成手段（６）とを備えて構
成される。
と記プログラム作成手段（６）は、タイミング等を同期
させる周辺装置インターフェース部（５）を介してパス
（８）に接続され、このパス（８）にて主演算処理手段
（１）の指令を受けると共にプログラム記憶手段（２）
にて作成したプログラムを出力する。
させる周辺装置インターフェース部（５）を介してパス
（８）に接続され、このパス（８）にて主演算処理手段
（１）の指令を受けると共にプログラム記憶手段（２）
にて作成したプログラムを出力する。
次に上記従来の演算処理データの入力装置の動作につい
て説明する。まず、主中央演算処理手段（１）がプログ
ラム記憶手段（２）に格納されてｌ、Ｎるプログラムに
基づいて演算処理の動作中のである場合に上記現在勤作
中のプログラムを別のプログラムに入れ換えるには、主
中央演算処理手段（１）が演算処理の動作が終了し停止
状態となった後、外部より入出力（Ｉｌｏ）部（７）を
介して主中央演算処理手段（１）に別のプログラムの入
力動作を指令し、この指令を受けた主中央演算処理手段
（１）がプログラム作成手段（６）にプログラムの作成
を命令して作成されたプログラムをプログラム記憶手段
（２）に格納する。このようにして別のプログラムがプ
ログラム記憶手段（２）に前のプログラムと同様に別の
プログラムが格納されることとなる。
て説明する。まず、主中央演算処理手段（１）がプログ
ラム記憶手段（２）に格納されてｌ、Ｎるプログラムに
基づいて演算処理の動作中のである場合に上記現在勤作
中のプログラムを別のプログラムに入れ換えるには、主
中央演算処理手段（１）が演算処理の動作が終了し停止
状態となった後、外部より入出力（Ｉｌｏ）部（７）を
介して主中央演算処理手段（１）に別のプログラムの入
力動作を指令し、この指令を受けた主中央演算処理手段
（１）がプログラム作成手段（６）にプログラムの作成
を命令して作成されたプログラムをプログラム記憶手段
（２）に格納する。このようにして別のプログラムがプ
ログラム記憶手段（２）に前のプログラムと同様に別の
プログラムが格納されることとなる。
以上説明したように従来の演算処理データの入力装置は
、別のプログラムの格納もしくは入れ換えを行なう場合
には主中央演算処理手段（１）が演算処理の動作を停止
しているとき以外には別のプログラムの格納もしくは入
れ換え動作ができないという欠点を有していた。また、
現在勤作中のプログラムに引き続いて別のプログラムを
主中央演算処理手段（１）に動作させる場合には、予め
動作中のプログラムと同時に別のプログラムを格納して
おく必要があり、動作中のプログラムに新たなプログラ
ムを後に付加して連続動作させることはできないという
欠点があった。
、別のプログラムの格納もしくは入れ換えを行なう場合
には主中央演算処理手段（１）が演算処理の動作を停止
しているとき以外には別のプログラムの格納もしくは入
れ換え動作ができないという欠点を有していた。また、
現在勤作中のプログラムに引き続いて別のプログラムを
主中央演算処理手段（１）に動作させる場合には、予め
動作中のプログラムと同時に別のプログラムを格納して
おく必要があり、動作中のプログラムに新たなプログラ
ムを後に付加して連続動作させることはできないという
欠点があった。
本発明は上記点に鑑みてなされたもので、一方のプログ
ラムが動作中であっても異なるプログラムを外部指令に
基づきプログラム記憶手段に格納し、一方のプログラム
の終了後連続して異なるプログラムに基づいて主中央演
算処理手段の演算処理が可能となる演算処理データの入
力装置を提案することを目的とする。
ラムが動作中であっても異なるプログラムを外部指令に
基づきプログラム記憶手段に格納し、一方のプログラム
の終了後連続して異なるプログラムに基づいて主中央演
算処理手段の演算処理が可能となる演算処理データの入
力装置を提案することを目的とする。
本発明に係る演算処理データの入力装置は、周辺装置の
制御に必要な演算処理を行なう主中央演算処理手段と、
該主中央演算処理手段の演算処理に必要な処理データを
格納する複数記憶手段と、該複数の記憶手段のいずれか
を上記主中央演算処理手段の制御から分離し、外部指令
の制御下に切換える切換手段とを備え、上記切換手段の
切換動作により一上記記憶手段のいずれかを主中央演算
処理手段もしくは外部指令の制御において別の処理デー
タを格納し、上記処理データに引き続いて別の処理デー
タで主中央演算処理手段を動作させる構成である。
制御に必要な演算処理を行なう主中央演算処理手段と、
該主中央演算処理手段の演算処理に必要な処理データを
格納する複数記憶手段と、該複数の記憶手段のいずれか
を上記主中央演算処理手段の制御から分離し、外部指令
の制御下に切換える切換手段とを備え、上記切換手段の
切換動作により一上記記憶手段のいずれかを主中央演算
処理手段もしくは外部指令の制御において別の処理デー
タを格納し、上記処理データに引き続いて別の処理デー
タで主中央演算処理手段を動作させる構成である。
本発明によれば、切換手段にて外部指令の制御下に切換
えられた記憶手段に上記外部指令に基づいて主中央演算
処理手段の演算処理に必要な処理データを格納できるこ
ととなり、主中央演算処理手段の動作中であっても別の
処理データを格納し、現在の処理データの動作に引き続
いて別の処理データにて動作させる。
えられた記憶手段に上記外部指令に基づいて主中央演算
処理手段の演算処理に必要な処理データを格納できるこ
ととなり、主中央演算処理手段の動作中であっても別の
処理データを格納し、現在の処理データの動作に引き続
いて別の処理データにて動作させる。
以下、未発明の一実施例を第１図、第２図及び第３図に
基づいて前記第４図に示す従来装置と同−又は相当部分
の説明を省略して説明する。第１図に本実施例に係る演
算処理データの入力装置の全体回路ブロック図、第２図
に第１図に示す実施例の動作を説明するためのプログラ
ムの図表及び第３図に第１図の動作説明のフローチャー
トを各々示し、上記各図ずにおいて本実施例に係る演算
処理データの入力装置は、周辺装置の制御に必要な演算
処理を行なう主中央演算処理手段（１）と、該主中央演
算処理手段（１）の演算処理に必要な処理データである
プログラムを格納する主及び副゛の各プログラム記憶手
段（２）、（３）と、該副プロゲラ・ ム記憶手段（３
）を−上記主中央演算処理手段（１）の制御から分離し
、１１０部（７）を介して入力される外部指令の制御下
に切換えるバス切換手段（４）と、ｈ肥土及び副の各プ
ログラム記憶手段（２）、（３）に格納するプログラム
を作成するプログラム作成手段（６）とを備え、外部指
令の制御下に切換えられた副プログラム記憶手段（３）
に外部指令に基づいて上記プログラム作成手段（８）で
作成された副プログラムを格納し、上記主プログラム記
憶手段に格納される主プログラムの最終ステップにプロ
グラム変更命令を入力しておき、上記主プログラムに基
づく主中央演算処理手段（１）の動作終了後引き続いて
、上記バス切換手段（０の切換動作により外部指令の制
御下におかれた副プログラム記憶手段（３）に格納され
る副プログラムにより主中央演算処理手段（１）を動作
させる構成とされる。 上記プログラム作成手段（［１
）は、副プログラム記憶手段（３）が外部指令の制御下
に切換えられる際には、同時に前記切換手段（４）にて
外部指令の制御下におかれ、外部指令に基づいてプログ
ラム作成動作を開始・遂行するものである。
基づいて前記第４図に示す従来装置と同−又は相当部分
の説明を省略して説明する。第１図に本実施例に係る演
算処理データの入力装置の全体回路ブロック図、第２図
に第１図に示す実施例の動作を説明するためのプログラ
ムの図表及び第３図に第１図の動作説明のフローチャー
トを各々示し、上記各図ずにおいて本実施例に係る演算
処理データの入力装置は、周辺装置の制御に必要な演算
処理を行なう主中央演算処理手段（１）と、該主中央演
算処理手段（１）の演算処理に必要な処理データである
プログラムを格納する主及び副゛の各プログラム記憶手
段（２）、（３）と、該副プロゲラ・ ム記憶手段（３
）を−上記主中央演算処理手段（１）の制御から分離し
、１１０部（７）を介して入力される外部指令の制御下
に切換えるバス切換手段（４）と、ｈ肥土及び副の各プ
ログラム記憶手段（２）、（３）に格納するプログラム
を作成するプログラム作成手段（６）とを備え、外部指
令の制御下に切換えられた副プログラム記憶手段（３）
に外部指令に基づいて上記プログラム作成手段（８）で
作成された副プログラムを格納し、上記主プログラム記
憶手段に格納される主プログラムの最終ステップにプロ
グラム変更命令を入力しておき、上記主プログラムに基
づく主中央演算処理手段（１）の動作終了後引き続いて
、上記バス切換手段（０の切換動作により外部指令の制
御下におかれた副プログラム記憶手段（３）に格納され
る副プログラムにより主中央演算処理手段（１）を動作
させる構成とされる。 上記プログラム作成手段（［１
）は、副プログラム記憶手段（３）が外部指令の制御下
に切換えられる際には、同時に前記切換手段（４）にて
外部指令の制御下におかれ、外部指令に基づいてプログ
ラム作成動作を開始・遂行するものである。
次に上記本実施例に係る演算処理データの入力装届の動
作について説明する。まず、主中央演算処理手段（１）
が主プログラム記憶手段（２）に格納された主プログラ
ムに基づいて動作中である場合（第３図の主プログラム
実行）において、新たなプログラムである副プログラム
を格納するには、１１０部（７）を介して外部指令がバ
ス切換手段（４）にバス（８）の切換えを行なわせ、上
記切換えられたバス（８）により副プログラム記憶手段
（３）１周辺装置インターフェース部（５）及びプログ
ラム作成手段（６）を外部指令の制御下におく。上記外
部指令の制御下におかれたプログラム作成手段（６）は
副プログラムを作成し、この副プログラムを外部指令の
指令に基づき副プログラム記憶手段（３）に格納される
べく出力する。この副プログラムの格納終了と同時に上
記副プログラム記憶手段（３）１周辺装置インターフェ
ース部（５）及びプログラム作成手段（８）は再び主中
央演算処理手段（１）の制御下にもどる。
作について説明する。まず、主中央演算処理手段（１）
が主プログラム記憶手段（２）に格納された主プログラ
ムに基づいて動作中である場合（第３図の主プログラム
実行）において、新たなプログラムである副プログラム
を格納するには、１１０部（７）を介して外部指令がバ
ス切換手段（４）にバス（８）の切換えを行なわせ、上
記切換えられたバス（８）により副プログラム記憶手段
（３）１周辺装置インターフェース部（５）及びプログ
ラム作成手段（６）を外部指令の制御下におく。上記外
部指令の制御下におかれたプログラム作成手段（６）は
副プログラムを作成し、この副プログラムを外部指令の
指令に基づき副プログラム記憶手段（３）に格納される
べく出力する。この副プログラムの格納終了と同時に上
記副プログラム記憶手段（３）１周辺装置インターフェ
ース部（５）及びプログラム作成手段（８）は再び主中
央演算処理手段（１）の制御下にもどる。
次に、上記主プログラムに引き続いて副プログラムによ
り主中央演算処理手段（１）を動作させる場合には、主
プログラムの最終ステップに外部指令に基づき閉成する
書間接点命令（ＭＯ）とプログラム変更命令（ＣＨＡＮ
ＧＥ）とを予め設けて構成し、上記副プログラムが副プ
ログラム記憶手段（３）に格納された後に書間接点命令
（ＭＯ）が閉成する命令、となり、プログラム変更命令
が主中央演算処理手段（１）に入力され、自動的に主プ
ログラムに引き続いて副プログラムにより動作されるこ
ととなる（第３図の副プログラム実行）。
り主中央演算処理手段（１）を動作させる場合には、主
プログラムの最終ステップに外部指令に基づき閉成する
書間接点命令（ＭＯ）とプログラム変更命令（ＣＨＡＮ
ＧＥ）とを予め設けて構成し、上記副プログラムが副プ
ログラム記憶手段（３）に格納された後に書間接点命令
（ＭＯ）が閉成する命令、となり、プログラム変更命令
が主中央演算処理手段（１）に入力され、自動的に主プ
ログラムに引き続いて副プログラムにより動作されるこ
ととなる（第３図の副プログラム実行）。
なお、上記バス切換手段（０は主中央演算処理手段（１
）の主プログラム実行中信号が入力されると共に外部指
令が１１０部（７）を介して入力され、Ｅ記信号及び指
令により外部指令もしくは主中央演算処理手段（１）の
いずれかの制御下におくか判断し切換え動作を行なう（
第３図の切換手段判断）。
）の主プログラム実行中信号が入力されると共に外部指
令が１１０部（７）を介して入力され、Ｅ記信号及び指
令により外部指令もしくは主中央演算処理手段（１）の
いずれかの制御下におくか判断し切換え動作を行なう（
第３図の切換手段判断）。
なお、上記実施例においてはバス切換手段（４）が副プ
ログラム記憶手段（３）を主中央演算処理手段（１）の
制御から外部指令の制御下に切換える構成を採ったが、
主プログラム記憶手段（２）を上記副プログラム記憶手
段（３）と同様に切換える構成としてもよい。
ログラム記憶手段（３）を主中央演算処理手段（１）の
制御から外部指令の制御下に切換える構成を採ったが、
主プログラム記憶手段（２）を上記副プログラム記憶手
段（３）と同様に切換える構成としてもよい。
〔発明の効果）
本発明は以−ヒ説明したとおり、周辺装置の制御に必要
な演算処理を行なう主中央演算処理手段と、該主中央演
算処理手段の演算処理に必要な処理データを格納する複
数記憶手段と、該複数の記憶手段のいずれかを上記主中
央演算処理手段の制御から分離し、外部指令の制御下に
切換える切換手段とを備え、上記切換手段の切換動作に
より上記記憶手段のいずれかを主中央演算処理手段もし
くは外部指令の制御において別の処理データを格納し、
上記処理データに引き続いて別の処理データで主中央演
算処理手段を動作させる構成を採ったことから、切換手
段にて外部指令の制御下に切換えられた記憶手段に上記
外部指令に基づいて主中央演算処理手段の演算処理に必
要な処理データを格納できるとととなり、主中央演算処
理手段の動作中であっても別の処理データを格納できる
とい効果を奏する。また、現在の処理データの動作に引
き続いて別の処理データにて動作させるという効果を併
有するものである。
な演算処理を行なう主中央演算処理手段と、該主中央演
算処理手段の演算処理に必要な処理データを格納する複
数記憶手段と、該複数の記憶手段のいずれかを上記主中
央演算処理手段の制御から分離し、外部指令の制御下に
切換える切換手段とを備え、上記切換手段の切換動作に
より上記記憶手段のいずれかを主中央演算処理手段もし
くは外部指令の制御において別の処理データを格納し、
上記処理データに引き続いて別の処理データで主中央演
算処理手段を動作させる構成を採ったことから、切換手
段にて外部指令の制御下に切換えられた記憶手段に上記
外部指令に基づいて主中央演算処理手段の演算処理に必
要な処理データを格納できるとととなり、主中央演算処
理手段の動作中であっても別の処理データを格納できる
とい効果を奏する。また、現在の処理データの動作に引
き続いて別の処理データにて動作させるという効果を併
有するものである。
第１図は本発明の一実施例に係る演算処理データの入力
装置の全体回路ブロック図、第２図は第１図に示す実施
例の動作を説明するためのプログラムの図表、第３図は
第１図に示す実施例の動作説明のフローチャート、第４
図は従来の演算処理データの入力装置の全体回路ブロッ
ク図を示す。 （＋’）・・・主中央演算処理手段、 （２）・・・ （主）プログラム記憶手段、（３）・・
・副プログラム記憶手段。 （４）・・・バス切換手段、 （５）・・・周辺装置インターフェース部、（６）・・
・プログラム作成手段。 （７）・・・入出；１１’（ｒｌｏ）部、（８）・・・
バス。 なお、図中同一符号は同−又は相当部分を示すものとす
る。 第１図 第２図 第３図 手続補正書（自発） Ｉ３和 ６％１０月９ 日 １、事件の表示 特願昭５９−２７２６３８号２、
発明の名称 演算処理データの入力装置 ３、補正をする者 代表者志岐守哉 ４、代理人 ６、補正の内容 （１）明細書第３頁第１３行の「動作中のである」とい
う記載を「動作中である」と補正る。 （２）明細書第６頁第１４行の「上記各図ずにおいて」
という記載を「上記各図において」と補正する。 以 上
装置の全体回路ブロック図、第２図は第１図に示す実施
例の動作を説明するためのプログラムの図表、第３図は
第１図に示す実施例の動作説明のフローチャート、第４
図は従来の演算処理データの入力装置の全体回路ブロッ
ク図を示す。 （＋’）・・・主中央演算処理手段、 （２）・・・ （主）プログラム記憶手段、（３）・・
・副プログラム記憶手段。 （４）・・・バス切換手段、 （５）・・・周辺装置インターフェース部、（６）・・
・プログラム作成手段。 （７）・・・入出；１１’（ｒｌｏ）部、（８）・・・
バス。 なお、図中同一符号は同−又は相当部分を示すものとす
る。 第１図 第２図 第３図 手続補正書（自発） Ｉ３和 ６％１０月９ 日 １、事件の表示 特願昭５９−２７２６３８号２、
発明の名称 演算処理データの入力装置 ３、補正をする者 代表者志岐守哉 ４、代理人 ６、補正の内容 （１）明細書第３頁第１３行の「動作中のである」とい
う記載を「動作中である」と補正る。 （２）明細書第６頁第１４行の「上記各図ずにおいて」
という記載を「上記各図において」と補正する。 以 上
Claims (2)
- （１）周辺装置の制御に必要な演算処理を行なう主中央
演算処理手段と、該主中央演算処理手段の演算処理に必
要な処理データを格納する複数の記憶手段と、該複数の
記憶手段のうちいずれかを上記主中央演算処理手段の制
御から分離し、外部指令の制御下に切換える切換手段と
を備え、上記切換手段にて外部指令の制御下に切換えら
れた記憶手段に外部指令に基づいて上記主中央演算処理
手段の演算処理に必要な処理データを格納する構成とし
たことを特徴とする演算処理データの入力装置。 - （２）上記複数の記憶手段のうち主中央演算処理手段の
制御下にある記憶手段に格納される処理データの最終ス
テップに処理データ変更命令を入力しておき、該処理デ
ータに基づく主中央演算処理手段の動作終了後引き続い
て、上記切換手段の切換動作により外部指令の制御下に
おかれた記憶手段に格納される処理データにより主中央
演算処理手段を動作させる構成としたことを特徴とする
特許請求の範囲第１項記載の演算処理データの入力装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27263884A JPS61148531A (ja) | 1984-12-24 | 1984-12-24 | 演算処理デ−タの入力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27263884A JPS61148531A (ja) | 1984-12-24 | 1984-12-24 | 演算処理デ−タの入力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61148531A true JPS61148531A (ja) | 1986-07-07 |
| JPH0564372B2 JPH0564372B2 (ja) | 1993-09-14 |
Family
ID=17516710
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27263884A Granted JPS61148531A (ja) | 1984-12-24 | 1984-12-24 | 演算処理デ−タの入力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61148531A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH025103A (ja) * | 1988-06-23 | 1990-01-10 | Matsushita Electric Ind Co Ltd | プログラマブルコントローラ |
| JP2007220126A (ja) * | 2007-02-22 | 2007-08-30 | Hitachi Ltd | 制御装置及びそれを用いた光ディスク装置 |
-
1984
- 1984-12-24 JP JP27263884A patent/JPS61148531A/ja active Granted
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH025103A (ja) * | 1988-06-23 | 1990-01-10 | Matsushita Electric Ind Co Ltd | プログラマブルコントローラ |
| JP2007220126A (ja) * | 2007-02-22 | 2007-08-30 | Hitachi Ltd | 制御装置及びそれを用いた光ディスク装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0564372B2 (ja) | 1993-09-14 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |