JPS60153602A - コプレ−ナ線路・スロツト線路変換回路 - Google Patents

コプレ−ナ線路・スロツト線路変換回路

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JPS60153602A
JPS60153602A JP1049784A JP1049784A JPS60153602A JP S60153602 A JPS60153602 A JP S60153602A JP 1049784 A JP1049784 A JP 1049784A JP 1049784 A JP1049784 A JP 1049784A JP S60153602 A JPS60153602 A JP S60153602A
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JP
Japan
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line
slot
coplanar
conductor
coplanar line
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JP1049784A
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JPS6349402B2 (ja
Inventor
Tetsuo Hirota
哲夫 廣田
Hirotsugu Ogawa
博世 小川
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Nippon Telegraph and Telephone Corp
Original Assignee
Nippon Telegraph and Telephone Corp
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Publication date
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    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01P—WAVEGUIDES; RESONATORS, LINES, OR OTHER DEVICES OF THE WAVEGUIDE TYPE
    • H01P5/00—Coupling devices of the waveguide type
    • H01P5/08—Coupling devices of the waveguide type for linking dissimilar lines or devices
    • H01P5/10—Coupling devices of the waveguide type for linking dissimilar lines or devices for coupling balanced lines or devices with unbalanced lines or devices
    • H01P5/1015—Coplanar line transitions to Slotline or finline

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  • Microwave Amplifiers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明はマイクロ波・ミリ波集積回路において用いら
れ、コプレーナ線路とスロット線路とを結合する変換回
路に関するものである。　・〈従来技術〉□ マイクロ波・ミリ波集積回路を＠成する伝送線・、路と
しては、不平衡線路としてマイクロストリップ線路、コ
プレーナ線路があシ、平衡線路としてスロット線路等が
ある。このうちスロット線路は逆相分配回路が容易に構
成できる利点をもつため周波数変換回路、・変調回路等
に多用されるが、この際不平衡形の他の線路との変換（
結合）が必要となる。
第１図及び第２図にコプレーナ線路とスロット線路との
変換回路の従来例を示す。誘電体基板１１上にコプレー
ナ線路１２が形成され、コプレーナ線路１２は外側導体
１３．１４と中心導体１５とよシなる。外備導４”ｘ　
３及び中心導体１５間のスロ？トが延長きれてスロット
線路１６がｉ電体基板１１上に形成ｉれ、外側導体１４
及び中心導体１５間のスロットが延長されてスロット線
路１７が形成される。コプレーナ線路１２とスロット線
路１６．１７との接続点で外側導体１３及び１４が短絡
線１８で接続される。スロット線路１７は４分の１波長
の長さで短絡しであるため短絡線１８の接続点では開放
条件を与える。
したがってこの従来の回路の等価回路は第２図に示すよ
うに表わすことができ、コプレーナ線゛路１２とスロッ
ト線路１６との変換が行なわれる。
しかしこの従来の回路は相反回路であるため、入出力の
分離がとれておらず、例えば線路１６に接続された回路
から反射がある場合は、その・反射波はそのままコプレ
ーナ線路１２へ現れる。この反射波が望ましくない場合
には史にアイソレータを設けてこの反射波を除去する必
要があるという欠点があった。また４分の１波長線路１
７を用いるため、全体の回路が大きくなりがちであった
。これらは歩留まり向上のため回路面積の小形化が要求
されるとともにアイソレータの実現が困難なモノリシッ
ク集積回路への適用に際しては特に著しい欠点となる。
〈発明の目的〉 この発明はこれらの欠点を除去するため、電界効果、ト
ランジスタ（Ｆ　Ｅ　Ｔ　）　’ｔｌ”　Ｋ＠’ｆｌ１
５分に用いることによシ、小形で入出力の分離の工いコ
プレーナ線路・ス；ロ゛ット線路変換回路を提供するこ
とを目的とするものである。
く第１実施例〉 第４図はこの発明の第１実施例を示し、第１図と対応す
る部分に同一符号を付けである。コプレーナ線路１２゛
及びスロット線路１６の接続部において誘電体基板１１
上にパッケージ人、！１）ＦＥＴ１９が設けられる。ス
ロット線路１６を構成する一方の導体はコプレーナ線路
１２の一方の外側導体１４と接続され、他方の導体２１
は外側導体１３と分離される。ＦＥＴ１９のソース端子
２２．２３はそれぞれ導体１３．１４に接続され、ゲー
ト端子２４は中心導体１５に接゛続され、ドレイン端子
２５は導体２１に接続される。導体１５．．２１にそれ
ぞれバイアス供給端子２６．２７がそれぞれ接続される
。
この構成によればコプレーナ線路１２が入力線路、スロ
ット線路１６が出力線路となり、その等価回路は第５図
のようになる。同図に示すようにコプレーナ線路１２よ
！ｌｌＦＥＴ１９のゲート・ソース間に印加された信号
Ｖが増幅され、電流ｇｍｖ（ｇｍはＦＥＴの相互コンダ
クタンス）としてドレインｅンース間に出力されてスロ
ット線路１６に加えられる。このためコプレーナ線路１
２とスロット線路１６との間の変換が行われるとともに
ＦＥＴ１９によシ増幅作用があシ、またＦＥＴ１９によ
シ入出力の分離が良好である。
ゲート端子２４、ドレイン端子２５をそれぞれ導体２１
．１５に接続してもよい。この場合にはスロット線路１
６が入力線路、コプレーナ線路１２が出力線路となシ、
等価回路は第６図に示すようになる。同様にスロット線
路１６からの信号はＦＥＴ１９のゲート・ソース間に印
加され、雪の増幅出力はコプレーナ線路１２に印加され
る。
く第２実施例〉 第７図は第２の実施例を示し、回路全体を半導体基板上
に形成し、モノリシック集積回路とじた例である。半導
体基板２８上に第４図と同様にコプレーナ線路１２、ス
ロット線路１６が形成され、更にこれら線路１２．１６
の接続部において半導体基板２８にＦＥＴ２９が形成さ
れる。Ｆ　Ｅ　Ｔ２９のソース電極３１、ゲート電極３
２、ドレイン電極３３はそれぞれ導体１３，１４、中心
導体１５、導体２１にそれぞれ接続される。導体１３．
１４はソース電極３１を通じて接続され、この接続部と
中心導体１５及びゲート電極の接続部とは互に絶縁され
る。第１の実施例と同様にコプレーナ線路１２よ少入力
された１１号は増幅されてスロット線路１６へ出力され
る。
く第３実施例〉 第８図はこの発明の第３の実施例を示し、スロット線路
１６を入力線路とした例である。ＦＥＴ２９のソース電
極３１．ゲート電極３２、ドレイン電極３３はそれぞれ
導体１３，１４、導体２１、中心導体３３に接続される
。これらの例においても入出力の分離が良好であるとと
もに極めて小形にでき、モノリシック集積回路に適して
いる。
く効　果〉 以上説明したようにこの発明によれば、入出力の分離が
よく、増幅作用をもつコプレーナ線路・スロット線路変
換回路を実現できる。この発明の回路は入力と出力との
アイソレータの機能をあわせもち、かつ極めて小形にで
きるため、特に平衡形層波数変換器、平衡形変調器等、
スロット線路を用いた各種モノリシック、マイクロ波・
ミリ波集積回路への応用に際して有効である。
【図面の簡単な説明】
第１図は従来のコプレーナ線路・スロット線路変換回路
を示す平面図、第２図は第１図のＡＡ’線断面図、第３
図はその等価１０１路図、第４図はこの発明の第１の実
施例を示す平面図、第５図はその等価回路図、第６図は
第４図においてゲート端子２４とドレイン端子２５とを
接続換えした場合の等価回路図、第７図はこの発明の第
２の実施例を示す平面図、第８図はこの発明′の第３の
実施例を示す平面図である。 １１：誘電体基板、１２：コプレーナ線路、１３．１４
：コプレーナ線路外側導体、１′５：コプレーナ線路中
心尋体、１６：スロット線路、１８：短絡線、１９：パ
ッケージ入シ電界効果トランジスタ（ＦＥＴ　）、２２
，２３：ソース端子、２４：ゲート端子、２５ニドレイ
ン端子、２６．２７：バイアス印加端子、２８二半纏体
基板、２９：半導体基＆２８に形成されたＦＥＴ、３１
：ソース電極、３２：ゲート電極、３３ニドレイン電極
。 特許出願人　日本電信電話公社 代理人草野　卓 第１　図　７２図 ７３　図 オ　４　図 ８６　図

Claims (1)

    【特許請求の範囲】
  1. （１）基板上にコプレーナ線路及びスロット線路がそれ
    ぞれその一端を互に近接して形成され、そのコプレーナ
    線路の外側２導体と上記スロット線路を構成する門導体
    のうちの一方の導体とが互に接続され、上記コプレーナ
    線路及びスロット線路の近接点に電界効果トランジスタ
    が設けられ、その電界効果トランジスタのソース電極が
    上記外側２導体に接続され、ゲート電極゛が上記コプレ
    ーナ線路の中心導体又は上記スロット線路を構成す乙２
    ・導体の他方の導体に接続され、ドレイン電極が上記ス
    ロット線路を構成する２導体の他方の導体又は上記コプ
    レーナ線路の中心導体に接続されて成るコプレーナ線路
    ・スロット線路変換回路。
JP1049784A 1984-01-23 1984-01-23 コプレ−ナ線路・スロツト線路変換回路 Granted JPS60153602A (ja)

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