JPS59112654A - 砒化ガリウム半導体装置 - Google Patents

砒化ガリウム半導体装置

Info

Publication number
JPS59112654A
JPS59112654A JP57222469A JP22246982A JPS59112654A JP S59112654 A JPS59112654 A JP S59112654A JP 57222469 A JP57222469 A JP 57222469A JP 22246982 A JP22246982 A JP 22246982A JP S59112654 A JPS59112654 A JP S59112654A
Authority
JP
Japan
Prior art keywords
film
gallium arsenide
semiconductor device
bonding
barrier metal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP57222469A
Other languages
English (en)
Inventor
Kazuhiko Inoue
和彦 井上
Takeshi Kuramoto
倉本 毅
Yoshihiro Kinoshita
木下 義弘
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP57222469A priority Critical patent/JPS59112654A/ja
Publication of JPS59112654A publication Critical patent/JPS59112654A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02Bonding areas ; Manufacturing methods related thereto
    • H01L24/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L24/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02Bonding areas ; Manufacturing methods related thereto
    • H01L24/03Manufacturing methods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/45Ohmic electrodes
    • H01L29/452Ohmic electrodes on AIII-BV compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/03Manufacturing methods
    • H01L2224/0347Manufacturing methods using a lift-off mask
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/04042Bonding areas specifically adapted for wire connectors, e.g. wirebond pads
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05075Plural internal layers
    • H01L2224/0508Plural internal layers being stacked
    • H01L2224/05083Three-layer arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05144Gold [Au] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05166Titanium [Ti] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05169Platinum [Pt] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/0555Shape
    • H01L2224/05556Shape in side view
    • H01L2224/05558Shape in side view conformal layer on a patterned surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05599Material
    • H01L2224/056Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05617Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/05624Aluminium [Al] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484Connecting portions
    • H01L2224/48463Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01006Carbon [C]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01007Nitrogen [N]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01013Aluminum [Al]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01015Phosphorus [P]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01022Titanium [Ti]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01031Gallium [Ga]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/1026Compound semiconductors
    • H01L2924/1032III-V
    • H01L2924/10329Gallium arsenide [GaAs]

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 この発明は電界効果型トランジスタ、ホール素手等に用
いられる砒化ガリウム半導体装置に係り、特にその電極
構造を改良した砒化ガリウム半導体装置に関する。
〔7発明の技術的背景〕 従来、第1図(a)に示すようなN型砒化ガリウム(G
aAs )基板1上に良好で均一なオーム性接触の電極
を形成するには、AuGe膜2を熱処理によって砒化−
jf ’Jウムと合金化する方法が広く使われている。
そして、ボンディング・々ノド電極膜3としての最」二
層の金属をAu又はAtとしている。ところで、電極を
形成した場合、砒化ガリウムを構成するガリウム(Ga
)の電極膜への拡散、所謂1ガリウムの浮き出し′が起
って、電極表面に薄いガリウム酸化膜(GaO)層がで
きてしまい、ボンティングワイヤの接着性が著しく阻害
される。このだめ、ボンディング・やノド電極膜3の下
はガリウム拡散の障壁となる金属、例えばTi、 Pt
、 Mo又はTa等の障壁金属膜4を形成するのが一般
的である。第1図(b)はボンディング後の構造を示す
もので、5はボンティングワイヤ、6は合金層である。
この構造の問題点は、ボンディングパノド電極膜3迄形
成し、しかる後合金化のだめの熱処理を行うことにある
。すなわち、熱処理は400℃以上の高温で数分行うた
め、この時にガリウムの一部が障壁金属膜4を抜けてポ
ンディングパッド電極膜3へ拡散してし1い、障壁金統
膜4が本来の役割を十分果さない。このため組立後はオ
ープン不良か多く、歩留が低下し量産性に欠ける。
このことを解決する手段として、次の方法がある。すな
わち、第2図に示すように、AuGe膜2を形成した後
、合金化のだめの熱処理を行い、しかる後障壁金属膜4
とポンディングパッド電極膜3を形成する。すなわち、
ガリウムの障壁金属膜4を抜ける要因となる熱処理工程
をポンディングパッド電極膜3の形成前に行うものであ
る。ここで、AuGe膜2のみで熱処理を行うと、膜中
のゲルマニウム(Ge)の酸化あるいは膜のボール化、
所甜″ボールアソゾが起り、特性上好しく無い。このた
め、第3′図(a)に示すようにAuGe膜2上に例え
ばpt険7を形成し、Pt/AuGeの構造で熱処理を
行うのが一般的である。第3図(b)は最終的な構造を
示す。
〔背景技術の問題点〕
しかしながら、この構造においても、合金化のだめの熱
処理を施しているAuGe膜2及びpt膜7上に障壁金
属膜4及びポンディングパッド電極膜3を積層している
ため、次のような欠点がある。すなわち、合金化のだめ
の熱処理後は、pt膜7の表面には砒化ガリウム基板1
から拡散したガリウムやAuGe膜2中のゲルマニウム
が析出する。これらは空気中で酸化されやすいため、薄
いガリウム及びゲルマニウムの酸化層(Gap。
GeO)ができている。この上に障壁金属膜4及びポン
ディングパッド電極膜3を積層した場合、pt膜7と障
壁金属膜4との密着力は弱く、ボンディング時の機械的
衝撃で障壁金属膜4がpt膜7から剥離し易い。このた
め、ボンディング時の作業性が低下し、又、組立後のオ
ープン不良も多くやはり量産性に欠ける。
尚、以上の説明はN型砒化ガリウム基板1上においてな
されたが、P型砒化ガリウム基板上であっても合金化の
熱処理化工程を伴っており、N型の場合と同様の問題が
存在する。
〔発明の目的〕
この発明は上記実情に鑑みてなされたもので、その目的
は、ボンディングの接着性が良好で、かつ電極膜の密着
力が強固であり、ポンディ。
グ時の機械的衝撃があっても膜が剥離するようなことの
無いボンディング性に優れた電極構造を有する砒化ガ゛
リウム半導体装置を提供することにある。
〔発明の概要〕
す、なわち、この発明は、砒化ガリウム基板上の合金化
の熱処理工程を経て形成しだオーム性−接触電極に、ガ
リウム拡散の障壁となシ、がっ砒化ガリウムとの密着力
が強い金属、例えばTiあるいはptからなる障壁金属
膜を下地とし、その上にポンディングパッド電枠膜を積
層する。
この際、少くともボンディングされる部分を障壁金属膜
が直接砒化ガリウム基板に密着する構造とするものであ
る。
〔発明の実施例〕
以下、図面に参照してこの発明の一実施例を説明する。
この実施例においては、N型砒化ガリウム基板を用いた
例で説明する。先ず、第4図(a)に示すように、N型
砒化ガリウム基板11にSiH4の熱分解法によシSi
O□膜12を2000に堆積する。次に、通常のフォト
エツチング技術によりS iO2膜12をエツチングし
てPt/AuGe膜コンタクト用の開口13を形成する
。次いで真空蒸着法によりAuGe膜14、Pt膜15
の順に各各2000X、300Xづつ堆積する。次に、
第4図(b)に示すように上記フォトエツチングの際に
用いたフォトレジスト膜16をアセトン等の有機溶剤に
溶かすことにより、フォトレジスト膜16上の不要なA
uG e膜14及びpt膜15を除去する。さらに、N
′H4F液によりSiO2膜12も除く。しかる後、温
度430℃の窒素(N2)雰囲気において約5分の熱処
理を行い、AuGe膜14膚 と砒化ガリウム基板1ノとの間に合金躊17を形成し、
オーム性接触金とる。次に、第4図(c)に示すように
、再び5IH4の熱分解法により、S iO2膜18を
13000X堆積し、コノ5lo2膜18を通常のフォ
トエツチング技術によりエツチングしてボンディング・
ぐッド電極コンタクト用の開口19を形成する。この間
[」19は上記開口13より後述のビンディングパッド
電極部分だけ広く形成されている。次いで、真空蒸着法
により例えばTiからなる障壁金属膜2o及び例えばl
tからなるボンディング・ぐッド電極膜2)(7) I
IFj K、G々2000X 、10000Xづ−)堆
fNする。
次に、フォトレジスト膜22をアセトン等の有機溶剤に
溶かずことにより、フォトレノスト膜22上の不要な障
壁金属膜2o及びポンディングパッド電極膜21を除去
する。第4図(d)はその時点の構造を示すものである
。この構造において、ビンディングは障壁金属膜2oが
砒化ガリウム基板11に密着した領域(Aで示す領域)
上のポンディングパッド電極膜2ノに行うものである。
上記電極構造を有する砒化ガリウム半導体装置にあって
は、デンディング部が、ポンディングパッド電極膜21
/障壁金属膜20/砒化ガリウム基板11の構造となっ
ているため、オーム性接触は無く、ボンディング時の衝
撃で金属膜間の剥離は起きない。又、障壁金属膜20は
、砒化ガリウム基板11と密着力の強固な金属(Ti)
によυ形成されているため、障壁金属膜20と砒化ガリ
ウム基板11間の剥離は起きない。
さらに、ポンプイングツ2ツド電極膜21の形成後は、
合金化のための熱処理のような長時間の高温にさらされ
る工程も無いので、障壁金属膜20はその効果を十分発
揮し、ボンディングワイヤの接着性が悪くなることもな
い。なお、オーム性接触電極(Au膜15 / AuG
e膜14膜長4ポンディングパッド電極膜21の障壁金
属膜20とのそれぞれの界面には、薄いガリウム酸化膜
及びゲルマニウム酸化膜が存在するが、素子特性上及び
信頼性上なんの影響も受けず、問題はない。
尚、上記実施例においては、オーム性接触電極としてp
t膜15/AuGe膜14、障壁金属膜2゜としてTI
、ポンディングパッド電極膜2ノとしてAtをそれぞれ
用いて説明しだが、これらに限定するものではなく、オ
ーム性接触電極としてNi / AuGe 、 Au 
/ AuGe等、障壁金属膜2oとしてMo、 Ta、
 Pt等、ポンディングパッド電極膜21としてAu等
を用いてもよい。また、上記実施例においては、N型砒
化ガリウム基板を用いて説明したが、P型砒化ガリウム
基板としてもよいことは勿論である。
〔発明の効果〕
以上のようにこの発明によれば、ボンディング性が良好
であるだめ、組立後でも高歩留りであり、量産性に優れ
た砒化ガリウム半導体装置を提供できる。
【図面の簡単な説明】
第1図乃至第3図はそれぞれ従来の砒化ガリウム半導体
装置の電極構造を示す断面図、第4図はこの発明の一実
施例に係る砒化ガリウム半導体装置の電極構造を示す断
面図である。 1ノ・・・N型砒化ガリウム基板、12・・・5IO2
膜、SiO□膜、19・・・開口、20・・・障壁金属
膜、21・・・ビンディングパッド電極膜、22・・・
フォトレジスト膜。 出願人代理人 弁理士 鈴 江 武 彦牙1図 〉・3図 号 40

Claims (1)

    【特許請求の範囲】
  1. 砒化ガリウム基板と、この砒化ガリウ・ム基板上に形成
    されだオーム性接触電極層と、前記砒化ガリウム基板と
    強固に密着し、かつガリウム拡散の障壁となる金属によ
    り形成され、前記オーム性接触電極層及び前記砒化ガリ
    ウム基板上に形成された障壁金属膜と、この障壁金属膜
    上に形成されたボンディング・フッド電極膜とを具備し
    、前記障壁金属膜が前記砒化ガリウム基板に密着した領
    域上のボンディング・Fノド電極膜に対しボンディング
    を行うことを特徴とする砒化ガリウム半導体装置。
JP57222469A 1982-12-18 1982-12-18 砒化ガリウム半導体装置 Pending JPS59112654A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP57222469A JPS59112654A (ja) 1982-12-18 1982-12-18 砒化ガリウム半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP57222469A JPS59112654A (ja) 1982-12-18 1982-12-18 砒化ガリウム半導体装置

Publications (1)

Publication Number Publication Date
JPS59112654A true JPS59112654A (ja) 1984-06-29

Family

ID=16782898

Family Applications (1)

Application Number Title Priority Date Filing Date
JP57222469A Pending JPS59112654A (ja) 1982-12-18 1982-12-18 砒化ガリウム半導体装置

Country Status (1)

Country Link
JP (1) JPS59112654A (ja)

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60170945A (ja) * 1984-02-15 1985-09-04 Mitsubishi Electric Corp 半導体装置
JPH01186671A (ja) * 1988-01-14 1989-07-26 Toshiba Corp 化合物半導体装置
JPH03219674A (ja) * 1990-01-25 1991-09-27 Toshiba Corp 半導体装置の電極構造及びその製造方法
JP2007317913A (ja) * 2006-05-26 2007-12-06 Matsushita Electric Ind Co Ltd 半導体発光素子およびその製造方法
WO2012064636A3 (en) * 2010-11-10 2012-08-09 Cree, Inc. Contact pad and method of manufacturing the same

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60170945A (ja) * 1984-02-15 1985-09-04 Mitsubishi Electric Corp 半導体装置
JPH01186671A (ja) * 1988-01-14 1989-07-26 Toshiba Corp 化合物半導体装置
JPH03219674A (ja) * 1990-01-25 1991-09-27 Toshiba Corp 半導体装置の電極構造及びその製造方法
JP2007317913A (ja) * 2006-05-26 2007-12-06 Matsushita Electric Ind Co Ltd 半導体発光素子およびその製造方法
WO2012064636A3 (en) * 2010-11-10 2012-08-09 Cree, Inc. Contact pad and method of manufacturing the same
US9607955B2 (en) 2010-11-10 2017-03-28 Cree, Inc. Contact pad

Similar Documents

Publication Publication Date Title
JP2967743B2 (ja) n型窒化ガリウム系半導体のコンタクト電極及びその形成方法
JPS59112654A (ja) 砒化ガリウム半導体装置
US5260603A (en) Electrode structure of semiconductor device for use in GaAs compound substrate
JPS5912021B2 (ja) 半導体装置の製造方法
JPH0394451A (ja) 半導体装置の配線構造
JPS60113954A (ja) 半導体基板とヒ−トシンクとの固着方法
JPS63224344A (ja) 半導体装置の製造方法
JPH0513584A (ja) 半導体装置およびその製造方法
JPH0365015B2 (ja)
JPH04206842A (ja) パッド形成方法
JPH05299634A (ja) 化合物半導体素子およびその製法
JPS60123026A (ja) 半導体装置の製造方法
JPS58197883A (ja) 半導体装置の製造法
JPH0831480B2 (ja) GaAs半導体装置およびその製造方法
JPS60211974A (ja) 半導体素子
JPH06120292A (ja) 電界効果トランジスタ
JPS62118582A (ja) 半導体装置の製造方法
JPH0224021B2 (ja)
JPH0513365A (ja) 半導体装置の製造方法
JPH03219674A (ja) 半導体装置の電極構造及びその製造方法
JPH0475385A (ja) 半導体装置およびその製造方法
JPS62169350A (ja) 半導体装置とその製造方法
JPS6173381A (ja) 半導体集積回路装置の製造方法
JPS6240770A (ja) 半導体装置の製造方法
JPS62165345A (ja) 半導体装置の電極配線形成方法