JPS58175038A - ストア−ドプログラム方式の電子機器 - Google Patents
ストア−ドプログラム方式の電子機器Info
- Publication number
- JPS58175038A JPS58175038A JP57056824A JP5682482A JPS58175038A JP S58175038 A JPS58175038 A JP S58175038A JP 57056824 A JP57056824 A JP 57056824A JP 5682482 A JP5682482 A JP 5682482A JP S58175038 A JPS58175038 A JP S58175038A
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- JP
- Japan
- Prior art keywords
- program
- input
- devices
- electronic device
- ram
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/382—Information transfer, e.g. on bus using universal interface adapter
- G06F13/385—Information transfer, e.g. on bus using universal interface adapter for adaptation of a particular data processing system to different peripheral devices
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- Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はストアードプログラム方式の電子機器の改良に
関し、更に詳細には電子機器に接続する複数種類の入出
力装置（以下単にＩ１０装置と称す）に対応して、この
し６装置を接続するコネクタ手段を複数個電子機器に設
けることなく、唯一のコネクタ手段により複数のＩ１０
装置より任意のＩ１０装置を選択して電子機器に接続し
得るようにしたものである。
関し、更に詳細には電子機器に接続する複数種類の入出
力装置（以下単にＩ１０装置と称す）に対応して、この
し６装置を接続するコネクタ手段を複数個電子機器に設
けることなく、唯一のコネクタ手段により複数のＩ１０
装置より任意のＩ１０装置を選択して電子機器に接続し
得るようにしたものである。
従来の電子機器においては、該電子機器に接続する必要
のある１ろ装置（例えばＯＣＲ！Ｊ−ダ。
のある１ろ装置（例えばＯＣＲ！Ｊ−ダ。
プリンタ等）の数だけＩ１０コネクタを設ける必要があ
るため、そのコネクタ群を取付けるスペースを電子機器
に設ける必要があり、装置が大型化する傾向があった。
るため、そのコネクタ群を取付けるスペースを電子機器
に設ける必要があり、装置が大型化する傾向があった。
即ち、従来の電子機器は例えば第１図に示す様な構成に
なっている。
なっている。
第１図において、１は中央演算処理装置（ＣＰＵ）、２
は該中央演算処理装置１に対して装置本体の基本機能を
制御するプログラムを記憶するマスクリードオンリメモ
リ（ＭＡＳＫ ＲＯＭ）、３は装■ 置本体の具体的動作及び各種、４装置ヲ制御するプログ
ラムを書込むためのプログラム書込み制御手段、４は該
プログラム書込み制御手段３によりプログラム書込みモ
ード時に書込まれるアプリケーションプログラムを読込
み記憶するためのアプリケーションプログラム用ランダ
ムアクセスメモ！Ｊ（ＲＡＭ）、５は装置本体の各種操
作で発生したデータを記憶するデータランダムアクセス
メモリ、６は各種操作で発生したデータを表示する表示
手段、７は各種操作で発生したデータを印字する印字手
段、９〜１２はそれぞれ各種Ｉ１０装置１５〜１８を接
続するためのＩ１０インターフェイス、１３は各種情報
を入力処理するキー人力手段、１４は装置本体の動作モ
ード（プログラムの書込み、各操作の実行等のモード）
を規定するモード選択手段であり、上記各構成要素が相
互にデータバス１９及びアドレスバス２０により接続さ
れている。
は該中央演算処理装置１に対して装置本体の基本機能を
制御するプログラムを記憶するマスクリードオンリメモ
リ（ＭＡＳＫ ＲＯＭ）、３は装■ 置本体の具体的動作及び各種、４装置ヲ制御するプログ
ラムを書込むためのプログラム書込み制御手段、４は該
プログラム書込み制御手段３によりプログラム書込みモ
ード時に書込まれるアプリケーションプログラムを読込
み記憶するためのアプリケーションプログラム用ランダ
ムアクセスメモ！Ｊ（ＲＡＭ）、５は装置本体の各種操
作で発生したデータを記憶するデータランダムアクセス
メモリ、６は各種操作で発生したデータを表示する表示
手段、７は各種操作で発生したデータを印字する印字手
段、９〜１２はそれぞれ各種Ｉ１０装置１５〜１８を接
続するためのＩ１０インターフェイス、１３は各種情報
を入力処理するキー人力手段、１４は装置本体の動作モ
ード（プログラムの書込み、各操作の実行等のモード）
を規定するモード選択手段であり、上記各構成要素が相
互にデータバス１９及びアドレスバス２０により接続さ
れている。
また２１はアドレスバス２０上の信号をデコードするデ
コーダである。
コーダである。
上記の如き構成において、今この様な電子機器゛を使用
する場合、オペレータはまずモード選択手段１４をプロ
グラム書込みモードとして、ＣＰＵＩの制御のもとにＭ
ＡＳＫ ＲＯＭ２に記憶されているプログラム書込み
指示プログラムに従って装置をどの様に使用するかを規
定するアプリケーションプログラムをプログラム書込制
御手段３よりＲＡＭ４の所定のエリアに書込み記憶させ
る。
する場合、オペレータはまずモード選択手段１４をプロ
グラム書込みモードとして、ＣＰＵＩの制御のもとにＭ
ＡＳＫ ＲＯＭ２に記憶されているプログラム書込み
指示プログラムに従って装置をどの様に使用するかを規
定するアプリケーションプログラムをプログラム書込制
御手段３よりＲＡＭ４の所定のエリアに書込み記憶させ
る。
一般にこのアプリケーションプログラムには装置をどの
様に制御するかを規定するプログラムの他に所望のＩ、
１０装置の制御プログラムが含まれ、このプログラムは
一つの仕様に対して一つのＩ１０装置制御プログラムが
含まれるのが一般的であった○ この様にしてアプリケーションプログラムの書込みが完
了すればオペレータは所望のＩ／１０装置１５〜１８の
一つを所定のＩ１０インターフェイス９〜１２の一つに
接続してモード選択手段１４を実行モードとして所望の
操作をキー人力手段１３により行ない、入力データ及び
入力指示がＲＡＭ４に記憶されているプログラムにもと
づいてＣＰＵ１において処理される。上述の様な電子機
器にあってはＩ１０装置をある時点から、例えばＡ−Ｂ
に変更したい場合には再度ＲＡＭ４に記憶されているア
プリケーションプログラムを変更する必要がある。又■
ろ装置を接続するためのコネクター（１９〜２２）が多
数あるため誤ってＩ１０装置とは不適合なＩ１０インタ
ーフェースにＶＱ装置を接続してしまう可能性がある。
様に制御するかを規定するプログラムの他に所望のＩ、
１０装置の制御プログラムが含まれ、このプログラムは
一つの仕様に対して一つのＩ１０装置制御プログラムが
含まれるのが一般的であった○ この様にしてアプリケーションプログラムの書込みが完
了すればオペレータは所望のＩ／１０装置１５〜１８の
一つを所定のＩ１０インターフェイス９〜１２の一つに
接続してモード選択手段１４を実行モードとして所望の
操作をキー人力手段１３により行ない、入力データ及び
入力指示がＲＡＭ４に記憶されているプログラムにもと
づいてＣＰＵ１において処理される。上述の様な電子機
器にあってはＩ１０装置をある時点から、例えばＡ−Ｂ
に変更したい場合には再度ＲＡＭ４に記憶されているア
プリケーションプログラムを変更する必要がある。又■
ろ装置を接続するためのコネクター（１９〜２２）が多
数あるため誤ってＩ１０装置とは不適合なＩ１０インタ
ーフェースにＶＱ装置を接続してしまう可能性がある。
本発明は上記した問題点を除去したストアードプログラ
ム方式の電子機器を提供することを目的として成された
ものであシ、この目的を達成するため、本発明の複数の
入出力装置の任意選択された入出力装置の接続される電
子機器は、上記の入出力装置の接続される接続口を有す
るインターフェイス手段と、このインターフェイス手段
に接続する入出力装置を指定する工、４指定手段と、複
数の入出力装置の制御プログラムを記憶する記憶手段と
を備え、上記のＩ１５指定手段によシ指定された所定の
入出力装置の制御プログラムを上記の記憶手段より選択
して上記のインターフェイス手段に接続される入出力装
置を制御せしめるように構成され、これにより予め記憶
手段に複数のＩろ装置の制御プログラムを記憶させキー
人力手段に設けたＩ／、指定キーの操作により、そのＩ
／、装置制御プログラムを指定出来る様にして制御プロ
グラム記憶手段に記憶したプログラムを変更することな
く Ｉ１０装置の接続を任意に変更出来る様にしたもの
である。更には汎用インターフェイスを使用することに
より唯一の１７４コネクターで複数のＩろ装置より所望
の一つを選択して任意に接続出来る様にしたものである
。
ム方式の電子機器を提供することを目的として成された
ものであシ、この目的を達成するため、本発明の複数の
入出力装置の任意選択された入出力装置の接続される電
子機器は、上記の入出力装置の接続される接続口を有す
るインターフェイス手段と、このインターフェイス手段
に接続する入出力装置を指定する工、４指定手段と、複
数の入出力装置の制御プログラムを記憶する記憶手段と
を備え、上記のＩ１５指定手段によシ指定された所定の
入出力装置の制御プログラムを上記の記憶手段より選択
して上記のインターフェイス手段に接続される入出力装
置を制御せしめるように構成され、これにより予め記憶
手段に複数のＩろ装置の制御プログラムを記憶させキー
人力手段に設けたＩ／、指定キーの操作により、そのＩ
／、装置制御プログラムを指定出来る様にして制御プロ
グラム記憶手段に記憶したプログラムを変更することな
く Ｉ１０装置の接続を任意に変更出来る様にしたもの
である。更には汎用インターフェイスを使用することに
より唯一の１７４コネクターで複数のＩろ装置より所望
の一つを選択して任意に接続出来る様にしたものである
。
以下、本発明の一実施例について図面を参照して詳細に
説明する。
説明する。
第２図は本発明を実施したストアードプログラム方式の
電子機器の構成を示すフロック図であり、第１図に示し
た従来装置と同一部分は同一符号で示している。
電子機器の構成を示すフロック図であり、第１図に示し
た従来装置と同一部分は同一符号で示している。
第２図において、１は中央演算処理装置（ＣＰＵ）であ
り、該ＣＰＵＩのＲＡＭエリアａに複数のＩ／、装置（
１５〜１８）の内のいずれのＩ／、装置を選択指定した
かを記憶するフラグエリアが設けられている。２はＣＰ
ＵＩに対して装置本体の基本機能を制御するプログラム
を記憶するマスクリードオンリメモリ（ＭＡＳＫ Ｒ
ＯＭ） 、３は装置本体の具体的動作及び各種ＶＱ装置
を制御するプログラムを書込むためのプログラム書込み
制御手段、４は該プログラム書込み制御手段３によりプ
ログラム書込みモード時に書込まれるアプリケーション
プログラムを読込み記憶するためのアプリケーションプ
ログラム用ランダムアクセスメモリ（ＲＡＭ）であり、
該ＲＡＭ４内には各種■ろ装置（例えば１５〜１８）を
制御するプログラムをそれぞれ記憶するためのエリアＡ
−Ｄが設けられている。５は装置本体の各種操作で発生
したデータを記憶するデータランダムアクセスメモリ、
６は各種操作で発生し−たデータを表示する表示手段、
７は各種操作で発生したデータを印字する印字手段、８
は複数のＩ／、装置１５〜１８の内の選択指定された一
つのＩ１０装置を接続するための唯一の接続口（コネク
ター）２２を有するＶＱインターフェイス手段、１３は
各種情報を入力処理するキー人力手段であり、該キー人
力手段１３にはＶＱ装置１５〜１８の特定のＩろ装置を
選択指定するためのＩ１０指定手段（指定キー）ＫＡ−
ＫＤが設けられている。１４は装置本体の動作モード（
プログラムの書込み、各操作の実行等のモード）を規定
するモード選択手段であり、上記各構成要素が相互にデ
ータバス１９及びアドレスバス２０によ°り接続されて
いる。また２１はアドレスバス２０上の信号をデコード
するデコーダである。
り、該ＣＰＵＩのＲＡＭエリアａに複数のＩ／、装置（
１５〜１８）の内のいずれのＩ／、装置を選択指定した
かを記憶するフラグエリアが設けられている。２はＣＰ
ＵＩに対して装置本体の基本機能を制御するプログラム
を記憶するマスクリードオンリメモリ（ＭＡＳＫ Ｒ
ＯＭ） 、３は装置本体の具体的動作及び各種ＶＱ装置
を制御するプログラムを書込むためのプログラム書込み
制御手段、４は該プログラム書込み制御手段３によりプ
ログラム書込みモード時に書込まれるアプリケーション
プログラムを読込み記憶するためのアプリケーションプ
ログラム用ランダムアクセスメモリ（ＲＡＭ）であり、
該ＲＡＭ４内には各種■ろ装置（例えば１５〜１８）を
制御するプログラムをそれぞれ記憶するためのエリアＡ
−Ｄが設けられている。５は装置本体の各種操作で発生
したデータを記憶するデータランダムアクセスメモリ、
６は各種操作で発生し−たデータを表示する表示手段、
７は各種操作で発生したデータを印字する印字手段、８
は複数のＩ／、装置１５〜１８の内の選択指定された一
つのＩ１０装置を接続するための唯一の接続口（コネク
ター）２２を有するＶＱインターフェイス手段、１３は
各種情報を入力処理するキー人力手段であり、該キー人
力手段１３にはＶＱ装置１５〜１８の特定のＩろ装置を
選択指定するためのＩ１０指定手段（指定キー）ＫＡ−
ＫＤが設けられている。１４は装置本体の動作モード（
プログラムの書込み、各操作の実行等のモード）を規定
するモード選択手段であり、上記各構成要素が相互にデ
ータバス１９及びアドレスバス２０によ°り接続されて
いる。また２１はアドレスバス２０上の信号をデコード
するデコーダである。
次に上記第２図に示した電子機器の動作を第３図に示す
動作フロー図を参照して説明する。
動作フロー図を参照して説明する。
まずモード選択手段１４をプログラム書込みモードに設
定して、電源スィッチ′（図示せず）をオンしてＣＰＵ
Ｉにこのプログラム書込みモード情報を与える（第３図
ステップｎ１〜ｎ３）。このモード情報を受けたＣＰＵ
ＩはＭＡＳＫ ＲＯＭ２に記憶しているプログラム読
込みプログラムを選択し、プログラム書込み制御手段３
を介して入力される装置をどの様に使用するかを規定す
るアプリケーションプログラムをＲＡＭ４の所定のエリ
アへ書込み記憶させる（ステップｎ４〜ｎ５）。
定して、電源スィッチ′（図示せず）をオンしてＣＰＵ
Ｉにこのプログラム書込みモード情報を与える（第３図
ステップｎ１〜ｎ３）。このモード情報を受けたＣＰＵ
ＩはＭＡＳＫ ＲＯＭ２に記憶しているプログラム読
込みプログラムを選択し、プログラム書込み制御手段３
を介して入力される装置をどの様に使用するかを規定す
るアプリケーションプログラムをＲＡＭ４の所定のエリ
アへ書込み記憶させる（ステップｎ４〜ｎ５）。
この時このアプリケーションプログラムにはＶ。
装置１５〜１８の全てを制御するプログラムもＲＡＭ４
の所定のエリア（Ａ、Ｂ、Ｃ，Ｄ）に記憶させる。
の所定のエリア（Ａ、Ｂ、Ｃ，Ｄ）に記憶させる。
この様にしてアプリケーションプログラムの書込みが完
了すればオペレータは今記憶させたプログラムにもとづ
く仕事をすべく装置を上記同様の手順で実行モードとす
る（ステップｎ７）。このモードが指定されるとＣＰＵ
ＩはＲＡＭ４にアプリケーションプログラムが書込まれ
ているか否かチェックし、もし書込まれていなければオ
ペレータに対して表示部６等からプログラムの書込み指
示を与える（ステップｎ８．ｎ９）。
了すればオペレータは今記憶させたプログラムにもとづ
く仕事をすべく装置を上記同様の手順で実行モードとす
る（ステップｎ７）。このモードが指定されるとＣＰＵ
ＩはＲＡＭ４にアプリケーションプログラムが書込まれ
ているか否かチェックし、もし書込まれていなければオ
ペレータに対して表示部６等からプログラムの書込み指
示を与える（ステップｎ８．ｎ９）。
一方もしプログラムが書込まれていればＩ１０装置の選
択待ち状態となる。
択待ち状態となる。
次にオペレータはキー人力手段１３のＩ／、選択キー（
ＫＡ−ＫＤ）の所望のＩ／Ｑ装置に対応したキーを押圧
して所望のＩろ装置の一つを選択指定し、ＣＰＵ１のＲ
ＡＭエリアの対応エリアａにフラグを立てる（ステップ
ｎｌｏ、ｎ１ｌ）。このフラグを判定したＣＰＵＩはＲ
ＡＭ４のアプリケーションプログラムの内指定されたＩ
／、制御プログラム（例えばＡ）を選択指定する（ステ
ップｎ１２）。次にオペレータは自分の指定した１、１
０装置（例えばＩ／ＣＰ置１装）を汎用インターフェイ
ス８のコネクタ２２に接続する。この様にして全ての準
備の完了を確認してオペレータはキー人力手段１３より
所望の業務を実行させる（ステップｎ１３）。
ＫＡ−ＫＤ）の所望のＩ／Ｑ装置に対応したキーを押圧
して所望のＩろ装置の一つを選択指定し、ＣＰＵ１のＲ
ＡＭエリアの対応エリアａにフラグを立てる（ステップ
ｎｌｏ、ｎ１ｌ）。このフラグを判定したＣＰＵＩはＲ
ＡＭ４のアプリケーションプログラムの内指定されたＩ
／、制御プログラム（例えばＡ）を選択指定する（ステ
ップｎ１２）。次にオペレータは自分の指定した１、１
０装置（例えばＩ／ＣＰ置１装）を汎用インターフェイ
ス８のコネクタ２２に接続する。この様にして全ての準
備の完了を確認してオペレータはキー人力手段１３より
所望の業務を実行させる（ステップｎ１３）。
またある時点からＩ１０装置を変更させたい場合には■
／、選択キーＫＡ−Ｋをも任意に選択指定するのみで所
望の１／１０装置に対するＩ／、制御プログラムがＲＡ
Ｍ４内より選択され、所望のＩ／、装置をインターフェ
イス手段８の接続口２２に接続し直すことにより所望の
Ｉ／Ｑ装置を動作させて所望の業務の実行がなされる。
／、選択キーＫＡ−Ｋをも任意に選択指定するのみで所
望の１／１０装置に対するＩ／、制御プログラムがＲＡ
Ｍ４内より選択され、所望のＩ／、装置をインターフェ
イス手段８の接続口２２に接続し直すことにより所望の
Ｉ／Ｑ装置を動作させて所望の業務の実行がなされる。
以上述べた様に本発明によれば電子機器に接続する複数
種類の■１０装置に対応して、このＩろ装置を接続する
コネクタ手段を複数個電子機器に設けることなく、唯一
のコネクタ手段を介して上記の複数のＶＱ装置より所定
のＶＱ装置の一つを任意に接続すると共にしも選択キー
Ａ−Ｄｔ−任意に選択指定するのみで当該Ｉ、５装置を
動作させることが出来、Ｉ１０装置の制御用プログラム
を新たに再書込する必要がない。
種類の■１０装置に対応して、このＩろ装置を接続する
コネクタ手段を複数個電子機器に設けることなく、唯一
のコネクタ手段を介して上記の複数のＶＱ装置より所定
のＶＱ装置の一つを任意に接続すると共にしも選択キー
Ａ−Ｄｔ−任意に選択指定するのみで当該Ｉ、５装置を
動作させることが出来、Ｉ１０装置の制御用プログラム
を新たに再書込する必要がない。
従って本発明によれば、電子機器の小型化が計れると共
に電子機器の組立作業等の作業性が向上する。
に電子機器の組立作業等の作業性が向上する。
更にＩ／、装置のインターフェイスコネクタへの接続誤
りを防止できると共に一つの電子機器において複数種類
のＩ／、装置より特定の一つのＩ／Ｑ装置を任意に選択
して制御することが出来る。
りを防止できると共に一つの電子機器において複数種類
のＩ／、装置より特定の一つのＩ／Ｑ装置を任意に選択
して制御することが出来る。
第１図は従来装置の構成を示すブロック図、第２図は本
発明のストアードプログラム方式の電子機器の構成を示
すブロック図、第３図はその動作を説明するための動作
フロー図である。 １・中央演算処理装置（ＣＰＵ）、 啼・・・アプリケーションプログラム用ランダムアクセ
スメモリ、 Ａ−Ｄ・・・■ろ装置制御プログラム記憶エリア、８・
・・インターフェイス手段、 １３・・・キー人力手段、 ＫＡ〜ＫＤ・・・工／。指定手段、 １５〜１８・・・入出力装置、 ２２・・・接続口。
発明のストアードプログラム方式の電子機器の構成を示
すブロック図、第３図はその動作を説明するための動作
フロー図である。 １・中央演算処理装置（ＣＰＵ）、 啼・・・アプリケーションプログラム用ランダムアクセ
スメモリ、 Ａ−Ｄ・・・■ろ装置制御プログラム記憶エリア、８・
・・インターフェイス手段、 １３・・・キー人力手段、 ＫＡ〜ＫＤ・・・工／。指定手段、 １５〜１８・・・入出力装置、 ２２・・・接続口。
Claims (1)
- 【特許請求の範囲】 １、複数の入出力装置の任意選択された入出力装置の接
続される電子機器であって、 上記入出力装置の接続される接続口を有す必インターフ
ェイス手段と、該インターフェイス手段に接続する入出
力装置を指定するＩ１０指定手段と、複数の入出力装置
の制御プログラムを記憶する記憶手段とを備え、 上記１／１０指定手段により指定された所定の入出力装
置の制御プログラムを上記記憶手段より選択して上記イ
ンターフェイス手段に接続される入出力装置を制御せし
めるように成したことを特徴とするストアードプログラ
ム方式の電子機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57056824A JPS58175038A (ja) | 1982-04-05 | 1982-04-05 | ストア−ドプログラム方式の電子機器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57056824A JPS58175038A (ja) | 1982-04-05 | 1982-04-05 | ストア−ドプログラム方式の電子機器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58175038A true JPS58175038A (ja) | 1983-10-14 |
Family
ID=13038119
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57056824A Pending JPS58175038A (ja) | 1982-04-05 | 1982-04-05 | ストア−ドプログラム方式の電子機器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58175038A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01116751A (ja) * | 1987-10-30 | 1989-05-09 | Canon Inc | 情報処理装置の起動方法 |
| JPH10269171A (ja) * | 1997-03-24 | 1998-10-09 | Nippon Denki Ido Tsushin Kk | データ通信方式 |
-
1982
- 1982-04-05 JP JP57056824A patent/JPS58175038A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01116751A (ja) * | 1987-10-30 | 1989-05-09 | Canon Inc | 情報処理装置の起動方法 |
| JPH10269171A (ja) * | 1997-03-24 | 1998-10-09 | Nippon Denki Ido Tsushin Kk | データ通信方式 |
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