JPS58142674A - フアクシミリ用デ−タ処理装置 - Google Patents
フアクシミリ用デ−タ処理装置Info
- Publication number
- JPS58142674A JPS58142674A JP57024442A JP2444282A JPS58142674A JP S58142674 A JPS58142674 A JP S58142674A JP 57024442 A JP57024442 A JP 57024442A JP 2444282 A JP2444282 A JP 2444282A JP S58142674 A JPS58142674 A JP S58142674A
- Authority
- JP
- Japan
- Prior art keywords
- memory
- speed
- circuit
- data
- conversion circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
この発明は、ファクシミリ用データ処理装置に関し、特
に原稿読取部において原稿走査方向におけるシェーディ
ング（濃淡）の歪を補正するためのデータ処理装置に関
する。 一般に、ファクシミＩＪの原稿読取部においては、光学
系レンズの構成や光源ムラ等によって、シェーディング
歪が生じてしまう。つまり、ＣＣＵのようなイメージセ
ンサによって白紙のような一様な明度の原稿を走査した
場合でも、センサの画像信号のレベルが第１回し）のよ
うに原稿の両端部において中央部分よりも低下してしま
うという現象が生じていた。 そのため、実際の原稿の読敗り画像信号も、第１図（ｂ
）のように、両端部のレベルが低下してしまう。従って
、このようなシェーディング歪を持つアナログビデオ信
号を例えば一定値のしきいレベル（スライスレベル）に
もとづ〜・て２値化もしくはディジタル化するような場
合には両端部で感度がダウンすることに応じて、読取り
ミスが発生する。 従来、この画像信号におけるシェーディング歪を補正す
るために、ＡＧＣ（自動利得制御）方式のような調整方
式によって、得られる画像信号しベルが一様になるよう
にする方法が知られている。 しかし、この方法では、光源など装置の各機構部分の調
整箇所が多くなり、調整作業が極めて面倒になるという
不都合がある。 また、第２図に示すような回路により、初めに一度白紙
の原稿を走査して、シェーディング歪をメモリに記憶さ
せておき、このシェーディング歪に対応したスライスレ
ベルな基準と１７で画像信号を２値化するようにしたも
のも提案されている。 しかしながら、このようなデータ処理回路では、一般に
Ｄ／Ａ変換に比べてＡ／Ｄ変換の方が変換のために時間
を要するため、イメージセンサの走査速度に合わせてメ
モリへのデータ書込み速度を続出し速度に一致させよう
トすると、非常に複雑な高速のＡ／ｌ）変換回路が必要
になるという不都合がある。 そこで、この発明は、フェーディングφに関するデータ
をメモリに格納する−の書込み速度がメモリ続出し速度
よりも遅くなるようにして、回路設計の簡単な低速のＡ
／ｌ）変換回路を使用することができ、また、シェーデ
ィング歪除去のためにファクシミリの各機構部の調整も
ほとんど必要としないファクシミリ用データ処理装置を
提供することを目的とする。 以下図面に基づいてこの発明を説明する。 第３図は、本発明に係るデータ処理回路の一実施例を示
す。 ＣＣＤのようｔ
に原稿読取部において原稿走査方向におけるシェーディ
ング（濃淡）の歪を補正するためのデータ処理装置に関
する。 一般に、ファクシミＩＪの原稿読取部においては、光学
系レンズの構成や光源ムラ等によって、シェーディング
歪が生じてしまう。つまり、ＣＣＵのようなイメージセ
ンサによって白紙のような一様な明度の原稿を走査した
場合でも、センサの画像信号のレベルが第１回し）のよ
うに原稿の両端部において中央部分よりも低下してしま
うという現象が生じていた。 そのため、実際の原稿の読敗り画像信号も、第１図（ｂ
）のように、両端部のレベルが低下してしまう。従って
、このようなシェーディング歪を持つアナログビデオ信
号を例えば一定値のしきいレベル（スライスレベル）に
もとづ〜・て２値化もしくはディジタル化するような場
合には両端部で感度がダウンすることに応じて、読取り
ミスが発生する。 従来、この画像信号におけるシェーディング歪を補正す
るために、ＡＧＣ（自動利得制御）方式のような調整方
式によって、得られる画像信号しベルが一様になるよう
にする方法が知られている。 しかし、この方法では、光源など装置の各機構部分の調
整箇所が多くなり、調整作業が極めて面倒になるという
不都合がある。 また、第２図に示すような回路により、初めに一度白紙
の原稿を走査して、シェーディング歪をメモリに記憶さ
せておき、このシェーディング歪に対応したスライスレ
ベルな基準と１７で画像信号を２値化するようにしたも
のも提案されている。 しかしながら、このようなデータ処理回路では、一般に
Ｄ／Ａ変換に比べてＡ／Ｄ変換の方が変換のために時間
を要するため、イメージセンサの走査速度に合わせてメ
モリへのデータ書込み速度を続出し速度に一致させよう
トすると、非常に複雑な高速のＡ／ｌ）変換回路が必要
になるという不都合がある。 そこで、この発明は、フェーディングφに関するデータ
をメモリに格納する−の書込み速度がメモリ続出し速度
よりも遅くなるようにして、回路設計の簡単な低速のＡ
／ｌ）変換回路を使用することができ、また、シェーデ
ィング歪除去のためにファクシミリの各機構部の調整も
ほとんど必要としないファクシミリ用データ処理装置を
提供することを目的とする。 以下図面に基づいてこの発明を説明する。 第３図は、本発明に係るデータ処理回路の一実施例を示
す。 ＣＣＤのようｔ
【イメージセンサ１からのアナログビデ
オ信号は、読取制御回路２から一上記センサ１へ供給さ
れるＩＭＩ−１ｚ のようなりロック信号φ。 によって、低速系のＡ／Ｄ変換回路３へ送られる。 Ａ／Ｄ変換回路３は、タイミング発生回路４から供給さ
れる上記クロック信号φ。よりも遅い例えば１００ＫＨ
ｚのようなサンプリング信号φ８によって、イメージセ
ンサ１から出力されろアナログビデオ信号をＡ／Ｄ変換
してメモリ５に転送する。 メモリ５では、上記読取制御回路２から供給されるアド
レそ信号によって指定されるメモリエリアに、上記Ａ／
Ｄ変換回路３からのデータが格納される。このメモリ５
へのデータの書込みは、タイミング発生回路４からメモ
リ５に供給される一上記すンプリング信号φ８と同じ速
度（１００ＫＩ（ｚ）のライトイネーブル信号のタイミ
ングによって行なわれる。 また、上記メモリ５に格納さねたデー々は、タイミング
回路４から供給されろＩＭＨｚのり一ドイネープル（ｍ
号のタイミングによって読み出される。読み出されたデ
ータは、ｌ） ／ Ａ変換回路６においてＤ／Ａ変換さ
れてコンパレ〜り７の一力の端子に供給され、基準電圧
となるようにさねて（・る。 次に、−上記回路の一連の動作を説明する。 先ず初めに、転速すべき原稿の読取りに先＼°ｒつて白
紙の原稿をイメージセンサ１により走査することによっ
て、上記コンノくレータ７の基準電圧たるスライスレベ
ルを決定するためのシェーディング歪を読み取り、メモ
リ５に記憶させる。 この嚇合、Ａ／Ｄ変換回路３として低速系の回路が使用
されているため、タイミング発生回路４からはＡ／Ｄ変
換回路３に対して、イメージセンサ１を駆動ＩＭＨｚの
クロック信号φ。よりも遅い１００ＫＨｚのサンプリン
グ信号φ８が供給される。 Ａ／Ｄ変換回路３はこのサンプリング信号φ８のタイミ
ングによって、イメージセンサ１からのアナログビデオ
信号なＡ／Ｄ変換してメモリ５に送る。メモリ５は、タ
イミング発生回路４から供給されるサンプリング信号φ
８と同期したライトイネーブル信号（１００ＫＨｚ）に
よって、読取制御回路２によって指定されたアドレスに
、上記Ａ／Ｄ変換回路３からのデータを書き込む。 そして、イメージセンサ１によって原稿の同じところを
繰り返して走査し、かつサンプリングの位置なずらして
行く。これによって得られたデータをメモリ５の所定の
エリアに次々と曹き込んで行く。例えば、この実施例の
場合には、サンプリング速度（１００ＫＨｚ）がイメー
ジセンサ１の走査速度（ＩＭＨｚ）の１０分の１である
から、上述の走査及びデータのサンプリングを１０回繰
り返す。これによって、結局イメージセンサ１の走査速
度と同じ速度でＡ／Ｄ変換した場合と同じデータをメモ
リ５に記憶させることができる。 その結果、メモリ５にはファクシミリ読取部の光学系の
シェーディング歪と同じ傾向を持つデータがスライスレ
ベルとして格納される。 なお、このメモリ５へのデータの書込みは、例えばけい
光灯等の光源の交換の度ごとに行ｌＩつようにされてい
る。 このようにして、メモリ５に格納されたデータは転送す
べき原稿の読取り時に、リアルタイムで読み出される。 つまり、イメージセンサ１に供給されるクロック信号φ
。と同期して、タイミング発生回路４からメモリ５に供
給されるリードイネーブル信号（ＩＭＨｚ）によって、
次々とメモリ５からデータが読み出される。 読み出されたデータはＤ／Ａ変換回路６において、Ｄ／
Ａ変換されてコンパレータ７に出力される。 この際、１）／Ａ変換回路６はＡ／Ｄ変換回路３に比べ
て高速で信号変換することができるため、ＩＭＨｚの速
度でメモリ５から読み出されたデータをリアルタイムで
１）／Ａ変換することができる。 これによって、コンパレータ７には、イメージセンサ】
からのアナログビデオ信号と同期して基準電圧となるデ
ータ信号が供給される。このデータ信号は、光学系のシ
ェーディング歪と同じ傾向を持たされている。 その結果、アナログビデオ信号は、コンパレータ７にお
いて、第１図（ｂ）に破線Ｓで示されているようなスラ
イスレベルによって２値化される。２値化された信号は
、図示しない送信部に送られて変調された後、受信部へ
と転送される。 なお、第３図において鎖線Ａによって囲まれて（・る回
路は、メモリなど他の回路とは別個にＬＳＩ化すること
も可能である。 以上説明したように、本発明によれば、メモリへのデー
タの書込み速度と続出し速度とが異なっていても、シェ
ーディング歪に対応したスライスレベルを決定するため
のデータを全（支障なくメモリに記憶させることができ
る。しかも、原稿読取り時には、リアルタイムでメモリ
からデータな読み出してＤ／Ａ変換し、イメージセンサ
からのアナログビデオ信号と比較させることができる。 そのため、本発明装置では、複雑な高速系のＡ／Ｄ変換
回路を使う必要がなくなり、低速系のＡ／Ｄ変換回路で
済むので、回路設計が簡単になる。また、シェーディン
グ歪を補正するために行なわれる装置の各機構部分の調
整がほとんど必要なくなり、調整作業が極めて容易にな
るという効果を奏する。
オ信号は、読取制御回路２から一上記センサ１へ供給さ
れるＩＭＩ−１ｚ のようなりロック信号φ。 によって、低速系のＡ／Ｄ変換回路３へ送られる。 Ａ／Ｄ変換回路３は、タイミング発生回路４から供給さ
れる上記クロック信号φ。よりも遅い例えば１００ＫＨ
ｚのようなサンプリング信号φ８によって、イメージセ
ンサ１から出力されろアナログビデオ信号をＡ／Ｄ変換
してメモリ５に転送する。 メモリ５では、上記読取制御回路２から供給されるアド
レそ信号によって指定されるメモリエリアに、上記Ａ／
Ｄ変換回路３からのデータが格納される。このメモリ５
へのデータの書込みは、タイミング発生回路４からメモ
リ５に供給される一上記すンプリング信号φ８と同じ速
度（１００ＫＩ（ｚ）のライトイネーブル信号のタイミ
ングによって行なわれる。 また、上記メモリ５に格納さねたデー々は、タイミング
回路４から供給されろＩＭＨｚのり一ドイネープル（ｍ
号のタイミングによって読み出される。読み出されたデ
ータは、ｌ） ／ Ａ変換回路６においてＤ／Ａ変換さ
れてコンパレ〜り７の一力の端子に供給され、基準電圧
となるようにさねて（・る。 次に、−上記回路の一連の動作を説明する。 先ず初めに、転速すべき原稿の読取りに先＼°ｒつて白
紙の原稿をイメージセンサ１により走査することによっ
て、上記コンノくレータ７の基準電圧たるスライスレベ
ルを決定するためのシェーディング歪を読み取り、メモ
リ５に記憶させる。 この嚇合、Ａ／Ｄ変換回路３として低速系の回路が使用
されているため、タイミング発生回路４からはＡ／Ｄ変
換回路３に対して、イメージセンサ１を駆動ＩＭＨｚの
クロック信号φ。よりも遅い１００ＫＨｚのサンプリン
グ信号φ８が供給される。 Ａ／Ｄ変換回路３はこのサンプリング信号φ８のタイミ
ングによって、イメージセンサ１からのアナログビデオ
信号なＡ／Ｄ変換してメモリ５に送る。メモリ５は、タ
イミング発生回路４から供給されるサンプリング信号φ
８と同期したライトイネーブル信号（１００ＫＨｚ）に
よって、読取制御回路２によって指定されたアドレスに
、上記Ａ／Ｄ変換回路３からのデータを書き込む。 そして、イメージセンサ１によって原稿の同じところを
繰り返して走査し、かつサンプリングの位置なずらして
行く。これによって得られたデータをメモリ５の所定の
エリアに次々と曹き込んで行く。例えば、この実施例の
場合には、サンプリング速度（１００ＫＨｚ）がイメー
ジセンサ１の走査速度（ＩＭＨｚ）の１０分の１である
から、上述の走査及びデータのサンプリングを１０回繰
り返す。これによって、結局イメージセンサ１の走査速
度と同じ速度でＡ／Ｄ変換した場合と同じデータをメモ
リ５に記憶させることができる。 その結果、メモリ５にはファクシミリ読取部の光学系の
シェーディング歪と同じ傾向を持つデータがスライスレ
ベルとして格納される。 なお、このメモリ５へのデータの書込みは、例えばけい
光灯等の光源の交換の度ごとに行ｌＩつようにされてい
る。 このようにして、メモリ５に格納されたデータは転送す
べき原稿の読取り時に、リアルタイムで読み出される。 つまり、イメージセンサ１に供給されるクロック信号φ
。と同期して、タイミング発生回路４からメモリ５に供
給されるリードイネーブル信号（ＩＭＨｚ）によって、
次々とメモリ５からデータが読み出される。 読み出されたデータはＤ／Ａ変換回路６において、Ｄ／
Ａ変換されてコンパレータ７に出力される。 この際、１）／Ａ変換回路６はＡ／Ｄ変換回路３に比べ
て高速で信号変換することができるため、ＩＭＨｚの速
度でメモリ５から読み出されたデータをリアルタイムで
１）／Ａ変換することができる。 これによって、コンパレータ７には、イメージセンサ】
からのアナログビデオ信号と同期して基準電圧となるデ
ータ信号が供給される。このデータ信号は、光学系のシ
ェーディング歪と同じ傾向を持たされている。 その結果、アナログビデオ信号は、コンパレータ７にお
いて、第１図（ｂ）に破線Ｓで示されているようなスラ
イスレベルによって２値化される。２値化された信号は
、図示しない送信部に送られて変調された後、受信部へ
と転送される。 なお、第３図において鎖線Ａによって囲まれて（・る回
路は、メモリなど他の回路とは別個にＬＳＩ化すること
も可能である。 以上説明したように、本発明によれば、メモリへのデー
タの書込み速度と続出し速度とが異なっていても、シェ
ーディング歪に対応したスライスレベルを決定するため
のデータを全（支障なくメモリに記憶させることができ
る。しかも、原稿読取り時には、リアルタイムでメモリ
からデータな読み出してＤ／Ａ変換し、イメージセンサ
からのアナログビデオ信号と比較させることができる。 そのため、本発明装置では、複雑な高速系のＡ／Ｄ変換
回路を使う必要がなくなり、低速系のＡ／Ｄ変換回路で
済むので、回路設計が簡単になる。また、シェーディン
グ歪を補正するために行なわれる装置の各機構部分の調
整がほとんど必要なくなり、調整作業が極めて容易にな
るという効果を奏する。
第１図（ａ）、 （ｂ）はイメージセンサの出力信号の
シェーディング歪および出力波形例な示す波形図、第２
図は従来提案されているファクシミリ用データ処理装置
の一例を示すブロック図、第３図は本発明に係るデータ
処理装置の一実施例を示すブロック図である。 １・・フォトセンサ（イメージセンサ）、３・・Ａ／Ｄ
変換回路、５・・メモリ、６・・・Ｄ／Ａ変換回路、７
コンパレータ。 代理人 弁理士 薄 １）利 幸。 ゛・１ 、′、′ノ ・ ｌ′
シェーディング歪および出力波形例な示す波形図、第２
図は従来提案されているファクシミリ用データ処理装置
の一例を示すブロック図、第３図は本発明に係るデータ
処理装置の一実施例を示すブロック図である。 １・・フォトセンサ（イメージセンサ）、３・・Ａ／Ｄ
変換回路、５・・メモリ、６・・・Ｄ／Ａ変換回路、７
コンパレータ。 代理人 弁理士 薄 １）利 幸。 ゛・１ 、′、′ノ ・ ｌ′
Claims (1)
- フォトセンサから出力されるアナログビデオ信号が所定
の基準値と比較されてディジタル化され、転送されるよ
う圧されているファクシミリにおいて、上記フォトセン
サからのアナログビデオ信号をＡ／Ｄ変換するためのＡ
／Ｄ変換回路と、このＡ／Ｄ変換回路からのデータを記
憶することにより上記フォトセンサの信号のシェーディ
ング歪に対応したスライスレベルを決定するデータを記
憶するメモリとこのメモリから読み出さねたデータなり
／Ａ変換するＩ）／Ａ変換回路とを備え、上記メモリへ
のデータの書込みおよび読出しが、それぞれ異なる速度
で行なわれるようにされてなることを特徴とするファク
シミリ用データ処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57024442A JPS58142674A (ja) | 1982-02-19 | 1982-02-19 | フアクシミリ用デ−タ処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57024442A JPS58142674A (ja) | 1982-02-19 | 1982-02-19 | フアクシミリ用デ−タ処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58142674A true JPS58142674A (ja) | 1983-08-24 |
Family
ID=12138250
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57024442A Pending JPS58142674A (ja) | 1982-02-19 | 1982-02-19 | フアクシミリ用デ−タ処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58142674A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01204568A (ja) * | 1988-02-10 | 1989-08-17 | Mitsubishi Electric Corp | スライスレベル自動調整読取信号処理装置 |
-
1982
- 1982-02-19 JP JP57024442A patent/JPS58142674A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01204568A (ja) * | 1988-02-10 | 1989-08-17 | Mitsubishi Electric Corp | スライスレベル自動調整読取信号処理装置 |
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