JPS58120290A - 画像表示装置 - Google Patents
画像表示装置Info
- Publication number
- JPS58120290A JPS58120290A JP243982A JP243982A JPS58120290A JP S58120290 A JPS58120290 A JP S58120290A JP 243982 A JP243982 A JP 243982A JP 243982 A JP243982 A JP 243982A JP S58120290 A JPS58120290 A JP S58120290A
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- JP
- Japan
- Prior art keywords
- column
- row
- image display
- scroll
- memory
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は画像表示メモリから順次画像データを読出し
て表示画面にスクロール表示する画像表示装置に関する
ものである。なお、ここで画１家とは文字、数字、記号
、符号等を含むものとする。
て表示画面にスクロール表示する画像表示装置に関する
ものである。なお、ここで画１家とは文字、数字、記号
、符号等を含むものとする。
従来、この神のｍ沫表示装置は、表示用のメモリとは別
にバッファーメモリとして少なくとも１行分以上の画像
ラインメモリを用意していた。−例としてスクロールア
ンプする場合を第１図に示す。スクロール入力しようと
する新データを表示期間の外にあるラインバッファーメ
モリに書キ込んだ後にスクロールアップする方法が一般
である。
にバッファーメモリとして少なくとも１行分以上の画像
ラインメモリを用意していた。−例としてスクロールア
ンプする場合を第１図に示す。スクロール入力しようと
する新データを表示期間の外にあるラインバッファーメ
モリに書キ込んだ後にスクロールアップする方法が一般
である。
なお、第１図において、ムは最下行に現わ扛る賀データ
を示し、Ａ′は最下行よシ消滅するデータを示す。従っ
て表示に必要なメモリとは別に少なくとも１行分余計に
メモリを用意するという無駄があった。
を示し、Ａ′は最下行よシ消滅するデータを示す。従っ
て表示に必要なメモリとは別に少なくとも１行分余計に
メモリを用意するという無駄があった。
この発明の目的は、画像表示メモリの一部をト記バッフ
ァーメモリ用として利用することによって画像表示メモ
リの容量Ω無駄を省き、しかも画像表示データのヌクロ
ール表示を行わせることができる画像表示装置を提供す
ることである。
ァーメモリ用として利用することによって画像表示メモ
リの容量Ω無駄を省き、しかも画像表示データのヌクロ
ール表示を行わせることができる画像表示装置を提供す
ることである。
以ｒ、本発明を第２図に示す実施例に基いて説明する。
第２図において、１は列（または水平）アドレスカウン
タ、２は列スクロールアドレス検出回路、３は列アドレ
ス変換回路、４は行（または垂直）アドレスカウンタ、
６は行スクロールアドレス検出回路、６は行アドレス変
換回路、７は読み出される画像表示メモリ、８はスクロ
ール表示タイミング回路、９はシフトレジスタである。
タ、２は列スクロールアドレス検出回路、３は列アドレ
ス変換回路、４は行（または垂直）アドレスカウンタ、
６は行スクロールアドレス検出回路、６は行アドレス変
換回路、７は読み出される画像表示メモリ、８はスクロ
ール表示タイミング回路、９はシフトレジスタである。
画像表示メモリ７のサイズを列方向Ｘ行９行方向Ｙとす
る。（実際にはメモリはジ−ケンシャ！しなものである
が２次元と考えることは可能である。）通常の（ヌクロ
ール表示しない）表示の状態は列および行アドレスカウ
ンタ１および４の初期設定軸は水平帰線期ｒｉ’ｌにお
いて上口設定される。カウント出力は表示期間にてゼロ
からｘ−１，及びＹ〜１まで１ずつ計数され、この範囲
内のカウント出力では列および行スクロールアドレス検
出回路２および６の出力はノンアクティブである様に構
成されているので、カウント出力は列およヒ行アドレス
変換回路３および６にて影智されず、画像表示メモリ７
を直接アクセスする。この時はスクロール表示タイミン
グ回路８の出力も全表示期間にわたってシフトレジスタ
９をアクティブにする様に働く。
る。（実際にはメモリはジ−ケンシャ！しなものである
が２次元と考えることは可能である。）通常の（ヌクロ
ール表示しない）表示の状態は列および行アドレスカウ
ンタ１および４の初期設定軸は水平帰線期ｒｉ’ｌにお
いて上口設定される。カウント出力は表示期間にてゼロ
からｘ−１，及びＹ〜１まで１ずつ計数され、この範囲
内のカウント出力では列および行スクロールアドレス検
出回路２および６の出力はノンアクティブである様に構
成されているので、カウント出力は列およヒ行アドレス
変換回路３および６にて影智されず、画像表示メモリ７
を直接アクセスする。この時はスクロール表示タイミン
グ回路８の出力も全表示期間にわたってシフトレジスタ
９をアクティブにする様に働く。
今、上方向（行方向）のスクロールを考える。
この時は画像表示メモリ７の最下行メモリをスクロール
用のバッファメモリとして利用する。スクロール表示す
る最初の１行の新データを最下行メモリに書込む。続い
てスクロール表示タイミング回路８の設定値を変えて画
像表示メモリ７の最下行メモリだけを非表示にする。そ
して行アドレスカウンタ４の初期設定値を０から１に変
四する。
用のバッファメモリとして利用する。スクロール表示す
る最初の１行の新データを最下行メモリに書込む。続い
てスクロール表示タイミング回路８の設定値を変えて画
像表示メモリ７の最下行メモリだけを非表示にする。そ
して行アドレスカウンタ４の初期設定値を０から１に変
四する。
これによって画像表示メモリ７は第２（ｊより読み出さ
れることになる。カウント出力は１からＹまでの範囲を
計数し、０からＹ−１までの範囲ではノンアクティブで
あった行スクロールアドレス検出回路５の出力は計数値
がＹの時にアクティブになり、行アドレス変換回路６に
てこの値は０に変換される。（これは簡単な論堆回路に
て実現でき−る。） 従って、画像表示メモリ７の第１行データは表小画面」
二の最下行に位置することになるが、表示ｌｌ４ｑ而」
二の最下行はスクロール表示タイミング回路８にて非表
示状態にされているので、上スクロールによって最下行
よシロールオーバーしたデータは表示画面上より消える
。以後、同様の処理を繰り返すことによって最下行の隠
れた行メモリより、人力・ら次へと新しいデータが現わ
れ、上ヌクロールが実現できる。スクロールが終了すれ
ば最下行の非表示制約を解くことによシ、全画面表示に
戻る。
れることになる。カウント出力は１からＹまでの範囲を
計数し、０からＹ−１までの範囲ではノンアクティブで
あった行スクロールアドレス検出回路５の出力は計数値
がＹの時にアクティブになり、行アドレス変換回路６に
てこの値は０に変換される。（これは簡単な論堆回路に
て実現でき−る。） 従って、画像表示メモリ７の第１行データは表小画面」
二の最下行に位置することになるが、表示ｌｌ４ｑ而」
二の最下行はスクロール表示タイミング回路８にて非表
示状態にされているので、上スクロールによって最下行
よシロールオーバーしたデータは表示画面上より消える
。以後、同様の処理を繰り返すことによって最下行の隠
れた行メモリより、人力・ら次へと新しいデータが現わ
れ、上ヌクロールが実現できる。スクロールが終了すれ
ば最下行の非表示制約を解くことによシ、全画面表示に
戻る。
トスクロール、左右スクロールについても、同（十の方
法にて実現できるし、更に組み合せて斜め方向のスクロ
ールも可能である。
法にて実現できるし、更に組み合せて斜め方向のスクロ
ールも可能である。
以１−のように本発明は余分のバッファーメモリを用意
することなく画像表示メモリのスクロールｂｌＪ−ζを
１’＋ｆ能とするもので、構成のｆｌｉＪ単な低コスト
の１…１１家表示装置１！ｔを実現するうえで、多大の
効果をもたらすものである。
することなく画像表示メモリのスクロールｂｌＪ−ζを
１’＋ｆ能とするもので、構成のｆｌｉＪ単な低コスト
の１…１１家表示装置１！ｔを実現するうえで、多大の
効果をもたらすものである。
第１図はスクロール表示フ”を、況明するだめの概略図
、第２図は本発明の一実／ｍ例のゾロツク図である。 １・・・・・・列アドレスカウンタ、２・・・・・・Ｉ
／１］スクロールアドレス検出回路、３・・・・・・列
アドレス変換回路、４・・・・・・行アドレスカウンタ
、５・・・・・・行スクロールアドレス検出回路、６・
・・・・・行アドレス変換回路、７・・・・・・画像表
示メモリ、８・・・・・・ヌクロール表示タイミンク回
路、９・・・・・・シフトレジスタ。 代理人の氏名 ４Ｃ理十 中 尾 敏 男 ほか１名第
１図 Ａ′ ［２図
、第２図は本発明の一実／ｍ例のゾロツク図である。 １・・・・・・列アドレスカウンタ、２・・・・・・Ｉ
／１］スクロールアドレス検出回路、３・・・・・・列
アドレス変換回路、４・・・・・・行アドレスカウンタ
、５・・・・・・行スクロールアドレス検出回路、６・
・・・・・行アドレス変換回路、７・・・・・・画像表
示メモリ、８・・・・・・ヌクロール表示タイミンク回
路、９・・・・・・シフトレジスタ。 代理人の氏名 ４Ｃ理十 中 尾 敏 男 ほか１名第
１図 Ａ′ ［２図
Claims (1)
- ｎ枚（ただし、ｎ≧１）の画像表示メモリを持ち、該画
像表示メモリをアクセスするアドレスを生成するプリセ
ット可能な行（または垂直）および列（または水平）ア
ドレスカウンタと、前記性１・・よび列アドレスカウン
タの出力が一定範囲内か：１ｉｉｉ囲外かを検出する行
および列スクロールアドレス検出回路と、前記性および
列スクロールアドレス検出回路の各出力が入力されてア
ドレスカウント出力を変換し、画像表示データの最左列
と最右列、同様に最」１行と最下行とが連続性を保つよ
うにする行および列アドレス変換回路と、スクロール方
向に従って最左列、最右列、最上行または最下行の期間
を表示しない様にするスクロール表示タイミンク回路を
備えてなる画像表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP243982A JPS58120290A (ja) | 1982-01-11 | 1982-01-11 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP243982A JPS58120290A (ja) | 1982-01-11 | 1982-01-11 | 画像表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58120290A true JPS58120290A (ja) | 1983-07-18 |
Family
ID=11529300
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP243982A Pending JPS58120290A (ja) | 1982-01-11 | 1982-01-11 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58120290A (ja) |
-
1982
- 1982-01-11 JP JP243982A patent/JPS58120290A/ja active Pending
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