JPS58102520A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

Info

Publication number
JPS58102520A
JPS58102520A JP20126181A JP20126181A JPS58102520A JP S58102520 A JPS58102520 A JP S58102520A JP 20126181 A JP20126181 A JP 20126181A JP 20126181 A JP20126181 A JP 20126181A JP S58102520 A JPS58102520 A JP S58102520A
Authority
JP
Japan
Prior art keywords
pattern
photosensitive resin
photoresist
metal layer
forming
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP20126181A
Other languages
English (en)
Inventor
Hiroaki Mukohara
向原 広章
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP20126181A priority Critical patent/JPS58102520A/ja
Publication of JPS58102520A publication Critical patent/JPS58102520A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Electrodes Of Semiconductors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は半導体装置の製造方法、特に半導体基板を選択
的に食刻して凹形領域を設け、ここに電極金属を形成す
る方法に関するものである。
従来、高出力を得る丸めに半導体基板、例えばガリウム
ーヒ素基板を選択的に食刻し、しかるのちの食刻領域に
電極形成をおこなうことが知られている。しかしながら
この方法では、ガリウムーヒ素基板に食刻され九凹部領
域が微小であること、および凹部領域に精度よく電極金
属を形成しなければないこと等を注意しなければならな
いが、フォトレジスト工程における目合せズレ、フォト
マスクと半導体基板とのピッチズレ、及び電極金属エツ
チング時のアンダーカット等が生じ、目的に沿り九電極
を形成することが困難であった。
そこでこの欠点をとシのぞ〈丸め、フォトレジスト工程
での目金露光において、顕微鏡の倍率を上げる。また基
板をできるだけ平坦にする。高精度のフォトマスクを使
用する、あるいはフォトレジストと基板もしくは表面保
膜膜との密着性を強くする等の対策をおこなっていた。
しかしながら、かかる対、策において4精変の問題は完
全に解決されてはおらず、逆に処理時間が長くなること
、およびフォトレジストの密着性も弱くなること等の弊
害を生じていえ。
本発明の目的は、電極エツチング時のアンダーカットや
フォトマスクの位置ズレを除去し精度よく金属層を形成
する方法を提供することにある。
以下本発明の一実施例を図面を参照して詳しく説明する
。第1図乃至@5図は1本発明の一実施例におけるその
製造順の各工程における断面図である。
まず第1図に示すように、半導体基板l(本実施例では
ガリウムーヒ素基板)に絶縁膜2(本実施例では、ポリ
イミド樹脂)を約5000A8度形成し、これを150
℃及び300℃で熱処理する0次に、ポジ型レジスト3
を形成し、フォトマスクを用いて、選択的に光照射をお
こなう。(本実施例では、開口部4は約1μ)。次にこ
れを熱処理したのち、酸素プラズマ中で開口部のポリイ
ミド樹脂を精度よく窓開けし、フォトマスクと同じ寸法
の開口部を形成する。しかるのち基板を電解液(本実施
例では5%酒石酸溶液)中で反応させ、開口部に対応す
る基板を食刻する(第2図)。
次に、前記開口部4を有するフォトレジスト上にさらに
ネガ型の7オトレジスト5を形成し、フォトマスクを使
用して開口部4よシ広いパターン4′を窓開けする(本
実施例では約3μのパターンをドライ現像法で実現し九
)。しかるのちネガ型および開口部のポジ型レジストを
酸素プラズマで除去する。そめ後真空蒸着法等によシ金
属層6(本実施例ではアルミニウム)を形成する(第4
図)。
しかるのち残され九ポジ型フォトレジストを除去する時
、同時にその上の金属層を除去(リフトオフ)して所望
の電極パターン6′を形成する。
本方法を採用することによシ、従来実施していた半導体
基板に絶縁膜を形成し、基板を7オトレジストエ程で選
択的にウェット方法で食刻し、しかるのち金属層を形成
して金属をパターニングする方法よシ精度よく電極を、
形成することを可能となした。即ち、電極のパターニン
グではエツチング除去を採用しておらず、その丸めにア
ンダーカット口やマスクズレは生じない。さらに処理工
程の短縮1種々の薬品の削減等の効果が期待できるとい
う製造上の効果も大きい。
なお本実施例は半導体基板としてガリウムーヒ素の場合
について述べたが、シリコン等地の半導体基板で本同様
の効果を得ることができる。また絶縁膜としてはポリイ
ミド樹脂を使用し九個を示したが、酸化膜や窃化膜等で
屯よい。さらに、フォトレジストとしてはネガ型および
ポジ型の順序を入れか、えて使用してもよい。
【図面の簡単な説明】
第1図乃至第5図は本発明の一実施例を説明する九めの
各工程断面図である。 1・・・・・・半導体基板、2・・・・・・ポリイミド
樹脂、3・・・・・・ポジ型フォトレジスト、4.4’
・・・・・・フォトレジスト、ポリイミド及び基板の開
口部、5・旧・・ネガ型フォトレジスト、6.6’・・
・・・・アルミニウム層。 半1図 *zm 半3図 j4+図 峯ダ旧 83−

Claims (1)

    【特許請求の範囲】
  1. 半導体基板上に絶縁膜を形成する工程と、該絶縁膜上に
    感光性樹脂を形成し選択的に第1のパターンを窓開けす
    る工程と、該窓開けされた領域に相当する前記絶縁膜を
    除去する工程と、除去され九部分に相当する領域の前記
    半導体基板に凹部を形成する工程と、@2の感光性W@
    を形成しこれに前記第1の微小パターンを含むようにそ
    れより大きい第2のパターンを窓開けする工程と、該第
    2の感光性樹脂をマスクとして前記第1の感光性樹脂を
    除去する工程と、この除去を含めて前記第2の感光性樹
    脂上に金属層を形成する工程と、前記第1および第2の
    感光性樹脂上の金属層を除去する工程とを含むことを特
    徴とする早導体装蓋の製造方法。
JP20126181A 1981-12-14 1981-12-14 半導体装置の製造方法 Pending JPS58102520A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP20126181A JPS58102520A (ja) 1981-12-14 1981-12-14 半導体装置の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP20126181A JPS58102520A (ja) 1981-12-14 1981-12-14 半導体装置の製造方法

Publications (1)

Publication Number Publication Date
JPS58102520A true JPS58102520A (ja) 1983-06-18

Family

ID=16438007

Family Applications (1)

Application Number Title Priority Date Filing Date
JP20126181A Pending JPS58102520A (ja) 1981-12-14 1981-12-14 半導体装置の製造方法

Country Status (1)

Country Link
JP (1) JPS58102520A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113539806A (zh) * 2020-04-15 2021-10-22 苏州能讯高能半导体有限公司 电极的制造方法、电极及半导体器件

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113539806A (zh) * 2020-04-15 2021-10-22 苏州能讯高能半导体有限公司 电极的制造方法、电极及半导体器件

Similar Documents

Publication Publication Date Title
EP0265638A2 (en) Lithographic image size reduction
GB1457924A (en) Manufacturing processes using photoresist masks
EP0072933B1 (en) Method for photolithographic pattern generation in a photoresist layer
JPS58102520A (ja) 半導体装置の製造方法
JPS633453B2 (ja)
WO1983003485A1 (en) Electron beam-optical hybrid lithographic resist process
JPS5950053B2 (ja) 写真蝕刻方法
US20040002218A1 (en) Method for patterning dense and isolated features on semiconductor devices
JPS5828735B2 (ja) ハンドウタイソウチノセイゾウホウホウ
JPS6191948A (ja) 半導体装置の製造方法
JPS6386550A (ja) 多層配線層の形成方法
JPH01189923A (ja) 半導体装置の製造方法
JPH06338452A (ja) レジストパタ−ンの形成方法
JPS6359540B2 (ja)
JP2811724B2 (ja) エッチング方法
KR100239435B1 (ko) 반도체 소자의 제조 방법
KR100289664B1 (ko) 노광 마스크의 제조방법
JPS5984529A (ja) パタ−ン形成方法
KR0134109B1 (ko) 반도체소자의 콘택홀 제조방법
KR100396689B1 (ko) 반도체소자의게이트제조방법
JPH03203239A (ja) 半導体装置の製造方法
JPH0282527A (ja) 半導体装置の製造方法
JPS62277746A (ja) 半導体装置の製造方法
JPS59211232A (ja) 半導体装置における金属層パタ−ンの形成方法
JPS6175525A (ja) 微細加工方法