JPH10228442A - ダイレクト・メモリ・アクセスによるデータ受信装置,方法および記憶媒体 - Google Patents

ダイレクト・メモリ・アクセスによるデータ受信装置,方法および記憶媒体

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JPH10228442A
JPH10228442A JP9032120A JP3212097A JPH10228442A JP H10228442 A JPH10228442 A JP H10228442A JP 9032120 A JP9032120 A JP 9032120A JP 3212097 A JP3212097 A JP 3212097A JP H10228442 A JPH10228442 A JP H10228442A
Authority
JP
Japan
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data
receiving
received
length
memory access
Prior art date
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Withdrawn
Application number
JP9032120A
Other languages
English (en)
Inventor
Takeaki Nakano
武秋 中野
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Canon Inc
Original Assignee
Canon Inc
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Filing date
Publication date
Application filed by Canon Inc filed Critical Canon Inc
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Priority to US09/024,866 priority patent/US6151642A/en
Publication of JPH10228442A publication Critical patent/JPH10228442A/ja
Withdrawn legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/20Handling requests for interconnection or transfer for access to input/output bus
    • G06F13/28Handling requests for interconnection or transfer for access to input/output bus using burst mode transfer, e.g. direct memory access DMA, cycle steal

Abstract

(57)【要約】 【課題】 ダイレクト・メモリ・アクセス(DMA)に
よるデータ受信において、予め設定されたデータ長に満
たないデータを受信した場合にも、受信したデータの内
容を確認できるダイレクト・メモリ・アクセスによる受
信装置,方法および記憶媒体を提供する。 【解決手段】 ホストコンピュータからyバイトのデー
タを受信した場合に、MPU1に割込み要求を出しDM
A処理を行う受信装置において、ホストコンピュータか
ら送信されてくるデータの長さがyバイトに満たないと
きに、データ内容が確認できるよう、データの長さyバ
イトの他にxバイトも設定し(S1,S2)、ホストコ
ンピュータからデータをxバイト受信した割込み要求を
出す(S5)。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、ダイレクト・メモ
リ・アクセスによるデータ受信装置,方法および記憶媒
体に関するものである。
【0002】
【従来の技術】従来のダイレクト・メモリ・アクセス
(以下DMAと記す)データ受信では、予め受信するデ
ータ長を設定し、設定されたデータ長のデータを受信し
た場合に、マイクロ・プロセッサ・ユニット(以下MP
Uと記す)に対して割り込みを要求していた。
【0003】
【発明が解決しようとする課題】前述のように、従来の
DMAデータ受信では、予め受信するデータ長を設定
し、設定されたデータ長のデータを受信した場合にの
み、MPUに対して割り込みを要求していたため、設定
されたデータ長に満たないデータを受信した場合に、M
PUに対して割り込みを要求することができなかった。
【0004】本発明の目的は、このような従来の問題に
着目し、その解決を図るべく、DMAによるデータ受信
において、予め設定されたデータ長に満たないデータを
受信した場合にも、受信したデータの内容を確認できる
ダイレクト・メモリ・アクセスによる受信装置,方法お
よび記憶媒体を提供することにある。
【0005】
【課題を解決するための手段】前記目的を達成するた
め、本発明では、ダイレクト・メモリ・アクセスによる
データ受信装置を次の(1)のとおりに、ダイレクト・
メモリ・アクセスによるデータ受信方法を次の(2)の
とおりに、また、記憶媒体を次の(3)のとおりに構成
する。
【0006】(1)ホストコンピュータに接続する接続
手段と、ホストコンピュータから送信されてくるデータ
を受信する受信手段と、受信データをランダム・アクセ
ス・メモリの予め設定されたアドレスに転送する転送手
段と、受信するデータ長を設定する設定手段と、この設
定手段に設定された第1のデータ長のデータを受信した
場合に、MPUに対して割込みを要求する第1の割込み
要求手段と、受信したデータが第1のデータ長に満たな
い前記設定手段に設定された第2のデータ長のデータを
受信している場合に、前記MPUに対して割込みを要求
する第2の割込み要求手段と、受信データを判別する判
別手段とを具備するダイレクト・メモリ・アクセスによ
るデータ受信装置。
【0007】(2)ダイレクト・メモリ・アクセスによ
るデータ受信装置についてのデータ受信方法であって、
受信する第1のデータ長を設定するステップと、前記第
1のデータ長より短い、受信する第2のデータ長を設定
するステップと、前記第1のデータ長のデータを受信し
たときMPUに割込み要求をするステップと、前記第2
のデータ長のデータを受信したときMPUに割込み要求
をするステップとを備えたダイレクト・メモリ・アクセ
スによるデータ受信方法。
【0008】(3)前記(2)記載のダイレクト・メモ
リ・アクセスによるデータ受信方法を実現するためのプ
ログラムを格納した記憶媒体。
【0009】
【発明の実施の形態】以下本発明の実施の形態を“ダイ
レクト・メモリ・アクセスによるデータ受信装置”の実
施例により詳しく説明する。なお本発明は、データ受信
装置に限らず、ダイレクト・メモリ・アクセスによるデ
ータ受信方法、およびこの方法を実現するためのプログ
ラムを格納した記憶媒体の形で実施することができる。
【0010】
【実施例】図1は実施例である“ダイレクト・メモリ・
アクセスによる受信装置”のブロック構成図である。
【0011】マイクロ・プロセッサ・ユニット(MP
U)1は、リード・オンリー・メモリ(以下ROMと記
す)2に内蔵されたプログラムに従い、本受信装置全体
の制御を行う。ランダム・アクセス・メモリ(以下RA
Mと記す)3は、MPU1のワークエリア、受信したデ
ータの記憶領域等に使用される。ホストコンピュータ接
続部4は、ホストコンピュータとのデータ送受信に必要
な制御を行う。受信データ長設定部5は、ホストコンピ
ュータから送信されてくるデータのデータ長を設定す
る。受信データ転送アドレス設定部6は、受信データを
RAM2上に転送する際に必要な転送先のアドレスを設
定する。データ受信部7はホストコンピュータからデー
タを受信し、受信データ転送アドレス設定部6によって
設定されたアドレスから順次受信データをRAM3に転
送していく。受信データ長計数部8は受信したデータの
長さを計数し、それが受信データ長設定部5において設
定したデータ長に達したらMPU1に対して割り込み要
求をする。データ判別部9は受信データの判別を行う。
システムバス10は前述の各構成部をつなぐバスであ
る。
【0012】以上の構成において、本受信装置の受信動
作を図2のフローチャートを参照して以下に説明する。
なお、これらのフローチャートの手順は、MPU1がR
OM2に格納されたプログラムを実行することで実現さ
れる。
【0013】実施例として、本受信装置が、ホストコン
ピュータからデータ長yバイトのデータを受信する場合
における、受信動作の流れを示す。ここで、ホストコン
ピュータから送信されてくるデータの長さの最小値をx
とし、各データの第一バイト目にはそのデータの長さ、
すなわちx,y等の値が入っているものとする。
【0014】まず、ステップS1でホストコンピュータ
からデータをyバイト受信した場合にMPU1に割り込
み要求をするように設定する。ステップS2で受信途中
でデータの内容を確認するために、ホストコンピュータ
からデータをxバイト受信した場合にMPU1に割り込
み要求をするように設定する。ステップS3で受信デー
タを転送するRAM3のアドレスを設定する。ステップ
S4で受信を開始する。ステップS5では、xバイト受
信による割り込み要求を待っている。ホストコンピュー
タからデータをxバイト受信したとき、MPU1に割り
込み要求がなされ、ステップS6に進む。ステップS6
では受信したデータの第一バイトを判別する。もし、第
一バイトがyでなかったならば、ステップS7で受信を
終了してステップS1に戻る。第一バイトがyである場
合にはステップS8に進む。ステップS8ではyバイト
受信による割り込み要求を待っている。yバイト受信に
よる割り込み要求があったら、ステップS7で受信を終
了してステップS1に戻る。
【0015】以上説明したように、本実施例によれば、
予め設定したyバイトに満たないデータを受信した場合
にも、MPUに割り込み要求をし、受信したデータの内
容を確認できる。
【0016】
【発明の効果】以上説明したように、本発明によれば、
ホストコンピュータからのDMAによるデータ受信にお
いて、予め設定されたデータ長に満たないデータを受信
した場合にも、MPUに割り込み要求をし受信したデー
タの内容を確認することを可能にすることで、データ通
信中に何らかの障害によって、本来受信すべきデータが
喪失した場合に、次のデータ受信における処理をより早
く行うことができる。
【図面の簡単な説明】
【図1】 実施例のブロック図
【図2】 受信動作を示すフローチャート
【符号の説明】
1 マイクロ・プロセッサ・ユニット(MPU) 4 ホストコンピュータ接続部 5 受信データ長設定部 7 データ受信部 8 受信データ長計数部 9 データ判別部

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】 ホストコンピュータに接続する接続手段
    と、ホストコンピュータから送信されてくるデータを受
    信する受信手段と、受信データをランダム・アクセス・
    メモリの予め設定されたアドレスに転送する転送手段
    と、受信するデータ長を設定する設定手段と、この設定
    手段に設定された第1のデータ長のデータを受信した場
    合に、MPUに対して割込みを要求する第1の割込み要
    求手段と、受信したデータが第1のデータ長に満たない
    前記設定手段に設定された第2のデータ長のデータを受
    信している場合に、前記MPUに対して割込みを要求す
    る第2の割込み要求手段と、受信データを判別する判別
    手段とを具備することを特徴とするダイレクト・メモリ
    ・アクセスによるデータ受信装置。
  2. 【請求項2】 ダイレクト・メモリ・アクセスによるデ
    ータ受信装置についてのデータ受信方法であって、受信
    する第1のデータ長を設定するステップと、前記第1の
    データ長より短い、受信する第2のデータ長を設定する
    ステップと、前記第1のデータ長のデータを受信したと
    きMPUに割込み要求をするステップと、前記第2のデ
    ータ長のデータを受信したときMPUに割込み要求をす
    るステップとを備えたことを特徴とするダイレクト・メ
    モリ・アクセスによるデータ受信方法。
  3. 【請求項3】 請求項2記載のダイレクト・メモリ・ア
    クセスによるデータ受信方法を実現するためのプログラ
    ムを格納したことを特徴とする記憶媒体。
JP9032120A 1997-02-17 1997-02-17 ダイレクト・メモリ・アクセスによるデータ受信装置,方法および記憶媒体 Withdrawn JPH10228442A (ja)

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Application Number Priority Date Filing Date Title
JP9032120A JPH10228442A (ja) 1997-02-17 1997-02-17 ダイレクト・メモリ・アクセスによるデータ受信装置,方法および記憶媒体
US09/024,866 US6151642A (en) 1997-02-17 1998-02-17 System for DMA data reception capable of confirming the content of a received data even if the received data is less than a preset length

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP9032120A JPH10228442A (ja) 1997-02-17 1997-02-17 ダイレクト・メモリ・アクセスによるデータ受信装置,方法および記憶媒体

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JPH10228442A true JPH10228442A (ja) 1998-08-25

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Application Number Title Priority Date Filing Date
JP9032120A Withdrawn JPH10228442A (ja) 1997-02-17 1997-02-17 ダイレクト・メモリ・アクセスによるデータ受信装置,方法および記憶媒体

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Publication number Priority date Publication date Assignee Title
US6560652B1 (en) * 1998-11-20 2003-05-06 Legerity, Inc. Method and apparatus for accessing variable sized blocks of data

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6052468B2 (ja) * 1982-03-04 1985-11-19 株式会社東芝 Dmaバス負荷可変装置
US5386532A (en) * 1991-12-30 1995-01-31 Sun Microsystems, Inc. Method and apparatus for transferring data between a memory and a plurality of peripheral units through a plurality of data channels
US5412782A (en) * 1992-07-02 1995-05-02 3Com Corporation Programmed I/O ethernet adapter with early interrupts for accelerating data transfer
US5983275A (en) * 1994-05-04 1999-11-09 Cirrus Logic, Inc. Apparatus for and method of providing interrupts to a host processor in a frame receiving system

Also Published As

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US6151642A (en) 2000-11-21

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