JPH0870248A - パルス発生回路 - Google Patents
パルス発生回路Info
- Publication number
- JPH0870248A JPH0870248A JP6203863A JP20386394A JPH0870248A JP H0870248 A JPH0870248 A JP H0870248A JP 6203863 A JP6203863 A JP 6203863A JP 20386394 A JP20386394 A JP 20386394A JP H0870248 A JPH0870248 A JP H0870248A
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- JP
- Japan
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- circuit
- reference signal
- phase
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- signal
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- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Abstract
(57)【要約】
【目的】 本発明は、ある基準とする信号から温度によ
りその精度を低下させることなく任意の位相と幅とを有
する信号を作ることを目的とする。 【構成】 選択されたパルスのモードの基準信号を基準
信号制御用データｋを用いてＰＬＬ回路用基準信号発生
回路１１で発生させＰＬＬ回路用基準信号ｅとしてＰＬ
Ｌ回路１２に送る。ＰＬＬ回路１２においてＰＬＬ回路
用基準信号ｅからモードの基準信号と同位相のＰＬＬ回
路出力基準信号ｄとクロックｇを発生させ位相制御回路
１３と幅制御回路１４に送る。位相制御回路１３と幅制
御回路１４において位相制御用データｉと幅制御用デー
タｊにより位相と幅を制御されたパルス発生回路出力信
号ｈを発生させる。
りその精度を低下させることなく任意の位相と幅とを有
する信号を作ることを目的とする。 【構成】 選択されたパルスのモードの基準信号を基準
信号制御用データｋを用いてＰＬＬ回路用基準信号発生
回路１１で発生させＰＬＬ回路用基準信号ｅとしてＰＬ
Ｌ回路１２に送る。ＰＬＬ回路１２においてＰＬＬ回路
用基準信号ｅからモードの基準信号と同位相のＰＬＬ回
路出力基準信号ｄとクロックｇを発生させ位相制御回路
１３と幅制御回路１４に送る。位相制御回路１３と幅制
御回路１４において位相制御用データｉと幅制御用デー
タｊにより位相と幅を制御されたパルス発生回路出力信
号ｈを発生させる。
Description
【０００１】
【産業上の利用分野】本発明は、ある基準とする信号か
ら任意の位相と幅とを有する信号を作ることを目的とし
たパルス発生回路に関するものである。
ら任意の位相と幅とを有する信号を作ることを目的とし
たパルス発生回路に関するものである。
【０００２】
【従来の技術】図２に、従来のパルス発生回路のブロッ
ク図一例を示す。
ク図一例を示す。
【０００３】従来のパルス発生回路では、ある基準とす
る信号から任意の位相と幅とを有する信号を作ろうとす
るときには、マイコンからの信号で電圧制御回路を制御
し、この電圧制御回路が制御する電圧と抵抗やコンデン
サーを用いてパルス位相成果やパルス幅制御回路を制御
することにより任意の位相と幅とを有する信号を作って
いた。
る信号から任意の位相と幅とを有する信号を作ろうとす
るときには、マイコンからの信号で電圧制御回路を制御
し、この電圧制御回路が制御する電圧と抵抗やコンデン
サーを用いてパルス位相成果やパルス幅制御回路を制御
することにより任意の位相と幅とを有する信号を作って
いた。
【０００４】
【発明が解決しようとする課題】しかしながら上記構成
では、抵抗やコンデンサーを用いて位相や幅を制御して
いるため、温度や部品定数のバラツキによりその信号の
位相や幅の精度が著しく低下するという欠点があった。
では、抵抗やコンデンサーを用いて位相や幅を制御して
いるため、温度や部品定数のバラツキによりその信号の
位相や幅の精度が著しく低下するという欠点があった。
【０００５】そこで、本発明は上述の欠点に鑑み、ある
基準とする信号から温度によりその精度を低下させるこ
となく任意の位相と幅とを有する信号を作ることができ
る回路を提供するものである。
基準とする信号から温度によりその精度を低下させるこ
となく任意の位相と幅とを有する信号を作ることができ
る回路を提供するものである。
【０００６】
【課題を解決するための手段】複数のモード（ＨＤ，Ｅ
Ｄ，ＮＴＳＣ）の中から選択されたパルスのモードの基
準信号を発生させるＰＬＬ回路用基準信号発生回路と、
前記ＰＬＬ回路用基準信号発生回路の出力信号から選択
されたモードの基準信号と同位相の基準信号とクロック
を発生させるＰＬＬ回路と、マイコンからのＩＩＣデー
タをデコードし各回路にデータを送るＩＩＣデコード回
路と、前記ＰＬＬ回路からの基準信号と前記ＩＩＣデコ
ード回路からのデータをもとに前記ＰＬＬ回路からのク
ロックを用いてパルス発生回路出力信号の位相を決定す
る位相制御回路と、前記位相制御回路の出力信号と前記
ＩＩＣデコード回路からのデータをもとに前記ＰＬＬ回
路からのクロックを用いてパルス発生回路出力信号の幅
を決定する幅制御回路とから構成される。
Ｄ，ＮＴＳＣ）の中から選択されたパルスのモードの基
準信号を発生させるＰＬＬ回路用基準信号発生回路と、
前記ＰＬＬ回路用基準信号発生回路の出力信号から選択
されたモードの基準信号と同位相の基準信号とクロック
を発生させるＰＬＬ回路と、マイコンからのＩＩＣデー
タをデコードし各回路にデータを送るＩＩＣデコード回
路と、前記ＰＬＬ回路からの基準信号と前記ＩＩＣデコ
ード回路からのデータをもとに前記ＰＬＬ回路からのク
ロックを用いてパルス発生回路出力信号の位相を決定す
る位相制御回路と、前記位相制御回路の出力信号と前記
ＩＩＣデコード回路からのデータをもとに前記ＰＬＬ回
路からのクロックを用いてパルス発生回路出力信号の幅
を決定する幅制御回路とから構成される。
【０００７】
【作用】本発明は上記した構成によって、ある基準とす
る信号から温度や部品定数のバラツキにより、その精度
を低下させることなく任意の位相と幅とを有する信号を
作ることができる。
る信号から温度や部品定数のバラツキにより、その精度
を低下させることなく任意の位相と幅とを有する信号を
作ることができる。
【０００８】
【実施例】以下、本発明の一実施例におけるパルス発生
回路について図面を参照しながら説明する。図１は本発
明の一実施例におけるパルス発生回路のブロック図を示
すものである。
回路について図面を参照しながら説明する。図１は本発
明の一実施例におけるパルス発生回路のブロック図を示
すものである。
【０００９】図１において、１１はＰＬＬ回路用基準信
号発生回路、１２はＰＬＬ回路、１３は位相制御回路、
１４は幅制御回路、１５はＩＩＣデコード回路、１６は
マイコンである。
号発生回路、１２はＰＬＬ回路、１３は位相制御回路、
１４は幅制御回路、１５はＩＩＣデコード回路、１６は
マイコンである。
【００１０】以上のように構成されたパルス発生回路に
ついて、図１を参照しながら、その動作を説明する。
ついて、図１を参照しながら、その動作を説明する。
【００１１】まず、マイコン１６から送られたＩＩＣデ
ータｃをＩＩＣデコード回路１５において制御データに
変換し、ＰＬＬ回路用基準信号発生回路１１と位相制御
回路１３と幅制御回路１４に送る。あるモードの基準信
号ａや異なるモードの基準信号ｂの中から選択されたパ
ルスのモードの基準信号を基準信号制御用データｋを用
いてＰＬＬ回路用基準信号発生回路１１で発生させＰＬ
Ｌ回路用基準信号ｅとしてＰＬＬ回路１２に送る。ＰＬ
Ｌ回路１２においてＰＬＬ回路用基準信号ｅからモード
の基準信号と同位相のＰＬＬ回路出力基準信号ｄとクロ
ックｇを発生させ位相制御回路１３と幅制御回路１４に
送る。位相制御回路１３において送られてきたＰＬＬ回
路出力基準信号ｄと位相制御用データｉを用いてパルス
発生回路出力信号ｈの位相を決定する位相決定信号ｆを
発生させ幅制御回路１４へ送る。幅制御回路１４におい
て送られてきた位相決定信号ｆと幅制御用データｊを用
いてパルス発生回路出力信号ｈの幅を決定し、位相と幅
を制御したパルス発生回路出力信号を発生させる。
ータｃをＩＩＣデコード回路１５において制御データに
変換し、ＰＬＬ回路用基準信号発生回路１１と位相制御
回路１３と幅制御回路１４に送る。あるモードの基準信
号ａや異なるモードの基準信号ｂの中から選択されたパ
ルスのモードの基準信号を基準信号制御用データｋを用
いてＰＬＬ回路用基準信号発生回路１１で発生させＰＬ
Ｌ回路用基準信号ｅとしてＰＬＬ回路１２に送る。ＰＬ
Ｌ回路１２においてＰＬＬ回路用基準信号ｅからモード
の基準信号と同位相のＰＬＬ回路出力基準信号ｄとクロ
ックｇを発生させ位相制御回路１３と幅制御回路１４に
送る。位相制御回路１３において送られてきたＰＬＬ回
路出力基準信号ｄと位相制御用データｉを用いてパルス
発生回路出力信号ｈの位相を決定する位相決定信号ｆを
発生させ幅制御回路１４へ送る。幅制御回路１４におい
て送られてきた位相決定信号ｆと幅制御用データｊを用
いてパルス発生回路出力信号ｈの幅を決定し、位相と幅
を制御したパルス発生回路出力信号を発生させる。
【００１２】
【発明の効果】以上のような本発明によれば、複数のモ
ード（ＨＤ，ＥＤ，ＮＴＳＣ）の中から選択されたパル
スのモードの基準信号を発生させるＰＬＬ回路用基準信
号発生回路と、ＰＬＬ回路用基準信号発生回路の出力信
号から選択されたモードの基準信号と同位相の基準信号
とクロックを発生させるＰＬＬ回路と、マイコンからの
ＩＩＣデータをデコードし各回路にデータを送るＩＩＣ
デコード回路と、ＰＬＬ回路からの基準信号とＩＩＣデ
コード回路からのデータをもとにＰＬＬ回路からのクロ
ックを用いてパルス発生回路出力信号の位相を決定する
位相制御回路と、位相制御回路の出力信号とＩＩＣデコ
ード回路からのデータをもとにＰＬＬ回路からのクロッ
クを用いてパルス発生回路出力信号の幅を決定する幅制
御回路を有するパルス発生回路を有することにより、あ
る基準とする信号から温度や部品定数のバラツキにより
その精度を低下させることなく、任意の位相と幅とを有
する信号をつくることができる。
ード（ＨＤ，ＥＤ，ＮＴＳＣ）の中から選択されたパル
スのモードの基準信号を発生させるＰＬＬ回路用基準信
号発生回路と、ＰＬＬ回路用基準信号発生回路の出力信
号から選択されたモードの基準信号と同位相の基準信号
とクロックを発生させるＰＬＬ回路と、マイコンからの
ＩＩＣデータをデコードし各回路にデータを送るＩＩＣ
デコード回路と、ＰＬＬ回路からの基準信号とＩＩＣデ
コード回路からのデータをもとにＰＬＬ回路からのクロ
ックを用いてパルス発生回路出力信号の位相を決定する
位相制御回路と、位相制御回路の出力信号とＩＩＣデコ
ード回路からのデータをもとにＰＬＬ回路からのクロッ
クを用いてパルス発生回路出力信号の幅を決定する幅制
御回路を有するパルス発生回路を有することにより、あ
る基準とする信号から温度や部品定数のバラツキにより
その精度を低下させることなく、任意の位相と幅とを有
する信号をつくることができる。
【図１】本発明の一実施例におけるパルス発生回路のブ
ロック図
ロック図
【図２】従来のパルス発生回路のブロック図
１，１６ マイコン ２ 電圧制御回路 ３ パルス位相制御回路 ４ パルス幅制御回路 １１ ＰＬＬ回路用基準信号発生回路 １２ ＰＬＬ回路 １３ 位相制御回路 １４ 幅制御回路 １５ ＩＩＣデコード回路 Ａ 入力基準信号 Ｂ パルス位相制御回路出力信号 Ｃ パルス幅制御回路出力信号 Ｄ 電圧制御回路制御信号 Ｅ パルス位相制御電圧 Ｆ パルス幅制御電圧 ａ るあモードの基準信号 ｂ ａと違うモードの基準信号 ｃ ＩＩＣデータ ｄ ＰＬＬ回路出力基準信号 ｅ ＰＬＬ回路用基準信号 ｆ 位相決定信号 ｇ ＰＬＬ回路出力クロック ｈ パルス発生回路出力信号 ｉ 位相制御用データ ｊ 幅制御用データ ｋ 基準信号制御用データ
Claims (1)
- 【請求項１】 複数のモード（ＨＤ，ＥＤ，ＮＴＳＣ）
の中から選択されたパルスのモードの基準信号を発生さ
せるＰＬＬ回路用基準信号発生回路と、前記ＰＬＬ回路
用基準信号発生回路の出力信号から選択されたモードの
基準信号と同位相の基準信号とクロックを発生させるＰ
ＬＬ回路と、マイコンからのＩＩＣデータをデコードし
各回路にデータを送るＩＩＣデコード回路と、前記ＰＬ
Ｌ回路からの基準信号と前記ＩＩＣデコード回路からの
データをもとに前記ＰＬＬ回路からのクロックを用いて
パルス発生回路出力信号の位相を決定する位相制御回路
と、前記位相制御回路の出力信号と前記ＩＩＣデコード
回路からのデータをもとに前記ＰＬＬ回路からのクロッ
クを用いてパルス発生回路出力信号の幅を決定する幅制
御回路を有するパルス発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20386394A JP3239626B2 (ja) | 1994-08-29 | 1994-08-29 | パルス発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20386394A JP3239626B2 (ja) | 1994-08-29 | 1994-08-29 | パルス発生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0870248A true JPH0870248A (ja) | 1996-03-12 |
| JP3239626B2 JP3239626B2 (ja) | 2001-12-17 |
Family
ID=16480956
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20386394A Expired - Fee Related JP3239626B2 (ja) | 1994-08-29 | 1994-08-29 | パルス発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3239626B2 (ja) |
-
1994
- 1994-08-29 JP JP20386394A patent/JP3239626B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3239626B2 (ja) | 2001-12-17 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20081012 Year of fee payment: 7 |
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| LAPS | Cancellation because of no payment of annual fees |