JPH0677787A - 最小値回路 - Google Patents
最小値回路Info
- Publication number
- JPH0677787A JPH0677787A JP4252093A JP25209392A JPH0677787A JP H0677787 A JPH0677787 A JP H0677787A JP 4252093 A JP4252093 A JP 4252093A JP 25209392 A JP25209392 A JP 25209392A JP H0677787 A JPH0677787 A JP H0677787A
- Authority
- JP
- Japan
- Prior art keywords
- pmos
- output
- minimum
- voltage
- trs
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R19/00—Arrangements for measuring currents or voltages or for indicating presence or sign thereof
- G01R19/0038—Circuits for comparing several input signals and for indicating the result of this comparison, e.g. equal, different, greater, smaller (comparing pulses or pulse trains according to amplitude)
Abstract
(57)【要約】
【目的】 小型かつ高速の最小値回路を提供することを
目的とする。 【構成】 複数のpMOS、T1,T2,T3のソース
を、ドレインよりも低電圧の電源−Vccに接続するとと
もに、ドレインを高抵抗Rを介して接地し、各pMO
S、T1,T2,T3のゲートに入力電圧x,y,zを
接続し、各pMOS、T1,T2,T3のドレインに共
通出力Doを接続する。
目的とする。 【構成】 複数のpMOS、T1,T2,T3のソース
を、ドレインよりも低電圧の電源−Vccに接続するとと
もに、ドレインを高抵抗Rを介して接地し、各pMO
S、T1,T2,T3のゲートに入力電圧x,y,zを
接続し、各pMOS、T1,T2,T3のドレインに共
通出力Doを接続する。
Description
【0001】
【産業上の利用分野】この発明は複数入力の最小値を出
力する最小値回路に関する。
力する最小値回路に関する。
【0002】
【従来の技術】複数データの最小値の算出のような複雑
な演算は、従来はデジタルコンピュータで実現されるこ
とが多く、複数段の比較回路とマルチプレクサを用いた
比較的大規模な構成が必要であった。
な演算は、従来はデジタルコンピュータで実現されるこ
とが多く、複数段の比較回路とマルチプレクサを用いた
比較的大規模な構成が必要であった。
【0003】
【発明が解決しようとする課題】この発明はこのような
従来の問題点を解消すべく創案されたもので、小型かつ
高速の最小値回路を提供することを目的とする。
従来の問題点を解消すべく創案されたもので、小型かつ
高速の最小値回路を提供することを目的とする。
【0004】
【課題を解決するための手段】この発明に係る最小値回
路は、複数のpMOSのスッチング特性を利用するもの
で、pMOSのドレインを共通出力に接続し、各pMO
Sのゲートに入力電圧を入力し、最小入力のpMOSを
導通させ、これによって他のpMOSのドレイン側に電
圧を生じさせて、最小入力以外のpMOSを遮断するも
のである。
路は、複数のpMOSのスッチング特性を利用するもの
で、pMOSのドレインを共通出力に接続し、各pMO
Sのゲートに入力電圧を入力し、最小入力のpMOSを
導通させ、これによって他のpMOSのドレイン側に電
圧を生じさせて、最小入力以外のpMOSを遮断するも
のである。
【0005】
【実施例】次にこの発明に係る平均値回路の1実施例を
図面に基づいて説明する。図1において、最小値回路は
複数のpMOS(符号T1、T2、T3で示す。)を並
列接続してなり、T1、T2、T3には入力電圧x、
y、zが入力されている。T1、T2、T3はソースフ
ォロワ出力D1、D2、D3を有し、これら出力は共通
出力Doに接続されている。
図面に基づいて説明する。図1において、最小値回路は
複数のpMOS(符号T1、T2、T3で示す。)を並
列接続してなり、T1、T2、T3には入力電圧x、
y、zが入力されている。T1、T2、T3はソースフ
ォロワ出力D1、D2、D3を有し、これら出力は共通
出力Doに接続されている。
【0006】各pMOSの独立の特性として、入力電圧
に等しい出力がドレインに生じ、 D1=x D2=y D3=z となる。ここで、x<y、x<zとすると、T1はD1
=xとなり、T2、T3はゲート電圧よりもドレイン電
圧が低くなる。従って、T2、T3は遮断され、D1が
そのままDoに表れる。yまたはzが最小であったとき
も同様であり、最小入力電圧がDoに表れる。
に等しい出力がドレインに生じ、 D1=x D2=y D3=z となる。ここで、x<y、x<zとすると、T1はD1
=xとなり、T2、T3はゲート電圧よりもドレイン電
圧が低くなる。従って、T2、T3は遮断され、D1が
そのままDoに表れる。yまたはzが最小であったとき
も同様であり、最小入力電圧がDoに表れる。
【0007】なお上記実施例は3個のpMOSを並列接
続したが、2個あるいは4個以上のpMOSを同様に接
続することにより、2個あるいは4個以上の入力に対す
る最小値を出力し得る。そしてこれらの出力を得るため
の時間は1個のpMOSの応答時間に略等しく、デジタ
ル回路による演算を行う場合に比較して著しく高速であ
る。そしてその構成から明らかなように、回路規模は極
めて小さい。
続したが、2個あるいは4個以上のpMOSを同様に接
続することにより、2個あるいは4個以上の入力に対す
る最小値を出力し得る。そしてこれらの出力を得るため
の時間は1個のpMOSの応答時間に略等しく、デジタ
ル回路による演算を行う場合に比較して著しく高速であ
る。そしてその構成から明らかなように、回路規模は極
めて小さい。
【0008】
【発明の効果】前述のとおり、この発明に係る最小値回
路は、pMOSのソースフォロワ出力を共通出力に接続
することにより、各pMOSの入力の最小値が共通出力
に生じるようにしたので、回路が小型であるとともに、
応答速度が極めて高速であるという優れた効果を有す
る。
路は、pMOSのソースフォロワ出力を共通出力に接続
することにより、各pMOSの入力の最小値が共通出力
に生じるようにしたので、回路が小型であるとともに、
応答速度が極めて高速であるという優れた効果を有す
る。
【図1】本発明に係る最小値回路の1実施例を示す回路
図である。
図である。
T1,T2,T3 pMOS D1,D2,D3 ソースフォロワ出力 x,y,z 入力電圧 Do 共通出力 R 高抵抗 −Vcc 電源
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ウィワット・ウォンワラウィパット 東京都世田谷区北沢3−5−18 株式会社 鷹山内 (72)発明者 高取 直 東京都世田谷区北沢3−5−18 株式会社 鷹山内 (72)発明者 山本 誠 東京都世田谷区北沢3−5−18 株式会社 鷹山内
Claims (1)
- 【請求項1】 複数のpMOSのソースを、ドレインよ
りも低電圧の電源に接続するとともに、ドレインを高抵
抗を介して接地し、各pMOSのゲートに入力電圧を接
続し、各pMOSのドレインに共通出力を接続してある
最小値回路。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4252093A JPH0677787A (ja) | 1992-08-26 | 1992-08-26 | 最小値回路 |
EP92121191A EP0584403A1 (en) | 1992-08-26 | 1992-12-11 | Circuit calculating the minimum value |
KR1019930016680A KR940004964A (ko) | 1992-08-26 | 1993-08-26 | 최소치회로 |
US08/322,407 US5471161A (en) | 1992-08-26 | 1994-10-12 | Circuit for calculating the minimum value |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4252093A JPH0677787A (ja) | 1992-08-26 | 1992-08-26 | 最小値回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0677787A true JPH0677787A (ja) | 1994-03-18 |
Family
ID=17232442
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4252093A Pending JPH0677787A (ja) | 1992-08-26 | 1992-08-26 | 最小値回路 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5471161A (ja) |
EP (1) | EP0584403A1 (ja) |
JP (1) | JPH0677787A (ja) |
KR (1) | KR940004964A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008141550A (ja) * | 2006-12-04 | 2008-06-19 | Nec Electronics Corp | イメージセンサ |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8098707B2 (en) * | 2006-01-31 | 2012-01-17 | Regents Of The University Of Minnesota | Ultra wideband receiver |
CN103973294A (zh) * | 2014-05-05 | 2014-08-06 | 上海空间电源研究所 | 取最小值电路 |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5644218A (en) * | 1979-09-20 | 1981-04-23 | Nec Corp | Electronic circuit using field effect transistor |
JPS60173924A (ja) * | 1984-02-20 | 1985-09-07 | Toshiba Corp | 論理回路 |
US4613772A (en) * | 1984-04-11 | 1986-09-23 | Harris Corporation | Current compensation for logic gates |
JPS6234416A (ja) * | 1985-08-07 | 1987-02-14 | Victor Co Of Japan Ltd | 信号選択回路 |
JPS6234417A (ja) * | 1985-08-07 | 1987-02-14 | Victor Co Of Japan Ltd | 信号選択回路 |
JPH01265718A (ja) * | 1988-04-18 | 1989-10-23 | Toshiba Corp | シュミットトリガ回路 |
US4896059A (en) * | 1988-07-26 | 1990-01-23 | Microelectronics Center Of North Carolina | Circuit to perform variable threshold logic |
JPH02221870A (ja) * | 1989-02-22 | 1990-09-04 | Toshiba Corp | 最大値検出回路及び最小値検出回路 |
JPH03291571A (ja) * | 1990-04-09 | 1991-12-20 | Toshiba Corp | 最大値出力回路及び最小値出力回路 |
JP3178716B2 (ja) * | 1990-09-04 | 2001-06-25 | キヤノン株式会社 | 最大値出力回路及び最小値出力回路並びに最大値最小値出力回路 |
-
1992
- 1992-08-26 JP JP4252093A patent/JPH0677787A/ja active Pending
- 1992-12-11 EP EP92121191A patent/EP0584403A1/en not_active Withdrawn
-
1993
- 1993-08-26 KR KR1019930016680A patent/KR940004964A/ko not_active Application Discontinuation
-
1994
- 1994-10-12 US US08/322,407 patent/US5471161A/en not_active Expired - Fee Related
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008141550A (ja) * | 2006-12-04 | 2008-06-19 | Nec Electronics Corp | イメージセンサ |
Also Published As
Publication number | Publication date |
---|---|
KR940004964A (ko) | 1994-03-16 |
US5471161A (en) | 1995-11-28 |
EP0584403A1 (en) | 1994-03-02 |
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