JPH0676090A - 最大値回路 - Google Patents
最大値回路Info
- Publication number
- JPH0676090A JPH0676090A JP4252048A JP25204892A JPH0676090A JP H0676090 A JPH0676090 A JP H0676090A JP 4252048 A JP4252048 A JP 4252048A JP 25204892 A JP25204892 A JP 25204892A JP H0676090 A JPH0676090 A JP H0676090A
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- JP
- Japan
- Prior art keywords
- nmos
- output
- source
- input
- maximum
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- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/687—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors
- H03K17/693—Switching arrangements with several input- or output-terminals, e.g. multiplexers, distributors
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R19/00—Arrangements for measuring currents or voltages or for indicating presence or sign thereof
- G01R19/0038—Circuits for comparing several input signals and for indicating the result of this comparison, e.g. equal, different, greater, smaller (comparing pulses or pulse trains according to amplitude)
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Electronic Switches (AREA)
- Logic Circuits (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】
【目的】 小型かつ高速の最大値回路を提供することを
目的とする。 【構成】 複数のnMOS、T1,T2,T3のドレイ
ンを電源Vccに接続するとともに、ソースを高抵抗Rに
介して接地し、各nMOS、T1,T2,T3のゲート
に入力電圧、x,y,zを接続し、各nMOS、T1,
T2,T3のソースに出力端子を接続する。
目的とする。 【構成】 複数のnMOS、T1,T2,T3のドレイ
ンを電源Vccに接続するとともに、ソースを高抵抗Rに
介して接地し、各nMOS、T1,T2,T3のゲート
に入力電圧、x,y,zを接続し、各nMOS、T1,
T2,T3のソースに出力端子を接続する。
Description
【0001】
【産業上の利用分野】この発明は複数入力の最大値を出
力する最大値回路に関する。
力する最大値回路に関する。
【0002】
【従来の技術】複数データの最大値の算出のような複雑
な演算は、従来はデジタルコンピュータで実現されるこ
とが多く、複数段の比較回路とマルチプレクサを用いた
比較的大規模な構成が必要であった。
な演算は、従来はデジタルコンピュータで実現されるこ
とが多く、複数段の比較回路とマルチプレクサを用いた
比較的大規模な構成が必要であった。
【0003】
【発明が解決しようとする課題】この発明はこのような
従来の問題点を解消すべく創案されたもので、小型かつ
高速の最大値回路を提供することを目的とする。
従来の問題点を解消すべく創案されたもので、小型かつ
高速の最大値回路を提供することを目的とする。
【0004】
【課題を解決するための手段】この発明に係る最大値回
路は、複数のnMOSのスッチング特性を利用するもの
で、nMOSのソースを共通出力に接続し、各nMOS
のゲートに入力電圧を入力し、最大入力のnMOSを導
通させ、これによって他のnMOSのソース側に電圧を
生じさせて、最大入力以外のnMOSを遮断するもので
ある。
路は、複数のnMOSのスッチング特性を利用するもの
で、nMOSのソースを共通出力に接続し、各nMOS
のゲートに入力電圧を入力し、最大入力のnMOSを導
通させ、これによって他のnMOSのソース側に電圧を
生じさせて、最大入力以外のnMOSを遮断するもので
ある。
【0005】
【実施例】次にこの発明に係る平均値回路の1実施例を
図面に基づいて説明する。図1において、最大値回路は
複数のnMOS(符号T1、T2、T3で示す。)を並
列接続してなり、T1、T2、T3には入力電圧x、
y、zが入力されている。T1、T2、T3はソースフ
ォロワ出力D1、D2、D3を有し、これら出力は共通
出力Doに接続されている。
図面に基づいて説明する。図1において、最大値回路は
複数のnMOS(符号T1、T2、T3で示す。)を並
列接続してなり、T1、T2、T3には入力電圧x、
y、zが入力されている。T1、T2、T3はソースフ
ォロワ出力D1、D2、D3を有し、これら出力は共通
出力Doに接続されている。
【0006】各nMOSの独立の特性として、入力電圧
に等しい出力がソースに生じ、 D1=x D2=y D3=z となる。ここで、x>y、x>zとすると、T1はD1
=xとなり、T2、T3はゲート電圧よりもソース電圧
が高くなる。従って、T2、T3は遮断され、D1がそ
のままDoに表れる。yまたはzが最大であったときも
同様であり、最大入力電圧がDoに表れる。
に等しい出力がソースに生じ、 D1=x D2=y D3=z となる。ここで、x>y、x>zとすると、T1はD1
=xとなり、T2、T3はゲート電圧よりもソース電圧
が高くなる。従って、T2、T3は遮断され、D1がそ
のままDoに表れる。yまたはzが最大であったときも
同様であり、最大入力電圧がDoに表れる。
【0007】なお上記実施例は3個のnMOSを並列接
続したが、2個あるいは4個以上のnMOSを同様に接
続することにより、2個あるいは4個以上の入力に対す
る最大値を出力し得る。そしてこれらの出力を得るため
の時間は1個のnMOSの応答時間に略等しく、デジタ
ル回路による演算を行う場合に比較して著しく高速であ
る。そしてその構成から明らかなように、回路規模は極
めて小さい。
続したが、2個あるいは4個以上のnMOSを同様に接
続することにより、2個あるいは4個以上の入力に対す
る最大値を出力し得る。そしてこれらの出力を得るため
の時間は1個のnMOSの応答時間に略等しく、デジタ
ル回路による演算を行う場合に比較して著しく高速であ
る。そしてその構成から明らかなように、回路規模は極
めて小さい。
【0008】
【発明の効果】前述のとおり、この発明に係る最大値回
路は、nMOSのソースフォロワ出力を共通出力に接続
することにより、各nMOSの入力の最大値が共通出力
に生じるようにしたので、回路が小型であるとともに、
応答速度が極めて高速であるという優れた効果を有す
る。
路は、nMOSのソースフォロワ出力を共通出力に接続
することにより、各nMOSの入力の最大値が共通出力
に生じるようにしたので、回路が小型であるとともに、
応答速度が極めて高速であるという優れた効果を有す
る。
【図1】本発明に係る最大値回路の1実施例を示す回路
図である。
図である。
T1,T2,T3 nMOS x,y,z 入力電圧 D1,D2,D3 ソースフォロワ出力 Do 共通出力 Vcc 電源 R 高抵抗
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成4年10月2日
【手続補正1】
【補正対象書類名】図面
【補正対象項目名】図1
【補正方法】変更
【補正内容】
【図1】
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ウィワット・ウォンワラウィパット 東京都世田谷区北沢3−5−18 株式会社 鷹山内 (72)発明者 高取 直 東京都世田谷区北沢3−5−18 株式会社 鷹山内 (72)発明者 山本 誠 東京都世田谷区北沢3−5−18 株式会社 鷹山内
Claims (1)
- 【請求項1】 複数のnMOSのドレインを電源に接続
するとともに、ソースを高抵抗を介して接地し、各nM
OSのゲートに入力電圧を接続し、各nMOSのソース
に出力端子を接続してある最大値回路。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4252048A JPH0676090A (ja) | 1992-08-26 | 1992-08-26 | 最大値回路 |
EP92121189A EP0584402A1 (en) | 1992-08-26 | 1992-12-11 | Circuit calculating the maximum value |
KR1019930016679A KR940004963A (ko) | 1992-08-26 | 1993-08-26 | 최대치회로 |
US08/322,408 US5467030A (en) | 1992-08-26 | 1994-10-12 | Circuit for calculating a maximum value |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4252048A JPH0676090A (ja) | 1992-08-26 | 1992-08-26 | 最大値回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0676090A true JPH0676090A (ja) | 1994-03-18 |
Family
ID=17231848
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4252048A Pending JPH0676090A (ja) | 1992-08-26 | 1992-08-26 | 最大値回路 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5467030A (ja) |
EP (1) | EP0584402A1 (ja) |
JP (1) | JPH0676090A (ja) |
KR (1) | KR940004963A (ja) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0731921A1 (en) * | 1994-09-30 | 1996-09-18 | Koninklijke Philips Electronics N.V. | Extreme level circuit |
FR2728744B1 (fr) * | 1994-12-21 | 1997-03-14 | Sgs Thomson Microelectronics | Circuit de fourniture de tension extremum |
FR2728745B1 (fr) * | 1995-06-09 | 1997-03-21 | Sgs Thomson Microelectronics | Circuit de fourniture de tension extremum |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5644218A (en) * | 1979-09-20 | 1981-04-23 | Nec Corp | Electronic circuit using field effect transistor |
JPS60173924A (ja) * | 1984-02-20 | 1985-09-07 | Toshiba Corp | 論理回路 |
US4613772A (en) * | 1984-04-11 | 1986-09-23 | Harris Corporation | Current compensation for logic gates |
JPS6234416A (ja) * | 1985-08-07 | 1987-02-14 | Victor Co Of Japan Ltd | 信号選択回路 |
JPS6234417A (ja) * | 1985-08-07 | 1987-02-14 | Victor Co Of Japan Ltd | 信号選択回路 |
JPH01265718A (ja) * | 1988-04-18 | 1989-10-23 | Toshiba Corp | シュミットトリガ回路 |
US4896059A (en) * | 1988-07-26 | 1990-01-23 | Microelectronics Center Of North Carolina | Circuit to perform variable threshold logic |
JPH02221870A (ja) * | 1989-02-22 | 1990-09-04 | Toshiba Corp | 最大値検出回路及び最小値検出回路 |
JPH03291571A (ja) * | 1990-04-09 | 1991-12-20 | Toshiba Corp | 最大値出力回路及び最小値出力回路 |
JP3178716B2 (ja) * | 1990-09-04 | 2001-06-25 | キヤノン株式会社 | 最大値出力回路及び最小値出力回路並びに最大値最小値出力回路 |
-
1992
- 1992-08-26 JP JP4252048A patent/JPH0676090A/ja active Pending
- 1992-12-11 EP EP92121189A patent/EP0584402A1/en not_active Withdrawn
-
1993
- 1993-08-26 KR KR1019930016679A patent/KR940004963A/ko not_active Application Discontinuation
-
1994
- 1994-10-12 US US08/322,408 patent/US5467030A/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
US5467030A (en) | 1995-11-14 |
EP0584402A1 (en) | 1994-03-02 |
KR940004963A (ko) | 1994-03-16 |
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