JPH064041A - 表示制御装置及び方法 - Google Patents

表示制御装置及び方法

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JPH064041A
JPH064041A JP4162946A JP16294692A JPH064041A JP H064041 A JPH064041 A JP H064041A JP 4162946 A JP4162946 A JP 4162946A JP 16294692 A JP16294692 A JP 16294692A JP H064041 A JPH064041 A JP H064041A
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Abstract

(57)【要約】 【目的】 強誘電性液晶表示装置を制御する表示制御装
置において、電源切断要求が発生したときに、表示画面
の表示内容を初期化し、違和感のない表示画面にするこ
とを目的とする。 【構成】 強誘電性液晶表示装置を制御する表示制御装
置に、電源の切断を検出する検出手段と表示画面の表示
内容を初期化する初期化手段を設けることにより、電源
の切断を検出し、表示画面の内容を初期化する。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、表示制御装置及び方法
に関し、詳しくは、例えば強誘電性液晶を表示更新のた
めの動作媒体として用い電界の印加等によって更新され
た表示状態を保持可能な表示素子を具えた表示装置のた
めの表示制御装置及び方法に関する。
【０００２】
【従来の技術】一般に、情報処理システムなどには、情
報の視覚表示機能を果たす情報表示手段として表示装置
が接続されている。このような表示装置としてはＣＲＴ
が広く利用されていたが、ＣＲＴは特に表示画面の厚み
方向の長さをある程度必要とするため全体としてその容
積が大きくなり、表示装置全体の小型化を図り難い。ま
たこれにより、このようなＣＲＴを表示器として用いた
情報処理システムの使用にあたっての自由度、すなわち
設置場所、携帯性等の自由度が損なわれる。
【０００３】この点を補うものとして液晶表示器（以
下、ＬＣＤという）を用いることができる。すなわち、
ＬＣＤによれば表示装置全体の小型化（特に薄型化）を
図ることができる。このようなＬＣＤの中には、強誘電
性液晶（以下、ＦＬＣ：Ferroelectric Liquid Crystal
という）の液晶セルを用いた表示器（以下ＦＬＣＤ：Ｆ
ＬＣディスプレイという）があり、その特長の１つは、
その液晶セルの表示状態の保存性にある。そのため、Ｆ
ＬＣＤを駆動する場合には、ＣＲＴや他の液晶表示器と
異なり、表示画面の連続的なリフレッシュ駆動の周期に
時間的余裕ができ、また、その連続的なリフレッシュ駆
動とは別に、表示画面上の変更に当たる部分のみの表示
状態を更新する部分書き変え駆動が可能となる。したが
って、このようなＦＬＣＤは他の液晶表示器と比較して
大画面の表示器とすることができる。
【０００４】ここで、ＦＬＣＤは、その液晶セルが充分
に薄いものであり、その中の細長いＦＬＣの分子は、電
界の印加方向に応じて第１の安定状態または第２の安定
状態に配向し、電界を切ってもそれぞれの配向状態を維
持する。このようなＦＬＣの分子の双安定性により、Ｆ
ＬＣＤは記憶性を有する。このようなＦＬＣおよびＦＬ
ＣＤの詳細は、例えば特開昭６３ー２４３９１９号に記
載されている。
【０００５】
【発明が解決しようとしている課題】ところが、ＦＬＣ
Ｄは以上のような特長を有するために、それがかえって
次のような欠点となってしまう。例えば、電源を投入す
ると、前の電源切断時の画面が記憶されており、一瞬そ
れが表示されその後に立ち上げ画面が表示される。ま
た、電源を切断している時でも液晶の表示面に外光が照
射されると液晶表示器が動作していないにもかかわらず
電源切断時に記憶された画面が見えてしまうといったこ
とが起こる。
【０００６】
【課題を解決するための手段】そのために本発明では、
電源切断時に表示画面に対応した記憶手段の状態を初期
化して出力することで、表示内容を消去する手段を具え
たことを特徴とする。
【０００７】
【作用】本発明では、電源切断を検出したときに、表示
画面に対応した記憶手段の状態を初期化して表示装置へ
出力することで、表示内容を消去する。このような処理
を行うことにより、ＦＬＣＤの特徴である双安定性によ
り記憶されている電源切断時の表示内容が、次に電源を
投入された時に表示されても、初期化された記憶手段の
内容が表示されるため、見た目に違和感のないスムーズ
な立ち上げが実現出来る。
【０００８】
【実施例】以下、図面を参照して本発明の実施例を詳細
に説明する。
【０００９】図１は、本発明の一実施例にかかる表示制
御装置を具えたＦＬＣ表示装置を各種文字、画像情報等
の表示装置として用いた情報処理システムのブロック図
である。
【００１０】図において、１１は情報処理システム全体
の制御を実行するＣＰＵ、１３はＣＰＵ１１が実行する
プログラムを記憶したり、この実行の際にワーク領域と
して用いられるメインメモリ、１４はＣＰＵ１１の制御
を介さずにメインメモリ１３と本システムを構成する各
種機器との間でデータの転送を行うＤＭＡコントローラ
（Direct Memory Access Controller 以下ＤＭＡＣとい
う）である。１５はイーサネット（ＸＥＲＯＸ社によ
る）等のＬＡＮ（ローカルエリアネットワーク）１６と
本システムとの間のＬＡＮインタフェース、１７はＲＯ
Ｍ、ＳＲＡＭ，ＲＳ２３２Ｃ方式インターフェースなど
を有した入出力装置（以下Ｉ／Ｏという）である。Ｉ／
Ｏ１７には各種外部機器を接続可能である。１８および
１９は外部記憶装置としてのそれぞれハードディスク装
置およびフロッピーディスク装置、２０はハードディス
ク装置１８やフロッピーディスク装置１９と本システム
との間で信号接続を行うためのディスクインタフェース
である。２１は比較的高解像度の記録を行うことが可能
なインクジェットプリンタ、レーザービームプリンタ等
によって構成することが出来るプリンタ、２２はプリン
タ２１と本システムとの間で信号接続を行うためのプリ
ンタインタフェースである。２３は各種文字等のキャラ
クタ情報、制御情報などを入力するためのキーボード、
２４はポインティングデバイスとしてのマウス、２５は
キーボード２３およびマウス２４と本システムとの間で
信号接続を行うためのキーインタフェースである。２６
は、本発明の一実施例にかかる表示制御装置としてのＦ
ＬＣＤインタフェース２７によって、その表示が制御さ
れるＦＬＣ表示装置（以下、ＦＬＣＤという）であり、
上述の強誘電性液晶をその表示動作媒体とする表示画面
を有する。１２は上記各機器間を信号接続するためのデ
ータバス、コントロールバス、アドレスバスからなるシ
ステムバスである。２８は電源であり、各機器に所定の
電力を供給する。ハードスイッチ２８１により接続、切
断が行われ、スイッチ検出部２８２により、ハードスイ
ッチ２８１の動作が検出されＣＰＵ１１に供給される。
【００１１】以上説明した各種機器などを接続してなる
情報処理システムでは、一般にシステムのユーザは、Ｆ
ＬＣＤ２６の表示画面に表示される各種情報に対応しな
がら操作を行う。すなわち、ＬＡＮ１６、Ｉ／Ｏ１７に
接続される外部機器、ハードディスク１８、フロッピー
ディスク１９、キーボード２３、マウス２４から供給さ
れる文字、画像情報等、またメインメモリ１３に格納さ
れたユーザのシステム操作にかかる操作情報などがＦＬ
ＣＤ２６の表示画面に表示され、ユーザはこの表示を見
ながら情報の収集、システムに対する指示操作を行う。
ここで、上記各種機器等は、それぞれＦＬＣＤ２６に対
して表示情報供給手段を構成する。
【００１２】（第１実施例）図２は、本実施例の第１実
施例にかかるＦＬＣＤインタフェース２７の詳細を示す
ブロック図である。
【００１３】図において、３１はアドレスバスドライ
バ、３２はコントロールバスドライバ、３３、４３、４
４、４５はデータバスドライバであり、それぞれはシス
テムバス１２の各バスと接続している。ＣＰＵ１１から
のアドレスデータは、システムバス１２を介しアドレス
バスドライバ３１から、メモリコントローラ４０および
アドレスセレクタ３５の一方の入力部に与えられるとと
もに、第１のスイッチＳ１の切り換えによってＦＩＦＯ
形態のメモリ３６または３７に選択的に与えられて記憶
される。すなわち、これらメモリ３６および３７（以
下、それぞれＦＩＦＯ（Ａ）およびＦＩＦＯ（Ｂ）とい
う）は、書込んだ順番にデータを読み出すＦＩＦＯ（Fi
rst In First Out）メモリであり、これらのメモリ３６
および３７に書き込まれたアドレスデータは、第２のス
イッチＳ２の切り換えによって選択的に読み出される。
【００１４】これらメモリ３６または３７から読み出さ
れたアドレスデータと、後述するアドレスカウンタ３８
からのアドレスデータは、第３のスイッチＳ３の切り換
えによって選択的にアドレスセレクタ３５の他方の入力
部に与えられる。アドレスカウンタ３８は、画面全体を
ライン順次にリフレッシュするためのアドレスデータを
発生するものであり、そのアドレスデータの発生タイミ
ングは同期制御回路３９によって制御される。この同期
制御回路３９は、前記スイッチＳ１、Ｓ２およびＳ３の
切り換え制御信号や後述するメモリコントローラ４０へ
のデータトランスファ要求信号をも発生する。さらに、
電源切断要求信号であるＰＯＦＦ信号がデータバスドラ
イバ４５と、パワコントロールレジスタ４６を介して入
力されており、本信号がアクティブになることにより、
後述するように強制的にスイッチＳ３をアドレスカウン
タ３８の出力に選択する。
【００１５】ＣＰＵ１１からのコントロール信号は、シ
ステムバス１２を介しコントロールバスドライバ３２か
らメモリコントローラ４０に与えられ、そのメモリコン
トローラ４０は、サンプリングカウンタ３４と、アドレ
スセレクタ３５の制御信号、および後述するビデオメモ
リ４１の制御信号を発生する。サンプリングカウンタ３
４はメモリコントローラ４０からの歩進信号に基づいて
計数動作を行い、同期制御回路３９の制御信号を発生す
る。また、アドレスセレクタ３５はメモリコントローラ
４０からの制御信号に基づいて、当該アドレスセレクタ
３５の入力部に与えられる２つのアドレスデータの一方
を選択してビデオメモリ４１に与える。
【００１６】ビデオメモリ４１は表示データを記憶する
ものであり、デュアルポートのＤＲＡＭ（ダイナミック
ＲＡＭ）で構成されていて、システムバス１２とデータ
バスドライバ３３を介して表示データの書込みと読み出
しを行う。ビデオメモリ４１に書き込まれた表示データ
は、ドライバレシーバ４２を介してＦＬＣＤ２６に転送
されて表示される。またドライバレシーバ４２は、ＦＬ
ＣＤ２６からの同期信号を同期制御回路３９に与える。
【００１７】さらに、システムバス１２とデータバスド
ライバ４３を介して、部分書き換えとリフレッシュ駆動
との割合などを設定するためのデータが同期制御回路３
９に与えられる。
【００１８】パワーコントロールレジスタ４６は電源切
断の要求が発生したときに使用され、表示画面の初期化
処理を要求する信号であるＰＯＦＦ信号を発生する。
【００１９】ＦＬＣＤ２６のＦＬＣパネルにはその温度
を検出するための温度センサ２６ａが設けられており、
温度センサ２６ａの出力信号は、データバスドライバ４
４とシステムバス１２を介してＣＰＵ１１に転送され
る。
【００２０】以上の図２に示す構成において、ＣＰＵ１
１が表示の変更を行う場合、所望するデータの書き換え
に対応するビデオメモリ４１のアドレスがメモリコント
ローラ４０に与えられる。これに応じて、メモリコント
ローラ４０では、ＣＰＵ１１のメモリアクセス要求信号
と同期制御回路３９からのデータトランスファ要求信号
とのアービトレーションが行われる。そしてＣＰＵ１１
側のアクセスが権利を得ると、メモリコントローラ４０
はアドレスセレクタ３５に対し、ビデオメモリ４１へ与
えるアドレスとしてアドレスドライバ３１からのアドレ
ス、すなわち、現在ＣＰＵ１１がアクセスしているアド
レスを選択するよう切り換えを行う。これと同時にメモ
リコントローラ４０からビデオメモリ４１への制御信号
が発生され、データバスドライバ３３を介してデータの
読み書き、すなわちビデオメモリ４１のデータ書き換え
が行われる。この時、ＣＰＵ１１によってアクセスされ
るアドレスデータはスイッチＳ１を介してＦＩＦＯ
（Ａ）３６またはＦＩＦＯ（Ｂ）３７に記憶され、後述
する表示データの転送の際利用される。このようにＣＰ
Ｕ１１から見た表示データのアクセス方法はＣＲＴの場
合と変わらない。
【００２１】一方、ビデオメモリ４１からデータを読み
出しこのデータをＦＬＣＤ２６へ転送して表示する場
合、同期制御回路３９からメモリコントローラ４０へデ
ータトランスファ要求が発生され、ビデオメモリ４１に
対するアドレスとして、スイッチＳ３の切り換えに応じ
アドレスカウンタ３８またはＦＩＦＯ側のアドレスが、
アドレスセレクタ３５において選択される。これととも
に、ビデオメモリ４１のメモリセルからシフトレジスタ
へ該当アドレスのラインの表示データが転送され、シリ
アルポートの制御信号によりドライバ４２へ出力され
る。
【００２２】同期制御回路３９は、前述したようにＦＬ
ＣＤ２６からの水平同期信号ＨＳＹＮＣに基づいてスイ
ッチＳ３を切り換えることにより、表示画面を全面リフ
レッシュしていくサイクル、またはＣＰＵ１１によりア
クセスされたラインの書換を行う部分書き換えサイクル
を生じさせる。ここで、全面リフレッシュのサイクルと
は表示画面を構成するラインを１ラインずつ順次表示駆
動するサイクルをいい、これは、アドレスカウンタ３８
で順次インクリメントされるアドレスに応じて、アクセ
スするラインが順次１ラインずつ変化することによって
可能となる。また、アクセスラインの部分書き換えサイ
クルとはそのサイクルの直前の所定時間内にＣＰＵ１１
によりアクセスされたラインを書き換えるものである。
【００２３】以下に、電源切断の要求が発生したときの
動作について説明する。
【００２４】図３および図４は、それぞれ電源切断の要
求が発生したときの処理ルーチンおよびタイミング図を
示す。
【００２５】ハードスイッチの押下等により電源切断の
要求が発生し（３０１）、それがＣＰＵ１１に通知され
ると、まずＣＰＵ１１によりビデオメモリ４１の表示領
域のデータが”１”（または”０”）になるように書き
込みが行われる（３０２）。表示領域全てのデータが”
１”（または”０”）に書き換えられる（３０３）とＦ
ＬＣＤインタフェース２７内にあるパワーコントロール
レジスタ４６のＰＯＦＦビットに１をセットする（３０
４）。図８にパワーコントロールレジスタ４６の構成を
示す。本例ではパワーコントロールレジスタを８ビット
構成としてビット０にＰＯＦＦビットを充て、このビッ
トに１がセットされたときにActiveとなる事とする。Ｐ
ＯＦＦビットは表示画面の初期化要求信号であるＰＯＦ
Ｆ信号としてアドレスカウンタ３８および同期制御回路
３９に入力されている。ＰＯＦＦ信号がActiveになると
同期制御回路３９にてスイッチＳ３が強制的に表示画面
を全面リフレッシュするサイクルに切り換られる（３０
５）。同時に、アドレスカウンタ３８では全面リフレッ
シュするサイクルのアドレスを０にクリアして、０から
ＦＬＣＤ２６の垂直方向のライン数（本例では１３１
１）まで順次インクリメントされる。ＦＬＣＤ２６は、
全面リフレッシュのサイクルにより１ラインずつ順次”
１”（または”０”）の同一データに書き換えられてい
き、表示画面全てをリフレッシュサイクルにより書き換
えが完了する（３０６）と、ＦＬＣＤの表示画面には全
面黒（または全面白）が表示されることになる。情報処
理システム側ではＰＯＦＦ信号発生後ＦＬＣＤ２６の表
示画面全面をリフレッシュサイクルにより書き換えられ
るのに充分な時間をおいてから電源を切断（３０７）す
れば、ＦＬＣＤ２６は全面黒（または全面白）の状態を
記憶したまま電源が切断されることになる。この電源の
切断は、例えば電源２８内に充分な容量のコンデンサを
設ける又はソフト的に電源の接続・切断を行うことによ
り実現できる。
【００２６】（第２実施例）第１実施例では、電源切断
の要求が発生した時に、ビデオメモリ４１の表示領域の
データを全て”１”（または全て”０”）の同一データ
に書き換えることにより、ＦＬＣＤ２６の表示画面を全
面黒（または全面白）に書き換える構成について説明し
たが、本例では、ビデオメモリ４１上に電源切断の要求
が発生した時に強制的にアクセスさせる領域を設け、そ
の領域のデータを”１”（または”０”）の同一データ
としておくことによりＦＬＣＤ２６の表示画面を全面黒
（または全面白）に書き換えることが出来る構成につい
て説明する。
【００２７】図５は、本例にかかるＦＬＣＤインタフェ
ース２７の詳細を示すブロック図である。
【００２８】図において、４７はデータバスドライバ、
４８はＰＯＦＦ信号がActiveのときにビデオメモリ４１
へアクセスするアドレスを記憶しておくメモリアドレス
レジスタ、４９はビデオメモリ４１へのアドレスを、通
常動作の時はアドレスセレクタ３５からの出力へ、ＰＯ
ＦＦ信号が発生した時にはメモリアドレスレジスタの出
力へ、強制的に切り換えるアドレスセレクタ（２）であ
る。
【００２９】以上の図５に示す構成において、電源切断
の要求が発生したときの動作を以下に示す。
【００３０】電源切断の要求が発生すると、まずＣＰＵ
１１はＦＬＣＤインタフェース２７内のパワーコントロ
ールレジスタ４６のＰＯＦＦビットに１をセットしＰＯ
ＦＦ信号をActiveにする。ＰＯＦＦ信号がActiveになる
と、同期制御回路３９にてスイッチＳ３が強制的に表示
画面を全面リフレッシュするサイクルに切り換えられ
る。同時にビデオメモリ４１のアドレスがアドレスセレ
クタ（２）４９によってアドレスセレクタ３５からメモ
リアドレスレジスタ４８に切り換えられる。メモリアド
レス４８からは予めデータバスドライバ４７を介してセ
ットされていた表示領域以外のアドレスが出力される。
メモリアドレスレジスタ４８から出力されるアドレスに
対応するビデオメモリ４１には予め”１”（または”
０”）が１ライン分セットされており、全面リフレッシ
ュサイクルが発生すると１ラインずつ順次”１”（また
は”０”）の状態に書き換えられていき、表示画面全て
をリフレッシュサイクルにより書き換えて完了すると、
ＦＬＣＤの表示画面には全面黒（または全面白）が表示
されることになる。情報処理システム側ではＰＯＦＦ信
号発生後ＦＬＣＤ２６の表示画面全面をリフレッシュサ
イクルにより書き換えられるのに充分な時間をおいてか
ら電源を切断すれば、ＦＬＣＤ２６は全面黒（または全
面白）の状態を記憶したまま電源が切断されることにな
る。
【００３１】図６に、ビデオメモリ４１と表示領域との
関係を示す。ビデオメモリ４１のメモリ容量が２５６Ｋ
Ｂｙｔｅｓで水平方向の画素数を１０２４画素とすると
垂直方向の画素数は２０４８画素となる。ＦＬＣＤ２６
の表示領域を水平方向が９６０ｂｉｔｓ、垂直方向が１
３１２ｂｉｔｓで、１画素のｂｉｔ数が１ｂｉｔ／ｐｉ
ｘｅｌ（画素）とすると、ビデオメモリ４１におけるＦ
ＬＣＤ２６の表示領域は、図中の斜線部分になる。この
表示領域以外のメモリ空間、例えば垂直方向２０４８画
素の所に１ライン分のデータを記憶しておく領域を設け
ておく。この領域に予め”１”（または”０”）の同一
データを書込んでおき、ＰＯＦＦ信号が発生した時に強
制的にこのメモリ領域をアクセスするようにしておけ
ば、全面リフレッシュサイクルで、ＦＬＣＤ２６の表示
画面を全面黒（または全面白）にすることが出来る。
【００３２】（第３実施例）第２実施例では、電源切断
の要求が発生した時に、ビデオメモリ４１へのアドレス
を強制的に切り換え、予め”１”（または”０”）の同
一データが書き込まれている表示領域以外のメモリ空間
へアクセスすることにより、ＦＬＣＤ２６の表示画面を
全面黒（または全面白）に書き換える構成について説明
したが、本例では、ＦＬＣＤ２６に転送されるデータを
ビデオメモリ４１からの出力データから、予め”１”
（または”０”）の同一データが書き込まれているメモ
リデータレジスタ５０からの出力データに強制的に切り
換えることにより、ＦＬＣＤ２６の表示画面を全面黒
（または全面白）に書き換えることが出来る構成につい
て説明する。
【００３３】図７は、本例にかかるＦＬＣＤインタフェ
ース２７の詳細を示すブロック図である。
【００３４】図において、５２はデータバスドライバ、
５０はＰＯＦＦ信号がActiveの時にＦＬＣＤ２６に転送
するデータを記憶しておくメモリデータレジスタ、５１
はＦＬＣＤ２６への出力データを、通常動作の時はビデ
オメモリ４１からの出力へ、ＰＯＦＦ信号がActiveの時
はメモリデータレジスタ５０からの出力へ、強制的に切
り換えるデータセレクタである。
【００３５】以上の図７に示す構成において、電源切断
の要求が発生したときの動作を以下に示す。
【００３６】電源切断の要求が発生すると、まずＣＰＵ
１１はＦＬＣＤインタフェース２７内のパワーコントロ
ールレジスタ４６のＰＯＦＦビットに１をセットしＰＯ
ＦＦ信号をActiveにする。ＰＯＦＦ信号がActiveになる
と同期制御信号回路３９にてスイッチＳ３が強制的に表
示画面を全面リフレッシュするサイクルに切り換えられ
る。同時にＦＬＣＤ２６に転送されるデータがデータセ
レクタ５１によってビデオメモリ４１からの出力データ
からメモリデータレジスタ５０からの出力データに切り
換えられる。メモリデータレジスタ５０からは予めデー
タバスドライバ５２を介してセットされていたデー
タ（”１”または”０”）が出力される。全面リフレッ
シュサイクルが発生すると１ラインずつ順次”１”（ま
たは”０”）の同一データに書き換えられていき、表示
領域全てをリフレッシュサイクルにより書き換えが完了
すると、ＦＬＣＤの表示画面には全面黒（または全面
白）が表示されることになる。情報処理システム側では
ＰＯＦＦ信号発生後ＦＬＣＤ２６の表示画面全面をリフ
レッシュサイクルにより書き換えられるのに充分な時間
をおいてから電源を切断すれば、ＦＬＣＤ２６は全面黒
の状態（または全面白の状態）を記憶したまま電源が切
断されることになる。
【００３７】以上説明したように、本実施例によれば、
電源を切断する前に、ＦＬＣＤ２６の表示画面を全面黒
または全面白に書き直すため、ＦＬＣＤの特長である双
安定性のために電源切断時の表示内容が記憶され、電源
投入時の前の電源切断時の画面が一瞬表示されたり、電
源を切断しているにもかかわらずＦＬＣＤの表示面に外
光が照射され電源切断時に記憶された画面が見えてしま
うというようなことが起こっても、違和感のない表示に
することが出来る。
【００３８】
【発明の効果】以上、本発明によれば、電源の切断によ
り、表示画面の内容が違和感のないものとなる。
【図面の簡単な説明】
【図１】本発明の一実施例にかかる表示制御装置を組込
んだ情報処理システムのブロック図
【図２】本発明の第１実施例にかかるＦＬＣＤインタフ
ェースの構成を示すブロック図
【図３】本発明の第１実施例において電源切断の要求が
発生した時のフローチャート
【図４】図３で示したフローチャートのタイミング図
【図５】本発明の第２実施例にかかるＦＬＣＤインター
フェースの構成を示すブロック図
【図６】図５で示したＦＬＣＤインタフェースにおける
ビデオメモリのマッピング図
【図７】本発明の第３実施例にかかるＦＬＣＤインタフ
ェースの構成を示すブロック図
【図８】パワーコントロールレジスタの構成を示す図。
【符号の説明】
１１ ＣＰＵ １２ システムバス １３ メインメモリ １４ ＤＭＡコントローラ １５ ＬＡＮインタフェース １６ ＬＡＮ １７ Ｉ／Ｏ装置 １８ ハードディスク装置 １９ フロッピーディスク装置 ２０ ディスクインタフェース ２１ プリンタ ２２ プリンタインタフェース ２３ キーボード ２４ マウス ２５ キーインタフェース ２６ ＦＬＣＤ（ＦＬＣＤディスプレイ） ２６ａ 温度センサ ２７ ＦＬＣＤインタフェース ２８ 電源 ３１ アドレスバスドライバ ３２ コントロールバスドライバ ３３、４３、４４、４５、４７、５２ データバスドラ
イバ ３４ サンプリングカウンタ ３５ アドレスセレクタ ３６ ＦＩＦＯ（Ａ） メモリ ３７ ＦＩＦＯ（Ｂ） メモリ ３８ アドレスカウンタ ３９ 同期制御回路 ４０ メモリコントローラ ４１ ビデオメモリ ４２ ドライバレシーバ Ｓ１、Ｓ２、Ｓ３ スイッチ ４６ パワーコントロールレジスタ ４８ メモリアドレスレジスタ ４９ アドレスセレクタ（２） ５０ メモリデータレジスタ ５１ データセレクタ

Claims (4)

    【特許請求の範囲】
  1. 【請求項１】 表示状態を保持可能な表示素子が配列さ
    れた表示画面を具えた表示装置を制御する表示制御装置
    において、 前記表示画面に対応した記憶手段と、電源の切断を検出
    する検出手段と、前記記憶手段を初期化する初期化手段
    とを具え、前記検出手段が電源の切断を検出したことに
    より、前記初期化手段が前記記憶手段を初期化すること
    を特徴とする表示制御装置。
  2. 【請求項２】 請求項１に記載の表示制御装置におい
    て、前記記憶手段の内容に従って前記表示装置の表示の
    更新を行う手段を具え、 前記電源切断検出手段により電源の切断を検出したこと
    により前記記憶手段の状態を初期化し、初期化された内
    容に従って表示の更新を行うことを特徴とする表示制御
    装置。
  3. 【請求項３】 表示状態を保持可能な表示素子が配列さ
    れた表示画面を具えた表示装置を制御する表示制御装置
    において、 前記表示画面に対応した記憶手段と、電源の切断を検出
    する検出手段と、所定の内容で前記記憶手段の内容を変
    更する変更手段を具え、 前記検出手段が電源の切断を検出したことにより、前記
    変更手段が前記記憶手段の内容を変更することを特徴と
    する表示制御装置。
  4. 【請求項４】 表示状態を保持可能な表示素子が配列さ
    れた表示画面を具えた表示装置の表示制御方法におい
    て、 電源の切断を検出し、 表示内容を初期化することを特徴とする表示制御方法。
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