JPH0582981B2 - - Google Patents

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JPH0582981B2
JPH0582981B2 JP61163032A JP16303286A JPH0582981B2 JP H0582981 B2 JPH0582981 B2 JP H0582981B2 JP 61163032 A JP61163032 A JP 61163032A JP 16303286 A JP16303286 A JP 16303286A JP H0582981 B2 JPH0582981 B2 JP H0582981B2
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JP
Japan
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pellet
lead frame
lead
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internal
Prior art date
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JP61163032A
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English (en)
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JPS6318652A (ja
Inventor
Tetsuro Okatome
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP16303286A priority Critical patent/JPS6318652A/ja
Publication of JPS6318652A publication Critical patent/JPS6318652A/ja
Publication of JPH0582981B2 publication Critical patent/JPH0582981B2/ja
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49503Lead-frames or other flat leads characterised by the die pad
    • H01L23/49506Lead-frames or other flat leads characterised by the die pad an insulative substrate being used as a diepad, e.g. ceramic, plastic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4912Layout
    • H01L2224/49171Fan-out arrangements

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  • Engineering & Computer Science (AREA)
  • Ceramic Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の製造方法に関し、特にペ
レツト搭載部を有しないリードフレームを用い
て、任意の大きさのペレツトを搭載することがで
きる半導体装置の製造方法に関するものである。
〔従来の技術〕
従来の半導体装置は、第4図および第5図に示
すように、ペレツト搭載部9を有するリードフレ
ーム30にペレツト9を搭載し、ワイヤーボンデ
イング10を行い、樹脂封止し、選別・調査を行
つて製造されていた。なお、7はリード端子のイ
ンナーリード部である。
〔発明が解決しようとする問題点〕
上述した従来のペレツト搭載部を有する様なリ
ードフレームを使用して、半導体装置の製造を行
うと下記の様な欠点があつた。
ペレツト搭載部8の大きさを任意に変更できな
いので、ペレツト9が大きすぎて搭載できないた
めに高額な費用を投じて新しいリードフレーム3
0を準備せねばならない。又逆にペレツトが小さ
すぎるとワイヤーボンデイング時にワイヤー10
の長さが極端に長くなりワイヤー−ペレツト間等
の短絡をおこし、特性不良となりやすい。
内部リード先端7が独立しているのでリードフ
レーム搬送時、外部からの衝撃等により、リード
先端が変形して、リード間シヨートをおこした
り、シヨートしなくてもボンデイング不可能な状
態となりやすい。
〔問題点を解決するための手段〕
本発明は、複数の内部リードの夫々の先端部が
連結されているリードフレームを用い、収納すべ
きペレツトの大きさに従つて、このペレツトサイ
ズより大きな開孔を形成すべく、前記連結した部
分を除去して開孔部を形成し、しかる後この開孔
部をカバーするように絶縁シートをリードフレー
ムに接着し、前記絶縁シートにペレツトを装着す
ることを特徴とする。
〔実施例〕
次に本発明について図面を参照して説明する。
第1図は夫々本発明の一実施例のリードフレー
ムの内部パターンである。本実施例のリードフレ
ーム20では、内部リード2が内部リード連結部
1にて連結されている。これを第2図のように、
ペレツトの大きさによりパンチングしてインナー
リード部3とし、しかる後シート状の絶縁物4を
ワイヤーボンデイングを行わない方のリードフレ
ーム表面に接着し、ペレツト搭載部を形成する。
その後、第3図A,Bのように、ペレツト5をマ
ウントし、ワイヤーボンデイング6を行い、樹脂
封止するものである。
〔発明の効果〕
以上説明したように本発明は、 (1) リードフレームの内部リードを連結したた
め、組立投入前のリードフレーム変形によるト
ラブルをなくすことができる。
(2) 同一リードフレームにて第2図のa,bのサ
イズを変更することによりペレツトサイズにあ
つたペレツト搭載部を設けることができ、組立
歩留が飛躍的に向上する。
(3) 同一リードフレームにて任意のペレツトのマ
ウントが可能であるため従来の様にペレツトサ
イズにあつたリードフレーム金型を準備する必
要がなく設備費の低減が行える 等の効果がある。
【図面の簡単な説明】
第1図は本発明の一実施例に用いたリードフレ
ームの内部パターン図、第2図は内部リードをパ
ンチング加工し絶縁物を接着した状態の平面図、
第3図A,Bはワイヤーボンデイング後の平面
図、断面図、第4図および第5図A,Bは従来例
を示す工程図である。 1……内部リード連結部、2……内部リード、
3……パンチング後の内部リード、4……絶縁
物、5……ペレツト、6……ボンデイングワイヤ
ー、7……内部リード、8……ペレツト搭載部、
9……ペレツト、10……ボンデイングワイヤ
ー。

Claims (1)

    【特許請求の範囲】
  1. 1 複数の内部リードの夫々の先端部が連結され
    ているリードフレームを用い、収納すべきペレツ
    トの大きさに従つて、このペレツトサイズより大
    きな開孔を形成すべく、前記連結した部分を除去
    して開孔部を形成し、しかる後この開孔部をカバ
    ーするように絶縁シートをリードフレームに接着
    し、前記絶縁シートにペレツトを装着することを
    特徴とする半導体装置の製造方法。
JP16303286A 1986-07-11 1986-07-11 半導体装置の製造方法 Granted JPS6318652A (ja)

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JP16303286A JPS6318652A (ja) 1986-07-11 1986-07-11 半導体装置の製造方法

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JPS6318652A JPS6318652A (ja) 1988-01-26
JPH0582981B2 true JPH0582981B2 (ja) 1993-11-24

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Publication number Priority date Publication date Assignee Title
JPH0653400A (ja) * 1992-07-28 1994-02-25 Nec Corp リードフレーム
JP2809206B2 (ja) 1995-06-26 1998-10-08 松下電器産業株式会社 光ディスク記録再生方法及び光ディスク装置
KR19980067079A (ko) * 1997-01-31 1998-10-15 이대원 트랜지스터용 리드프레임 제조방법

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Publication number Priority date Publication date Assignee Title
JPS5421262A (en) * 1977-07-18 1979-02-17 Daiakon Inc Method of producing electronic part package and device used therefor
JPS6095941A (ja) * 1983-10-31 1985-05-29 Toshiba Corp 半導体装置

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JPS6318652A (ja) 1988-01-26

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