JPH0578214B2 - - Google Patents

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JPH0578214B2
JPH0578214B2 JP58205176A JP20517683A JPH0578214B2 JP H0578214 B2 JPH0578214 B2 JP H0578214B2 JP 58205176 A JP58205176 A JP 58205176A JP 20517683 A JP20517683 A JP 20517683A JP H0578214 B2 JPH0578214 B2 JP H0578214B2
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JP
Japan
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resistors
resistor
voltage
series
converter
Prior art date
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JP58205176A
Other languages
English (en)
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JPS6096925A (ja
Inventor
Yutaka Katabe
Hiroshi Yoshizawa
Hiromi Kobayashi
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Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Publication date
Application filed by Matsushita Electronics Corp filed Critical Matsushita Electronics Corp
Priority to JP20517683A priority Critical patent/JPS6096925A/ja
Publication of JPS6096925A publication Critical patent/JPS6096925A/ja
Publication of JPH0578214B2 publication Critical patent/JPH0578214B2/ja
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    • H03—ELECTRONIC CIRCUITRY
    • H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M1/00—Analogue/digital conversion; Digital/analogue conversion
    • H03M1/12—Analogue/digital converters
    • H03M1/14—Conversion in steps with each step involving the same or a different conversion means and delivering more than one bit
    • H03M1/142—Conversion in steps with each step involving the same or a different conversion means and delivering more than one bit the reference generators for the steps being arranged in a common two-dimensional array
    • H—ELECTRICITY
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    • H03M1/365—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type the reference values being generated by a resistive voltage divider the voltage divider being a single resistor string
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    • H03M1/76—Simultaneous conversion using switching tree
    • H03M1/765—Simultaneous conversion using switching tree using a single level of switches which are controlled by unary decoded digital signals

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、Ａ／Ｄ変換器あるいはＤ／Ａ変換器
等の信号変換装置、特に、その基準電圧形成手段
に関するものである。
従来例の構成とその問題点 電圧基準として変換を行なうモノリシツクの
Ａ／Ｄ変換器やＤ／Ａ変換器では、各ステツプの
変換基準電圧を得るために、直列に複数の抵抗を
接続して、１ケの基準電源の電圧を分圧する手段
を用いることが多い。第１図は前記分圧手段の代
表的回路図で、１〜３２は各抵抗、２００は基準
電圧源、２０１，２０２はその電源用端子、３０
０〜３３２は各寄生容量である。この電圧分割回
路の抵抗の抵抗値の総和をＲ、寄生容量の容量値
の総和をＣとする。たとえば、抵抗１〜３２はそ
の値がすべて等しいとし、それぞれ1KΩとした。
ここでこの電圧分割回路で発生する電圧が供給さ
れる回路（例えばアナログスイツチや比較器）の
入力容量を充放電する場合の時定数をτとすると τCR ……(1) となる。この電圧分割回路を用いてＮビツト分解
能のＡ／Ｄ変換器あるいはＤ／Ａ変換器を構成
し、±1/2LSBの精度を得るのに必要な充放電時
間ｔは ｔ｛（Ｎ＋１）ln ２｝ ……(2) となる。例えば10ビツトの逐次比較型Ａ／Ｄ変換
器の場合は変換時間Ｔは Ｔ10t ……(3) となる。式(3)に式(2)を代入し、Ｎ＝10とすると Ｔ76τ となる。したがつてこの電圧分割回路を用いた
Ａ／Ｄ変換器あるいはＤ／Ａ変換器を高速化ある
いは高精度化するには式(1)で示される時定数τを
小さくすることが重要である。時定数τを小さく
するには式(1)より容量総和Ｃあるいは抵抗総和Ｒ
を小さくすればよい。容量総和Ｃあるいは抵抗総
和Ｒを小さくするには電圧分割回路の抵抗の長さ
を短くすることが有効である。しかし第１図に示
すような抵抗の直列接続による回路構成では、中
間端子などの接続のため抵抗の長さを短くするに
は限度があり、この方式で容量総和Ｃあるいは抵
抗総和Ｒを小さくしてＡ／Ｄ変換器あるいはＤ／
Ａ変換器の高速化あるいは高精度化を図るには限
界があつた。
発明の目的 本発明は主にモノリシツクのＡ／Ｄ変換器や
Ｄ／Ａ変換器の信号変換の基準となる電圧を得る
ために用いられる電圧分割回路の抵抗の抵抗値
を、チツプ面積の増大を招かずに等価的に減少さ
せ、Ａ／Ｄ変換器あるいはＤ／Ａ変換器の高速化
あるいは高精度化を図ることを目的としてなされ
たものである。
発明の構成 2mn個（ｍ，ｎは整数で、ｍ２，ｎ１）の
等しい抵抗値の抵抗を直列に、一方向にｎ個連結
した点で180°向きをかえ、逆方向ｎ個連結した配
列を、順次位置をずらしながらｍ回くりかえして
連結した第１の抵抗群と、これに並列にｍ個の等
しい抵抗値の抵抗を直列に連結した第２の抵抗群
とを接続し、第１の抵抗群の2n個目毎の連結点
と第２の抵抗群の連結点を相互に接続して配置
し、半導体基板内につくり込んだ分圧器を有する
信号変換回路である。
実施例の説明 本発明の実施例を第２図に基づいて説明する。
第２図において抵抗１０１から抵抗１３２の32本
の抵抗は５ビツトの分解能を持つ直列抵抗であ
る。この直列抵抗はたとえば８本毎に端子を出し
抵抗１５１から抵抗１５４の４本の抵抗を接続し
ている。今、１０１から１３２の32本の抵抗の抵
抗値の総和をＲ、寄生容量４００〜４３２の容量
値の総和をＣ、１５１から１５４の４本の抵抗の
抵抗値の総和をR′、寄生容量４５０〜４５４の
容量値の総和をC′とする。たとえばＲが32KΩ、
Ｃが2PFの場合、R′を2KΩ、C′を0.1PFと設定す
ると、 R′≪Ｒ、C′≪Ｃ ……(4) と見倣すことができ、この場合、前記充放電時定
数τは、 τCR′ ……(5) となり、１５１から１５４の４本の抵抗がない従
来の回路構成と比較すると、等価的に抵抗値がＲ
からR′に減少したことにより、この電圧分割回
路を各比較回路の所定基準電圧（分圧）源に用い
たＡ／Ｄ変換器あるいはＤ／Ａ変換器では、その
動作速度を著しく改善することができる。これは
Ａ／Ｄ変換器あるいはＤ／Ａ変換器の高速化ある
いは高精度化につながる。また本発明はその実施
に於いても数本の抵抗を付加するだけでありチツ
プ面積の増大はごくわずかであり、第２図の回路
図のような抵抗の配置とすればレイアウト上何ら
問題は発生しない。
発明の効果 以上説明したように、本発明はモノリシツクの
Ａ／Ｄ変換器やＤ／Ａ変換器においてチツプ面積
の増大やレイアウトの変更に関する問題を発生さ
せずに、信号変換の基準となる電位を得るための
電圧分割回路の等価抵抗値を低減させることがで
き、高速化や高精度化を図ることができ、その工
業的価値は大である。
【図面の簡単な説明】
第１図は従来における電圧分割回路の回路図、
第２図は本発明による電圧分割回路の回路図。 １〜３２，１０１〜１３２及び１５１〜１５４
……抵抗、２０１，２０２，２１１，２１２……
基準電圧端子、２００，２１０……基準電源、３
００〜３３２，４００〜４３２，４５０〜４５４
……寄生容量。

Claims (1)

    【特許請求の範囲】
  1. １ 2mn個（ｍ，ｎは整数で、ｍ２，ｎ１）
    の等しい抵抗値の抵抗を直列に、一方向にｎ個連
    結した点で180°向きをかえ、逆方向にｎ個連結し
    た配列を、順次位置をずらしながらｍ回くりかえ
    して連結した第１の抵抗群と、これに並列にｍ個
    の等しい抵抗値の抵抗を直列に連結した第２の抵
    抗群とを接続し、第１の抵抗群の2n個目毎の連
    結点と第２の抵抗群の連結点を相互に接続して配
    置し、半導体基板内につくり込んだ分圧器を有す
    る信号変換回路。
JP20517683A 1983-11-01 1983-11-01 信号変換回路 Granted JPS6096925A (ja)

Priority Applications (1)

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JP20517683A JPS6096925A (ja) 1983-11-01 1983-11-01 信号変換回路

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JP20517683A JPS6096925A (ja) 1983-11-01 1983-11-01 信号変換回路

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Publication Number Publication Date
JPS6096925A JPS6096925A (ja) 1985-05-30
JPH0578214B2 true JPH0578214B2 (ja) 1993-10-28

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ID=16502678

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JP20517683A Granted JPS6096925A (ja) 1983-11-01 1983-11-01 信号変換回路

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3019849U (ja) * 1995-06-22 1996-01-12 幹雄 斉藤 脱落防止付きコンドーム

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JPS5672527A (en) * 1979-11-19 1981-06-16 Matsushita Electric Ind Co Ltd Parallel analog-to-digital converter
JPS56146180A (en) * 1980-03-26 1981-11-13 Nichidenshi Technics Kk Digital picture processor

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JPS6096925A (ja) 1985-05-30

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