JPH05328294A - テレビジョン信号用メモリアドレス発生器 - Google Patents
テレビジョン信号用メモリアドレス発生器Info
- Publication number
- JPH05328294A JPH05328294A JP4132899A JP13289992A JPH05328294A JP H05328294 A JPH05328294 A JP H05328294A JP 4132899 A JP4132899 A JP 4132899A JP 13289992 A JP13289992 A JP 13289992A JP H05328294 A JPH05328294 A JP H05328294A
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- JP
- Japan
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- memory address
- counter
- counts
- clock
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- Pending
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- Television Signal Processing For Recording (AREA)
Abstract
面当りの有効ライン数によらずに、画像メモリにおいて
実際に画像が記憶されている部分の割合即ちメモリの使
用効率を最大の状態にする。 【構成】 メモリアドレスカウンタ2は、サンプリング
クロックCKをカウントする。クロックカウンタ1は、
1ライン当りの有効サンプル数をカウントする。水平同
期パルスカウンタ3は、1画面当りの有効ライン数をカ
ウントする。クロックカウンタ1が所定の有効サンプル
数分のサンプリングクロックCKをカウントした時点、
及び水平同期パルスカウンタ3が所定の有効ライン数分
の水平同期パルスPHをカウントした時点で、メモリア
ドレスカウンタ2のカウント動作を一時停止させ、水平
ブランキング期間及び垂直ブランキング期間は、メモリ
アドレスカウンタ2のカウント動作を禁止する。
Description
をディジタル信号に変換して記録する画像記録装置に有
用なテレビジョン信号用メモリアドレス発生器に関す
る。
ス発生器としては、図3に示すようなクロックカウンタ
4及び水平同期パルスカウンタ5からなる回路がある。
図3に示すテレビジョン信号用メモリアドレス発生器の
動作について説明する。クロックカウンタ4においてサ
ンプリングクロックCK’をカウントし、また水平同期
パルスカウンタ5において水平同期パルスPH’をカウ
ントする。そして、クロックカウンタ4の出力である水
平メモリアドレスCHと、水平同期パルスカウンタ5の
出力である垂直メモリアドレスCVとを合わせたもの
(CH+CV)をメモリアドレスとして出力する。
スPH’によってライン毎に、水平同期パルスカウンタ
5は垂直同期パルスPV’によって画面毎に夫々リセッ
トされる。
像データとの関係を示す説明図である。図5は、図3に
示す従来のテレビジョン信号用メモリアドレス発生器を
用いて構成した従来のテレビジョン信号用画像記録装置
の一例を示すブロック図である。動作について説明す
る。入力信号INは、A/D変換器6によってディジタ
ル信号DWに符号化されて、1画面以上の記憶容量をも
つ画像メモリ7に記憶される。このディジタル信号DWを
画像メモリ7に記憶する際の書き込みアドレスWを生成
する書き込みアドレス発生器8は、上述の図3に示すテ
レビジョン信号用メモリアドレス発生器を用いている。
図3に示すテレビジョン信号用メモリアドレス発生器を
用いた読み出しアドレス発生器9から出力される読み出
しアドレスRによって映像信号DRとして読み出され
る。映像信号DRは、D/A変換器10に入力されてア
ナログ信号ARに復号される。アナログ信号ARは、同期
信号付加器11において、タイミングパルス発生器12
が出力する同期信号を付加されて、正規のテレビジョン
映像信号である出力信号OUTとなって出力される。
た従来のテレビジョン信号用メモリアドレス発生器で
は、アドレス発生回路が容易に実現できる反面、水平ア
ドレスに対する有効サンプリング数の割合、又は垂直ア
ドレスに対する有効ライン数の割合が低い場合は、画像
メモリにおいて実際に画像が記憶されている部分の割合
即ちメモリの使用効率が極端に悪くなってしまうという
問題点がある。
のであって、テレビジョン映像信号をディジタル信号に
変換して記録する画像記録装置に用いられるテレビジョ
ン信号用メモリアドレス発生器において、1ライン当り
の有効サンプリング数及び1画面当りの有効ライン数に
よらずに、画像メモリにおいて実際に画像が記憶されて
いる部分の割合即ちメモリの使用効率を最大の状態にす
ることができるテレビジョン信号用メモリアドレス発生
器を提供することを目的とする。
ン信号用メモリアドレス発生器は、サンプリングクロッ
クをカウントするメモリアドレスカウンタと、1ライン
当りの有効サンプル数をカウントするクロックカウンタ
と、1画面当りの有効ライン数をカウントする水平同期
パルスカウンタとを有することを特徴とする。
ス発生器においては、テレビジョン映像信号をディジタ
ル信号に変換して記録する画像記録装置に用いられるテ
レビジョン信号用メモリアドレス発生器において、メモ
リアドレスカウンタはサンプリングクロックをカウント
し、このカウント値をメモリアドレスとして出力する。
クロックカウンタは、1ライン当りの有効サンプル数を
カウントする。水平同期パルスカウンタは、1画面当り
の有効ライン数をカウントする。そして、クロックカウ
ンタが所定の有効サンプル数分のサンプリングクロック
をカウントした時点、及び水平同期パルスカウンタが所
定の有効ライン数分の水平同期パルスをカウントした時
点で、メモリアドレスカウンタのカウント動作を一時停
止させることにより、水平ブランキング期間及び垂直ブ
ランキング期間は、メモリアドレスカウンタのカウント
動作を禁止する。これらにより本発明に係るテレビジョ
ン信号用メモリアドレス発生器は、画像の有効範囲のみ
でクロックをカウントすることができるので、1ライン
当りの有効サンプリング数及び1画面当りの有効ライン
数によらずに、画像メモリにおいて実際に画像が記憶さ
れている部分の割合即ちメモリの使用効率を最大の状態
にすることができる。
参照して説明する。
ン信号用メモリアドレス発生器を示すブロック図であ
る。図1に示すテレビジョン信号用メモリアドレス発生
器は、クロックカウンタ1,メモリアドレスカウンタ
2,水平同期パルスカウンタ3,アンド回路及びオア回
路から構成されている。
HとサンプリングクロックCKとを入力し、パルスD12
をオア回路に出力する。水平同期パルスカウンタ3は、
垂直同期パルスPVと水平同期パルスPHとを入力し、パ
ルスD32をオア回路に出力する。アンド回路は、垂直同
期パルスPVと水平同期パルスPHとを入力して、これら
の論理積信号をメモリアドレスカウンタ2に出力する。
オア回路は、パルスD12とパルスD32との論理和信号を
メモリアドレスカウンタ2に出力する。メモリアドレス
カウンタ2は、更にサンプリングクロックCKを入力
し、メモリアドレスとなるカウント値C2を出力する。
るテレビジョン信号用メモリアドレス発生器の動作につ
いて説明する。先ず、1ライン当りの有効サンプル数を
カウントするクロックカウンタ1は、サンプリングクロ
ックCKをカウントする。このとき、メモリアドレスカ
ウンタ2もサンプリングクロックCKをカウントしてい
る。クロックカウンタ1は、所定の有効サンプル数分の
サンプリングクロックCKをカウントした時点で、メモ
リアドレスカウンタ2のカウント動作を停止させるパル
スD12を出力する。これによりメモリアドレスカウンタ
2は、サンプリングクロックCKのカウントを一時中断
する。これらの動作により、水平ブランキング期間は、
メモリアドレスカウンタ2におけるサンプリングクロッ
クCKのカウントが禁止される。
ックカウンタ1がリセットされると、この時点から再び
クロックカウンタ1及びメモリアドレスカウンタ2が共
にサンプリングクロックCKのカウントを開始する。
面当りの有効ライン数をカウントする。これは水平同期
パルスPHをカウントすることで実現している。水平同
期パルスカウンタ3は、所定の有効ライン数分の水平同
期パルスPHをカウントした時点で、メモリアドレスカ
ウンタ2のカウント動作を停止させるパルスD32を出力
する。これによりメモリアドレスカウンタ2は、サンプ
リングクロックCKのカウントを一時中断する。これら
の動作により、垂直ブランキング期間は、メモリアドレ
スカウンタ2におけるサンプリングクロックCKのカウ
ントが禁止される。
同期パルスカウンタ3及びメモリアドレスカウンタ2が
リセットされると、この時点から再びメモリアドレスカ
ウンタ2はサンプリングクロックCKのカウントを開始
する。
ウンタ2は、画像の有効範囲内でのみサンプリングクロ
ックCKをカウントすることになるので、メモリアドレ
スカウンタ2の出力であるカウント値C2を1画面分の
メモリアドレスとして用いることにより、画像メモリを
最も効率よく使用することができるようになる。
出力であるカウント値C2(メモリアドレス)と画像デ
ータとの関係を示す説明図である。図2においては、1
ライン当りの有効サンプル数をN、1画面当りの有効ラ
イン数をMとしている。
ジョン信号用メモリアドレス発生器によれば、テレビジ
ョン映像信号をディジタル信号に変換して記録する画像
記録装置に用いられるテレビジョン信号用メモリアドレ
ス発生器において、サンプリングクロックをカウントす
るメモリアドレスカウンタと、1ライン当りの有効サン
プル数をカウントするクロックカウンタと、1画面当り
の有効ライン数をカウントする水平同期パルスカウンタ
とを有することにより、1ライン当りの有効サンプリン
グ数及び1画面当りの有効ライン数によらずに、画像メ
モリにおいて実際に画像が記憶されている部分の割合即
ちメモリの使用効率を最大の状態にすることができるの
で、複数の画面分の画像メモリをもつ画像記録装置で
は、従来と同じメモリ容量で従来より映像を記憶できる
画面数(記録時間)を増やすことができる。
リアドレス発生器を示すブロック図である。
発生器の出力であるカウント値C2(メモリアドレス)
と画像データとの関係を示す説明図である。
器の一例を示すブロック図である。
ドレス発生器が出力するメモリアドレス(CH+CV)と
画像データとの関係を示す説明図である。
ドレス発生器を用いて構成した従来のテレビジョン信号
用画像記録装置の一例を示すブロック図である。
Claims (2)
- 【請求項1】 サンプリングクロックをカウントするメ
モリアドレスカウンタと、1ライン当りの有効サンプル
数をカウントするクロックカウンタと、1画面当りの有
効ライン数をカウントする水平同期パルスカウンタとを
有することを特徴とするテレビジョン信号用メモリアド
レス発生器。 - 【請求項2】 前記メモリアドレスカウンタは、前記ク
ロックカウンタが所定の有効サンプル数分のサンプリン
グクロックをカウントした時点及び前記水平同期パルス
カウンタが所定の有効ライン数分の水平同期パルスをカ
ウントした時点で、前記サンプリングクロックをカウン
トする動作を一時停止することを特徴とする請求項1に
記載のテレビジョン信号用メモリアドレス発生器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4132899A JPH05328294A (ja) | 1992-05-25 | 1992-05-25 | テレビジョン信号用メモリアドレス発生器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4132899A JPH05328294A (ja) | 1992-05-25 | 1992-05-25 | テレビジョン信号用メモリアドレス発生器 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH05328294A true JPH05328294A (ja) | 1993-12-10 |
Family
ID=15092153
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4132899A Pending JPH05328294A (ja) | 1992-05-25 | 1992-05-25 | テレビジョン信号用メモリアドレス発生器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH05328294A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07236117A (ja) * | 1994-02-24 | 1995-09-05 | Nec Corp | 画像処理装置 |
US5612926A (en) * | 1994-11-30 | 1997-03-18 | Mitsubishi Denki Kabushiki Kaisha | Sequential access memory |
JPWO2006035843A1 (ja) * | 2004-09-30 | 2008-05-15 | シャープ株式会社 | タイミング信号生成回路、電子デバイス、表示装置、受像装置、及び駆動方法 |
-
1992
- 1992-05-25 JP JP4132899A patent/JPH05328294A/ja active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07236117A (ja) * | 1994-02-24 | 1995-09-05 | Nec Corp | 画像処理装置 |
US5612926A (en) * | 1994-11-30 | 1997-03-18 | Mitsubishi Denki Kabushiki Kaisha | Sequential access memory |
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JP4668202B2 (ja) * | 2004-09-30 | 2011-04-13 | シャープ株式会社 | タイミング信号生成回路、電子デバイス、表示装置、受像装置、及び電子デバイスの駆動方法 |
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