JPH05219510A - ビデオ信号処理装置 - Google Patents
ビデオ信号処理装置Info
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- JPH05219510A JPH05219510A JP4042397A JP4239792A JPH05219510A JP H05219510 A JPH05219510 A JP H05219510A JP 4042397 A JP4042397 A JP 4042397A JP 4239792 A JP4239792 A JP 4239792A JP H05219510 A JPH05219510 A JP H05219510A
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- Japan
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- circuit
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- signal
- video signal
- signal processing
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/79—Processing of colour television signals in connection with recording
- H04N9/80—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback
- H04N9/82—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback the individual colour picture signal components being recorded simultaneously only
- H04N9/83—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback the individual colour picture signal components being recorded simultaneously only the recorded chrominance signal occupying a frequency band under the frequency band of the recorded brightness signal
- H04N9/831—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback the individual colour picture signal components being recorded simultaneously only the recorded chrominance signal occupying a frequency band under the frequency band of the recorded brightness signal using intermediate digital signal processing
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/79—Processing of colour television signals in connection with recording
- H04N9/87—Regeneration of colour television signals
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/765—Interface circuits between an apparatus for recording and another apparatus
- H04N5/77—Interface circuits between an apparatus for recording and another apparatus between a recording apparatus and a television camera
- H04N5/772—Interface circuits between an apparatus for recording and another apparatus between a recording apparatus and a television camera the recording apparatus and the television camera being placed in the same enclosure
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S358/00—Facsimile and static presentation processing
- Y10S358/906—Hand-held camera with recorder in a single unit
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Processing Of Color Television Signals (AREA)
- Television Signal Processing For Recording (AREA)
- Color Television Image Signal Generators (AREA)
Abstract
(57)【要約】
【目的】 ＶＴＲ内蔵型ビデオカメラにおいて、部品点
数を少なくし、構成を簡略化して、低コスト化を実現す
る。 【構成】 再生モード時、フィードフォワードＡＰＣ回
路４に供給するデータを演算部２２において演算すると
き、データをＲＡＭ２３に随時記憶させる。また、記録
モード時、マイクロコンピュータ１３に供給するデータ
を演算部２２により演算し、ＲＡＭ２３に記憶させる。
即ち、記録モード時および再生モード時において、演算
部２２とＲＡＭ２３を共用する。
数を少なくし、構成を簡略化して、低コスト化を実現す
る。 【構成】 再生モード時、フィードフォワードＡＰＣ回
路４に供給するデータを演算部２２において演算すると
き、データをＲＡＭ２３に随時記憶させる。また、記録
モード時、マイクロコンピュータ１３に供給するデータ
を演算部２２により演算し、ＲＡＭ２３に記憶させる。
即ち、記録モード時および再生モード時において、演算
部２２とＲＡＭ２３を共用する。
Description
【０００１】
【産業上の利用分野】本発明は、例えばビデオカメラに
用いて好適なビデオ信号処理装置に関する。
用いて好適なビデオ信号処理装置に関する。
【０００２】
【従来の技術】ビデオカメラにおいては、露出、フォー
カスあるいはホワイトバランスなどを調整する必要があ
る。この調整を自動的に行なうために、被写体を撮影し
て得られたＹ，Ｒ，Ｇ，Ｂなどのデータをそれぞれ積分
処理するなどして、また、画面分割などに対応して、Ｒ
ＡＭにエリアデータとして記憶する。そして、このデー
タをカメラ用のマイクロコンピュータに転送し、アイリ
ス制御、フォーカス制御、ホワイトバランス制御用の信
号を生成する。
カスあるいはホワイトバランスなどを調整する必要があ
る。この調整を自動的に行なうために、被写体を撮影し
て得られたＹ，Ｒ，Ｇ，Ｂなどのデータをそれぞれ積分
処理するなどして、また、画面分割などに対応して、Ｒ
ＡＭにエリアデータとして記憶する。そして、このデー
タをカメラ用のマイクロコンピュータに転送し、アイリ
ス制御、フォーカス制御、ホワイトバランス制御用の信
号を生成する。
【０００３】また、ビデオカメラにＶＴＲが内蔵されて
いる場合においては、磁気テープから再生されたビデオ
信号を処理する回路が必要になる。この回路には、色信
号成分の位相を制御する自動位相制御回路（ＡＰＣ回
路）が含まれる。
いる場合においては、磁気テープから再生されたビデオ
信号を処理する回路が必要になる。この回路には、色信
号成分の位相を制御する自動位相制御回路（ＡＰＣ回
路）が含まれる。
【０００４】
【発明が解決しようとする課題】従来の装置において
は、このようなアイリス、フォーカスまたはホワイトバ
ランス調整用の信号処理を行なうＯＰＤ（オプティカル
ディテクタ）回路と、色信号成分の位相を制御するＡＰ
Ｃ回路とを、それぞれ独立に設けるようにしていた。そ
の結果、構成が複雑になり、部品点数が増加して装置が
大型化し、かつコスト高となる課題があった。
は、このようなアイリス、フォーカスまたはホワイトバ
ランス調整用の信号処理を行なうＯＰＤ（オプティカル
ディテクタ）回路と、色信号成分の位相を制御するＡＰ
Ｃ回路とを、それぞれ独立に設けるようにしていた。そ
の結果、構成が複雑になり、部品点数が増加して装置が
大型化し、かつコスト高となる課題があった。
【０００５】本発明はこのような状況に鑑みてなされた
ものであり、構成を簡略化し、低コスト化を可能にする
ものである。
ものであり、構成を簡略化し、低コスト化を可能にする
ものである。
【０００６】
【課題を解決するための手段】本発明のビデオ信号処理
装置は、ビデオ信号中に含まれる色信号成分の位相を制
御する位相制御手段としてのＡＰＣ回路１７と、ビデオ
カメラより出力されたビデオ信号を検出し、アイリス、
フォーカスまたはホワイトバランス調整用の信号を生成
する生成手段としてのマイクロコンピュータ１３と、Ａ
ＰＣ回路１７およびマイクロコンピュータ１３が処理す
る信号を演算する、ＡＰＣ回路１７およびマイクロコン
ピュータ１３において兼用される演算手段としてのデジ
タル演算回路１２とを備えることを特徴とする。
装置は、ビデオ信号中に含まれる色信号成分の位相を制
御する位相制御手段としてのＡＰＣ回路１７と、ビデオ
カメラより出力されたビデオ信号を検出し、アイリス、
フォーカスまたはホワイトバランス調整用の信号を生成
する生成手段としてのマイクロコンピュータ１３と、Ａ
ＰＣ回路１７およびマイクロコンピュータ１３が処理す
る信号を演算する、ＡＰＣ回路１７およびマイクロコン
ピュータ１３において兼用される演算手段としてのデジ
タル演算回路１２とを備えることを特徴とする。
【０００７】
【作用】上記構成のビデオ信号処理装置においては、Ａ
ＰＣ回路１７とマイクロコンピュータ１３において処理
される信号を演算するデジタル演算回路１２が、ＡＰＣ
動作およびＯＰＤ動作において兼用されている。従っ
て、部品点数を少なくし、構成を簡略化して、低コスト
化することが可能になる。
ＰＣ回路１７とマイクロコンピュータ１３において処理
される信号を演算するデジタル演算回路１２が、ＡＰＣ
動作およびＯＰＤ動作において兼用されている。従っ
て、部品点数を少なくし、構成を簡略化して、低コスト
化することが可能になる。
【０００８】
【実施例】図１は、本発明のビデオ信号処理装置を応用
したビデオカメラ（ＶＴＲ内蔵タイプ）の一実施例の構
成を示すブロック図である。ＡＣＣ回路１は、入力され
たデジタルビデオデータのうち、カラーバースト成分の
レベルが一定となるように調整した後、デコーダ２に出
力している。デコーダ２はＡＣＣ回路１より入力される
７４３ｋＨｚに低域変換されているＲ−Ｙ，Ｂ−Ｙのク
ロマデータをベースバンドに変換し、色信号処理回路３
に出力している。色信号処理回路３は入力されたデータ
にディエンファシス処理、クロストーク除去のためのく
し型フィルタ処理を施す。このデータは、フィードフォ
ワード（ＦＦ）ＡＰＣ回路４とバーストゲート回路８に
供給されている。
したビデオカメラ（ＶＴＲ内蔵タイプ）の一実施例の構
成を示すブロック図である。ＡＣＣ回路１は、入力され
たデジタルビデオデータのうち、カラーバースト成分の
レベルが一定となるように調整した後、デコーダ２に出
力している。デコーダ２はＡＣＣ回路１より入力される
７４３ｋＨｚに低域変換されているＲ−Ｙ，Ｂ−Ｙのク
ロマデータをベースバンドに変換し、色信号処理回路３
に出力している。色信号処理回路３は入力されたデータ
にディエンファシス処理、クロストーク除去のためのく
し型フィルタ処理を施す。このデータは、フィードフォ
ワード（ＦＦ）ＡＰＣ回路４とバーストゲート回路８に
供給されている。
【０００９】バーストゲート回路８は、入力されたビデ
オデータからバースト成分のみを通過させる。バースト
ゲート回路８の出力は積分回路９により積分され、スイ
ッチ１１の接点Ｐを介してデジタル演算回路１２のデー
タ入出力部２１に供給されている。データ入出力部２１
より出力されたデータは、スイッチ１０の接点Ｂを介し
てＶＣＯ７に供給され、ＶＣＯ７の発振周波数を制御す
るようになされている。ＶＣＯ７より出力された７４３
ｋＨｚの基準信号は、デコーダ２に供給されている。以
上の回路により、自動位相制御回路１７が構成されてい
る。
オデータからバースト成分のみを通過させる。バースト
ゲート回路８の出力は積分回路９により積分され、スイ
ッチ１１の接点Ｐを介してデジタル演算回路１２のデー
タ入出力部２１に供給されている。データ入出力部２１
より出力されたデータは、スイッチ１０の接点Ｂを介し
てＶＣＯ７に供給され、ＶＣＯ７の発振周波数を制御す
るようになされている。ＶＣＯ７より出力された７４３
ｋＨｚの基準信号は、デコーダ２に供給されている。以
上の回路により、自動位相制御回路１７が構成されてい
る。
【００１０】フィードフォワードＡＰＣ回路４より出力
された信号は、エンコーダ５に供給され、周波数ｆ
SC（＝３．５８ＭＨｚ）の基準色副搬送波と乗算される
ようになされている。エンコーダ５はフィードフォワー
ドＡＰＣ回路４より供給された色差データを３．５８Ｍ
Ｈｚのクロマデータに変換し、Ｄ／Ａ変換器６に出力す
る。Ｄ／Ａ変換器６は、入力されたクロマデータをアナ
ログクロマ信号に変換して出力するようになされてい
る。
された信号は、エンコーダ５に供給され、周波数ｆ
SC（＝３．５８ＭＨｚ）の基準色副搬送波と乗算される
ようになされている。エンコーダ５はフィードフォワー
ドＡＰＣ回路４より供給された色差データを３．５８Ｍ
Ｈｚのクロマデータに変換し、Ｄ／Ａ変換器６に出力す
る。Ｄ／Ａ変換器６は、入力されたクロマデータをアナ
ログクロマ信号に変換して出力するようになされてい
る。
【００１１】デジタル演算回路１２は、データ入出力部
２１の他、例えばＡＬＵにより構成される演算部２２、
随時データを記憶するＲＡＭ２３、並びにデータ入出力
部２１、演算部２２およびＲＡＭ２３をマイクロプログ
ラミング方式により制御する制御部２４とを有してい
る。これらは１つのデジタル信号処理ＩＣの内部に形成
される。
２１の他、例えばＡＬＵにより構成される演算部２２、
随時データを記憶するＲＡＭ２３、並びにデータ入出力
部２１、演算部２２およびＲＡＭ２３をマイクロプログ
ラミング方式により制御する制御部２４とを有してい
る。これらは１つのデジタル信号処理ＩＣの内部に形成
される。
【００１２】マイクロコンピュータ１３は、ＲＡＭ２３
より供給されたデータを処理し、アイリス制御信号、フ
ォーカス制御信号、ホワイトバランス制御信号などを生
成する。
より供給されたデータを処理し、アイリス制御信号、フ
ォーカス制御信号、ホワイトバランス制御信号などを生
成する。
【００１３】次に、その動作について説明する。最初
に、図示せぬビデオテープからビデオ信号を再生する場
合の動作について説明する。このとき、ビデオテープよ
り再生されたビデオ信号がＡ／Ｄ変換されてデジタルデ
ータとされた後、ＡＣＣ回路１に供給される。ＡＣＣ回
路１は、カラーバースト成分のレベルを一定にしてデコ
ーダ２に出力する。デコーダ２は、ＡＣＣ回路１より入
力された７４３ｋＨｚの低域クロマ信号に、ＶＣＯ７よ
り供給されている７４３ｋＨｚの基準データを乗算し
て、ベースバンドの色差データＲ−Ｙ，Ｂ−Ｙを生成
し、色信号処理回路３に出力する。色信号処理回路３は
このデータに、ディエンファシス処理、くし型フィルタ
処理を施し、バーストゲート回路８に供給する。
に、図示せぬビデオテープからビデオ信号を再生する場
合の動作について説明する。このとき、ビデオテープよ
り再生されたビデオ信号がＡ／Ｄ変換されてデジタルデ
ータとされた後、ＡＣＣ回路１に供給される。ＡＣＣ回
路１は、カラーバースト成分のレベルを一定にしてデコ
ーダ２に出力する。デコーダ２は、ＡＣＣ回路１より入
力された７４３ｋＨｚの低域クロマ信号に、ＶＣＯ７よ
り供給されている７４３ｋＨｚの基準データを乗算し
て、ベースバンドの色差データＲ−Ｙ，Ｂ−Ｙを生成
し、色信号処理回路３に出力する。色信号処理回路３は
このデータに、ディエンファシス処理、くし型フィルタ
処理を施し、バーストゲート回路８に供給する。
【００１４】バーストゲート回路８は、入力された信号
からバースト信号成分のみを抽出する。このバースト信
号成分は、積分回路９により積分され、スイッチ１１の
接点Ｐ（このスイッチ１１は再生モード時、接点Ｐ側に
切換えられている）を介してデータ入出力部２１に供給
される。制御部２４は、データ入出力部２１に入力され
たデータを演算部２２に供給し、フィードバックループ
による再生（ＰＢ）ＡＰＣフィルタ（ローパスフィル
タ）処理する上に必要な演算を実行させるとともに、フ
ィードフォワードＡＰＣフィルタ処理する上に必要な演
算を実行させる。この複雑な演算を実行するとき、デー
タは必要に応じてＲＡＭ２３に書き込まれ、また、読み
出される。
からバースト信号成分のみを抽出する。このバースト信
号成分は、積分回路９により積分され、スイッチ１１の
接点Ｐ（このスイッチ１１は再生モード時、接点Ｐ側に
切換えられている）を介してデータ入出力部２１に供給
される。制御部２４は、データ入出力部２１に入力され
たデータを演算部２２に供給し、フィードバックループ
による再生（ＰＢ）ＡＰＣフィルタ（ローパスフィル
タ）処理する上に必要な演算を実行させるとともに、フ
ィードフォワードＡＰＣフィルタ処理する上に必要な演
算を実行させる。この複雑な演算を実行するとき、デー
タは必要に応じてＲＡＭ２３に書き込まれ、また、読み
出される。
【００１５】演算部２２により演算されたフィードバッ
クＡＰＣフィルタ処理に必要なデータは、データ入出力
部２１からスイッチ１０の接点Ｂを介してＶＣＯ７に供
給される。ＶＣＯ７は、この入力に対応して、カラーバ
ーストの位相に同期した７４３ｋＨｚの基準信号を発生
し、デコーダ２に出力する。即ち、このように、デコー
ダ２、色信号処理回路３、バーストゲート回路８、積分
回路９、デジタル演算回路１２、ＶＣＯ７により構成さ
れるフィードバックループにより、カラーバースト信号
の位相が制御されることになる。
クＡＰＣフィルタ処理に必要なデータは、データ入出力
部２１からスイッチ１０の接点Ｂを介してＶＣＯ７に供
給される。ＶＣＯ７は、この入力に対応して、カラーバ
ーストの位相に同期した７４３ｋＨｚの基準信号を発生
し、デコーダ２に出力する。即ち、このように、デコー
ダ２、色信号処理回路３、バーストゲート回路８、積分
回路９、デジタル演算回路１２、ＶＣＯ７により構成さ
れるフィードバックループにより、カラーバースト信号
の位相が制御されることになる。
【００１６】制御部２４は、演算部２２により演算した
フィードフォワードＡＰＣフィルタ処理に必要なデータ
を出力するとき、スイッチ１０の接点をＦ側に切換え
る。これにより、フィードフォワードＡＰＣ回路４に演
算部２２より演算したデータが供給されることになる。
フィードフォワードＡＰＣ回路４は、データ入出力部２
１より供給されたこのデータに対応して、上記したフィ
ードバックループにより除去しきれなかった位相誤差を
さらに抑制するように制御する。
フィードフォワードＡＰＣフィルタ処理に必要なデータ
を出力するとき、スイッチ１０の接点をＦ側に切換え
る。これにより、フィードフォワードＡＰＣ回路４に演
算部２２より演算したデータが供給されることになる。
フィードフォワードＡＰＣ回路４は、データ入出力部２
１より供給されたこのデータに対応して、上記したフィ
ードバックループにより除去しきれなかった位相誤差を
さらに抑制するように制御する。
【００１７】このようにして位相が調整された信号は、
エンコーダ５に供給され、３．５８ＭＨｚの基準信号と
乗算されて、元の周波数３．５８ＭＨｚのクロマデータ
に戻される。エンコーダ５にはこの処理に必要な周波数
ｆSC（３．５８ＭＨｚ）の基準信号が供給されている。
そして、このクロマデータはさらにＤ／Ａ変換器６によ
りＤ／Ａ変換され、アナログクロマ信号として出力され
る。
エンコーダ５に供給され、３．５８ＭＨｚの基準信号と
乗算されて、元の周波数３．５８ＭＨｚのクロマデータ
に戻される。エンコーダ５にはこの処理に必要な周波数
ｆSC（３．５８ＭＨｚ）の基準信号が供給されている。
そして、このクロマデータはさらにＤ／Ａ変換器６によ
りＤ／Ａ変換され、アナログクロマ信号として出力され
る。
【００１８】従って、再生モード時においては、図１の
回路は図２に示すように構成されているのと等価とな
る。即ち、デジタル演算回路１２の演算部２２により再
生（ＰＢ）ＡＰＣフィルタ３１とフィードフォワード
（ＦＦ）ＡＰＣフィルタ３２が構成され、このフィード
フォワードＡＰＣフィルタ３２にＲＡＭ２３が接続され
た構成となっている。
回路は図２に示すように構成されているのと等価とな
る。即ち、デジタル演算回路１２の演算部２２により再
生（ＰＢ）ＡＰＣフィルタ３１とフィードフォワード
（ＦＦ）ＡＰＣフィルタ３２が構成され、このフィード
フォワードＡＰＣフィルタ３２にＲＡＭ２３が接続され
た構成となっている。
【００１９】次に、ビデオカメラで被写体を撮像する場
合の動作について説明する。このとき、制御部２４はス
イッチ１１を接点Ｃ側に切換える。この接点Ｃには、ビ
デオカメラの図示せぬＣＣＤなどの撮像素子から出力さ
れたＹ，Ｒ，Ｇ，Ｂデータが供給されている。このデー
タは、データ入出力部２１から演算部２２に供給され、
必要に応じてＲＡＭ２３に書き込まれる。演算部２２
は、これらＹ，Ｒ，Ｇ，Ｂのデータをそれぞれ積分処理
し、画面分割などに応じてＲＡＭ２３にエリアデータと
してそれぞれ記憶させる。この積分値データあるいはヒ
ストグラムデータは、マイクロコンピュータ１３に供給
される。マイクロコンピュータ１３は、これらのデータ
を処理し、アイリス、フォーカス、ホワイトバランスな
どを調整する制御信号を生成する。
合の動作について説明する。このとき、制御部２４はス
イッチ１１を接点Ｃ側に切換える。この接点Ｃには、ビ
デオカメラの図示せぬＣＣＤなどの撮像素子から出力さ
れたＹ，Ｒ，Ｇ，Ｂデータが供給されている。このデー
タは、データ入出力部２１から演算部２２に供給され、
必要に応じてＲＡＭ２３に書き込まれる。演算部２２
は、これらＹ，Ｒ，Ｇ，Ｂのデータをそれぞれ積分処理
し、画面分割などに応じてＲＡＭ２３にエリアデータと
してそれぞれ記憶させる。この積分値データあるいはヒ
ストグラムデータは、マイクロコンピュータ１３に供給
される。マイクロコンピュータ１３は、これらのデータ
を処理し、アイリス、フォーカス、ホワイトバランスな
どを調整する制御信号を生成する。
【００２０】従って、記録モード時、図１に示す回路は
等価的に図３に示すように表すことができる。即ち、こ
の場合においては、デジタル演算回路１２がＯＰＤ（オ
プティカルディテクタ）回路４１とＲＡＭ２３により構
成されることになる。このＯＰＤ回路４１は、上述した
演算部２２により構成される回路である。
等価的に図３に示すように表すことができる。即ち、こ
の場合においては、デジタル演算回路１２がＯＰＤ（オ
プティカルディテクタ）回路４１とＲＡＭ２３により構
成されることになる。このＯＰＤ回路４１は、上述した
演算部２２により構成される回路である。
【００２１】
【発明の効果】以上の如く本発明のビデオ信号処理装置
によれば、位相制御手段および生成手段の処理に必要な
演算を共用の演算手段において行なうようにしたので、
部品点数を少なくし、構成を簡略化して、低コストの装
置を実現することが可能になる。
によれば、位相制御手段および生成手段の処理に必要な
演算を共用の演算手段において行なうようにしたので、
部品点数を少なくし、構成を簡略化して、低コストの装
置を実現することが可能になる。
【図１】本発明のビデオ信号処理装置を応用したビデオ
カメラの一実施例の構成を示すブロック図である。
カメラの一実施例の構成を示すブロック図である。
【図２】再生モード時における図１の実施例の等価的構
成を示すブロック図である。
成を示すブロック図である。
【図３】記録モード時における図１の実施例の等価的構
成を示すブロック図である。
成を示すブロック図である。
２ デコーダ ４ フィードフォワードＡＰＣ回路 ５ エンコーダ ７ ＶＣＯ ８ バーストゲート回路 ９ 積分回路 １２ デジタル演算回路 １３ マイクロコンピュータ １７ 自動位相制御回路 ２１ データ入出力部 ２２ 演算部 ２３ ＲＡＭ ２４ 制御部 ３１ フィードバックＡＰＣフィルタ ３２ フィードフォワードＡＰＣフィルタ ４１ ＯＰＤ回路
Claims (1)
- 【請求項１】 ビデオ信号中に含まれる色信号成分の位
相を制御する位相制御手段と、 ビデオカメラより出力されたビデオ信号を検出し、アイ
リス、フォーカスまたはホワイトバランス調整用の信号
を生成する生成手段と、 前記位相制御手段および前記生成手段が処理する信号を
演算する、前記位相制御手段および前記生成手段におい
て兼用される演算手段とを備えることを特徴とするビデ
オ信号処理装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4042397A JPH05219510A (ja) | 1992-01-31 | 1992-01-31 | ビデオ信号処理装置 |
| US08/006,774 US5291298A (en) | 1992-01-31 | 1993-01-21 | Video signal processing apparatus for controlling exposure, focus, and white balance for a VTR incorporated in a video camera |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4042397A JPH05219510A (ja) | 1992-01-31 | 1992-01-31 | ビデオ信号処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05219510A true JPH05219510A (ja) | 1993-08-27 |
Family
ID=12634937
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4042397A Withdrawn JPH05219510A (ja) | 1992-01-31 | 1992-01-31 | ビデオ信号処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5291298A (ja) |
| JP (1) | JPH05219510A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003101857A (ja) * | 2001-09-19 | 2003-04-04 | Sony Corp | 撮像装置 |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5772116A (en) * | 1993-12-02 | 1998-06-30 | Holt; Earl R. | Recirculating paint system having an improved spray gun |
| JP3865482B2 (ja) * | 1997-10-07 | 2007-01-10 | 松下電器産業株式会社 | 信号波形等化装置 |
| US6845176B1 (en) * | 1998-03-17 | 2005-01-18 | Sharp Laboratories Of America, Inc. | System and method for on-line computation and storage of scene histograms in an image acquisition appliance |
| US20070043677A1 (en) * | 2005-08-17 | 2007-02-22 | Idt Corporation | Point of sale product authorization |
| US11295387B2 (en) * | 2007-02-06 | 2022-04-05 | The Prudential Insurance Company Of America | System and method for providing a financial instrument with an asset transfer feature |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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