JPH05217001A - データ収集装置 - Google Patents
データ収集装置Info
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- JPH05217001A JPH05217001A JP4214592A JP4214592A JPH05217001A JP H05217001 A JPH05217001 A JP H05217001A JP 4214592 A JP4214592 A JP 4214592A JP 4214592 A JP4214592 A JP 4214592A JP H05217001 A JPH05217001 A JP H05217001A
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- cpu
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- data collecting
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Abstract
装置内データを収集するためのRAMアクセス回数およ
びアクセス時間が増加することはなく、装置の動作性能
を高めることができるデータ収集装置を得ること。 【構成】 複数の装置構成部31〜3Nと、各装置構成
部31〜3Nの装置内データを収集するデータ収集手段
20と、データ収集手段20から装置内データを読み出
すCPU10とから構成されるデータ収集装置におい
て、各装置構成部31〜3Nからの装置内データの空間
的および時間的な入れ替えを行いデータ収集手段20に
出力するスイッチ手段1と、スイッチ手段1を制御する
切り替え制御手段4と、CPU10の制御に基づいて切
り替え制御手段4での入れ替え情報の設定を行う切り替
え設定手段5とを併設する。
Description
り、とくにCPU制御のデジタル機器におけるデータ収
集装置に関する。
4の従来例は、複数の装置構成部31〜3N(Nは正の
整数)と、データバス100を介して時分割で各装置構
成部31〜3Nから装置内データを収集するデータ収集
手段20と、データ収集手段20へ読み出し信号11を
出力するとともにCPUデータバス110を介してデー
タ収集手段20から装置内データを読み出すCPU10
とを備えている。
れるように、入力タイミング信号24および書き込みア
ドレス信号25を出力する書き込み制御手段23と、書
き込み制御手段23からの入力タイミング信号24に基
づいてデータバス100を介して入力される装置内デー
タを取り込むデータ入力手段22と、書き込み制御手段
23からの書き込みアドレス信号25に基づいて入力デ
ータバス120を介してデータ入力手段22からの装置
内データを書き込むとともにCPU10からの読み出し
信号11に基づいて格納している装置内データをCPU
データバス110に送出するRAM21とから構成され
る。
ータを時分割でデータバス100に送出する。
段23からの入力タイミング信号24に同期してデータ
バス100上の装置内データを取り込むとともに入力デ
ータバス120に送出する。
らの書き込みアドレス信号25に基づいて入力データバ
ス120上の装置内データを書き込む。
ように第1の装置構成部31の装置内データ230から
順に第2の装置構成部32の装置内データ240,・・
・・・のように、各装置構成部の装置内データは各装置
構成部毎にアドレス単位で書き込まれている。
AM21に出力される。
タをCPUデータバス110に送出する。
上の装置内データを読み出す。
来例においては、各装置構成部の装置内データは各装置
構成部毎にアドレス単位でRAMに格納されているため
に、異なる装置構成部間にまたがる情報あるいは異なる
装置構成部間で相関の強い情報を処理する場合には、R
AM上の複数のアドレスに書き込まれている情報をCP
Uがランダムに読み出さなければならず、装置構成部が
増加するとCPUが読み出さなければならないRAM上
のアドレス領域が増加し、CPUのRAMアクセス回数
とアクセス時間が増加するとともに装置の動作性能が確
保できなくなるという不都合があった。
不都合を改善し、とくにCPU制御のデジタル機器にお
いて、装置を構成する部分が増加してもCPUが各装置
内データを収集するためにRAMをアクセスする回数お
よびアクセスする時間が増加することはなく、装置の動
作性能を高めることができるデータ収集装置を提供する
ことにある。
数の装置構成部と、各装置構成部からの装置内データの
時間的および空間的な入れ替えを行うスイッチ手段と、
スイッチ手段を制御する切り替え制御手段と、切り替え
制御手段での入れ替え情報設定を行う切り替え設定手段
と、スイッチ手段にて切り替えられた装置内データを収
集するデータ収集手段と、切り替え設定手段を制御する
とともにデータ収集手段から装置内データを読み出すC
PUとを具備するという構成を採っている。これによっ
て前述した目的を達成しようとするものである。
づいて入れ替え情報の設定を行い、切り替え制御手段へ
出力する。各装置構成部から装置内データが時分割で送
出されると、スイッチ手段は切り替え制御手段の制御に
基づき受信した各装置構成部の装置内データに対しデー
タ間での入れ替えと各データビット列の前後関係の入れ
替えを行う。データ収集手段はスイッチ手段にて空間的
および時間的に入れ替えられた装置内データを取り込み
記憶する。読み出し信号がCPUからデータ収集手段に
出力されると、データ収集手段は記憶している装置内デ
ータをCPUに送出する。
図3に基づいて説明する。
3N(Nは正の整数)と、データバス100を介して各
装置構成部から集められた装置内データの空間的および
時間的な入れ替えを行うスイッチ手段1と、スイッチ手
段1を制御する切り替え制御手段4と、切り替え制御手
段4での装置内データの入れ替え情報設定を行う切り替
え設定手段5と、スイッチ手段1にて切り替えられた装
置内データを収集するデータ収集手段20と、切り替え
設定手段5を制御するとともにデータ収集手段20へ読
み出し信号11を出力しCPUデータバス110を介し
てデータ収集手段20から装置内データを読み出すCP
U10とから構成される。
れている従来例と同様に入力タイミング信号24および
書き込みアドレス信号25を出力する書き込み制御手段
23と、書き込み制御手段23からの入力タイミング信
号24に基づいてスイッチ手段1からの装置内データを
取り込むデータ入力手段22と、書き込み制御手段23
からの書き込みアドレス信号25に基づいて入力データ
バス120を介してデータ入力手段22からの装置内デ
ータを記憶するとともにCPU10からの読み出し信号
11に基づいて記憶している装置内データをCPUデー
タバス110に送出するRAM21とから構成される。
段4からの制御信号に基づいてデータバス100上の装
置内データを空間的に入れ替える空間スイッチ手段2
と、空間スイッチ手段2からの装置内データを時間的に
入れ替える時間スイッチ手段3とから構成される。
こでは一例として3個の装置構成部を有する場合につい
て説明する。また、図3に示されるように第1の装置構
成部の装置内データを「1,2,3,4」、第2の装置
構成部32の装置内データを「A,B,C,D」、第3
の装置構成部33の装置内データは「α,β,γ,δ」
とし、さらにCPU10での処理1に必要なデータは
「4,γ,A,B」、処理mに必要なデータは「1,
3,β,D」、処理nに必要なデータは「2,α,δ,
C」であるとする。
御信号を出力する。
の制御信号に基づいて入れ替え情報設定を行い、切り替
え制御手段4へ出力する。
タとして「1,2,3,4」が、第2の装置構成部32
から装置内データとして「A,B,C,D」が、第3の
装置構成部33から装置内データとして「α,β,γ,
δ」が時分割でデータバス100に送出される。
手段4の制御に基づき各装置構成部のデータ間で入れ替
えを行う。
うに「A,B,γ,4」、「1,β,3,D」、「α,
2,C,δ」のように入れ替えられる。
手段4の制御に基づき各データビット列の前後関係を入
れ替える。
うに「4,γ,A,B」、「1,3,β,D」、「2,
α,δ,C」のように入れ替えられる。
段23からの入力タイミング信号24に同期して時間ス
イッチ手段3からの切り替えられた装置内データを取り
込むとともに入力データバス120に送出する。
らの書き込みアドレス信号25に基づいて入力データバ
ス120上の装置内データを記憶する。
の各処理毎にアドレス単位で書き込まれている。例えば
図3に示されるように処理1で必要なデータ「4,γ,
A,B」はアドレス1から、処理mで必要なデータ
「1,3,β,D」はアドレスmから、処理nで必要な
データ「2,α,δ,C」はアドレスnから書き込まれ
ている。
AM21に出力される。この読み出し信号11によって
CPU10は、必要とする装置内データが格納されてい
るRAM21内での先頭アドレスを指定する。例えば、
CPU10が処理mを行いたい場合には先頭アドレスm
が指定される。
いて、指定されたアドレスから装置内データを読み出
し、CPUデータバス110に送出する。例えば、読み
出し信号11で先頭アドレスmが指定されているとデー
タ「1,3,β,D」が送出される。CPU10は、C
PUデータバス110上の装置内データを読み出す。
入れ替えにより装置内データをCPU10の処理に適合
するように配置変換し、CPU10の各処理毎にアドレ
ス単位でRAM21内に記憶しているために、CPU1
0は1度で必要なデータを得ることができ、RAM21
へのアクセス回数およびアクセス時間を減少させること
ができる。
ので、これによると、収集手段に記憶される装置内デー
タの配置をCPUの処理に適合するように変換すること
ができ、これがため、装置を構成する部分が増加しても
CPUからRAMへのアクセス回数およびアクセス時間
を減少させることができ、装置の動作性能を高めること
ができるという従来にない優れたデータ収集装置を提供
することができる。
めの説明図である。
タフォーマットを説明するための説明図である。
タフォーマットを説明するための説明図である。
Claims (2)
- 【請求項1】 複数の装置構成部と、前記各装置構成部
の装置内データを収集するデータ収集手段と、前記デー
タ収集手段から装置内データを読み出すCPUとから構
成されるデータ収集装置において、前記各装置構成部か
らの装置内データの空間的および時間的な入れ替えを行
い前記データ収集手段に出力するスイッチ手段と、前記
スイッチ手段を制御する切り替え制御手段と、前記CP
Uの制御に基づいて前記切り替え制御手段での入れ替え
情報の設定を行う切り替え設定手段とを併設することを
特徴とするデータ収集装置。 - 【請求項2】 複数の装置構成部と、前記各装置構成部
の装置内データを収集するデータ収集手段と、前記デー
タ収集手段から装置内データを読み出すCPUとから構
成されるデータ収集装置において、前記各装置構成部か
らの装置内データの空間的な入れ替えを行う空間スイッ
チ手段と、前記空間スイッチ手段にて入れ替えられた装
置内データの時間的な入れ替えを行い前記データ収集手
段に出力する時間スイッチ手段と、前記スイッチ手段を
制御する切り替え制御手段と、前記CPUの制御に基づ
いて前記切り替え制御手段での入れ替え情報の設定を行
う切り替え設定手段とを併設することを特徴とするデー
タ収集装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4214592A JP2845009B2 (ja) | 1992-01-31 | 1992-01-31 | データ収集装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4214592A JP2845009B2 (ja) | 1992-01-31 | 1992-01-31 | データ収集装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH05217001A true JPH05217001A (ja) | 1993-08-27 |
JP2845009B2 JP2845009B2 (ja) | 1999-01-13 |
Family
ID=12627777
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4214592A Expired - Fee Related JP2845009B2 (ja) | 1992-01-31 | 1992-01-31 | データ収集装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2845009B2 (ja) |
-
1992
- 1992-01-31 JP JP4214592A patent/JP2845009B2/ja not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
JP2845009B2 (ja) | 1999-01-13 |
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