JPH04321315A - パワーオンリセット装置 - Google Patents

パワーオンリセット装置

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JPH04321315A
JPH04321315A JP3115562A JP11556291A JPH04321315A JP H04321315 A JPH04321315 A JP H04321315A JP 3115562 A JP3115562 A JP 3115562A JP 11556291 A JP11556291 A JP 11556291A JP H04321315 A JPH04321315 A JP H04321315A
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power
reset
power supply
voltage
circuit
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Nobutaka Nagai
長井　信孝
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    • H03K17/22—Modifications for ensuring a predetermined initial state when the supply voltage has been applied
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はパワーオンリセットに関
し、特にパワーオンリセットされるタイミングを２回以
上設定できるパワーオンリセット回路に関する。
【０００２】
【従来の技術】従来のパワーオンリセット回路は、図５
に示されているように、リファレンス電圧（Ｖ３）を発
生させるダイオード列１８と抵抗１９を電源電圧ＶＣＣ
と接地間に接続し、これと並列に電源電圧ＶＣＣを分圧
（Ｖ２）するための抵抗２０，２１を設け、リファレン
ス電圧Ｖ３と分圧Ｖ２とをコンパレータ１７に供給して
いる。コンパレータ１７は分圧Ｖ２とリファレンス電圧
Ｖ３を比較してパワーオンリセット信号を出力する。
【０００３】次に動作について説明する。ダイオード列
１８と抵抗１９に作られるリファレンス電圧Ｖ３は、各
ダイオードの順方向電圧ＶＦを０．６Ｖとすると、０．
６Ｖ×３コ＝１．８Ｖとなる。コンパレータ１７には、
このリファレンス電圧Ｖ３と電源電圧ＶＣＣを抵抗２０
，２１によって分圧電圧Ｖ２とが供給され、分圧電圧Ｖ
２は電源電圧ＶＣＣの立ち上がりと共に大きくなる。分
圧電圧Ｖ２がリファレンス電圧Ｖ３（１．８Ｖ）よりも
大きくなると、図６のＡ点でコンパレータ１７の出力が
反転する。このパワーオンリセット信号が内部回路をセ
ット状態からリセット状態にして、立ち上がり時の過渡
状態に起因する誤動作から半導体装置を守り、以後、正
常に動作させる。
【０００４】
【発明が解決しようとする課題】この従来のパワーオン
リセット回路では唯１点（Ａ点）のみ監視しているので
、１種類の電源に対してのみ有効であり、例えば３電源
以上が同一半導体装置に混在する場合、各電源の立ち上
がり時間が異なるため、いずれか１種類の電源の電圧が
Ａ点に達したとしても、パワーオンリセットの効かない
電源系に出力電圧の波形異状等が生じるという問題点が
あった。
【０００５】仮に、図５に示したパワーオンリセット回
路を２つ用い、３電源の素子にパワーオンリセットをか
けた場合、上記出力電圧の波形異状は生じにくくなるも
のの同一構成の回路を２つ用いなければならないため、
回路電流の増加、素子数の増加などの問題点があった。
【０００６】
【課題を解決するための手段】本発明の要旨は、外部か
ら供給される外部電源電圧が第１基準電圧に達すると第
１パワーオンリセット信号を出力する第１パワーオンリ
セット回路と、内部電源電圧が第２の基準電圧に達する
と第２パワーオンリセット信号を出力する第２パワーオ
ンリセット回路と、第２パワーオンリセット信号に応答
して第１パワーオンリセット回路を非活性化し第１パワ
ーリセット信号の出力レベルを固定する手段とを備えた
ことである。
【０００７】
【発明の作用】外部電源電圧が上昇を開始し、第１基準
電圧に達すると、第１パワーオンリセット信号が出力さ
れ、その後、内部電源電圧が第２の基準電圧に達すると
、第２パワーオンリセット信号が出力される。この第２
パワーオンリセット信号は第１パワーオンリセット回路
にも供給され、第１パワーオンリセット信号の出力レベ
ルの固定と、第１パワーオンリセット回路の非活性化に
も使用される。
【０００８】
【実施例】次に本発明の実施例について図面を参照して
説明する。図１は本発明の第１実施例を示す等価回路で
ある。
【０００９】本実施例はＤＣ／ＤＣコンバータで５Ｖ電
源（ＶＣＣ）を＋１０Ｖ（ＶＤＤ）と−１０Ｖ（ＶＳＳ
）に昇圧し、この電源で内部回路を動作させる４電源の
半導体装置のパワーオンリセットを行う。ＤＣ／ＤＣコ
ンバータ用のパワーオンリセット回路１００は、基準電
圧Ｖ３を作るためのダイオード列１８と抵抗１９との直
列接続体と、５Ｖ電源ＶＣＣの立ち上がりに従い増加す
る分圧Ｖ２を作る抵抗列２０と、基準電圧Ｖ３と分圧Ｖ
２を入力し、ＤＣ／ＤＣコンバータで昇圧された電圧＋
１０Ｖ（ＶＤＤ）と−１０Ｖ（ＶＳＳ）で動作するオペ
アンプで構成されたコンパレータ５と、コンパレータ５
のオン／オフを行うコンパレータスイッチ３と、コンパ
レータ５がオフ状態であるときコンパレータ５の出力を
固定するインバータ固定用スイッチ６と、インバータ４
とで構成する。
【００１０】内部回路用のパワーオンリセット回路１１
０は、基準電圧Ｖ５を作る抵抗２１と、ダイオード列２
２と、ＤＣ／ＤＣコンバータによって昇圧される電圧Ｖ
ＤＤと基準電圧Ｖ５を入力し電源電圧ＶＣＣで動作する
コンパレータ１と、この出力信号をＤＣ／ＤＣコンバー
タで昇圧する電圧まで引き上げるレベルシフタ２とで構
成されている。
【００１１】コンパレータスイッチ３と入力固定用のス
イッチ６のゲートには、コンパレータ１から出力されレ
ベルシフタ２によって昇圧された信号が入力されている
。またコンパレータ５の出力は、インバータ４を介して
ＤＣ／ＤＣコンバータ部のセット用トランジスタ１０ａ
，１０ｂのゲートに接続されている（図３参照）。
【００１２】次に動作を図２を用いて説明する。５Ｖ電
源ＶＣＣを入力すると電源電圧ＶＣＣは５Ｖに向かって
立ち上がっていく。例えば、コンパレータ５の基準電圧
Ｖ３を１．８、もう一方の入力を３／５ＶＣＣとすると
、電源電圧ＶＣＣが３Ｖとなったとき（図２中Ａ点）、
コンパレータ５の出力が反転し、ＤＣ／ＤＣコンバータ
をリセットする。
【００１３】その結果、ＤＣ／ＤＣコンバータは動作を
開始し、昇圧電圧ＶＤＤは上昇しはじめる。
【００１４】次に、コンパレータ１の基準電圧Ｖ５をＶ
ＣＣ＋ＶＦ×２、もう一方の電圧をＶＤＤとすると、Ｖ
ＤＤが昇圧されＶＣＣよりも約１．５Ｖ以上高くなると
（図２Ｂ点）コンパレータ１の出力が反転し、このコン
パレータの出力信号がレベルシフタ２によってレベルを
上昇される。したがって内部回路がリセットされる。
【００１５】一方、コンパレータ５はオフ状態となり、
コンパレータ５の出力はインバータ入力固定用スイッチ
６がオンすることによって低レベルに固定される。
【００１６】逆に、５Ｖ電源ＶＣＣがオフしようとする
とき（図２のＤ点）は、ＶＤＤの電圧がＶＣＣ＋１．５
Ｖより低くなると（図２中Ｃ点）、コンパレータ１の出
力が反転し、内部回路がセットされる。コンパレータ５
のスイッチ３がオンし、インバータ入力固定用スイッチ
６はオフする。ＶＣＣが３Ｖ以下になると、５の出力が
反転しＤＣ／ＤＣコンバータ部がセットされる。
【００１７】ＤＣ／ＤＣコンバータ用パワーオンリセッ
ト回路１００は第１パワーオンリセット回路として機能
し、内部回路用パワーオンリセット回路１１０は第２パ
ワーオンリセット回路として機能する。スイッチ３，６
が第１パワーオンリセット回路の非活性化と第１パワー
オンリセット信号の出力レベルを固定する手段を構成す
る。
【００１８】次に本発明の第２実施例について図４を参
照して説明する。ＤＣ／ＤＣコンバータ用パワーオンリ
セット回路１５０は、基準電圧Ｖ８を作るためのダイオ
ード列１８と、抵抗１９と、ＶＣＣ電源の立ち上がりに
ともない増加するＶＣＣの分圧Ｖ６を作る抵抗列２０と
、電圧Ｖ６，Ｖ８を入力しＤＣ／ＤＣコンバータで昇圧
された電圧１０Ｖ（ＶＤＤ）と−１０Ｖ（ＶＳＳ）で動
作するコンパレータ１３と、コンパレータ用のスイッチ
１６と、インバータ１５の入力を固定するスイッチ１４
とで構成されている。
【００１９】内部回路用のパワーオンリセット回路１６
０は基準電圧Ｖ１０を作る抵抗２１とダイオード列２２
と、ＤＣ／ＤＣコンバータによって昇圧される電圧ＶＤ
Ｄの増加に伴って変化する分圧Ｖ９を作る抵抗列２３と
、これらの電圧Ｖ９，Ｖ１０を入力しＶＣＣで動作する
コンパレータ１１と、この出力信号をＤＣ／ＤＣコンバ
ータで昇圧する電圧に引き上げるレベルシフタ１２とで
構成されている。コンパレータ用のスイッチ１６と入力
固定用スイッチ１４のゲートには、レベルシフタ１２の
出力信号をインバータ４１を介して入力される。
【００２０】第２実施例の動作は第１実施例と同様であ
り、まず、ＶＣＣが３Ｖ程度となるとＤＣ／ＤＣコンバ
ータ用のパワーオンリセット回路１５０がリセットされ
る。ＤＣ／ＤＣコンバータが動作し、ＶＤＤの電位が上
昇し、電圧ＶＤＤがＶＣＣ＋１．５Ｖ程度の電圧となる
と、内部回路がリセットされ、先に働いたＤＣ／ＤＣコ
ンバータ側のコンパレータ１３がオフし、インバータ１
５の入力が固定される。
【００２１】
【発明の効果】以上説明したように本発明は、内部回路
用と移動電源電圧発生回路用のパワーオンリセット回路
を用い、内部回路用のパワーオンリセット回路で複数電
源電圧発生回路用のパワーオンリセット回路をオフさせ
ているので、消費電流を少なくすることができるという
効果を得られる。
【００２２】さらに、立ち上がりタイミングの異なる電
源を持つ素子の出力波形の異状などを防ぐことができる
という効果も得られる。
【００２３】複数電源発生回路用のパワーオンリセット
回路で回路電流を多少消費しても内部回路用パワーオン
リセット回路で停止でき、シフトレジスタを用いずに複
数電源電圧発生用パワーオンリセット回路が構成できる
ため素子数を少なくすることができるいう効果も有する
。
【図面の簡単な説明】
【図１】本発明の第１実施例を示す等価回路図である。
【図２】第１実施例のタイミングチャートである。
【図３】ＤＣ／ＤＣコンバータ部リセット用スイッチの
回路図である。
【図４】本発明の第２実施例を示す等価回路図である。
【図５】従来のパワーオンリセット回路の回路図である
。
【図６】従来のパワーオンリセット回路のタイミングチ
ャートである。
【符号の説明】
１　　コンパレータ ２　　レベルシフタ ３　　コンパレータスイッチ ４　　インバータ ５　　コンパレータ ６　　インバータ入力固定用スイッチ ７　　ＶＤＤ波形 ８　　ＶＣＣ波形 ９　　ＶＳＳ波形 １０　　ＤＣ／ＤＣコンバータ部リセットスイッチ１１
　　コンパレータ １２　　レベルシフタ １３　　コンパレータ １４　　インバータ入力固定用スイッチ１５　　インバ
ータ １６　　コンパレータスイッチ １７　　コンパレータ １８，２２　　ダイオード １９，２０，２１，２３　　抵抗 １００，１５０　　　　ＤＣ／ＤＣコンバータ用パワー
オンリセット回路（第１パワーオンリセット回路）１１
０，１６０　　　　内部回路用パワーオンリセット回路
（第２パワーオンリセット回路）

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】　　外部から供給される外部電源電圧が第
    １基準電圧に達すると第１パワーオンリセット信号を出
    力する第１パワーオンリセット回路と、内部電源電圧が
    第２の基準電圧に達すると第２パワーオンリセット信号
    を出力する第２パワーオンリセット回路と、第２パワー
    オンリセット信号に応答して第１パワーオンリセット回
    路を非活性化し第１パワーリセット信号の出力レベルを
    固定する手段とを備えたパワーオンリセット装置。
  2. 【請求項２】　　外部電源電圧が第１基準電圧に達する
    と内部電源電圧を発生させる内部電源回路をリセットす
    る第１パワーオンリセット信号を発生する第１パワーオ
    ンリセット回路と、内部電源電圧が第２基準電圧に達す
    ると内部電源回路以外の内部回路をリセットする第２パ
    ワーオンリセット信号を発生する第２パワーオンリセッ
    ト回路と、第２パワーオンリセット信号に応答して第１
    パワーオンリセット回路への電流の供給を停止するとと
    もに第１パワーオンリセット信号の出力レベルを固定す
    る手段とを備えたパワーオンリセット装置。
  3. 【請求項３】　　第１パワーオンリセット回路は、外部
    電源電圧から第１基準電圧を発生させる第１基準電圧発
    生部と、外部電圧の昇圧と共に上昇する第１監視電圧を
    発生させる抵抗列と、第１基準電圧と第１監視電圧とを
    比較する第１コンパレータとを有する請求項２記載のパ
    ワーオンリセット装置。
  4. 【請求項４】　　第２パワーオンリセット回路は、内部
    電源電圧から第２基準電圧を発生させる第２基準電圧発
    生部と、内部電源電圧と第２基準電圧を比較する第２コ
    ンパレータと、第２コンパレータの出力レベルを変更す
    るレベルシフタとを有する請求項３記載のパワーオンリ
    セット装置。
  5. 【請求項５】　　上記手段は第１内部電源線と第１コン
    パレータとの間に介在する第１スイッチングトランジス
    タと、第２コンパレータの出力と第２内部電源線との間
    に介在する第２スイッチングトランジスタとで構成され
    た請求項４記載のパワーオンリセット装置。
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