JPH04233265A - 可変架橋性接着剤を用いた多段積層高密度相互接続方法および構造物 - Google Patents
可変架橋性接着剤を用いた多段積層高密度相互接続方法および構造物Info
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- 239000000853 adhesive Substances 0.000 title claims abstract description 74
- 238000000034 method Methods 0.000 title claims abstract description 55
- 238000004132 cross linking Methods 0.000 title claims abstract description 8
- 230000001070 adhesive effect Effects 0.000 title claims description 71
- 239000002184 metal Substances 0.000 claims abstract description 100
- 229910052751 metal Inorganic materials 0.000 claims abstract description 100
- 239000000203 mixture Substances 0.000 claims abstract description 48
- 238000003475 lamination Methods 0.000 claims abstract description 47
- 229920001169 thermoplastic Polymers 0.000 claims abstract description 43
- 229920001187 thermosetting polymer Polymers 0.000 claims abstract description 42
- 239000004416 thermosoftening plastic Substances 0.000 claims abstract description 42
- 229920001721 polyimide Polymers 0.000 claims abstract description 38
- 239000003822 epoxy resin Substances 0.000 claims abstract description 34
- 229920000647 polyepoxide Polymers 0.000 claims abstract description 34
- KPUWHANPEXNPJT-UHFFFAOYSA-N disiloxane Chemical class [SiH3]O[SiH3] KPUWHANPEXNPJT-UHFFFAOYSA-N 0.000 claims abstract description 24
- 239000009719 polyimide resin Substances 0.000 claims abstract description 13
- 230000009477 glass transition Effects 0.000 claims abstract description 9
- 238000004519 manufacturing process Methods 0.000 claims description 32
- 239000004642 Polyimide Substances 0.000 claims description 22
- 230000002411 adverse Effects 0.000 claims description 13
- 239000004020 conductor Substances 0.000 claims description 11
- 238000010030 laminating Methods 0.000 claims description 11
- 239000004065 semiconductor Substances 0.000 claims description 11
- 239000004697 Polyetherimide Substances 0.000 claims description 9
- 229920001601 polyetherimide Polymers 0.000 claims description 9
- 238000001035 drying Methods 0.000 claims description 6
- 229920000642 polymer Polymers 0.000 claims description 5
- 238000000151 deposition Methods 0.000 claims description 4
- 239000003795 chemical substances by application Substances 0.000 claims description 3
- 229920005992 thermoplastic resin Polymers 0.000 claims description 2
- 239000004634 thermosetting polymer Substances 0.000 claims 6
- 150000001875 compounds Chemical class 0.000 claims 2
- 231100000989 no adverse effect Toxicity 0.000 claims 1
- 229920000728 polyester Polymers 0.000 claims 1
- 239000000463 material Substances 0.000 abstract description 33
- 238000010438 heat treatment Methods 0.000 abstract description 12
- 230000008439 repair process Effects 0.000 abstract description 8
- 239000012815 thermoplastic material Substances 0.000 abstract description 7
- 238000006116 polymerization reaction Methods 0.000 abstract 1
- 239000010410 layer Substances 0.000 description 315
- 239000000758 substrate Substances 0.000 description 41
- 229920001577 copolymer Polymers 0.000 description 34
- 230000008569 process Effects 0.000 description 13
- 229920004747 ULTEM® 1000 Polymers 0.000 description 11
- 239000012790 adhesive layer Substances 0.000 description 11
- 238000001723 curing Methods 0.000 description 11
- 239000002904 solvent Substances 0.000 description 10
- 229920005989 resin Polymers 0.000 description 9
- 239000011347 resin Substances 0.000 description 9
- 238000004528 spin coating Methods 0.000 description 8
- 238000012360 testing method Methods 0.000 description 8
- 230000008901 benefit Effects 0.000 description 7
- 238000001020 plasma etching Methods 0.000 description 7
- 229920004738 ULTEM® Polymers 0.000 description 5
- 230000002950 deficient Effects 0.000 description 5
- 238000013461 design Methods 0.000 description 5
- 238000005553 drilling Methods 0.000 description 5
- 239000003989 dielectric material Substances 0.000 description 4
- LNEPOXFFQSENCJ-UHFFFAOYSA-N haloperidol Chemical compound C1CC(O)(C=2C=CC(Cl)=CC=2)CCN1CCCC(=O)C1=CC=C(F)C=C1 LNEPOXFFQSENCJ-UHFFFAOYSA-N 0.000 description 4
- 230000008018 melting Effects 0.000 description 4
- 238000002844 melting Methods 0.000 description 4
- 240000008042 Zea mays Species 0.000 description 3
- 235000005824 Zea mays ssp. parviglumis Nutrition 0.000 description 3
- 235000002017 Zea mays subsp mays Nutrition 0.000 description 3
- 230000005540 biological transmission Effects 0.000 description 3
- 235000005822 corn Nutrition 0.000 description 3
- 230000003247 decreasing effect Effects 0.000 description 3
- 238000012545 processing Methods 0.000 description 3
- 230000004580 weight loss Effects 0.000 description 3
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 2
- CTQNGGLPUBDAKN-UHFFFAOYSA-N O-Xylene Chemical compound CC1=CC=CC=C1C CTQNGGLPUBDAKN-UHFFFAOYSA-N 0.000 description 2
- NIXOWILDQLNWCW-UHFFFAOYSA-N acrylic acid group Chemical group C(C=C)(=O)O NIXOWILDQLNWCW-UHFFFAOYSA-N 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 239000000919 ceramic Substances 0.000 description 2
- 238000001816 cooling Methods 0.000 description 2
- 238000005336 cracking Methods 0.000 description 2
- 238000005520 cutting process Methods 0.000 description 2
- 239000011353 cycloaliphatic epoxy resin Substances 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- SBZXBUIDTXKZTM-UHFFFAOYSA-N diglyme Chemical compound COCCOCCOC SBZXBUIDTXKZTM-UHFFFAOYSA-N 0.000 description 2
- 238000001704 evaporation Methods 0.000 description 2
- 238000013007 heat curing Methods 0.000 description 2
- 238000009413 insulation Methods 0.000 description 2
- 238000003698 laser cutting Methods 0.000 description 2
- 230000005012 migration Effects 0.000 description 2
- 238000013508 migration Methods 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 229920002120 photoresistant polymer Polymers 0.000 description 2
- 239000007787 solid Substances 0.000 description 2
- 239000007921 spray Substances 0.000 description 2
- 238000005507 spraying Methods 0.000 description 2
- 239000008096 xylene Substances 0.000 description 2
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 1
- 241001441571 Hiodontidae Species 0.000 description 1
- 101000651211 Homo sapiens Transcription factor PU.1 Proteins 0.000 description 1
- OWYWGLHRNBIFJP-UHFFFAOYSA-N Ipazine Chemical compound CCN(CC)C1=NC(Cl)=NC(NC(C)C)=N1 OWYWGLHRNBIFJP-UHFFFAOYSA-N 0.000 description 1
- 101000836070 Rattus norvegicus Serine protease inhibitor A3L Proteins 0.000 description 1
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 102100027654 Transcription factor PU.1 Human genes 0.000 description 1
- 239000003522 acrylic cement Substances 0.000 description 1
- 230000009471 action Effects 0.000 description 1
- 239000012190 activator Substances 0.000 description 1
- 230000003044 adaptive effect Effects 0.000 description 1
- PNEYBMLMFCGWSK-UHFFFAOYSA-N aluminium oxide Inorganic materials [O-2].[O-2].[O-2].[Al+3].[Al+3] PNEYBMLMFCGWSK-UHFFFAOYSA-N 0.000 description 1
- 238000004458 analytical method Methods 0.000 description 1
- 230000000712 assembly Effects 0.000 description 1
- 238000000429 assembly Methods 0.000 description 1
- 230000009286 beneficial effect Effects 0.000 description 1
- 239000003054 catalyst Substances 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 230000008602 contraction Effects 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 239000010949 copper Substances 0.000 description 1
- 229940120693 copper naphthenate Drugs 0.000 description 1
- SEVNKWFHTNVOLD-UHFFFAOYSA-L copper;3-(4-ethylcyclohexyl)propanoate;3-(3-ethylcyclopentyl)propanoate Chemical compound [Cu+2].CCC1CCC(CCC([O-])=O)C1.CCC1CCC(CCC([O-])=O)CC1 SEVNKWFHTNVOLD-UHFFFAOYSA-L 0.000 description 1
- 238000000354 decomposition reaction Methods 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 238000007872 degassing Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000004070 electrodeposition Methods 0.000 description 1
- 238000004100 electronic packaging Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000008020 evaporation Effects 0.000 description 1
- 239000012530 fluid Substances 0.000 description 1
- 230000005251 gamma ray Effects 0.000 description 1
- -1 hexafluoroantimonate Chemical compound 0.000 description 1
- 238000011065 in-situ storage Methods 0.000 description 1
- 238000009434 installation Methods 0.000 description 1
- 239000011229 interlayer Substances 0.000 description 1
- MGFYSGNNHQQTJW-UHFFFAOYSA-N iodonium Chemical compound [IH2+] MGFYSGNNHQQTJW-UHFFFAOYSA-N 0.000 description 1
- 238000000608 laser ablation Methods 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 238000012858 packaging process Methods 0.000 description 1
- 238000012536 packaging technology Methods 0.000 description 1
- 238000002161 passivation Methods 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 229920003223 poly(pyromellitimide-1,4-diphenyl ether) Polymers 0.000 description 1
- 229920002959 polymer blend Polymers 0.000 description 1
- 239000002861 polymer material Substances 0.000 description 1
- 239000002243 precursor Substances 0.000 description 1
- 230000005855 radiation Effects 0.000 description 1
- 239000003870 refractory metal Substances 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- 238000009987 spinning Methods 0.000 description 1
- 239000010421 standard material Substances 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 238000005303 weighing Methods 0.000 description 1
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Abstract
め要約のデータは記録されません。
Description
月 日に提出された「順次に低下するTg を
有する熱可塑性接着剤を用いた多段積層高密度相互接続
方法および構造物」と称するエイチ・エス・コール(H
.S. Cole) 等の米国特許出願第
号、 年 月
日に提出された「スペーサ構造物およびギャップを含
む高密度相互接続構造物」と称するエイチ・エス・コー
ル(H.S. Cole) 等の米国特許出願第 号
、並びに 年 月 日に提
出された「耐熱性ポリエーテルイミド組成物およびそれ
の製造方法」と称するジェイ・エイチ・ルピンスキー(
J.H. Lupinski) 等の米国特許出願第
号と関連するものである。
の高密度相互接続構造物の分野に関するものであって、
更に詳しく言えば、2つ以上の導体層を使用したかかる
構造物に関する。
(General Electric Company
)によって開発された高密度相互接続(HDI)構造物
は、コンパクトな電子装置の組立てのために多くの利益
をもたらす。たとえば、2インチの長さ、2インチの幅
および0.050インチの厚さを有する単一の基板上に
おいて、30〜50個のチップを組込んだマイクロコン
ピュータのごとき電子装置を完全に組立てかつ相互接続
することができるのである。 更に重要なことには、欠陥のある部品の補修または交換
を行うため、装置内に組込まれた良好な部品に顕著な悪
影響を及ぼすことなしにかかる高密度相互接続構造物を
分解して再び組立てることが可能である。このことは、
それぞれに2000ドルの原価を有する50個ものチッ
プを1枚の基板上に組込んで成る装置の場合において特
に重要である。このような補修可能性は、故障した部品
を交換するために装置を再加工することが不可能であっ
たり、あるいはかかる再加工が良好な部品に顕著な悪影
響を及ぼしたりするような従来の接続系に比べると実質
的な進歩を成すものである。
て簡単に述べれば、100ミルの厚さ並びに装置全体に
とって適当な寸法および強度を有する(たとえばアルミ
ナ製の)セラミック基板が用意される。それの寸法は通
例2インチ平方であるが、それより大きい場合も小さい
場合もある。個々のチップの位置が設定された後、適当
な深さを有する個別のキャビティまたは1個の大きいキ
ャビティがそれぞれのチップの位置に形成される。その
ためには、先ず最初に、一様な厚さおよび所望の寸法を
有する未加工の基板が用意される。次いで、通常の超音
波またはレーザ切削技術の使用により、個々のチップお
よびその他の電子部品を配置すべき位置にキャビティが
形成される。チップ同士を互いに近接した状態で配置す
ることが所望される多くの系においては、ただ1個の大
きなキャビティを形成すれば事足りる。半導体チップが
実質的に一様な厚さを有する場合には、かかる大きなキ
ャビティは一様な深さを有するのが通例である。特に厚
い電子部品または特に薄い電子部品を配置することが所
望される場合には、それらの電子部品の上面が残りの電
子部品の上面および周囲の基板表面と実質的に同一平面
内に位置するようにするため、キャビティの深さを加減
すればよい。次に、キャビティの底面に熱可塑性接着剤
層が配置される。かかる熱可塑性接着剤としては、ゼネ
ラル・エレクトリック・カンパニイ(General
Electric Company)からウルテム(U
LTEM) 6000の商品名で入手し得るポリエーテ
ルイミド樹脂を使用することが好ましい。次いで、キャ
ビティ内の所望位置にそれぞれの電子部品を配置し、ウ
ルテム6000の軟化点(約235℃)よりも高い約3
00℃の温度にまで構造物全体を加熱し、そして冷却す
れば、個々の電子部品は基板に対して熱可塑的に接着さ
れる。他方、イー・アイ・デュポン・ド・ネムール(E
.I. du Pont de Nemours)社か
ら入手し得るキャプトン(Kapton)フィルムのご
とき厚さ約0.0005〜0.003インチ(約12.
5〜75ミクロン)のポリイミドフィルムが用意され、
そして結合力を向上させるために反応イオンエッチング
(RIE)による前処理が施される。次いで、基板およ
び(チップを含めた)電子部品がウルテム1000また
はその他の熱可塑性樹脂で被覆され、そして基板および
電子部品上にキャプトンフィルムが積層される。その際
には、ウルテム1000がキャプトンフィルムを所定の
位置に保持するための熱可塑性接着剤として役立つ。そ
の後、電子部品上に配置された接触パッドに整列した位
置においてキャプトン層およびウルテム1000層中に
(好ましくはレーザ穴あけにより)スルーホールが形成
される。続いてキャプトン層上に設置された金属層がス
ルーホールの内部にまで伸び、そしてそれの下方に位置
する接触パッドに対して電気的接触を行う。この金属層
は、それを設置する工程中においてパターン化される場
合もあれば、あるいは連続層として設置された後にホト
レジストおよびエッチングの使用によりパターン化され
る場合もある。 工程の終了時において正確に整列した導体パターンが得
られるようにするためには、レーザを用いてホトレジス
トの露光を行うことが好ましい。あるいはまた、マスク
を通して露光を行うこともできる。
全に達成するために必要な場合には、追加の誘電体層お
よび金属層が設置される。個々の電子部品およびそれら
の接触パッドの位置の狂いを補償するためには、適応性
のあるレーザ写真食刻装置を使用すればよい。かかるレ
ーザ写真食刻装置は、後記に列挙される米国特許および
米国特許出願明細書の一部に記載されている。
利点を有している。かかる利点の1つは、上記のごとき
電子装置に対し、現在利用し得る最も軽量かつ最も体積
の小さいパッケージを提供することである。かかる高密
度相互接続構造物が有するもう1つの(恐らくは一層重
要な)利点は、かかる高密度相互接続構造物の使用すれ
ば、装置を設計しかつ製造するために必要な時間が短縮
されることである。従来の方法においては、各々の半導
体チップを予めパッケージ内に封入すること、封入され
たチップ同士を相互接続するための多層回路板を設計す
ること、などが必要とされていた。多層回路板は高価で
あると共に、それらの製造のために長いリードタイムを
必要とする。それに対し、HDI構造物を製造するため
に予め特別に準備しなければならないのは、個々の半導
体チップを装着するための基板のみである。かかる基板
は、標準的な素材に所要の加工を施すことによって得ら
れる。詳しく述べれば、半導体チップの相互接続面およ
び基板の表面が同一平面内にあるようにして個々の半導
体チップを配置するための適当なキャビティを基板に形
成すればよいのである。HDI構造物の製造方法に従え
ば、通常の切削技術またはレーザ切削技術の使用により
、予め焼成されたセラミック基板に所要のキャビティが
形成される。このような切削作業はかなり迅速に行うこ
とのできる簡単な仕事であるから、基板に関する所望の
形状が決定されれば、半導体チップを装着するための基
板は短い期間で準備することができるのである。たとえ
ば、量産に先立って設計を確認するための原型装置を製
造するために役立つ少量の基板を得るためには、僅か1
日(通例は4時間)の期間があれば十分である。
の他の電子部品を単一の基板上において相互接続するた
めの相互接続パターンを設計するためには、1〜5週間
の期間を要するのが通例である。かかる高密度相互接続
構造物の設計が完了すれば、基板上において装置の組立
てを開始することができる。先ず最初にチップが基板上
に装着され、次いでチップおよび基板上に積層構造物が
一度に1層ずつ形成される。通例、製造プロセス全体は
1日で完了することができるが、特に作業を急いだ場合
には4時間で完了することもできる。このように、かか
る高密度相互接続構造物は電子装置に対して実質的に軽
量かつコンパクトなパッケージを提供するばかりでなく
、他のパッケージ技術を使用した場合に比べて遥かに短
い期間で原型装置を製造しかつ試験することを可能にす
るのである。
製造方法、およびそれを製造するための道具は、「マル
チチップ集積回路パッケージ構造物および方法」と称す
るシー・ダブリュー・アイヘルベルガー(C.W. E
ichelberger) 等の米国特許第47836
95号、「高密度相互接続を行うために役立つ適応性の
ある写真食刻装置」と称するシー・ダブリュー・アイヘ
ルベルガー等の米国特許第4835704号、「多重電
子回路チップパッケージ用の高分子誘電体中にスルーホ
ールを形成する方法」と称するシー・ダブリュー・アイ
ヘルベルガー等の米国特許第4714516号、「新規
なレジストのエキシマレーザによるパターン化」と称す
るアール・ジェイ・ウォジュナロウスキー(R.J.
Wojnarowski)等の米国特許第478017
7号、1989年9月27日に提出された「基板に接着
された部品を取除くための方法および装置」と称するア
ール・ジェイ・ウォジュナロウスキー等の米国特許出願
第249927号、1989年2月14日に提出された
「重合体材料中にスルーホールを形成するためのレーザ
ビーム走査方法」と称するシー・ダブリュー・アイヘル
ベルガー等の米国特許出願第310149号、1989
年2月21日に提出された「高密度相互接続用の熱可塑
性ダイ接着材料および溶剤によるダイ接着処理法」と称
するアール・ジェイ・ウォジュナロウスキー等の米国特
許出願第312798号、1988年12月12日に提
出された「高密度相互接続回路の簡略化された補修方法
」と称するシー・ダブリュー・アイヘルベルガー等の米
国特許出願第283095号、1989年2月3日に提
出された「製造方法および集積回路試験構造物」と称す
るエイチ・エス・コール(H.S. Cole) 等の
米国特許出願第305314号、1988年9月27日
に提出された「高い体積効率を有する高密度相互接続方
法」と称するシー・ダブリュー・アイヘルベルガー等の
米国特許出願第250010号、1989年3月28日
に提出された「高密度相互接続アセンブリにおいて使用
するためのダイ接着方法」と称するアール・ジェイ・ウ
ォジュナロウスキー等の米国特許出願第329478号
、1988年10月4日に提出された「レーザによる相
互接続方法」と称するエイチ・エス・コール等の米国特
許出願第253020号、1988年8月5日に提出さ
れた「剥離可能な上層を用いた電子回路および集積回路
チップの試験方法並びに試験構造物」と称するシー・ダ
ブリュー・アイヘルベルガー等の米国特許出願第230
654号、1988年8月8日に提出された「集積回路
装置用金属パターンの直接形成」と称するワイ・エス・
リウ(Y.S. Liu)等の米国特許出願第2339
65号、1988年8月23日に提出された「活性剤の
紫外線レーザ切除による金属層の光パターン化方法」と
称するワイ・エス・リウ等の米国特許出願第23763
8号、1988年8月25日に提出された「集積回路装
置用高融点金属線の直接書込み」と称するワイ・エス・
リウ等の米国特許出願第237685号、1988年8
月30日に提出された「重合体フィルム上層を用いて集
積回路チップを封入するための方法および装置」と称す
るシー・ダブリュー・アイヘルベルガー等の米国特許出
願第240367号、1989年4月24日に提出され
た「電子パッケージ用途のためのシロキサンポリイミド
加工方法」と称するエイチ・エス・コール等の米国特許
出願第342153号、1988年12月27日に提出
された「導電性および非導電性基板上への選択的電着法
」と称するワイ・エス・リウ等の米国特許出願第289
944号、1989年2月17日に提出された「熱可塑
性材料に熱硬化性フィルムを接合して接着可能な積層物
を形成する方法」と称するアール・ジェイ・ウォジュナ
ロウスキーの米国特許出願第312536号、1989
年6月8日に提出された「迅速な注文設計および特異な
試験能力を達成するための集積回路パッケージ構造物」
と称するシー・ダブリュー・アイヘルベルガー等の米国
特許出願第363646号、1990年1月2日に提出
された「領域選択性の金属被覆方法」と称するエイチ・
エス・コール等の米国特許出願第07/459844号
、1989年12月26日に提出された「局部方位選択
性のルーチング装置」と称するティー・アール・ハラー
(T.R. Haller) 等の米国特許出願第07
/457023号、1989年12月26日に提出され
た「レーザ切除可能な高分子誘電体およびそれの形成方
法」と称するエイチ・エス・コール等の米国特許出願第
456421号、1989年12月21日に提出された
「密閉型高密度相互接続電子装置」と称するダブリュー
・ピー・コーンランプ(W.P. Kornrumpf
)等の米国特許出願第454546号、1989年12
月26日に提出された「増強蛍光重合体およびそれを用
いた相互接続構造物」と称するエイチ・エス・コール等
の米国特許出願第07/457127号、1989年1
2月21日に提出された「エポキシ樹脂/ポリイミド共
重合体ブレンド誘電体およびそれを組込んだ積層回路」
と称するシー・ダブリュー・アイヘルベルガー等の米国
特許出願第454545号、1990年4月5日に提出
された「マイクロ波モジュール用のビルディングブロッ
ク法」と称するダブリュー・ピー・コーンランプ等の米
国特許出願第07/504760号、1990年4月5
日に提出された「HDIマイクロ波回路アセンブリ」と
称するダブリュー・ピー・コーンランプ等の米国特許出
願第07/504821号、1990年4月5日に提出
された「高密度の電気結線を有する超音波アレイ」と称
するエル・エス・スミス(L.S. Smith)等の
米国特許出願第07/504750号、1990年4月
5日に提出された「マイクロ波部品試験方法および装置
」と称するダブリュー・ピー・コーンランプ等の米国特
許出願第07/504803号、1990年4月5日に
提出された「コンパクトな高密度相互接続マイクロ波装
置」と称するダブリュー・ピー・コーンランプの米国特
許出願第07/504753号、1990年4月5日に
提出された「柔軟な高密度相互接続構造物および柔軟に
相互接続された装置」と称するシー・ダブリュー・アイ
ヘルベルガー等の米国特許出願第07/504769号
、1990年4月5日に提出された「コンパクトな焦平
面アレイ並びにそれの試験および補修方法」と称するダ
ブリュー・ピー・コーンランプ等の米国特許出願第07
/504751号、1990年4月5日に提出された「
上部に取付けられた部品を有する高密度相互接続構造物
」と称するアール・ジェイ・ウォジュナロウスキー等の
米国特許出願第07/504749号、1990年4月
5日に提出された「内室を含む高密度相互接続構造物」
と称するアール・ジェイ・ウォジュナロウスキー等の米
国特許出願第07/504770号、並びに1990年
4月5日に提出された「調整された動作特性を有するマ
イクロ波部品および調整方法」と称するダブリュー・ピ
ー・コーンランプ等の米国特許出願第07/50474
8号の明細書中に開示されている。
の間の絶縁のため、あるいは外部導体との接触に原因す
る短絡の防止のために追加の誘電体層が必要とされる場
合には、それらは所望の熱可塑性誘電体材料の溶剤溶液
をスピン塗布または吹付塗布することによって形成され
る。次いで、構造物を加熱して溶剤を追出せば、溶剤を
含まない誘電体層が得られる。あるいはまた、「エポキ
シ樹脂/ポリイミド共重合体ブレンド誘電体およびそれ
を組込んだ積層回路」と称する米国特許出願第4545
45号に従い、シロキサンポリイミド/エポキシ樹脂共
重合体ブレンドをスピン塗布し、乾燥し、次いで硬化さ
せることによってかかる誘電体層を形成することもでき
る。その後、必要に応じてスルーホールが形成され、次
いでその上にパターン化金属層が設置される。かかる金
属層はスルーホールの内部にまで伸び、そして下方の金
属の間にオーム接触を成す。必要ならば、追加の誘電体
層および金属層が同様にして設置される。残念ながら、
このような上部誘電体層として使用するのに適した誘電
体材料の数は、それらが示さなければならない材料特性
の点から見れば限られている。すなわち、かかる誘電体
材料はスピン塗布または吹付塗布用の溶液として利用可
能でなければならないことに加え、下方の誘電体層およ
び金属層並びに以後に設置されることのある上方の金属
層または誘電体層の材料に対して良好な結合力を示さな
ければならない。また、それは本質的にレーザ切除可能
なものであるか、あるいは「レーザ切除可能な高分子誘
電体およびそれの形成方法」と称する米国特許出願第4
56421号に従ってレーザ切除可能性を付与し得るも
のであることも必要である。
多数の加熱/冷却サイクルの後にも初期の融点またはガ
ラス転移温度を実質的に保持するような重合体材料を意
味する。すなわち、加熱、融解および再凝固過程中に材
料の実質的な架橋が起こらないわけである。かかる重合
体材料は耐熱のより高い材料(重合体を含む)を基板に
接着するための接着剤層として適するばかりでなく、融
点のより低い接着剤層を用いて基板に接着すべき層自体
として使用することもできる。重合体材料のガラス転移
温度とは、該重合体材料の粘度が大幅に低下し、それに
より該重合体材料が流動しかつ他の材料に接着し得るよ
うになる温度を指す。かかるガラス転移温度よりも低い
温度にまで冷却されると、熱可塑性重合体材料は再凝固
し、そしてそれが接触している物体に対して密着した状
態に保たれる。ここで言う「熱硬化性材料」とは、それ
の初期加熱時またはそれの製造プロセス中において架橋
が起こる結果、全く融解しなくなるか、あるいは初期加
熱または製造以前の融点よりも遥かに高い温度でなけれ
ば融解しなくなるような重合体材料を意味する。
より上位の誘電体層としてスピン塗布または吹付塗布さ
れた誘電体層を使用することは有効であるが、それは幾
つかの欠点を有すると共に、製造プロセスの複雑化をも
たらす。特に、かかる誘電体層は加熱によって溶剤を追
出すことを必要とする。それに伴う加熱時間および加熱
温度条件は、ある種の電子部品に対して悪影響を及ぼす
ことがある。また、場合によっては、隣接する誘電体層
間の結合力が低下することもある。更にまた、場合によ
っては、誘電体層中または隣接する誘電体層間の界面に
過度の応力が生じ、それが高密度相互接続構造物の品質
および信頼性に悪影響を及ぼすこともある。更にまた、
追加の誘電体層を設置する際には、溶剤が既に形成され
た未反応の熱可塑性誘電体層の表面を再溶解する傾向が
ある。これは結合力を向上させるために役立つとは言え
、過度の界面応力および誘電体層の割れまたはひび割れ
を生じ、そのために高密度相互接続構造物の使用を不可
能にすることもある。
料を接着剤として使用するための技術も知られている。 一例を挙げれば、熱硬化性材料の前駆物質をスピン塗布
し、次いでそれをその場で反応させることによって熱硬
化誘電体層が形成される。かかる層を反応させた後には
、それは次の層を形成するために使用される溶剤にもは
や溶解しないから、以後の層を形成する際に下方の層が
損傷を受けることはない。かかる材料はシェルダール・
コーポレーション(Sheldahl Corpora
tion)から入手することができる。
造において使用されるような種類の積層板に関するもの
である。その実例としては、デュポン(Dupont)
社からパイロラックス(Pyrolux) の商品名で
入手し得る銅/誘電体積層板が挙げられる。この系にお
いては、約135℃の硬化温度で熱硬化するアクリル系
接着剤が使用されている。しかし残念ながら、アクリル
系接着剤は本発明の対象となるような多くの高密度相互
接続構造物において使用するのに十分な程度の熱安定性
を有するとは考えられず、またひとたび反応させれば全
く溶解しなくなるので普通である。特に、かかる高密度
相互接続構造物を含む装置は200℃付近あるいはそれ
以上の温度において動作し得ることが望ましいものと考
えられている。アクリル系接着剤は、150℃を越える
温度において使用することはできないものと考えられて
いる。エポキシ樹脂もまた熱的に不安定であり、そのた
めにかかる温度において使用することはできない。特に
、大部分のエポキシ樹脂は150℃で淡褐色に変わり、
そして180℃で黒色に変わる。
た印刷回路板は補修のために分解できないのであって、
欠陥のある印刷回路板のほとんどは廃棄しなければなら
ない。いかなる種類の印刷回路板であれ、それらは高価
な部品を装着する前に十分な試験を受ける。それ故、高
価なチップが欠陥のある印刷回路板に装着されることは
ない。このような補修可能性の欠如は欠点であるが、印
刷回路板用途においては、この欠点は試験時における比
較的高い歩留りと熱硬化構造物が回路板に付与する高度
の耐久性との組合せによって十二分に埋合わせることが
できる。
用することは有益であるが、本発明の対象となるような
種類の高密度相互接続構造物においてはかかる熱硬化構
造物を使用することはできない。なぜなら、高密度相互
接続構造物が製造される前に高価なチップが所定の位置
に装着されるからである。その結果、熱硬化後の高密度
相互接続構造物に欠陥が発見されれば、該構造物自体を
廃棄しなければならないばかりでなく、全てのチップも
廃棄しなければならないのである。それ故、上記のごと
き高密度相互接続構造物の代りに熱硬化構造物を採用す
ることは、多層高密度相互接続構造物の製造に関連する
諸問題の解決策として役立つとは考えられない。
じられているごとく、熱可塑性接着剤を用いて複数の熱
硬化性誘電体層を積層することによって各々の誘電体層
が熱硬化性の上層と熱可塑性の下層とを含むような多層
構造物を製造することは、これまで実施されていなかっ
た。その理由は、後続の層を積層する際に初期に設置さ
れた層が移動、変形またはその他の変化を受け易く、そ
のために層間に設けられたスルーホール接続が破断する
傾向を示すことにある。それ故、追加の誘電体層を設置
するための新たな方法が望まれているのである。
接続構造物をパッケージ内に封入する際に見出されたも
う1つの問題は、パッケージの底板と高密度相互接続構
造物の基板との間に十分な結合力を得るため高密度相互
接続構造物に力を加える操作を含むパッケージ封入工程
中に層間短絡が発生することである。本発明者等は、高
密度相互接続構造物中における第2段およびそれより上
位の誘電体層として使用されるスピン塗布誘電体層が軟
質または柔軟な状態にあり、そのために誘電体層が移動
する結果として短絡が生じるという結論を得た。これは
かかる回路が所望通りの丈夫さを有しないことを意味す
るばかりでなく、誘電体層の厚さが少なくとも一部の導
電路または特定の導体パターンの近傍において安定しな
いことをも意味している。このことは、かかる構造物の
マイクロ波用途に関して新たな関心を呼び起こす。なぜ
なら、マイクロ波用途の場合、所定のインピーダンスを
持った伝送線路を形成することによって所望のマイクロ
波性能を達成するため、一定の既知厚さを有する誘電体
層を設置することが要求されるからである。それ故、上
記の問題を排除もしくは低減させるような改良された高
密度相互接続方法および構造物が要望されているのであ
る。
有する熱可塑性接着剤を用いた多段積層高密度相互接続
方法および構造物」と称する米国特許出願第
号明細書中に記載された多段積層方法に
よって少なくとも部分的に解決されるはずである。詳し
く述べれば、この方法は各々の金属層上に熱硬化性材料
層または高温熱可塑性材料層を設置するものである。か
かる耐熱層は短絡の問題を解決するはずである。しかし
ながら、かかる構造物はそれの熱可塑性部分の移動およ
び/または厚さの変化の問題を解決することができない
。更にまた、次第に低下するTg を有する接着剤が多
層構造物中に使用される結果、熱可塑的な移動の問題は
一層悪化することもあり得る。
構造物の補修可能性を維持しながらそれらの耐久性を向
上させるようになお一層の改良を実現することが要望さ
れているのである。
る温度下での加熱が回避されるような方法によって高密
度相互接続構造物中に上部の誘電体層を積層することに
ある。
を用いて接着された層を含む補修可能な高密度相互接続
構造物を提供することにある。
おけるスルーホール接続の破壊の問題が回避されるよう
なプレーナ型の多段積層高密度相互接続構造物を提供す
ることにある。
びガンマ線に対する抵抗性の低い材料を含まないプレー
ナ型の多段積層高密度相互接続構造物を提供することに
ある。
ジへの封入またはその他の理由によって構造物の上面に
力が加えられた場合にも短絡の発生または誘電体層の厚
さの変化を実質的に示さないようなプレーナ型の多段積
層高密度相互接続構造物を提供することにある。
互接続構造物、それらの製造材料、およびそれらの製造
方法における融通性および多様性を一層拡大することに
ある。
を受けた複数の基礎高密度相互接続構造物を包括高密度
相互接続構造物により相互接続して一層複雑な系を形成
することにある。
ャプトン層を用いて高密度相互接続構造物のパッシベー
ションを達成することにある。
ことによって明らかとなる上記およびその他の目的は、
本発明に従えば、特異な接着剤を使用しながら複数の積
層工程を実施して高密度相互接続構造物中に誘電体層を
設置することによって達成される。かかる接着剤は、次
の積層工程の実施前に十分に硬化する結果、全ての上層
積層工程が同じ積層温度下で実施される場合にも既に形
成された構造に後続の積層工程が影響を及ぼすことはな
いのである。
に基本高密度相互接続構造物が製造される。そのために
は、第1のガラス転移温度Tg1を有する第1の熱可塑
性接着剤を用いて電子部品上に第1の誘電体層を積層し
、接続を行うべき接触パッドに整列した位置において第
1の誘電体層中にスルーホールを形成し、次いで第1の
誘電体層上にパターン化された第1の金属層を設置すれ
ばよい。なお、かかる基本高密度相互接続構造物を製造
するためにはその他の方法を使用することもできる。本
発明に従えば、上記のごとき基本高密度相互接続構造物
を構成する第1の金属層および第1の誘電体層の露出部
分上に熱可塑性の剥離層がスピン塗布される。かかる剥
離層は少なくとも部分的にスルーホールを充填する結果
、第1の誘電体層中に設けられたスルーホールの下部に
は熱的に剥離し得る剥離層が形成されることになる。そ
の後、剥離層上に可変架橋性接着剤をスピン塗布して第
1の金属層の導体パターン間を埋めることにより、実質
的に平坦な表面が形成される。次いで、かかる架橋性接
着剤が溶剤を含まない状態にまで乾燥され、そして得ら
れた架橋性接着剤層を接着剤として使用しながら第2の
誘電体層が構造物上に積層される。この積層工程は接着
剤の硬化が完了するような条件下で実施される。なお、
第1の金属層と電子部品上の接触パッドとの間における
スルーホール接続が破壊またはその他の悪影響を受ける
のを防止するため、第2の積層工程はTg1よりも低い
積層温度の下で実施することが好ましい。剥離層を設置
する目的は、架橋性接着剤が下方の接触パッドから破片
を剥ぎ取ることなしに高密度相互接続構造物本体を高温
下で下方の構造物から剥離し得るようにするためである
。第2の積層工程の完了後、電気的接続を行うことが所
望される導体に整列した位置において第2の誘電体層中
にスルーホールが形成される。かかる導体は第1の金属
層の特定部分であってもよいし、あるいは電子部品の接
触パッドであってもよい。次いで、第2の誘電体層上に
第2の金属層が設置され、そして適宜なパターン化が施
される。より多くの導電層が必要であれば、(剥離層を
設置することなく)同じ接着剤を用いて追加の誘電体層
を構造物上に積層し、そしてその上に適当な導電層を設
置すればよい。このようにすれば、装置の最高動作温度
を低下させることなしに所望数の導電層を設置すること
ができるのである。
詳細かつ明確に記載されている。とは言え、本発明の構
成や実施方法並びに追加の目的や利点は、添付の図面を
参照しながら以下の説明を読むことによって最も良く理
解されよう。
ール接続を含む従来の高密度相互接続構造物100の小
部分が横断面図として示されている。この高密度相互接
続構造物は、積層された第1の誘電体層122およびス
ピン塗布された第2の誘電体層132を含んでいる。こ
の構造物はまた、上面に配置された接触パッド118を
有するチップ116をも含んでいる。上方に配置された
高密度相互接続構造物の積層部分を構成する第1の層1
20は、第1の誘電体層122とパターン化された金属
層128とから成っている。第1の誘電体層122は、
互いに独立した下層124および上層126を含んでい
る。下層124はゼネラル・エレクトリック・カンパニ
ーから入手し得るポリエーテルイミド樹脂であるウルテ
ム1000のごとき熱可塑性接着剤から成り、また上層
126はイー・アイ・デュポン・ド・ネムール社から入
手し得る熱硬化ポリイミドフィルムであるキャプトンフ
ィルムから成っている。金属層128はスルーホール1
27の内部にまで伸び、そして接触パッド118との間
にオーム接触を成している。スルーホール127の側壁
は、レーザ穴あけによって形成された結果として、上方
に行くほど外側に向かって開いている。第1の層120
上には高密度相互接続構造物の積層部分を構成する第2
の層130が配置されているが、それは第2の誘電体層
132とパターン化された金属層138とから成ってい
る。第2の誘電体層132は、マイクロSi(Micr
oSi) 社から入手し得るSPIシロキサンポリイミ
ドのごとき熱可塑性材料をスピン塗布して成る層である
。
層物のうち、各々の誘電体層が熱可塑性の下層と熱硬化
性の上層とから成りかつ後続の誘電体層を積層する過程
においてスルーホール接続が破壊されたような多層積層
物の横断面を調べた。
されている。横断面図として示された高密度相互接続構
造物200は、積層された第1の誘電体層222および
第2の誘電体層232を含んでいる。この構造物はまた
、上面に配置された接触パッド218を有するチップ2
16をも含んでいる。上方に配置された高密度相互接続
構造物の積層部分を構成する第1の層220は、第1の
誘電体層222とパターン化された金属層228とから
成っている。第1の誘電体層222は、互いに独立した
下層224および上層226を含んでいる。下層224
はゼネラル・エレクトリック・カンパニーから入手し得
るポリエーテルイミド樹脂であるウルテム1000のご
とき熱可塑性接着剤から成り、また上層226はイー・
アイ・デュポン・ド・ネムール社から入手し得る熱硬化
ポリイミドフィルムであるキャプトンフィルムから成っ
ている。金属層228はスルーホール227の内部にま
で伸び、そしてそれの一部が接触パッド218との間に
オーム接触を成している。スルーホール227の側壁の
上部は、レーザ穴あけによって形成された結果として、
上方に行くほど外側に向かって開いている。第1の層2
20の上には高密度相互接続構造物の積層部分を構成す
る第2の層230が配置されているが、それは第2の誘
電体層232とパターン化された金属層238とから成
っている。第2の誘電体層232は、互いに独立した下
層234および上層236を含んでいる。下層234は
ゼネラル・エレクトリック・カンパニーから入手し得る
ポリエーテルイミド樹脂であるウルテム1000のごと
き熱可塑性接着剤から成り、また上層236はイー・ア
イ・デュポン・ド・ネムール社から入手し得る熱硬化ポ
リイミドフィルムであるキャプトンフィルムから成って
いる。
ールは、スルーホールが第1の誘電体層222を構成す
る熱硬化性の上層226の直下の空間内において拡張し
ているという点で、本発明者等が調べた破断状態のスル
ーホールの典型例を成すものである。スルーホール内の
金属層は上層226の下端の位置において破断し、それ
によって金属層228中にギャップ229が生じるのが
通例である。積層後にこのようなスルーホール形状が生
じる理由は、第2の誘電体層232の下層234を成す
熱可塑性接着剤がスルーホール内に入り込んで横方向の
圧力を及ぼすことにある。すなわち、第2の誘電体層2
32の下層234を成す熱可塑性接着剤が第1の誘電体
層222の熱硬化した上層226の下方にまで流れ込ん
だ場合、それが上層226の直下において前方の金属層
を圧迫し、かつその金属層が前方にある第1の誘電体層
222の下層224を圧迫することにより、金属層の破
断が起こるのである。本発明者等は、第1の誘電体層の
熱可塑性接着剤が十分な流動性を示すような温度におい
て第2の積層工程が実施される結果としてこのような問
題が生じるという結論に達した。すなわち、第2の積層
工程に際してスルーホールの側壁に加わる圧力の下で、
第1の誘電体層の熱可塑性接着剤がスルーホールの位置
から後退し得ることに問題があるのである。熱硬化性の
接着剤を用いた従来の印刷回路板技術においては、この
問題は第2の誘電体層の積層に先立って第1の誘電体層
の接着剤を熱硬化させることによって回避されている。 かかる解決策は、前述のごとく、本発明に係わる種類の
高密度相互接続構造物においては受入れることができな
い。それ故に本発明者等は、第1の誘電体層の熱可塑性
接着剤が流動しないような低い温度および積層圧力の下
で以後の積層工程を実施すれば上記の問題が解決される
という結論に達したのである。
接続構造物10が横断面図として示されている。この高
密度相互接続構造物10は、集積回路チップのごとき電
子部品16を配置するため上面に設けられたキャビティ
14を有する基板12を含んでいる。多くの高密度相互
接続構造物においては、かかる電子部品16は熱可塑性
接着剤15によって基板12に接着されている。なお、
電子部品16は(上部の)接触面上に接触パッド18を
有している。基板12はまた、それの上面に配置された
導電路13を有することもある。上方に配置された高密
度相互接続構造物の積層部分を構成する第1の層20は
、第1の誘電体層22とパターン化された第1の金属層
28とから成っている。第1の誘電体層22は、互いに
独立した下層24および上層26を含んでいる。上層2
6は熱硬化性材料またはTg の高い熱可塑性材料から
成っていればよい。下層24は第1のガラス転移温度T
g1を有する熱可塑性接着剤から成っている。チップま
たは電子部品が熱可塑性チップ接着剤15によって基板
12に接着されている場合、このチップ接着剤はTg1
よりも高いガラス転移温度(Tg0)を有することが好
ましい。
ロセス中においてそれをチップ上に積層する際に安定性
が維持されるようにするため、Tg1よりも高い一定の
温度範囲にわたって安定であることが必要である。特に
、上層26はTg1より少なくとも100℃だけ高い温
度範囲にわたって安定であることが好ましい。ここで言
う「安定」とは、積層工程中において望ましくない移動
、伸縮またはその他の変化を生じない程度の粘度を有す
ることを意味する。
ネムール社から販売されている熱硬化ポリイミドフィル
ムであるキャプトンフィルムのごとき熱硬化性フィルム
であることが好ましい。なお、十分な安定性を示すもの
であれば、熱可塑性樹脂を含めたその他の材料を使用す
ることもできる。下層24はゼネラル・エレクトリック
・カンパニーから入手し得るポリエーテルイミド樹脂で
あるウルテム1000(Tg1=約217℃)から成る
ことが好ましく、またチップ接着剤15はゼネラル・エ
レクトリック・カンパニイから入手し得るポリエーテル
イミド樹脂であるウルテム6000(Tg2=約235
℃)から成ることが好ましい。
の誘電体層22中に設けられたスルーホール23の内部
にまで伸び、そして基板12上の接触パッド18および
導電路13に接触している。
る第2の層30は、第2の誘電体層32とパターン化さ
れた第2の金属層38とから成っている。第2の誘電体
層32は、熱可塑性の剥離層34Rと互いに独立した下
層34および上層36を含んでいる。剥離層34RはS
PIシロキサンポリイミドから成ることが好ましい。こ
の剥離層が高密度相互接続構造物中に含まれる理由は、
電子部品の1者または該構造物それ自体に欠陥のあるこ
とが判明した場合に該構造物の補修を可能にすることに
ある。すなわち、補修のために高密度相互接続構造物を
分解しなければならない場合には、Tg1よりも高い温
度に加熱することにより、該構造物の積層部分を基板お
よび電子部品から剥離することができる。しかるに、下
層34が流動性を示す温度にまで加熱されない場合には
、剥離層34Rが存在しない状態で高密度相互接続構造
物の積層部分を剥離すると、下層34の接着剤がスルー
ホールの底部において金属層に付与する強い結合力のた
め、接触パッドおよび下方の半導体材料の破片が剥ぎ取
られることになる。
材料から成るものであるが、前記に引用された「エポキ
シ樹脂/ポリイミド共重合体ブレンド誘電体およびそれ
を組込んだ積層回路」と称する米国特許出願第4545
45号明細書中に開示されているようなポリイミドと架
橋性エポキシ樹脂との共重合体ブレンドから成ることが
好ましい。かかる共重合体ブレンドを構成するポリイミ
ドは、マイクロSi社から入手し得るシロキサンポリイ
ミドSPI−129またはSPI−135のごとき完全
に反応したシロキサンポリイミドであることが好ましい
。かかる共重合体ブレンドを構成する架橋性エポキシ樹
脂は、チバ・ガイギー(Ciba−Geigy)社製の
CY179(電子用)またはユニオン・カーバイド(U
nion Carbide) 社製のERL4221(
電子用)のごとき脂環式エポキシ樹脂であることが好ま
しい。なお、その他のエポキシ樹脂を使用することもで
きる。
と考えられる理由は、かかる材料が高度の放射線抵抗性
を示す結果、高密度相互接続構造物によって相互接続さ
れるシリコン半導体チップが耐えられないようなX線お
よびガンマ線環境中においてもかかる材料は損傷を受け
ないことにある。その上、こうして得られた構造物は極
めて安定である。すなわち、かかる材料を4000〜5
000時間にわたって200℃の温度に暴露したが、そ
れらの特性に顕著な変化は認められなかったのである。
たは熱可塑性材料から成り得るが、熱硬化性材料(キャ
プトンフィルム)から成ることが好ましい。パターン化
された第2の金属層38は第2の誘電体層32中に設け
られたスルーホール33の内部にまで伸び、そして第1
の金属層28に接触している。所望ならば、特定のスル
ーホール33が第1の誘電体層22をも貫通し、それに
よって特定の接触パッドに対する直接の接続を行うこと
もできる。とは言え、このような構成は好ましいもので
はない。その理由の1つは、深さの異なるスルーホール
を設ける必要があるために加工の複雑度が増すことにあ
る。もう1つの理由は、225〜250℃の範囲内の温
度において固体であるような材料で満たされたスルーホ
ールによって電子部品の接触パッドに対する直接接続が
行われる結果として補修可能性が悪影響を受けることに
ある。
る第3の層40は、第3の誘電体層42とパターン化さ
れた第3の金属層48とから成っている。第3の誘電体
層42は、互いに独立した下層44および上層46を含
んでいる。第3の誘電体層42の下層44はシロキサン
ポリイミド/エポキシ樹脂架橋性共重合体ブレンドから
成ることが好ましい。この場合にも、第3の誘電体層4
2の上層46は熱硬化性材料または熱可塑性材料から成
り得るが、熱硬化性材料から成ることが好ましい。なお
、下層44の下方に剥離層を設置する必要はない。
24、34および44を構成するシロキサンポリイミド
/エポキシ樹脂架橋性共重合体ブレンド接着剤は、高密
度相互接続構造物の積層部分またはそれによって相互接
続すべき電子部品に対して悪影響を及ぼさない程度の低
い温度においてそれらが硬化し得るように選定される。 その理由は、先行特許および先行特許出願の明細書中に
記載されているごとく、相互接続すべき電子部品に対し
て悪影響を及ぼすことなしに高密度相互接続構造物の製
造および(必要ならば)分解を行い得るようにすること
にある。すなわち本発明においては、下方の金属層およ
び誘電体層の両者に良く付着し、上方に積層されるフィ
ルムに対して良好な結合力を有し、積層を行うために役
立つ安定なB段階を示し、かつ高密度相互接続構造物の
残部に対して悪影響を及ぼさない程度の低い温度におい
て硬化するようなシロキサンポリイミド/エポキシ樹脂
架橋性共重合体ブレンド接着剤を使用することが必要な
のである。このような接着剤は本質的にレーザ切除可能
なものであることが好ましいが、さもなければ「レーザ
切除可能な高分子誘電体およびそれの形成方法」と称す
る米国特許出願第456421号に従ってレーザ切除可
能性を付与することが必要である。
用するためには各種の接着剤が利用可能である。とは言
え、前記に引用された「エポキシ樹脂/ポリイミド共重
合体ブレンド誘電体およびそれを組込んだ積層回路」と
称する米国特許出願第454545号明細書中に開示さ
れているようなシロキサンポリイミド/エポキシ樹脂架
橋性共重合体ブレンドを使用することが好ましい。スピ
ン塗布された誘電体層としてこのブレンドを使用するこ
とは、該特許出願明細書中に開示されている。本発明に
従えば、予め形成されたフィルムを積層するための平坦
化/接着剤層として使用することにより、かかるブレン
ドの融通性および応用性が拡張される。上記の特許出願
明細書中に記載されているごとく、シロキサンポリイミ
ドとエポキシ樹脂との比率を変えればブレンドの硬化後
特性が変化する。エポキシ樹脂を主成分とするブレンド
に対して351nmの波長におけるレーザ穴あけを施す
ためには、前記に引用された「レーザ切除可能な高分子
誘電体およびそれの形成方法」と称する米国特許出願第
456421号明細書中に記載されているような切除可
能化染料の添加によってそれを変性することが必要であ
る。本発明者等は、高密度相互接続構造物中に剥離層3
4Rを設置したすれば、このような架橋性接着剤による
積層工程の使用が該構造物の補修可能性に悪影響を及ぼ
さないことを見出した。なお、シロキサンポリイミド/
エポキシ樹脂架橋性共重合体ブレンドが十分に低いTg
を有する場合には、かかる剥離層は必要でない。すな
わち、シロキサンポリイミド/エポキシ樹脂架橋性共重
合体ブレンドが十分な流動性を示すような温度にまで高
密度相互接続構造物を加熱することができ、従って補修
目的のために高密度相互接続構造物の積層部分を除去す
る際に破片の剥ぎ取りが問題とならないような場合には
、剥離層は不要なのである。
接続構造物10を製造するための好適な製造プロセス4
00が示されている。
プを装着する工程401から開始される。基板が完成し
た高密度相互接続構造物の一部を成す場合には、かかる
装着は永久的なものとして実施される。しかるに、柔軟
な高密度相互接続構造物を得るため製造プロセスの完了
後に基板が除去される場合には、かかる装着は一時的な
ものとして実施される。かかる装着は、熱可塑性接着剤
としてウルテム6000を使用しながら250〜300
℃の範囲内の積層温度において実施することが好ましい
。
層22の上層26が適当な熱可塑性接着剤層24で被覆
される。なお、熱可塑性接着剤層24としては、ゼネラ
ル・エレクトリック・カンパニイから入手し得るポリエ
ーテルイミド樹脂であるウルテム1000を使用するこ
とが好ましい。
された第1の誘電体層22が第1の積層温度T1 の下
でチップおよび基板上に積層される。なお、ウルテム1
000については、第1の積層温度T1 は250〜3
00℃の範囲内にあるのが通例である。
層22中にスルーホール23が形成される。
層22上にパターン化された第1の金属層28が設置さ
れる。かかる目的のためには、一様な金属層を設置して
からそれのパターン化を行ってもよいし、あるいは前記
に引用された特許に基づく方法またはその他各種のパタ
ーン化堆積技術もしくは一様堆積/パターン化技術に従
ってパターン化された金属層を直接に設置してもよい。 この工程により、図3に示されたような高密度相互接続
構造物を構成する第1の層20が完成したことになる。
プロセスは、前記に引用された先行特許に基づくもので
ある。この段階に到達するまでの製造プロセスは本発明
にとって重要ではないのであって、本発明の範囲から逸
脱することなく広範囲にわたって変更することができる
。
、第2の誘電体層32の下層34の下方に位置する熱可
塑性の剥離層34Rが上記のごとき構造物上(すなわち
、パターン化された第1の金属層28および第1の誘電
体層22の露出部分の上)にスピン塗布される。次いで
、この剥離層34Rが適当な方法で乾燥される。
リイミド/エポキシ樹脂架橋性共重合体ブレンドが接着
剤として剥離層34R上に塗布される。
キシ樹脂との共重合体ブレンドが調製され、そして必要
に応じエポキシ樹脂用の適当な硬化剤がそれに添加され
る。次いで、かかる共重合体ブレンドを剥離層34R上
にスピン塗布または吹付塗布することによって下層34
が形成される。好適な接着剤溶液は、200gのチバ・
ガイギー社製脂環式エポキシ樹脂CY−179と472
gのマイクロSi社製シロキサンポリイミドSPI−1
35との均質ブレンド、2.0gのゼネラル・エレクト
リック・カンパニイ製オクチルオキシフェニル(フェニ
ル)ヨードニウムヘキサフルオロアンチモネート触媒、
および0.05gのムーニー・ケミカル(Mooney
Chemical) 社製12%ナフテン酸銅から成
るものである。なお、472gのSPI−135は17
5gの固形分(37%)と297gのジグリム/キシレ
ン溶剤とから成っており、また該溶剤は80%のジグリ
ムと20%のキシレンとから成っている。また、「エポ
キシ樹脂/ポリイミド共重合体ブレンド誘電体およびそ
れを組込んだ積層回路」と称する米国特許出願第454
545号明細書中に記載のごとくにして共重合体ブレン
ドの無溶剤塗布を行うこともできる。
程408においては、ホットプレートまたはその他の手
段を用いて構造物を約135℃の温度T2 にまで加熱
して溶剤を追出すことにより、共重合体ブレンド層が乾
燥される。その際には、接着剤溶液を塗布する前に構造
物を秤量し、次いで接着剤溶液を塗布した後に再び構造
物を秤量することにより、接着剤溶液の付着量(すなわ
ち、シロキサンポリイミド、エポキシ樹脂および溶剤の
合計量)を求めることが好ましい。2×2インチの基板
上に接着剤溶液を配置してから2600rpm の速度
で回転させれば、約70mgの接着剤溶液が構造物上に
一様に塗布された状態で残留する。次に、30分毎に構
造物を秤量することによって減量が測定される。乾燥工
程は47%の減量が生じた後に停止される。
基板上にスピン塗布してから上記のごとき手順に従って
乾燥した場合の経時的な減量を示すグラフである。最初
、接着剤溶液層から溶剤が蒸発することが認められよう
。その後も蒸発が継続するが、これはエポキシ樹脂が硬
化するのと同時に蒸発するからである。ホットプレート
上においてかかる過程を完了させれば、共重合体ブレン
ドの最終組成は約63重量%のシロキサンポリイミドと
約37重量%のエポキシ樹脂とから成ることになる。 なお、全ての溶剤を蒸発させると共に、大部分のエポキ
シ樹脂を残留させて約50重量%のシロキサンポリイミ
ドと約50重量%のエポキシ樹脂とから成る最終組成を
持った共重合体ブレンドを得るためには、約10%のエ
ポキシ樹脂が蒸発した時点で乾燥工程を停止することが
好ましい。次いで、構造物がホットプレートから取除か
れ、そして室温にまで放冷される。この段階(室温)に
おいては、共重合体ブレンド層はもはや粘着性を示さず
、従って容易に取扱うことができる。なお、かかる共重
合体ブレンド層は一般に約12μm の厚さを有してい
る。この乾燥工程においては、共重合体ブレンドの過度
の硬化を避けることが重要である。なぜなら、共重合体
ブレンドを過度に硬化させると、積層される上層36と
下層34との間の結合力が低下するからである。その上
、積層工程に際して共重合体ブレンドが十分に流動しな
い結果、上層(キャプトン層)36と下層(共重合体ブ
レンド層)34との間に存在するくぼみやその他の隙間
が完全に埋められず、従って両者間に空隙が生じること
にもなる。
ンド層への積層に先立ち、上層(キャプトン層)の下面
が反応性イオンエッチング(RIE)によって前処理さ
れる。これは、上層36と下層(共重合体ブレンド層)
34との間に強い結合力を生み出すために役立つ。
下で構造物を積層装置内に配置し、そして上層36の上
側および下側を真空に引くことによってガス抜きが行わ
れる。100mTorr の基本真空度を得るのに十分
な排気時間(通例は約20分)の経過後、上層36の上
面に約30〜45psi の窒素圧を加えることにより
、上層36が下層34に押付けられると共に、共重合体
ブレンドの流動によって隙間が埋められる。次いで、圧
力を維持しながら温度を180℃の積層温度T3 にま
で上昇させ、そして30分間にわたり構造物を180℃
に保つことにより、共重合体ブレンドの硬化が完了する
。その後、構造物が100℃未満の温度にまで冷却され
、圧力が解除され、そして積層装置から構造物が取出さ
れる。かかる積層工程に際しては、上層36の存在によ
ってエポキシ樹脂の蒸発が防止される。なお、共重合体
ブレンド層と上層との界面におけるエポキシ樹脂の凝離
は認められなかった。すなわち、共重合体ブレンドは硬
化の完了後にも均質な状態に維持されるのである。
される通り、硬化時間は硬化温度を上昇させることによ
って短縮することができ、また硬化温度は硬化時間を延
長することによって低下させることができる。
、ウルテム1000のTg (217℃)よりも十分に
低いものである。その結果、ウルテム1000から成る
熱可塑性接着剤層24はこの積層工程を通じて硬質の状
態に保たれる。それ故、下層24のTg よりも高い温
度において後続の積層工程を実施する際にスルーホール
接続の破断を示した従来の構造物とは異なり、積層圧力
の作用下でウルテム1000の下層24がスルーホール
の位置から押し戻される結果としてスルーホール接続が
破断することは防止されるのである。
造物の全表面にわたって実質的に一様な厚さの下層34
が形成される。下層34は約12μm の厚さを有する
のが通例であるが、それは金属層がそれよりも薄い場合
に適用される。金属層がそれよりも厚い場合には、共重
合体ブレンドをより遅い速度でスピン塗布することによ
ってより厚い下層34を形成することが好ましい。上層
(キャプトン層)36は約25μm の厚さを有するこ
とが好ましい。上層36は予め形成されたものであるか
ら、それの厚さは厳密に調節されている。その結果、第
2の誘電体層32は37μm にほぼ等しい厚さを有す
るのであって、それの厚さの変動は下層34の厚さの変
動に由来するものである。とは言え、この厚さはキャプ
トン層に対して2回のRIE工程を施す際に約5μm
だけ減少する。第1のRIE工程は結合力を向上させる
ための前処理であって、これはキャプトン層の厚さを約
1μm だけ減少させる。第2のRIE工程は穴あけ後
にスルーホールから灰またはその他の残渣を除去するた
めに実施されるクリーンアップ処理であって、これはキ
ャプトン層の厚さを約4μm だけ減少させる。とは言
え、スピン塗布のみによって誘電体層を設置する場合に
比べれば、本発明の方法は遥かに一様かつ遥かに再現可
能な厚さを与えるのである。このことは、高密度相互接
続構造物中に伝送線路が形成されるようなマイクロ波装
置の製造にとって特に望ましいものである。なぜなら、
所望のインピーダンスを持ったかかる伝送線路を設計し
かつ形成するためには、誘電体層の一様性および再現可
能性が重要だからである。
層32中にスルーホール33が形成される。
第1の金属層の場合と同じ技術または異なる技術を使用
することにより、第2の誘電体層32上にパターン化さ
れた第2の金属層38が設置される。これにより、図3
に示された高密度相互接続構造物を構成する第2の層3
0の形成が完了したことになる。
造物を構成する第3の層40が所望される場合には、引
続いて工程413が実施される。この工程413におい
ては、本発明に基づくシロキサンポリイミド/エポキシ
樹脂架橋性共重合体ブレンドから成る下層44が上記の
ごとき構造物上(すなわち、第2の金属層38および第
2の誘電体層32の露出部分の上)に設置される。この
場合には、熱可塑性の剥離層を設置することは不要であ
るが、所望ならばそれを設置することもできる。
す共重合体ブレンドが温度T2 (約135℃)におい
て乾燥される。
層42の上層46に前処理を施した後、それが積層温度
T3 (約180℃)において共重合体ブレンドから成
る下層44上に積層される。
層42中にスルーホール43が形成される。
層42上にパターン化された第3の金属層48が設置さ
れ、それによって図3に示された高密度相互接続構造物
の製造が完了する。なお、かかる高密度相互接続構造物
において追加の層が要求もしくは所望される場合には、
同様にして追加の層を設置し得ることが理解されよう。
、複雑な系を構成する個々の基礎高密度相互接続構造物
を互いに独立に製造してそれらの予備試験を行い得るこ
とである。かかる予備試験の後、図6に300として示
されるようなより大きい系を構成する個々の基礎高密度
相互接続構造物318が適切な相対位置に配置される。 次いで、これらの基礎高密度相互接続構造物318が包
括高密度相互接続構造物310によって相互接続される
。かかる包括高密度相互接続構造物310は、互いに隣
接した基礎高密度相互接続構造物318間の空隙を橋絡
する追加の誘電体層322を含んでいる。この誘電体層
322上に設置された金属層328が、スルーホール3
23を通して基礎高密度相互接続構造物318同士を相
互接続している。なお、包括高密度相互接続構造物31
0の製造に際しては、個々の基礎高密度相互接続構造物
318を担体または基板(図示せず)内に配置すること
が好ましい。かかる担体または基板は、(基礎高密度相
互接続構造物318ばかりでなく包括高密度相互接続構
造物310に対する支持体として最終の系中に残存させ
てもよい。あるいはまた、図示のごとく、かかる担体ま
たは基板を構造物から取除いてもよい。かかる包括高密
度相互接続構造物310は十分な柔軟性を有するから、
基礎高密度相互接続構造物318間に位置する部分にお
いて包括高密度相互接続構造物を折り曲げることにより
、基礎高密度相互接続構造物318同士を重ね合わせる
こともできる。基礎高密度相互接続構造物に誘電体層3
22を積層することによってかかる包括高密度相互接続
構造物を製造し得ることは、「柔軟な高密度相互接続構
造物および柔軟に相互接続された装置」と称する米国特
許出願第07/504769号の図面に示された構造物
(すなわち、個々の高密度相互接続構造物の基板同士を
高密度相互接続構造物により相互接続することによって
個々の基板のチップ同士を相互接続して成る構造物)に
比べ、高密度相互接続構造物の融通性を一層拡大するこ
とになる。
可能性の点から見れば、電子部品の1者または高密度相
互接続構造物の一部に欠陥のあることが判明した場合に
おける該構造物の補修を容易にするため、各々の接着剤
層は該構造物の寿命期間を通じて柔軟性を維持すること
が必要である。かかる柔軟性は、前記に引用された「高
密度相互接続回路の簡略化された補修方法」と称する米
国特許第4878991号明細書中に記載されているご
とく熱可塑性接着剤層24のTg1よりも高い温度に加
熱することによって高密度相互接続構造物全体をチップ
および基板から剥離することを容易にする。かかる加熱
温度はまた、接触パッドから破片が剥ぎ取られるのを防
止するため、剥離層34RのTg より高いことも必要
である。
板12を含んでいるが、「高い体積効率を有する高密度
相互接続方法」と称する米国特許出願第250010号
並びに「柔軟な高密度相互接続構造物および柔軟に相互
接続された装置」と称する米国特許出願第07/504
769号に従い、高密度相互接続構造物の製造後に基板
12を除去してもよいことを理解すべきである。この場
合には、電子部品16は高密度相互接続構造物に直接に
接着された状態にあるのであって、それ以外には支持を
受けていないことになる。
、次の誘電体層の下層を構成するシロキサンポリイミド
/エポキシ樹脂架橋性共重合体ブレンド接着剤で構造物
の表面を被覆することが好ましい。そうすれば、特に厚
い金属層が存在する場合において、誘電体層の平坦化が
容易になる。とは言え、所望ならば、次の誘電体層の上
層を構成するフィルムにシロキサンポリイミド/エポキ
シ樹脂架橋性共重合体ブレンド接着剤を塗布することも
できる。その場合には、隣接する導体パターン間に空隙
が生じるのを回避するため、接着剤層はそれが被覆すべ
き金属層よりも厚いことが必要である。
れにおいても、単なる絶縁目的のため、あるいは最終の
金属層を支持するため、スピン塗布によって最終の誘電
体層を設置し得ることは容易に理解されよう。このよう
にすれば、2つ以上のスピン塗布層を使用する場合に生
じる問題の多くが回避される。あるいはまた、内部にス
ルーホールが設けられておらずかつ上部に金属層が設置
されていないような最終の誘電体層を積層することもで
きる。上記のごとき材料はまた、印刷回路板の製造にも
使用することができる。
剤を使用することが好ましいが、所望ならば相異なる接
着剤を使用することもできる。
本発明を詳しく説明したが、本発明の精神および範囲か
ら逸脱することなしに様々な変更態様が可能であること
は当業者にとって自明であろう。それ故、前記特許請求
の範囲はかかる変更態様の全てを包括するものと理解す
べきである。
する従来の高密度相互接続構造物における典型的な第1
段のスルーホール接続を示す概略横断面図である。
ける破断状態のスルーホール接続を示す概略横断面図で
ある。
図である。
係わる諸工程を示すブロック図である。
程を示すグラフである。
接続構造物のそれぞれに積層された誘電体層を含む包括
高密度相互接続構造物によってそれらの基礎高密度相互
接続構造物を相互接続したところを示す概略斜視図であ
る。
Claims (20)
- 【請求項1】 (a) 第1の表面上に接触パッドを
それぞれ有する複数の半導体チップ、 (b) 前記半導体チップに接着された第1の誘電体層
であって、前記第1の誘電体層は第1の下層および第1
の上層を含み、前記第1の下層は第1のガラス転移温度
Tg1を有する熱可塑性樹脂から成り、前記第1の上層
はTg1よりも高い一定の温度範囲にわたって安定であ
り、かつ前記第1の誘電体層には少なくとも一部の前記
接触パッドに整列して配置されたスルーホールが設けら
れているような第1の誘電体層、 (c) 前記第1の誘電体層上に配置され、かつ前記第
1の誘電体層中に設けられた前記スルーホールの内部に
まで伸びて少なくとも一部の前記接触パッドに接触して
いるパターン化された第1の金属層、並びに(d) 前
記第1の金属層および前記第1の誘電体層の露出部分に
接着された第2の誘電体層であって、前記第2の誘電体
層は第2の下層および第2の上層を含み、前記第2の下
層はTg1よりも低い温度において硬化させ得る熱硬化
性重合体から成り、かつ前記第2の上層は前記熱硬化性
重合体の最低硬化温度よりも高い一定の温度範囲にわた
って安定であるような第2の誘電体層の諸要素から成る
高密度相互接続構造物。 - 【請求項2】 前記第2の下層と前記第1の金属層お
よび前記第1の誘電体層との間に配置された熱可塑性の
剥離層が追加包含される請求項1記載の高密度相互接続
構造物。 - 【請求項3】 前記第2の誘電体層には一部の前記接
触パッドおよび/または前記第1の金属層の特定部分に
整列して配置されたスルーホールが設けられていると共
に、前記第2の誘電体層上に配置され、かつ前記第2の
誘電体層中に設けられた前記スルーホールの内部にまで
伸びて一部の前記接触パッドおよび/または前記第1の
金属層の特定部分に接触しているパターン化された第2
の金属層が追加包含される請求項1記載の高密度相互接
続構造物。 - 【請求項4】 前記第2の金属層および前記第2の誘
電体層の露出部分に接着された第3の誘電体層が追加包
含されていて、前記第3の誘電体層は第3の下層および
第3の上層を含み、前記第3の下層はTg1よりも低い
温度において硬化させ得る熱硬化性重合体から成り、か
つ前記第3の上層は前記熱硬化性重合体の最低硬化温度
よりも高い一定の温度範囲にわたって安定である請求項
3記載の高密度相互接続構造物。 - 【請求項5】 前記第3の誘電体層には一部の前記接
触パッドおよび/または前記第1の金属層の特定部分お
よび/または前記第2の金属層の特定部分に整列して配
置されたスルーホールが設けられていると共に、前記第
3の誘電体層上に配置され、かつ前記第3の誘電体層中
に設けられた前記スルーホールの内部にまで伸びて一部
の前記接触パッドおよび/または前記第1の金属層の特
定部分および/または前記第2の金属層の特定部分に接
触しているパターン化された第3の金属層が追加包含さ
れる請求項4記載の高密度相互接続構造物。 - 【請求項6】 前記第2の誘電体層には少なくとも前
記第1の金属層の特定部分に整列して配置されたスルー
ホールが設けられていると共に、前記第2の誘電体層上
に配置され、かつ前記第2の誘電体層中に設けられた前
記スルーホールの内部にまで伸びて少なくとも前記第1
の金属層の特定部分に接触しているパターン化された第
2の金属層が追加包含される請求項1記載の高密度相互
接続構造物。 - 【請求項7】 前記第1および第2の上層が熱硬化性
重合体から成る請求項1記載の高密度相互接続構造物。 - 【請求項8】 前記第1および第2の上層が熱硬化性
ポリイミドから成る請求項7記載の高密度相互接続構造
物。 - 【請求項9】 前記第1の下層がポリエーテルイミド
から成り、かつ前記第2の下層がシロキサンポリイミド
/エポキシ樹脂共重合体ブレンドから成る請求項7記載
の高密度相互接続構造物。 - 【請求項10】 第2の高密度相互接続構造物と、前
記に記載された第1の高密度相互接続構造物および前記
第2の高密度相互接続構造物に接着された包括高密度相
互接続構造物とが追加包含されていて、前記括高密度相
互接続構造物は前記第1および第2の高密度相互接続構
造物上に積層された第1の包括誘電体層並びに前記第1
の包括誘電体層上に配置された第1の包括金属層を含み
、前記第1の包括誘電体層には前記第1および第2の高
密度相互接続構造物の特定の導体に整列して配置された
スルーホールが設けられており、かつ前記第1の包括金
属層は前記スルーホールの内部にまで伸びて前記第1お
よび第2の高密度相互接続構造物の特定の導体と電気的
に接触している請求項1記載の高密度相互接続構造物。 - 【請求項11】 前記第1および第2の上層の少なく
とも1者が熱可塑性を有する請求項1記載の高密度相互
接続構造物。 - 【請求項12】 前記第1および第2の上層が熱可塑
性を有する請求項1記載の高密度相互接続構造物。 - 【請求項13】 複数の電子チップ、前記電子チップ
に接着された誘電体層、および前記誘電体層上または前
記誘電体層中に配置されかつ前記電子チップ同士を電気
的に相互接続している導体パターンを含むような高密度
相互接続構造物の製造方法において、 (a) 前記電子チップ、前記電子チップに接着されか
つ内部に複数のスルーホールを有する第1の誘電体層、
および前記第1の誘電体層上に配置されかつ前記スルー
ホールの内部にまで伸びて接触パッドとの間にオーム接
触を成している部分を含むパターン化された第1の金属
層から成る基本構造物を用意し、 (b) 前記スルーホールを充填するようにして前記第
1の金属層上に剥離層を配置し、次いで (c) 前記基本構造物が安定であるような温度におい
て硬化させ得る架橋性重合体接着剤の使用により、前記
架橋性重合体接着剤の最低硬化温度よりも高い一定の温
度範囲にわたって安定な第2の誘電体層を前記剥離層上
に積層する諸工程を含んでいて、前記積層工程が前記第
1の誘電体層を固定状態に維持し得る程度に低い温度下
で実施される結果として前記積層工程は前記第1の金属
層および前記接触パッドに対するそれの接触部に悪影響
を及ぼさないことを特徴とする方法。 - 【請求項14】 (d) 前記接触パッドおよび/ま
たは前記第1の金属層の特定部分に整列した位置におい
て前記第2の誘電体層および前記架橋性重合体接着剤中
に第2段のスルーホールを形成し、次いで (e) 前記第2段のスルーホールの内部にまで伸びて
前記接触パッドおよび/または前記第1の金属層の特定
部分との間にオーム接触を成している部分を含むパター
ン化されただいの金属層を前記第2の誘電体層上に設置
する両工程が追加包含される請求項13記載の方法。 - 【請求項15】 (f) Tg1よりも低い温度にお
いて硬化させ得る熱硬化性重合体剤の使用により、前記
熱硬化性重合体の最低硬化温度よりも高い一定の温度範
囲にわたって安定な第3の誘電体層を前記第2の金属層
および前記第2の誘電体層の露出部分上に積層する工程
が追加包含されていて、前記積層工程が前記第1および
第2の誘電体層を固定状態に維持し得る程度に低い温度
下で実施される結果として前記積層工程は前記第2の金
属層並びに前記接触パッドおよび/または前記第1の金
属層に対するそれの接触部に悪影響を及ぼさず、また前
記積層工程は前記第1の金属層および前記接触パッドに
対するそれの接触部にも悪影響を及ぼさない請求項14
記載の方法。 - 【請求項16】 複数の電子チップ、前記電子チップ
に接着された誘電体層、および前記誘電体層上または前
記誘電体層中に配置されかつ前記電子チップ同士を電気
的に相互接続している導体パターンを含むような高密度
相互接続構造物の製造方法において、 (a) 第1のガラス転移温度Tg1を有する熱可塑性
接着剤を用いて第1の誘電体層を前記チップに積層し、
(b) 前記チップの接触パッドの少なくとも一部に整
列した位置において前記第1の誘電体層および前記熱可
塑性接着剤中にスルーホールを形成し、 (c) 前記スルーホールの内部にまで伸びて接触パッ
ドとの間にオーム接触を成している部分を含むパターン
化された第1の金属層を前記第1の誘電体層上に設置し
、(d) 前記スルーホールを充填するようにして前記
第1の金属層上に剥離層を配置し、次いで (e) このようにして得られた構造物が安定であるよ
うな温度において硬化させ得る架橋性重合体接着剤の使
用により、前記架橋性重合体接着剤の最低硬化温度より
も高い一定の温度範囲にわたって安定な第2の誘電体層
を前記剥離層上に積層する諸工程を含んでいて、前記積
層工程が前記第1の誘電体層を固定状態に維持し得る程
度に低い温度下で実施される結果として前記積層工程は
前記第1の金属層および前記接触パッドに対するそれの
接触部に悪影響を及ぼさない方法。 - 【請求項17】 (f) 前記接触パッドおよび/ま
たは前記第1の金属層の特定部分に整列した位置におい
て前記第2の誘電体層および前記架橋性重合体接着剤中
に第2段のスルーホールを形成し、次いで (g) 前記第2段のスルーホールの内部にまで伸びて
前記接触パッドおよび/または前記第1の金属層の特定
部分との間にオーム接触を成している部分を含むパター
ン化されただいの金属層を前記第2の誘電体層上に設置
する両工程が追加包含される請求項16記載の方法。 - 【請求項18】 (h) Tg1よりも低い温度にお
いて硬化させ得る熱硬化性重合体剤の使用により、前記
熱硬化性重合体の最低硬化温度よりも高い一定の温度範
囲にわたって安定な第3の誘電体層を前記第2の金属層
および前記第2の誘電体層の露出部分上に積層する工程
が追加包含されていて、前記積層工程が前記第1および
第2の誘電体層を固定状態に維持し得る程度に低い温度
下で実施される結果として前記積層工程は前記第2の金
属層並びに前記接触パッドおよび/または前記第1の金
属層に対するそれの接触部に悪影響を及ぼさず、また前
記積層工程は前記第1の金属層および前記接触パッドに
対するそれの接触部にも悪影響を及ぼさない請求項17
記載の方法。 - 【請求項19】 前記積層工程が、前記剥離層上に前
記架橋性重合体接着剤の層を設置し、前記架橋性重合体
接着剤の層を乾燥し、次いで前記架橋性重合体接着剤を
用いて予め形成された誘電体フィルムを前記剥離層上に
積層することから成る請求項16記載の方法。 - 【請求項20】 (a) 第1の熱硬化誘電体フィル
ム、(b) 前記第1の熱硬化誘電体フィルム上に配置
された第1の金属層、並びに (c) シロキサンポリイミド/エポキシ樹脂架橋性共
重合体ブレンドによって前 記第1の金属層および前記第1の熱硬化誘電体フィルム
に接着された第2の熱硬化誘電体フィルムの諸要素を含
む印刷回路板。
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- 1990-07-02 US US07/546,959 patent/US5161093A/en not_active Expired - Lifetime
-
1991
- 1991-06-19 JP JP17331791A patent/JP3246667B2/ja not_active Expired - Lifetime
- 1991-07-01 EP EP91305964A patent/EP0465199B1/en not_active Expired - Lifetime
- 1991-07-01 DE DE69128307T patent/DE69128307T2/de not_active Expired - Fee Related
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Also Published As
Publication number | Publication date |
---|---|
EP0465199A1 (en) | 1992-01-08 |
DE69128307T2 (de) | 1998-06-25 |
EP0465199B1 (en) | 1997-12-03 |
JP3246667B2 (ja) | 2002-01-15 |
US5161093A (en) | 1992-11-03 |
DE69128307D1 (de) | 1998-01-15 |
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