JPH04196428A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH04196428A JPH04196428A JP32808290A JP32808290A JPH04196428A JP H04196428 A JPH04196428 A JP H04196428A JP 32808290 A JP32808290 A JP 32808290A JP 32808290 A JP32808290 A JP 32808290A JP H04196428 A JPH04196428 A JP H04196428A
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Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、半導体装置、特にウェハプロセスで形成され
る集積回路の製造方法に関する。
る集積回路の製造方法に関する。
[発明の概要〕
本発明は、半導体装置の製造方法において、電流経路と
なる金属配線を1ミクロン以下の微細な配線の平行結合
で構成する事により、金属配線の最大許容電流密度を上
げる事が可能となり、金属配線のエレクトロマイグレー
シミンによる断線不良を防止するものである。
なる金属配線を1ミクロン以下の微細な配線の平行結合
で構成する事により、金属配線の最大許容電流密度を上
げる事が可能となり、金属配線のエレクトロマイグレー
シミンによる断線不良を防止するものである。
[従来の技術]
従来、金属配線を形成する方法として、第2図にあるよ
うに、電流経路として用いられる配線は単一配線構造の
金属膜どなるような工程が用いられている。
うに、電流経路として用いられる配線は単一配線構造の
金属膜どなるような工程が用いられている。
[発明が解決しようとする課題]
しかし、前述の従来の技術においては、金属配線に定状
的に電流が流れる様な場合、特にその金属配線の最大許
容電流密度以上に流れる場合、金属配線のエレクトロマ
イグレーション現象の反応が顕著になる。このような状
況で使用しつづけると、金属配線は設計寿命より短い時
間で断線が生じる事により、半導体装置の機能不良が発
生し、信頼性上の問題を発生させる事が考えられる。
的に電流が流れる様な場合、特にその金属配線の最大許
容電流密度以上に流れる場合、金属配線のエレクトロマ
イグレーション現象の反応が顕著になる。このような状
況で使用しつづけると、金属配線は設計寿命より短い時
間で断線が生じる事により、半導体装置の機能不良が発
生し、信頼性上の問題を発生させる事が考えられる。
本発明は、このような従来の半導体装置の問題点を解決
するもので、その目的とするところは、より安定した信
頼性の高い半導体装置を提供するところにある。
するもので、その目的とするところは、より安定した信
頼性の高い半導体装置を提供するところにある。
[課題を解決するための手段]
本発明の半導体装置の製造方法は、半導体装置に用いら
れる金属配線において、1系統の電流経路が1ミクロン
以下の配線幅を有する金属配線の複数の平行結合から構
成される事を特徴とする。
れる金属配線において、1系統の電流経路が1ミクロン
以下の配線幅を有する金属配線の複数の平行結合から構
成される事を特徴とする。
[実施例]
第1図(a)〜(d)は本発明の実施例における半導体
装置の製造工程に従う断面図である。
装置の製造工程に従う断面図である。
第1図(e)は、本発明の実施例における半導体装置の
平面図である。
平面図である。
まず、第1図(a)にあるように、比抵抗10(Ω−c
m)のN型シリコン基板100上に、二酸化珪素からな
る絶縁[101を通常の熱酸化法で形成する。
m)のN型シリコン基板100上に、二酸化珪素からな
る絶縁[101を通常の熱酸化法で形成する。
次に、第1図(b)にあるように、A1102を通常の
蒸着あるいはスパッタリングにより1ミクロン厚となる
よう形成させる。
蒸着あるいはスパッタリングにより1ミクロン厚となる
よう形成させる。
次に、第1図(c)にあるように、前述で形成したA1
102をレジストを用いてパターンニングする。この場
合、パターンニングに用いるフォトマスクは、パターン
ユング後の金属配線が細い金属配線の平行集合となるよ
うなマスクを用いる。
102をレジストを用いてパターンニングする。この場
合、パターンニングに用いるフォトマスクは、パターン
ユング後の金属配線が細い金属配線の平行集合となるよ
うなマスクを用いる。
ここで、細い金属配線の平行集合の個々の金属配線幅は
1ミクロン以下になるようにデザインする。
1ミクロン以下になるようにデザインする。
また、それらの微細配線の間隔は極力狭くなるようにし
、微細配線の数を極力多く形成するようにする。
、微細配線の数を極力多く形成するようにする。
次に、第1(d)にあるように、前述で形成された金属
配線103上にパッシベーション11104を形成する
。
配線103上にパッシベーション11104を形成する
。
以上の工程を経て、金属配線が形成される。第1図(e
)は、形成された金属配置5105の平面図である。本
実施例において、形成される金属配線は配線幅が1ミク
ロン以下となるように加工されているので、金属配線の
材料となるA1粒子のグレインサイズは少なくても1ミ
クロン以上になるように、A1のスパッタ時にコントロ
ールしなければならない。
)は、形成された金属配置5105の平面図である。本
実施例において、形成される金属配線は配線幅が1ミク
ロン以下となるように加工されているので、金属配線の
材料となるA1粒子のグレインサイズは少なくても1ミ
クロン以上になるように、A1のスパッタ時にコントロ
ールしなければならない。
本実施例においては、A1の単層構造の場合を述べたが
、しばしばTi、Wなどの金属との積層構造配線を採用
する場合があるが、この場合においてはA1粒子のグレ
インサイズはより小さくなる傾向にあるので、更にグレ
インサイズのコントロールに対して注意が必要である。
、しばしばTi、Wなどの金属との積層構造配線を採用
する場合があるが、この場合においてはA1粒子のグレ
インサイズはより小さくなる傾向にあるので、更にグレ
インサイズのコントロールに対して注意が必要である。
また、本実施例で形成される金属配線は、1ミクロン以
下の微細配線幅で形成される事より、金属配線上のパッ
シベーション膜からの応力に対する影響を受は易いので
、パッシベーション膜の低応力化についても注意が必要
である。
下の微細配線幅で形成される事より、金属配線上のパッ
シベーション膜からの応力に対する影響を受は易いので
、パッシベーション膜の低応力化についても注意が必要
である。
[発明の効果]
以上述べたように、本発明によれば、Al配線を1ミク
ロン以下の微細配線の集合体として形成する事で、個々
のAl配線幅がA1粒子のグレインサイズよりも小さく
なる、いわゆるバンブー構造となることで、エレクトロ
マイグレーションの発生原因といわれる粒界拡散現象を
最小限に抑える事が出来る。金属配線膜を微細に分割さ
せた構造では、分割しない単一の金属配線よりも断面積
の減少するが、前記の説明の効果によりエレクトロマイ
グレーションに対する耐量は向上する事になる効果の方
が大きい。このように、A1配線のエレクトロマイグレ
ーションの耐量を向上させ、金属配線の断線不良を低減
する事ができ、より信頼性の高い半導体装置を提供する
事ができる。
ロン以下の微細配線の集合体として形成する事で、個々
のAl配線幅がA1粒子のグレインサイズよりも小さく
なる、いわゆるバンブー構造となることで、エレクトロ
マイグレーションの発生原因といわれる粒界拡散現象を
最小限に抑える事が出来る。金属配線膜を微細に分割さ
せた構造では、分割しない単一の金属配線よりも断面積
の減少するが、前記の説明の効果によりエレクトロマイ
グレーションに対する耐量は向上する事になる効果の方
が大きい。このように、A1配線のエレクトロマイグレ
ーションの耐量を向上させ、金属配線の断線不良を低減
する事ができ、より信頼性の高い半導体装置を提供する
事ができる。
第1図(a)〜<e>は、本発明による実施例の半導体
装置の製造工程の断面図である。 第2図は、従来の半導体装置の構造を示す断面図である
。 100・・・N型シリコン基板 101・・・絶縁膜 102・・・A1 103 ・・−Aliii[iit& 104・・・パッシベーション 以上 出願人 セイコーエプソン株式会社
装置の製造工程の断面図である。 第2図は、従来の半導体装置の構造を示す断面図である
。 100・・・N型シリコン基板 101・・・絶縁膜 102・・・A1 103 ・・−Aliii[iit& 104・・・パッシベーション 以上 出願人 セイコーエプソン株式会社
Claims (1)
- 半導体装置に用いられる金属配線において、1系統の
電流経路が1ミクロン以下の配線幅を有する金属配線の
複数の平行結合から構成される事を特徴とする半導体装
置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32808290A JPH04196428A (ja) | 1990-11-28 | 1990-11-28 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32808290A JPH04196428A (ja) | 1990-11-28 | 1990-11-28 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04196428A true JPH04196428A (ja) | 1992-07-16 |
Family
ID=18206313
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP32808290A Pending JPH04196428A (ja) | 1990-11-28 | 1990-11-28 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04196428A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0701282A3 (en) * | 1994-08-01 | 1996-10-30 | Motorola Inc | Interconnection structure having a localized reduced maximum current density and method of manufacturing an interconnection level in a semiconductor device |
US6975124B2 (en) * | 2003-09-22 | 2005-12-13 | International Business Machines Corp. | Multipoint nanoprobe |
-
1990
- 1990-11-28 JP JP32808290A patent/JPH04196428A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0701282A3 (en) * | 1994-08-01 | 1996-10-30 | Motorola Inc | Interconnection structure having a localized reduced maximum current density and method of manufacturing an interconnection level in a semiconductor device |
US5760476A (en) * | 1994-08-01 | 1998-06-02 | Motorola, Inc. | Interconnect run between a first point and a second point in a semiconductor device for reducing electromigration failure |
US6975124B2 (en) * | 2003-09-22 | 2005-12-13 | International Business Machines Corp. | Multipoint nanoprobe |
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