JPH0359636B2 - - Google Patents

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JPH0359636B2
JPH0359636B2 JP57088402A JP8840282A JPH0359636B2 JP H0359636 B2 JPH0359636 B2 JP H0359636B2 JP 57088402 A JP57088402 A JP 57088402A JP 8840282 A JP8840282 A JP 8840282A JP H0359636 B2 JPH0359636 B2 JP H0359636B2
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JP
Japan
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input
output
microcomputer
tape recorder
amplifier
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JP57088402A
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JPS58205395A (ja
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Yoshio Osakabe
Tadao Suzuki
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Sony Corp
Original Assignee
Sony Corp
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Publication date
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Priority to AU14894/83A priority patent/AU562481B2/en
Priority to CA000428698A priority patent/CA1210478A/en
Priority to DE3318829A priority patent/DE3318829C2/de
Priority to GB08314312A priority patent/GB2123653B/en
Priority to FR8308640A priority patent/FR2527801B1/fr
Priority to KR1019830002298A priority patent/KR910010010B1/ko
Priority to NL8301852A priority patent/NL192653C/nl
Publication of JPS58205395A publication Critical patent/JPS58205395A/ja
Publication of JPH0359636B2 publication Critical patent/JPH0359636B2/ja
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04Q—SELECTING
    • H04Q9/00—Arrangements in telecontrol or telemetry systems for selectively calling a substation from a main station, in which substation desired apparatus is selected for applying a control signal thereto or for obtaining measured values therefrom
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04B—TRANSMISSION
    • H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
    • H04B1/06—Receivers
    • H04B1/16—Circuits
    • H04B1/20—Circuits for coupling gramophone pick-up, recorder output, or microphone to receiver
    • H04B1/202—Circuits for coupling gramophone pick-up, recorder output, or microphone to receiver by remote control

Description

【発明の詳細な説明】 本発明はチユーナ、テープレコーダ、アンプ等
複数の音響機器間で互いに制御を行うリモートコ
ントロール装置に関し、特に任意の音響機器間で
双方向性の制御を簡単な構成でできるようにした
ものである。
一般に、チユーナ、テープレコーダ、アンプ等
の音響機器間で互いに制御を行なうものとして第
１図乃至第４図に示すものが提案されている。こ
の第１及び第２図において、１，２及び３は夫々
チユーナ、テープレコーダ及びスピーカが接続さ
れたアンプを示し、これらチユーナ１、テープレ
コーダ２及びアンプ３は制御部としてマイクロコ
ンピユータ１ａ，２ａ及び３ａを夫々内蔵してい
る。このチユーナ１のマイクロコンピユータ１ａ
の入出力ポート１ｂをテープレコーダ２のマイク
ロコンピユータ２ａの入出力ポート２ｂに接続
し、このマイクロコンピユータ１ａの入出力ポー
ト１ｂ及びマイクロコンピユータ２ａの入出力ポ
ート２ｂの接続点をアンプ３のマイクロコンピユ
ータ３ａの入出力ポート３ｂに接続する。又、図
示せずもチユーナ１からの音声信号をテープレコ
ーダ２及びアンプ３に供給すると共に、テープレ
コーダ２からの再生音声信号をアンプ３に供給す
る様になされている。この様にしてなるマイクロ
コンピユータ１ａ，２ａ及び３ａはデータバス１
ｃ，２ｃ及び３ｃと入出力ポート１ｂ，２ｂ及び
３ｂとの間に夫々入出力インターフエース１ｄ，
２ｄ及び３ｄを有し、この入出力インターフエー
ス１ｄ，２ｄ及び３ｄによりマイクロコンピユー
タ１ａ，２ａ及び３ａ相互間で情報の交換ができ
るようになされている。この場合、マイクロコン
ピユータ１ａの中央処理装置（以下、CPUとい
う）が例えば４ビツトのアクセス単位のものであ
るとき、この入出力インターフエース１ｄはアク
セス単位４ビツト内の１ビツト分に当たり、図示
せずもこの入出力インターフエース１ｄの他にア
クセス単位４ビツトの内の３ビツト分に相当する
入出力インターフエースを有し、夫々独立に（或
いは同時に）アクセスできる。これは、データバ
ス１ｃの所定バスからの信号をＤ−フリツプフロ
ツプからなるラツチ回路１ｅの信号入力端子１ｆ
に供給し、このラツチ回路１ｅの信号出力端子１
ｇをｎチヤンネルの絶縁ゲート型電界効果トラン
ジスタ１ｈのゲートに接続し、この絶縁ゲート型
電界効果トランジスタ１ｈのソース接地し、この
絶縁ゲート型電界効果トランジスタ１ｈのドレイ
ンをｎチヤンネルの絶縁ゲート型電界効果トラン
ジスタ１ｉのソースに接続し、この絶縁ゲート型
電界効果トランジスタ１ｉのドレインを正の直流
電圧が供給される電源端子１ｊに接続し、この絶
縁ゲート型電界効果トランジスタ１ｉのゲートを
この絶縁ゲート型電界効果トランジスタ１ｈ及び
１ｉの接続点に接続すると共に、この絶縁ゲート
型電界効果トランジスタ１ｈ及び１ｉの接続点を
入出力ポート１ｂに接続する。又、入出力ポート
１ｂをインバータ回路１ｋを介してＤ−フリツプ
フロツプからなるラツチ回路１ｌの信号入力端子
１ｍに接続し、このラツチ回路１ｌの信号出力端
子１ｎをバツフア回路１ｏを介してデータバス１
ｃの所定のバスに接続する。１ｐ及び１ｑは夫々
ラツチ回路１ｅ及び１ｌのクロツク信号入力端子
であり、このクロツク信号入力端子１ｐ及び１ｑ
はクロツク信号が供給されるとラツチ回路１ｅ及
び１ｑを動作状態となすものである。尚、１ｒは
ラツチ回路１ｌとデータバス１ｃとの間に設けた
バツフア回路１ｏを導通状態及び不導通状態とな
す制御信号入力端子であり、ラツチ回路１ｌのク
ロツク信号入力端子１ｑに供給されるクロツク信
号と同期した制御信号が供給される。この入出力
インターフエース１ｄはラツチ回路１ｅのクロツ
ク信号入力端子１ｐに出力命令としてクロツク信
号が供給されると、データバス１ｃからの信号が
入出力ポート１ｂに得られる。又、この入出力イ
ンターフエース１ｄはラツチ回路１ｌのクロツク
信号入力端子１ｑ及びバツフア回路１ｏの制御信
号入力端子１ｒに入力命令としてクロツク信号及
び制御信号が夫々供給されると、入出力ポート１
ｂに供給される信号がデータバス１ｃに順次取り
込まれる。尚、マイクロコンピユータ２ａ及び３
ａもこのマイクロコンピユータ１ａと同様に構成
されている。斯かる構成によればチユーナ１、テ
ープレコーダ２及びアンプ３の夫々のマイクロコ
ンピユータ１ａ，２ａ及び３ａは所定時間例えば
100μSec毎に入出力ポート１ｂ，２ｂ及び３ｂに
得られる信号をCPUの内部のレジスタに夫々取
り込み、他の装置からスタートビツトが出力され
ていないかどうか監視する。そして、テープレコ
ーダ２からスタートビツトが出力されるとチユー
ナ１及びアンプ３を夫々信号を受け入れる側とな
り、テープレコーダ２のマイクロコンピユータ２
ａがどの音響機器を指定しているかをチユーナ１
及びアンプ３の夫々のマイクロコンピユータ１ａ
及び３ａが読み取り、例えばアンプ３が指定され
ると、テープレコーダ２のマイクロコンピユータ
２ａとアンプ３のマイクロコンピユータ３ａとの
間で情報の交換が行なわれ、この情報に従つてア
ンプ３が制御される。
この様にしてなる本例において、どれか１つの
音響機器例えばチユーナ１を使用しないで電源を
切つておき、テープレコーダ２とアンプ３とを使
用する場合、チユーナ１のマイクロコンピユータ
１ａの入出力インターフエース１ｄの絶縁ゲート
型電界効果トランジスタ１ｊのドレインが接地電
位即ち、入出力ポート１ｂが接地電位となる。従
つて、テープレコーダ２及びアンプ３のマイクロ
コンピユータ２ａ及び３ａの入出力ポート２ｂ及
び３ｂが接地されてしまい、テープレコーダ２と
アンプ３との間の情報の交換即ち、制御が不可能
となつてしまうという不都合があつた。
又、第３図及び第４図においては、上述例と同
様にチユーナ４、テープレコーダ５及びアンプ６
は夫々マイクロコンピユータ４ａ，５ａ及び６ａ
を内蔵している。即ち、チユーナ４のマイクロコ
ンピユータ４ａの出力ポート４ｂをテープレコー
ダ５のマイクロコンピユータ５ａの入力ポート５
ｃ及びアンプ６のマイクロコンピユータ６ａの入
力ポート６ｃに夫々接続し、マイクロコンピユー
タ４ａの入力ポート４ｃをマイクロコンピユータ
５ａ及び６ａの出力ポート５ｂ及び６ｂに夫々接
続すると共に、マイクロコンピユータ４ａのシス
テムクロツク信号端子４ｄをマイクロコンピユー
タ５ａ及び６ａの夫々のシステムクロツク信号端
子５ｄ及び６ｄに夫々接続する。この場合、チユ
ーナ４のマイクロコンピユータ４ａがテープレコ
ーダ５及びアンプ６の夫々のマイクロコンピユー
タ５ａ及び６ａに対してマスター（以下、マスタ
ーコンピユータという）となり、マイクロコンピ
ユータ５ａ及び６ａがスレーブ（以下、スレーブ
コンピユータという）となる。この様にしてなる
マスターコンピユータ４ａ並びにスレーブコンピ
ユータ５ａ及び６ａの夫々の入出力インターフエ
ースはマスターコンピユータ４ａの入出力インタ
ーフエース４ｅと同様に構成されている。即ち、
データバス４ｆを入出力インターフエース４ｅの
データバス４ｇを介してパラレル−シリアル交換
及びシリアル−パラレル交換を行なうことができ
るシリアルバツフア回路４ｈの信号入出力端に接
続し、このシリアルバツフア回路４ｈのシリアル
信号出力端を出力ポート４ｂに接続し、このシリ
アルバツフア回路４ｈのシリアル信号入力端を入
力ポート４ｃに接続する。このシリアルバツフア
回路４ｈはクロツク信号入力端子４ｉに供給され
るクロツク信号に同期して動作するものである。
従つて、データバス４ｆ及び４ｇを介して得られ
るパラレル信号を出力ポート４ｂにシリアル信号
として出力するためのクロツク信号を供給するク
ロツク信号発生器（図示せず）のクロツク信号出
力端子４ｊからのクロツク信号をバツフア回路４
ｋを介してクロツク信号入力端子４ｉに供給する
と共に、入力ポート４ｂに得られるシリアル信号
をデータバス４ｇ及び４ｆを介してCPUにパラ
レル信号として取り込むためのシステムクロツク
信号が供給されるシステムクロツク信号端子４ｄ
からのシステムクロツク信号をバツフア回路４ｌ
を介してクロツク信号入力端子４ｉに供給する。
４ｍ及び４ｎは夫々バツフア回路４ｋ及び４ｌの
導通状態及び不導通状態を制御する制御信号入力
端子である。斯かる構成に依ればチユーナ４のマ
スターコンピユータ４ａ並びにテープレコーダ５
及びアンプ６の夫々のスレーブコンピユータ５ａ
及び６ａはシステムクロツク信号が供給されるバ
ツフア回路を常に導通状態となし、システムクロ
ツク信号端子にシステムクロツク信号が供給され
ているかどうかを監視する。そして、例えばチユ
ーナ４からスタートビツト及びシステムクロツク
信号が出力されるとテープレコーダ５及びアンプ
６は夫々信号及びシステムクロツク信号を入力ポ
ート及びシステムクロツク信号端子を介してシリ
アルバツフア回路に夫々受け入れ、夫々のスレー
ブコンピユータ５ａ及び６ａに割り込みを掛け、
システムクロツク信号によりシリアルバツフア回
路内に取り込んだシリアルな信号をパラレル信号
に変換してデータバスを介してCPU内に夫々取
り込み、チユーナ４のマスターコンピユータ４ａ
がどの音響機器を指定しているかをテープレコー
ダ５及びアンプ６の夫々のスレーブコンピユータ
５ａ及び６ａが読み取り、例えばテープレコーダ
５が指定されると、チユーナ４のマスターコンピ
ユータ４ａとテープレコーダ５のスレーブコンピ
ユータ５ａとの間で情報の交換が行なわれ、この
情報に従つてテープレコーダ５が制御される。
本例においては、マスターコンピユータ４ａを
内蔵したチユーナ４以外のテープレコーダ５又は
アンプ６を使用しないで電源を切つておいてもチ
ユーナ４のマスターコンピユータ４ａと使用して
いる音響機器例えばテープレコーダ５のスレーブ
コンピユータ５ａとの間の情報を交換即ち、制御
が不可能となることはないけれども、スレーブコ
ンピユータ５ａ及び６ａ間での情報の交換即ち、
制御ができないという不都合があつた。又、この
様なものにあつてはシリアル信号を取り込む或い
は出力することができるマイクロコンピユータに
制限されるという不都合もあつた。
本発明は斯かる点に鑑み任意の音響機器間で双
方向性の制御を簡単な構成でできるようにしたも
のである。
以下、第５図及び第６図を参照して本発明リモ
ートコントロール装置の一実施例につき説明しよ
う。この第５図及び第６図において第１図及び第
２図と対応する部分に同一符号を付してその詳細
な説明は省略する。
本発明においては、チユーナ１、テープレコー
ダ２及びアンプ３の夫々の制御部としてのマイク
ロコンピユータ１ａ，２ａ及び３ａの夫々の入出
力端子を直列に接続する。即ち、マイクロコンピ
ユータ１ａ，２ａ及び３ａの入出力インターフエ
ース１ｄ，２ｄ及び３ｄの入出力ポート１ｂ，２
ｂ及び３ｂを夫々抵抗器１ｓ，２ｓ及び３ｓを介
してnpn形のトランジスタ１ｔ，２ｔ及び３ｔの
夫々のベースに接続し、このトランジスタ１ｔ，
２ｔ及び３ｔのエミツタを夫々接地し、このトラ
ンジスタ１ｔ，２ｔ及び３ｔのコレクタをダイオ
ード１ｕ，２ｕ及び３ｕのカソードに夫々接続
し、このダイオード１ｕ，２ｕ及び３ｕのアノー
ドを抵抗器１ｖ，２ｖ及び３ｖを介して電源端子
１ｊ，２ｊ及び３ｊに夫々接続し、ダイオード１
ｕ，２ｕ及び３ｕ及び抵抗器１ｖ，２ｖ及び３ｖ
の接続点をインバータ回路１ｋ，２ｋ及び３ｋを
介してラツチ回路１ｌ，２ｌ及び３ｌの信号入力
端子１ｍ，２ｍ及び３ｍに夫々接続し、トランジ
スタ１ｔ，２ｔ及び３ｔのコレクタ及びエミツタ
に並列に入出力端子１ｗ，１ｘ，２ｗ，２ｘ及び
３ｗ，３ｘを夫々接続する。１ｙ，２ｙ及び３ｙ
は入出力端子１ｘ，２ｘ及び３ｘと接地との間に
夫々接続したスイツチであり、このスイツチ１
ｙ，２ｙ及び３ｙは二重アースによる音声信号の
劣化を防止するものであり例えばチユーナ１の音
声信号の出力端の一方がアースされているときに
はスイツチ１ｙを遮断状態となす様にする。尚、
このスイツチ１ｙ，２ｙ及び３ｙの代わりに適当
な抵抗値を持つ抵抗器を接続するようにしても同
様に二重アースによる音声信号の劣化を防止でき
る。この様にしてなるチユーナ１のマイクロコン
ピユータ１ａの入出力端子１ｘを、第５図に示す
ように、テープレコーダ２のマイクロコンピユー
タ２ａの入出力端子２ｗに接続し、このマイクロ
コンピユータ２ａ入出力端子２ｘをアンプ３のマ
イクロコンピユータ３ａの入出力端子３ｗに接続
する。この場合、入出力端子１ｗ，１ｘ，２ｗ，
２ｘ及び３ｗ，３ｘは通常時ハイレベルとなされ
ている。尚、この様にしてなるマイクロコンピユ
ータ１ａ，２ａ及び３ａは第７図Ａ，Ｂ及びＣに
示す如き可変長の伝送フオーマツトに従つて信号
を出力すると共に、この様な伝送フオーマツトに
従つた信号を受けるとその信号の内容に従つて装
置を制御するようにプログラムしてある。この第
７図Ａ，Ｂ及びＣに示す可変長の伝送フオーマツ
トは信号の伝送開始を示す400μSecのローレベル
信号からなるスタートビツトと、このスタートビ
ツトに続き制御の対象としての装置を指定する４
ビツトからなるマネージメントデータと、このマ
ネージメントデータに続きデータの長さｎを示す
４ビツトからなるデータ長と、このデータ長に続
き情報の内容を示す８ビツトのデータ長ｎ倍のビ
ツト数８×ｎからなるデータ部とからなる。又、
本例においてはローレベル信号“０”を第７図Ｂ
に示す如くハイレベル区間t0−t1間が35μSecであ
り、ローレベル区間t1−t4間が65μSecであるパル
スとすると共に、ハイレベル信号“１”を第７図
Ｃに示す如くハイレベル区間t0−t3間が65μSecで
あり、ローレベル区間t3−t4間が35μSecであるパ
ルスとする。そして、この様なパルスを立ち上が
り時t0から半周期分50μSec後の時刻t2にてパルス
がローレベルであるか又はハイレベルであるかを
読み取ることによりローレベル信号“０”及びハ
イレベル信号“１”を判別する様にしている。そ
の他は従来と同様に構成する。
斯かる構成に依れば、チユーナ１のマイクロコ
ンピユータ１ａがアンプ３のマイクロコンピユー
タ３ａを指定して情報の交換即ち、制御を行なう
場合、マイクロコンピユータ１ａから第７図Ａに
示す伝送フオーマツトに従つた信号を入出力端子
１ｘに供給する。このとき、CPUからデータバ
ス１及び入出力インフエース１ｄを介して出力ポ
ート１ｂに得られる信号に従つてトランジスタ１
ｔがオン又はオフされて入出力端子１ｘに第７図
Ａに示す伝送フオーマツトに従つた信号が順次供
給される。一方、テープレコーダ２及びアンプ３
の夫々のマイクロコンピユータ２ａ及び３ａは
夫々入出力端子２ｗ及び３ｗを例えば100μSec毎
に常時監視しており、上述の如くチユーナ１のマ
イクロコンピユータ１ａから時間400μSecのロー
レベルのスタートビツトが出力されると、マイク
ロコンピユータ２ａ及び３ａは入出力端子２ｗ及
び３ｗに夫々供給されたスタートビツトを認識
し、夫々のCPUに割り込みが掛けられ、後続す
る信号が取り込まれる。即ち、入出力端子２ｗ及
び３ｗに供給された信号に応じてダイオード２ｕ
及び３ｕが夫々オン又はオフしてこのダイオード
２ｕ及び３ｕと抵抗器２ｖ及び３ｖとの夫々の接
続点の電位が入出力インターフエース２ｄ及び３
ｄ並びにデータバス２ｃ及び３ｃを介して夫々の
CPU内に取り込まれる。そして、マネージメン
トデータにより指定された音響機器例えばテープ
レコーダ２がデータ部の内容に従つてマイクロコ
ンピユータ３ａにより制御される。又、テープレ
コーダ２のマイクロコンピユータ２ａがチユーナ
１を制御する場合も同様に動作する。従つて、双
方性の制御ができることとなる。尚、チユーナ１
とアンプ３との間だけで制御を行ない、テープレ
コーダ２の電源をオフとした場合にはテープレコ
ーダ２の入出力端子２ｗ及び２ｘがトランジスタ
２ｔにより接地されることがない。従つて、チユ
ーナ１及びアンプ３間の制御ができなくなること
はない。
以上述べた如く本発明に依れば、チユーナ１、
テープレコーダ２及びアンプ３の夫々制御部とし
てのマイクロコンピユータ１ａ，２ａ及び３ａの
夫々の入出力端子を直列に接続するようにしたた
め、少ない制御信号線を接続する音響機器間に順
次引き回すだけでよい。
又、通常の入出力インターフエース１ｄ，２ｄ
及び３ｄを使用してマイクロコンピユータ１ａ，
２ａ及び３ａ間でシリアル信号の伝送をできるよ
うにしたため、専用のシリアル−パラレル変換及
びパラレル−シリアル変換を行なうことができる
シリアルバツフア回路４ｈを有する入出力インタ
ーフエース４ｅを設ける必要がない。
更に、通常の入出力インターフエース１ｄ，２
ｄ及び３ｄに構成の簡単な回路を付加するように
したため、複数の音響機器の電源をすべてオンと
しなくても、任意の音響機器間で双方向性の制御
を行なうことができる。
尚、上述実施例においては、複数の音響機器と
してチユーナ１、テープレコーダ２及びアンプ３
の３台の音響機器の場合について述べたけれど
も、更に台数を増加させることができるというこ
とはいうまでもない。又、本発明は上述実施例に
限らず本発明の要旨を逸脱することなくその他
種々の構成を取り得ることは勿論である。
【図面の簡単な説明】
第１図乃至第４図は夫々従来のリモートコント
ロール装置の例を示す構成図、第５図及び第６図
は本発明リモートコントロール装置の一実施例を
示す構成図、第７図Ａ，Ｂ及びＣは本発明の説明
に供する線図である。 １はチユーナ、１ａ，２ａ及び３ａは夫々マイ
クロコンピユータ、１ｃ，２ｃ及び３ｃは夫々デ
ータバス、１ｄ，２ｄ及び３ｄは夫々入出力イン
ターフエース、１ｓ，２ｓ，３ｓ，１ｖ，２ｖ及
び３ｖは夫々抵抗器、１ｔ，２ｔ及び３ｔは夫々
トランジスタ、１ｕ，２ｕ及び３ｕは夫々ダイオ
ード、１ｗ，２ｗ，３ｗ，１ｘ，２ｘ及び３ｘは
夫々入出力端子、１ｙ，２ｙ及び３ｙは夫々スイ
ツチである。

Claims (1)

  1. 【特許請求の範囲】 １ マイクロコンピユータ等の制御部と、この制
    御部に接続される入出力端子とを有する複数の音
    響機器を備え、 上記複数の音響機器の入出力端子は直列に接続
    されるものであり、 上記複数の音響機器の制御部は、双方向制御の
    ために、上記入出力端子から伝送フオーマツトに
    したがつた信号を出力するか、あるいは、上記入
    出力端子から供給される伝送フオーマツトにした
    がつた信号を受けるために上記入出力端子を監視
    するようにされており、 上記入出力端子を監視中の音響機器の制御部
    が、上記伝送フオーマツトにしたがつた信号に含
    まれるスタートビツトを認識したときには、その
    スタートビツトに後続するデータを取り込み、こ
    の後続するデータによつて指定される他の音響機
    器の制御部と双方向の制御を行うようにしたこと
    を特徴とするリモートコントロール装置。
JP57088402A 1982-05-25 1982-05-25 リモ−トコントロ−ル装置 Granted JPS58205395A (ja)

Priority Applications (9)

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Application Number Priority Date Filing Date Title
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Publication Number Publication Date
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JPH0359636B2 true JPH0359636B2 (ja) 1991-09-11

Family

ID=13941799

Family Applications (1)

Application Number Title Priority Date Filing Date
JP57088402A Granted JPS58205395A (ja) 1982-05-25 1982-05-25 リモ−トコントロ−ル装置

Country Status (9)

Country Link
US (1) US4598287A (ja)
JP (1) JPS58205395A (ja)
KR (1) KR910010010B1 (ja)
AU (1) AU562481B2 (ja)
CA (1) CA1210478A (ja)
DE (1) DE3318829C2 (ja)
FR (1) FR2527801B1 (ja)
GB (1) GB2123653B (ja)
NL (1) NL192653C (ja)

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