JPH0344414B2 - - Google Patents
Info
- Publication number
- JPH0344414B2 JPH0344414B2 JP60087853A JP8785385A JPH0344414B2 JP H0344414 B2 JPH0344414 B2 JP H0344414B2 JP 60087853 A JP60087853 A JP 60087853A JP 8785385 A JP8785385 A JP 8785385A JP H0344414 B2 JPH0344414 B2 JP H0344414B2
- Authority
- JP
- Japan
- Prior art keywords
- protrusion
- heat sink
- ceramic substrate
- header
- semiconductor device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 239000004065 semiconductor Substances 0.000 claims description 23
- 239000000919 ceramic Substances 0.000 claims description 22
- 239000000758 substrate Substances 0.000 claims description 22
- 238000004519 manufacturing process Methods 0.000 claims description 5
- 239000002184 metal Substances 0.000 description 8
- 229910052751 metal Inorganic materials 0.000 description 8
- 238000000034 method Methods 0.000 description 8
- 230000000694 effects Effects 0.000 description 3
- 238000005219 brazing Methods 0.000 description 2
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 1
- 229910000881 Cu alloy Inorganic materials 0.000 description 1
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- 238000005452 bending Methods 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 239000010949 copper Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 238000007747 plating Methods 0.000 description 1
- 238000003825 pressing Methods 0.000 description 1
- 229910000679 solder Inorganic materials 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4871—Bases, plates or heatsinks
- H01L21/4882—Assembly of heatsink parts
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32153—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate
- H01L2224/32175—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate the item being metallic
- H01L2224/32188—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate the item being metallic the layer connector connecting to a bonding area protruding from the surface of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/8119—Arrangement of the bump connectors prior to mounting
- H01L2224/81191—Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed only on the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/818—Bonding techniques
- H01L2224/81801—Soldering or alloying
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/156—Material
- H01L2924/15786—Material with a principal constituent of the material being a non metallic, non metalloid inorganic material
- H01L2924/15787—Ceramics, e.g. crystalline carbides, nitrides or oxides
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Wire Bonding (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は半導体チツプをフリツプチツプ方式
でヘツダに接続して構成される半導体装置の製造
方法に関するものである。
でヘツダに接続して構成される半導体装置の製造
方法に関するものである。
第2図、第3図はこの種の半導体装置、例えば
フリツプチツプ形の電界効果トランジスタ
(FET)の組立方法を示すものであり、第2図
a,bはリボン状の金属片を接続した半導体チツ
プの平面図および正面図を示したものである。す
なわち同図において、半導体チツプ1の表面に
は、ゲート電極2、ソース電極3およびドレイン
電極4がそれぞれ所定の間隔寸法を有して形成さ
れ、それぞれメツキ方法により、金属バンプ5が
形成されている。そして、これらの各電極2,
3,4に金属バンプ5を介して鎖線で示すような
リボン状の導電性金属からなる接続片6,7,8
が熱圧着法などにより固着接続されて外方に引き
出されている。この接続片6は半導体チツプ1表
面の中央部にあり、その両端側が外方に突出して
いる。また、接続片7,8は半導体チツプ1の表
面の両側位置にあり、両側および一方側が外方に
突出している。また、第2図a,bに示すように
接続片6,7,8が固着された半導体チツプ1は
第3図に示すようにヘツダ10に装着される。こ
のヘツダ10は、表面に突出部11を有する金属
性のヒートシンク12およびこのヒートシンク1
2の表面にメタライズ部13,14をそれぞれ有
するセラミツク基板15,16が接着配置されて
構成されている。そして、半導体チツプ1の中央
側接続片6はヘツダ10の突出部11に半田17
により接合されている。また、一端側の接続片7
はヘツダ10のセラミツク基板15上の外部電極
のメタライズ部13に、他端側の接続片8はヘツ
ダ10のセラミツク基板16上の外部電極のメタ
ライズ部14にそれぞれ熱圧着法により接合され
ている。
フリツプチツプ形の電界効果トランジスタ
(FET)の組立方法を示すものであり、第2図
a,bはリボン状の金属片を接続した半導体チツ
プの平面図および正面図を示したものである。す
なわち同図において、半導体チツプ1の表面に
は、ゲート電極2、ソース電極3およびドレイン
電極4がそれぞれ所定の間隔寸法を有して形成さ
れ、それぞれメツキ方法により、金属バンプ5が
形成されている。そして、これらの各電極2,
3,4に金属バンプ5を介して鎖線で示すような
リボン状の導電性金属からなる接続片6,7,8
が熱圧着法などにより固着接続されて外方に引き
出されている。この接続片6は半導体チツプ1表
面の中央部にあり、その両端側が外方に突出して
いる。また、接続片7,8は半導体チツプ1の表
面の両側位置にあり、両側および一方側が外方に
突出している。また、第2図a,bに示すように
接続片6,7,8が固着された半導体チツプ1は
第3図に示すようにヘツダ10に装着される。こ
のヘツダ10は、表面に突出部11を有する金属
性のヒートシンク12およびこのヒートシンク1
2の表面にメタライズ部13,14をそれぞれ有
するセラミツク基板15,16が接着配置されて
構成されている。そして、半導体チツプ1の中央
側接続片6はヘツダ10の突出部11に半田17
により接合されている。また、一端側の接続片7
はヘツダ10のセラミツク基板15上の外部電極
のメタライズ部13に、他端側の接続片8はヘツ
ダ10のセラミツク基板16上の外部電極のメタ
ライズ部14にそれぞれ熱圧着法により接合され
ている。
このように構成される半導体装置は、半導体チ
ツプ1動作時に発生する熱を熱伝導度の良好なヒ
ートシンク12に直接放熱することが可能とな
る。また、ソース電極3にワイヤを用いていない
ため、ソースインダクタンスを低くすることが可
能となるなどの利点を有しているので、高周波帯
の電力用GaAs FETに使用されている。
ツプ1動作時に発生する熱を熱伝導度の良好なヒ
ートシンク12に直接放熱することが可能とな
る。また、ソース電極3にワイヤを用いていない
ため、ソースインダクタンスを低くすることが可
能となるなどの利点を有しているので、高周波帯
の電力用GaAs FETに使用されている。
しかしながら、前述したように構成される半導
体装置は、ヒートシンク12の突出部11とセラ
ミツク基板15,16との高さの段差により、接
続片7,8をセラミツク基板15,16上のメタ
ライズ部13,14に熱圧着するときに接続片
7,8に過大な曲げ応力が加わり、金属バンプ5
と接続片7,8とが剥離したり、あるいは金属バ
ンプ5と電極2,4とが剥離することがあつた。
すなわち、突出部11とセラミツク基板15,1
6との段差を約0.1mm以下としなければならない。
ところが、通常セラミツク基板は±0.1mm程度の
公差があり、さらにセラミツク基板15,16と
ヒートシンク12とを接続するろう材の厚み公
差、突出部11の寸法公差等が重なるため、前述
した公差内にセラミツク基板15,16の表面と
突出部11との段差を入れることは困難であり、
前述したような不具合が発生した。
体装置は、ヒートシンク12の突出部11とセラ
ミツク基板15,16との高さの段差により、接
続片7,8をセラミツク基板15,16上のメタ
ライズ部13,14に熱圧着するときに接続片
7,8に過大な曲げ応力が加わり、金属バンプ5
と接続片7,8とが剥離したり、あるいは金属バ
ンプ5と電極2,4とが剥離することがあつた。
すなわち、突出部11とセラミツク基板15,1
6との段差を約0.1mm以下としなければならない。
ところが、通常セラミツク基板は±0.1mm程度の
公差があり、さらにセラミツク基板15,16と
ヒートシンク12とを接続するろう材の厚み公
差、突出部11の寸法公差等が重なるため、前述
した公差内にセラミツク基板15,16の表面と
突出部11との段差を入れることは困難であり、
前述したような不具合が発生した。
本発明は、前述したような問題点を解消するた
めになされたものであり、前述した不具合をなく
して歩留り、信頼性を向上させることができる半
導体装置の製造方法を得ることを目的としてい
る。
めになされたものであり、前述した不具合をなく
して歩留り、信頼性を向上させることができる半
導体装置の製造方法を得ることを目的としてい
る。
本発明に係る半導体装置の製造方法は、ヒート
シンクにセラミツク基板をろう付け後、ヒートシ
ンクの突出部を塑性変形させることにより、段差
をなくし、突出部表面とセラミツク基板表面とを
同時に接触可能としたものである。
シンクにセラミツク基板をろう付け後、ヒートシ
ンクの突出部を塑性変形させることにより、段差
をなくし、突出部表面とセラミツク基板表面とを
同時に接触可能としたものである。
この発明における半導体装置の製造方法は、ヒ
ートシンクの突出部を塑性変形させることによ
り、突出部とセラミツク基板との段差がなくな
り、半導体チツプをヘツダに装着する際オープン
不良が減少し、歩留りが向上し、かつ信頼性が向
上する。
ートシンクの突出部を塑性変形させることによ
り、突出部とセラミツク基板との段差がなくな
り、半導体チツプをヘツダに装着する際オープン
不良が減少し、歩留りが向上し、かつ信頼性が向
上する。
以下、この発明の実施例を図について説明す
る。
る。
第1図はこの発明の一実施例を説明するための
断面図である。まず、同図aに示すように突出部
11を有するヒートシンク12にセラミツク基板
15,16をろう付けする。この場合、突出部1
1はセラミツク基板15,16の表面高さよりも
若干高い。次に加圧治具18を図中の矢印A方向
に移動させ、突出部11を加圧し、塑性変形させ
る。通常、ヒートシンク12および突出部11は
銅または銅合金で構成されているため、容易に塑
性変形される。この場合、ここで用いる加圧治具
はセラミツク基板15,16の少なくとも一方お
よび突出部11に接触し得る大きさを有し、その
底面はヘツダ10の保持台(図示しない)とほぼ
平行な平坦面を有して構成されている。次に同図
bに示すように加圧治具18がセラミツク基板1
5,16の接触すると、このセラミツク基板1
5,16は剛体であるため、さらに塑性変形させ
るためには加圧力を極端に増加させなければなら
ない。この段階で加圧成形を停止すれば、同図c
に示すように突出部11の表面とセラミツク基板
15,16との段差がなくなり、前述した±0.1
mm以内の公差内に段差を入れることが可能とな
る。しかる後、第2図、第3図に示すように接続
片7,8,9を固着接続した半導体チツプ1を接
合する。
断面図である。まず、同図aに示すように突出部
11を有するヒートシンク12にセラミツク基板
15,16をろう付けする。この場合、突出部1
1はセラミツク基板15,16の表面高さよりも
若干高い。次に加圧治具18を図中の矢印A方向
に移動させ、突出部11を加圧し、塑性変形させ
る。通常、ヒートシンク12および突出部11は
銅または銅合金で構成されているため、容易に塑
性変形される。この場合、ここで用いる加圧治具
はセラミツク基板15,16の少なくとも一方お
よび突出部11に接触し得る大きさを有し、その
底面はヘツダ10の保持台(図示しない)とほぼ
平行な平坦面を有して構成されている。次に同図
bに示すように加圧治具18がセラミツク基板1
5,16の接触すると、このセラミツク基板1
5,16は剛体であるため、さらに塑性変形させ
るためには加圧力を極端に増加させなければなら
ない。この段階で加圧成形を停止すれば、同図c
に示すように突出部11の表面とセラミツク基板
15,16との段差がなくなり、前述した±0.1
mm以内の公差内に段差を入れることが可能とな
る。しかる後、第2図、第3図に示すように接続
片7,8,9を固着接続した半導体チツプ1を接
合する。
以上説明したようにこの発明によれば、ヘツダ
のヒートシンク上に形成された突出部とセラミツ
ク基板との段差をなくすことが可能となるので、
フリツプチツプボンド方式のチツプ装着方式にお
いて歩留り良くしかも信頼性の高い半導体装置を
得ることができる。
のヒートシンク上に形成された突出部とセラミツ
ク基板との段差をなくすことが可能となるので、
フリツプチツプボンド方式のチツプ装着方式にお
いて歩留り良くしかも信頼性の高い半導体装置を
得ることができる。
第1図はこの発明の一実施例を示す断面図、第
2図、第3図はこの発明の目的および効果を説明
するための半導体装置の組立方法を示す図であ
る。 1……半導体チツプ、2,3,4……電極、5
……バンプ、6,7,8……接続片、10……ヘ
ツダ、11……突出部、12……ヒートシンク、
13,14……メタライズ部、15,16……セ
ラミツク基板、17……半田、18……加圧治
具。
2図、第3図はこの発明の目的および効果を説明
するための半導体装置の組立方法を示す図であ
る。 1……半導体チツプ、2,3,4……電極、5
……バンプ、6,7,8……接続片、10……ヘ
ツダ、11……突出部、12……ヒートシンク、
13,14……メタライズ部、15,16……セ
ラミツク基板、17……半田、18……加圧治
具。
Claims (1)
- 1 ヒートシングの表面に突出部およびセラミツ
ク基板を設けてなるヘツダに半導体チツプの電極
を接続してなる半導体装置において、前記セラミ
ツク基板をヒートシンクに接合した後に前記突出
部を塑性変形させ、前記突出部表面とセラミツク
基板表面とをほぼ同一平面上に形成することを特
徴とした半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60087853A JPS61247040A (ja) | 1985-04-24 | 1985-04-24 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60087853A JPS61247040A (ja) | 1985-04-24 | 1985-04-24 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS61247040A JPS61247040A (ja) | 1986-11-04 |
JPH0344414B2 true JPH0344414B2 (ja) | 1991-07-05 |
Family
ID=13926442
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60087853A Granted JPS61247040A (ja) | 1985-04-24 | 1985-04-24 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61247040A (ja) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH071773B2 (ja) * | 1987-01-14 | 1995-01-11 | 株式会社日立製作所 | 電子部品の接続構造 |
JP2745786B2 (ja) * | 1990-06-15 | 1998-04-28 | 松下電器産業株式会社 | Tab半導体装置 |
US8399912B2 (en) | 2010-02-16 | 2013-03-19 | International Rectifier Corporation | III-nitride power device with solderable front metal |
JP6012990B2 (ja) * | 2012-03-19 | 2016-10-25 | 日本軽金属株式会社 | 放熱器一体型基板の製造方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS56107342A (en) * | 1980-01-31 | 1981-08-26 | Sanyo Electric Co Ltd | Reciprocating type cassette recorder |
JPS5844731A (ja) * | 1981-09-10 | 1983-03-15 | Mitsubishi Electric Corp | 半導体装置 |
-
1985
- 1985-04-24 JP JP60087853A patent/JPS61247040A/ja active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS56107342A (en) * | 1980-01-31 | 1981-08-26 | Sanyo Electric Co Ltd | Reciprocating type cassette recorder |
JPS5844731A (ja) * | 1981-09-10 | 1983-03-15 | Mitsubishi Electric Corp | 半導体装置 |
Also Published As
Publication number | Publication date |
---|---|
JPS61247040A (ja) | 1986-11-04 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP2840316B2 (ja) | 半導体装置およびその製造方法 | |
EP0468475B1 (en) | Power semiconductor device suitable for automation of production | |
JP2000003988A (ja) | リードフレームおよび半導体装置 | |
US6454153B2 (en) | Apparatuses for forming wire bonds from circuitry on a substrate to a semiconductor chip, and methods of forming semiconductor chip assemblies | |
WO2011030368A1 (ja) | 半導体装置とその製造方法 | |
JPH0344414B2 (ja) | ||
WO2011064817A1 (ja) | 半導体装置とその製造方法 | |
US7534661B2 (en) | Method of forming molded resin semiconductor device | |
JP2002368159A (ja) | 半導体装置およびその製造方法 | |
JPH0817870A (ja) | 半導体装置 | |
JPH0451056B2 (ja) | ||
JPH03228339A (ja) | ボンディングツール | |
JP2975783B2 (ja) | リードフレームおよび半導体装置 | |
JP2003007773A (ja) | ボンディングツールおよびボンディング方法 | |
JP2748759B2 (ja) | フィルムキャリアテープの製造方法 | |
JPS5915386B2 (ja) | 半導体装置用ヘッダの製造方法 | |
JPH03171744A (ja) | 半導体装置及びその製造方法 | |
JP2001308254A (ja) | 半導体装置及びその製造方法 | |
JP3246265B2 (ja) | ボンディングワイヤを用いた電子部品並びにその製造方法及びワイヤ成形方法 | |
JPH0685115A (ja) | 電子部品搭載用基板 | |
JPH0951058A (ja) | 半導体装置,及び半導体装置の製造方法,及び製造装置 | |
JP2003007953A (ja) | 樹脂封止型半導体装置およびその製造方法 | |
JPH09289226A (ja) | 半導体装置 | |
JPH03119755A (ja) | リードフレームの製造方法 | |
JPS6199359A (ja) | 混成集積回路装置 |