JP2000003988A - リードフレームおよび半導体装置 - Google Patents

リードフレームおよび半導体装置

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lead
leads
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Saeko Takagi
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Abstract

(57)【要約】 【課題】 半導体装置を基板に実装するためのリフロー
時における耐クラック性を向上させることができるリー
ドフレームおよび半導体装置を実現する。 【解決手段】 複数のリード2とリード2の先端によっ
て囲まれた位置に設けられたダイパット3とを有し、銅
材6を用いて形成されたリードフレーム1において、リ
ード3およびダイパット3のうち、少なくともダイパッ
ト3の表裏面がニッケルめっきされた面7からなってい
る。またこのリードフレーム1と、ダイパット3の表面
に搭載された半導体素子と、リードの先端側,ダイパッ
ト3および半導体素子を一体に樹脂封止する封止部によ
って半導体装置が構成されている。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明はリードフレームおよ
び半導体装置に関し、特に樹脂封止型の半導体装置に用
いられるリードフレームおよび樹脂封止型の半導体装置
に関する。
【0002】
【従来の技術】従来、樹脂封止型の半導体装置(半導体
パッケージ)は、図4に示すように複数のリード51お
よびこのリード51の先端によって囲まれた位置に設け
られたダイパット52を有したリードフレーム50と、
ダイパット52の表面にボンディング剤53を介して搭
載された半導体素子54と、この半導体素子54とリー
ド51の先端側とダイパット52とを一体に樹脂封止す
る封止部55とから構成されている。
【0003】この半導体装置に備えられるリードフレー
ム50は、現在のところその多くが鉄−42%ニッケル
材(以下、42アロイ材と記す)、もしくは銅を主成分
とする材料(以下、銅材と記す)にて形成されている
が、熱伝導性が高く、低コストであり、折り曲げ加工性
が良好である等の点から銅材による開発が進められてい
る。
【0004】
【発明が解決しようとする課題】しかしながら、銅材か
らなるリードフレームでは、作製後にダイパットの表面
および裏面に酸化銅(CuO,Cu2 O)からなる酸化
膜が発生することによって、例えばエポキシ樹脂系の銀
ペーストからなるボンディング剤とダイパットの表面と
の接着性(密着性)、および封止樹脂材とダイパットの
裏面との接着性が悪化する。このため、銅材のリードフ
レームを用いて製造された半導体装置では、封止部が吸
湿している状態において、42アロイ材のリードフレー
ムを用いて製造された半導体装置に比較し、リフローに
よって基板に実装する際に図4に示すごとく封止部55
に割れ(クラック)56が発生し易く、耐クラック性が
劣るという問題が生じている。
【0005】すなわち、封止樹脂は吸湿し易いものであ
り、実装時においては半導体装置の封止部が吸湿してい
る状態になっているため、リフロー時の高温によって封
止部内部に水蒸気が発生する。その結果、接着性の悪い
ボンディング剤とダイパットの表面との界面や、封止樹
脂材とダイパットの裏面との界面では、水蒸気の発生に
よって容易に剥離が起きてしまい、さらに剥離した部分
の水蒸気の膨張により生じた応力によって封止部にクラ
ックが発生するのである。
【0006】
【課題を解決するための手段】そこで、上記課題を解決
するために本発明に係るリードフレームは、複数のリー
ドとダイパットとを有し、銅材料を用いて形成されたも
のにおいて、リードおよびダイパットのうち、少なくと
もダイパットの表裏面がニッケルメッキされた面からな
る構成としている。
【0007】また本発明の半導体装置は、上記発明のリ
ードフレームと、ダイパットの表面にボンディング剤を
介して搭載された半導体素子と、半導体素子とリードの
先端側とを一体に樹脂封止する封止部と、を備えた構成
としている。
【0008】ニッケルめっきは、酸化銅に比較して銀ペ
ースト等のボンディング剤や樹脂封止材との接着性が良
く、特にニッケルめっきが酸化してなる酸化ニッケル
は、封止樹脂材との接着性が良いものである。またニッ
ケルめっきは、実装時に用いるはんだとの接着性が非常
に良好である。
【0009】本発明のリードフレームでは、少なくとも
ダイパットの表裏面がこのようなニッケルめっき面から
なっているため、ダイパットの表裏面に酸化銅が形成さ
れていた従来に比べて、ダイパットの表面にボンディン
グ剤を介して半導体素子を搭載するに際し、ダイパット
の表面とボンディング剤との間に高い接着力が得られる
とともに、ダイパットの表面に搭載された半導体素子と
リードの先端側とを樹脂封止するに際し、ダイパットの
裏面と封止樹脂との間に高い接着力が得られる。また樹
脂封止するに際し、ダイパットの裏面のニッケルめっき
が空気にさらされることによって酸化されていると、ダ
イパットの裏面と封止樹脂とがさらに強固に接着するこ
とになる。さらに、ダイパットとともにリードもニッケ
ルメッキされた面からなっていれば、このリードフレー
ムを用いて構成された半導体装置を基板にはんだにより
実装するに際し、リードとはんだとの間に高い接着力が
得られる。
【0010】本発明の半導体装置では、上記発明のリー
ドフレームを用いているため、ダイパットの表面および
ボンディング剤と、ダイパットの裏面および封止樹脂と
が、従来の銅材のみからなるリードフレームを用いて構
成された半導体装置に比較して、強く接着したものとな
る。また、ダイパットとともにリードもニッケルメッキ
された面からなっていれば、半導体装置を基板にはんだ
を用いて実装するに際し、リードが接着性良くはんだ付
けされる。
【0011】
【発明の実施の形態】以下に本発明に係るリードフレー
ムおよび半導体装置の実施形態を図面に基づいて説明す
る。図1は本発明に係るリードフレームの一実施形態を
説明する図であり、(a)は要部平面図、(b)は
(a)の一部を拡大した断面図である。図1に示すよう
にこのリードフレーム1は、複数のリード2と、リード
2の先端によって囲まれた位置に設けられたダイパット
3とを有して構成されている。
【0012】各リード2は、その先端側であるインナー
リード2aと、インナーリード2aの後端から外方に延
びたアウターリード2bとからなり、各インナーリード
2aがタイバー4によって連結されている。またダイパ
ット3は、平面視略矩形をなすもので、その四隅からそ
れぞれ延出した吊りリード5によってフレーム本体(図
示略)に支持されている。
【0013】このようなリードフレーム1は、銅材6に
よって形成されている。また本実施形態においては、リ
ードフレーム1全面、すなわちリード2,ダイパット
3,タイバー4および吊りリード5の表裏面が、銅材6
にニッケルめっきが施されたニッケルめっき面7となっ
ている。
【0014】次に、上記のリードフレーム1を含めた一
連の半導体装置(半導体パッケージ)の製造方法を図2
を用いて説明する。まず、ベースとなる長尺状の銅材6
からなるフレームにエッチング法やプレス打ち抜き法等
によって形状加工を施し、上記のリード2,ダイパット
3,タイバー4,吊りリード5等を形成する。その後、
加工された銅材6の表裏面にニッケルめっき処理を施し
て全面がニッケルめっき面7からなるリードフレーム1
を得る。
【0015】次いで、ダイパット2の表面にエポキシ樹
脂系の銀ペースト等のボンディング剤11を塗布し、そ
の上から半導体素子12を載せ、ボンディング剤11を
加熱硬化することによって半導体素子12を固定する。
ニッケルめっきは、従来の酸化銅に比較して銀ペースト
等のボンディング剤11との接着性が良いものであるた
め、このダイボンディングでは、ニッケルめっき面7で
あるダイパット3の表面とボンディング剤11との間に
従来よりも強い接着力が得られる。続いて、ダイパット
2の表面に搭載された半導体素子12の電極とインナー
リード2aの先端部とを金やアルミニウム等のワイヤー
(図示略)で電気的に接続する。
【0016】その後、トランスファーモールド等の封止
技術を用いて、リード2の先端側のインナーリード2a
とダイパット3と半導体素子12とを一体に樹脂封止し
て封止部13を形成する。封止樹脂材としては、例え
ば、一般に使用されているビフェニール樹脂やエポキシ
系樹脂等が用いられる。この際、ダイパット2の裏面も
ニッケルめっき面7となっているため、ダイパット2の
裏面と封止樹脂材とが、従来に比較して強く接着する。
また、ダイパット2の裏面のニッケルめっき面7は、樹
脂封止までの間、空気にさらされて酸化されることによ
って、ダイパット2の裏面と封止樹脂材との間にさらに
強固な接着力が得られる。以上の工程によって、リード
フレーム1と半導体素子12と封止部13とを備えた図
2に示す本発明の一実施形態の半導体装置10が製造さ
れる。
【0017】上記のようにして製造された半導体装置1
0では、ダイパット3の表裏面に対してボンディング剤
11および封止部13の樹脂封止剤が強固に接着してい
るため、それぞれの界面にて剥離強度が向上している。
したがって、基板に実装する際のはんだリフローにおい
て、ダイパット3の表裏面における界面剥離や、これに
伴う封止部13のクラックの発生を効果的に防止するこ
とができ、42アロイ材からなるリードフレームを用い
た半導体装置並の耐クラック性を確保することができ
る。またリード2の表裏面もニッケルめっき面7となっ
ているため、リード2のアウターリード2bを接着性良
く基板にはんだ付けすることができる。しかも、リード
2が折り曲げ加工性の良い銅材からなるため、所望の形
状に良好に加工されたものとなる。
【0018】なお、上記実施形態では、リードフレーム
1の全面がニッケルめっき面6である例を述べたが、本
発明はこの例に限定されない。例えば図3の要部平面図
に示すように、ダイパット3の表裏面のみがニッケルめ
っき面6であるリードフレーム8としてもよい。またこ
のようなリードフレーム8を備えた半導体装置とするこ
とも可能である。
【0019】上記のリードフレーム8においても、従来
の酸化銅に比較して、ダイパット3の表裏面にボンディ
ング剤11および封止部13の樹脂封止剤を強固に接着
させることができ、それぞれの界面における剥離強度の
向上を図ることができる。そして、リードフレーム8を
用いることによって、基板に実装するためのはんだリフ
ロー時における耐クラック性が向上した半導体装置を実
現できる
【0020】
【発明の効果】以上説明したように本発明に係るリード
フレームによれば、少なくともダイパットの表裏面がニ
ッケルめっき面からなっているため、ダイパットの表裏
面に酸化銅が形成されていた従来に比べて、ダイパット
の表面にボンディング剤を介して半導体素子を搭載する
に際し、ダイパットの表面とボンディング剤との間に高
い接着力を得ることができ、また樹脂封止するに際し、
ダイパットの裏面と封止樹脂との間に高い接着力を得る
ことができる。したがって、本発明のリードフレームを
用いて半導体装置を構成すれば、基板に実装するための
リフロー時にて、ダイパットの表面とボンディング剤と
の接着性およびダイパットの裏面と封止樹脂材との接着
性に起因するクラックの発生を防止できる。
【0021】また本発明の半導体装置によれば、上記発
明のリードフレームを用いることにより、ダイパットの
表面およびボンディング剤と、ダイパットの裏面および
封止樹脂とを、従来の銅材のみからなるリードフレーム
を用いて構成された半導体装置に比較して強く接着した
構成としたので、基板に実装するためのリフロー時にお
ける耐クラック性が向上した半導体装置を実現できる。
【図面の簡単な説明】
【図1】本発明に係るリードフレームの一実施形態を説
明する図であり、(a)は要部平面図、(b)は(a)
の一部を拡大した断面図である。
【図2】本発明に係る半導体装置の一実施形態を示す断
面図である。
【図3】本発明に係るリードフレームの他の実施形態を
示す要部平面図である。
【図4】従来の半導体装置の一例を示す断面図である。
【符号の説明】
1,8…リードフレーム、2…リード、3…ダイパッ
ト、6…銅材、7…ニッケルめっき面、10…半導体装
置、11…ボンディング剤、12…半導体素子、13…
封止部

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 複数のリードと該リードの先端によって
    囲まれた位置に設けられたダイパットとを有し、銅材料
    を用いて形成されたリードフレームにおいて、 前記リードおよび前記ダイパットのうち、少なくとも該
    ダイパットの表裏面がニッケルめっきされた面からなる
    ことを特徴とするリードフレーム。
  2. 【請求項2】 複数のリードと該リードの先端によって
    囲まれた位置に設けられたダイパットとを有し、銅材料
    を用いて形成されているとともに前記リードおよびダイ
    パットのうち、少なくとも該ダイパットの表裏面がニッ
    ケルめっきされた面からなるリードフレームと、 前記ダイパットの表面にボンディング剤を介して搭載さ
    れた半導体素子と、 前記ダイパットと前記半導体素子と前記リードの先端側
    とを一体に樹脂封止する封止部と、を備えてなることを
    特徴とする半導体装置。
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Families Citing this family (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001185670A (ja) * 1999-12-10 2001-07-06 Texas Instr Inc <Ti> リードフレームとその製法
US7061077B2 (en) * 2002-08-30 2006-06-13 Fairchild Semiconductor Corporation Substrate based unmolded package including lead frame structure and semiconductor die
US7196313B2 (en) * 2004-04-02 2007-03-27 Fairchild Semiconductor Corporation Surface mount multi-channel optocoupler
JP4624170B2 (ja) * 2005-04-25 2011-02-02 ルネサスエレクトロニクス株式会社 半導体装置の製造方法
US7772681B2 (en) * 2005-06-30 2010-08-10 Fairchild Semiconductor Corporation Semiconductor die package and method for making the same
KR20080065153A (ko) * 2007-01-08 2008-07-11 페어차일드코리아반도체 주식회사 메탈 태브 다이 접착 패들(dap)을 구비한 파워소자패키지 및 그 패키지 제조방법
US7955901B2 (en) * 2007-10-04 2011-06-07 Infineon Technologies Ag Method for producing a power semiconductor module comprising surface-mountable flat external contacts
JP5001872B2 (ja) * 2008-02-13 2012-08-15 ルネサスエレクトロニクス株式会社 半導体装置
US7973393B2 (en) * 2009-02-04 2011-07-05 Fairchild Semiconductor Corporation Stacked micro optocouplers and methods of making the same
CN102473700B (zh) * 2010-06-11 2015-05-20 松下电器产业株式会社 树脂封装型半导体装置及其制造方法
US20130249073A1 (en) * 2012-03-22 2013-09-26 Hsin Hung Chen Integrated circuit packaging system with support structure and method of manufacture thereof
JP6095997B2 (ja) * 2013-02-13 2017-03-15 エスアイアイ・セミコンダクタ株式会社 樹脂封止型半導体装置の製造方法
JP2014192222A (ja) * 2013-03-26 2014-10-06 Shinko Electric Ind Co Ltd リードフレーム及び半導体装置
JP2015056540A (ja) * 2013-09-12 2015-03-23 株式会社東芝 半導体装置及びその製造方法
US9070392B1 (en) 2014-12-16 2015-06-30 Hutchinson Technology Incorporated Piezoelectric disk drive suspension motors having plated stiffeners
WO2017003782A1 (en) 2015-06-30 2017-01-05 Hutchinson Technology Incorporated Disk drive head suspension structures having improved gold-dielectric joint reliability
DE102017212457A1 (de) * 2017-07-20 2019-01-24 Infineon Technologies Ag Halbleitergehäuse mit Nickelplattierung und Verfahren zum Herstellen desselben

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4141029A (en) * 1977-12-30 1979-02-20 Texas Instruments Incorporated Integrated circuit device
JPH0612796B2 (ja) * 1984-06-04 1994-02-16 株式会社日立製作所 半導体装置
US4673967A (en) * 1985-01-29 1987-06-16 Texas Instruments Incorporated Surface mounted system for leaded semiconductor devices
US4888449A (en) * 1988-01-04 1989-12-19 Olin Corporation Semiconductor package
DE69119952T2 (de) * 1990-03-23 1997-01-02 Motorola Inc Oberflächenmontierbare Halbleitervorrichtung mit selbstbeladenen Lötverbindungen
US5343073A (en) * 1992-01-17 1994-08-30 Olin Corporation Lead frames having a chromium and zinc alloy coating
DE4311872C2 (de) * 1993-04-10 1998-07-02 Heraeus Gmbh W C Leiterrahmen für integrierte Schaltungen
US5360991A (en) * 1993-07-29 1994-11-01 At&T Bell Laboratories Integrated circuit devices with solderable lead frame
KR970011623B1 (en) * 1994-01-13 1997-07-12 Samsung Electronics Co Ltd Lead frame of semiconductor package
US5454929A (en) * 1994-06-16 1995-10-03 National Semiconductor Corporation Process for preparing solderable integrated circuit lead frames by plating with tin and palladium
KR100266726B1 (ko) * 1995-09-29 2000-09-15 기타지마 요시토시 리드프레임과 이 리드프레임을 갖춘 반도체장치

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Publication number Publication date
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