JPH0262589A - 液晶マトリックス・パネルの中間調表示駆動回路 - Google Patents

液晶マトリックス・パネルの中間調表示駆動回路

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JPH0262589A
JPH0262589A JP63212488A JP21248888A JPH0262589A JP H0262589 A JPH0262589 A JP H0262589A JP 63212488 A JP63212488 A JP 63212488A JP 21248888 A JP21248888 A JP 21248888A JP H0262589 A JPH0262589 A JP H0262589A
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宏之 真野
Satoru Tsunekawa
悟 恒川
Kiyoshige Kinugawa
清重 衣川
Satoshi Konuma
小沼　智
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達裕 犬塚
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、液晶表示装置における中間調表示方式に関す
る。
〔従来の技術〕
従来、液晶マ）　ＩＪソックスパネルの中間調表示駆動
回路は、特開昭５０−１５６３９６号公報に記載のよう
に、液晶マトリックス・パネルの信号ライン、走査ライ
ン（：電圧の印加をする際、電圧の印加時間を変えるこ
とにより、液晶への実効電圧を変化させ中間調表示を行
なっていた。この時、同じ中間調色である点が多く存在
すると、信号ラインで、同時に行なわれる電圧の切り換
えが多くなり、液晶を通して走査ラインにノイズが発生
して液晶への実効電圧が低下し、輝度が低下する問題が
あった。
従来の液晶マトリックス・パネルの中間調表示駆動回路
を第２図〜第１７図を用いて詳しく説明する。
第２図は従来の中間調表示液晶表示装置である。
１は表示データ、２は表示データ１の同期クロックのシ
フトクロック、３は１水平期間の区切りを示す水平クロ
ックである。４は１水平期間の表示データ１を蓄える表
示データシフトレジスタであり、５のＤ１〜Ｄ、はその
表示データシフトレジスタ４により蓄えられた１水平期
間分の表示データ１の水平表示データである。６はデコ
ーダであり、７のＤｌｌ　Ｄ１２　Ｄ１５〜Ｄｎ、Ｄｎ
２Ｄｎ、はデコーダ６の出力のセレクト信号である。８
は１水平期間に２周期のクロック、ＧＣＬＫである。９
は１水平期間の丁１　　。
その１／ｎパルス発生手段９の出力の丁）・ルスである
。
１１はセレクタ、１２のＸ、〜Ｘｎはセレクタ１１の出
力で列選択信号である。１３はライン先頭クロック、１
４はライン先頭クロック１３が入力され、水平クロック
３に応じデータをシフトする垂直シフトレジスタである
。１５のＹ、〜Ｙｆｆｉは垂直シフトレジスター４の出
力で、行選択信号である。１６は電圧ｖＪＬテ、１７は
電圧Ｖ、であり、ｖ１１６はＶ。
１７より高電位であ１バまたＶ、　１６　、　Ｖ、　１
７共に正電位である。１８は列液晶駆動手段で、１９の
ｖｘ、〜ｖ、ｃｎは列液晶駆動手段１８の出力、列駆動
信号である。２０は行液晶駆動手段で、２１のＶ。
〜Ｖ　は行液晶駆動手段２０の出力、行駆動信号ｍ である。２２は液晶パネルである。
第３図は、表示データシフトレジスタ４の動作タイミン
グ図である。
第４図は、デコーダ６の内部で、２３はデコーダである
。
第５図は、デコーダ２３の真理値表である。
第６図は丁ハルス発生手段９の内部回路図で、２４はク
ロック用ＮＯＴ回路、２５はリセット用ＮＯＴ回路、２
６はリセット付Ｄフリップフロップ、２７はＤフリップ
である。
第７図はＴハルス発生手段９のタイミング図である。
第８図はセレクタ１１の内部回路図で、２８〜３０はＡ
ＮＤ回路、３１はＯＲ回路である。
第９図は垂直シフトレジスタ１４の動作タイミング図で
ある。
第１０図は列液晶駆動乎段１８の内部回路図であ１バ　
３２はＶ、用スイッチングトランジスタ、３３はｖ２用
スイッチングトランジスタ、３４はＮＯＴ　回路である
。
第１１図は列液晶駆動手段１８の動作タイミング図であ
る。
第１２図は、第２図の動作タイミング図である。
第１３図は、第２図の第１２図のタイミングで動作した
時の液晶パネル２２に印加される波形である。
第１４図は液晶パネル２２の動作原理図である。
第１５図は液晶パネル２２の等両回路である。
第１６図は液晶パネル２２の通常表示点の充電波形であ
る。
第１７図は液晶パネル２２の中間調表示点の充電波形で
ある。
第２図の動作を以下説明する。
表示データシフトレジスタ４は第３図のタイミング図の
ように、水平クロック３の立ち下りエツジから次の立ち
下りエツジまでの１水平期間１：、シフトクロック２に
同期して入力される表示データ１を順次取り込む、該水
平表示期間に取り込まれた表示データ１は次の水平表示
期間にｔ、で取り込まれた表示データ１に対応するデー
タが水平表示データ５のＤｌに、ｔ２で取り込まれた表
示データ１に対応するデータが水平表示データ５のＤｌ
に、同様にｔｌから１ｎで取り込まれた表示データ１に
対応するデータが水平表示データ５のＤ３からＤｎｔ＝
出力される。
デコーダ６１；は該水平表示データが入力され、Ｄφか
らＤｎまでのそれぞれのデータをデコードしてセレクト
信号７のＤｌｌ、Ｄｌ２．Ｄｌ３からＤｎｌ。
Ｄｎ２．Ｄｎｌに出力する。
デコーダ６の内部回路は第４図に示すよう（＝水平表示
データ５のＤｌからＤｎまでの中の１つの信号Ｄｊを入
力し、セレクト信号７のＤｌｌ、Ｄｌ２゜Ｄｌ５からＤ
ｎｌ、Ｄｎ２．Ｄｎ５までの中の１組の信号Ｄｊ１．Ｄ
ｊ２．Ｄｊ３に、第５図の真理値表に従った値を出力す
るｎ個のデコーダ２３から構成されている。
１　　。
丁ハルス発生手段９は第６図のようにＮＯＴ回路２４と
ＮＯＴ回路２５とリセット付りフリップ７０ツブ２６と
Ｄフリップ７０ツブ２７がら構成されている。
この÷パルス発生手段９の動作は第７図のタイミング図
のようにＧＣＬＫ８と水平クロック３より１水平期間の
前半゛ハイ″後半“ロウ″となる一パルス１０を発生す
る。
セレクタ１１はＤｌｌ、Ｄｌ２．Ｄｌ３〜Ｄｎ１．Ｄｎ
２゜Ｄｎ３のセレクト信号７：二よりｘ１〜Ｘｎの列選
択信号１２に出力する信号を１ハイ１又は核１／２パル
ス１０又は１０つ”をセレクトする回路である。
このセレクタ１１は第８図のように６個のＡＮＤ回路２
８〜３ｏと１個のＯＲ回路３１から構成される１組のセ
レクタがｎ組集って構成されている。
この１組のセレクタの動作はＤｊｌが１ハイ”の時Ｘｊ
に１ハイ”を、Ｄｌ２が１ハイ１の時Ｘｊに１／２パル
ス１０を出力し、Ｄｌ３がハイの時Ｘｊに“ロウ”を出
力する。なおりｊｌ、Ｄｌ２．Ｄｌ３はデコーダ６の出
力であり、第５図のデコーダ６の真理値表から判るよう
に、必ずＤｊｉ、Ｄｌ２．Ｄｌ３の内、１つだけが１ハ
イ”となる信号である。
列液晶駆動手段１８は第１０図のようにＮｏ？回路３４
、ｖ１用スイッチングトランジスタ３２、ｖｂ用ススイ
ツチングトランジスタ３３らなＩＪ、Ｘ１〜Ｘｎ列選択
信号を入力とし、ラインｖｘ、〜ｖｘｎに列駆動信号１
９として液晶を駆動する電圧な出力する６列液晶駆動手
段１８は第１１図のようにｘ１〜Ｘｎ列選択信号の中の
１つの信号Ｘｊが１の時にＸｊに対応する列駆動信号１
９のＶ、ｊに電圧ｖ、Ｌを出力しＸ１ｊが０の時ｖｂを
出力する。
乗置シフトレジスタ１４は第９図のようにライン先頭ク
ロック１３を水平クロック３の立ち下りエツジで取り込
み、行選択信号１５の中のＹ　ｉ　（ニー出力し、以後
、水平クロック３の立ち下りエツジで順次Ｙ２　、　Ｙ
３、〜Ｙｍとシフトして出力する。
行液晶駆動手段２ｏは列液晶駆動手段１８と同様な構成
であり、Ｙ１〜Ｙｍの行選択信号１５の中の１つの信号
Ｙ、が１の時、Ｙ、に対応する’／ｙ＋〜ＶＹｍの行駆
動信号２１のＶ、、　、ニーＶ、を出力し、０の時ｖｂ
を出力する。
第１２図は第２図において、入力信号１に０．１゜２が
入力された時の全体の動作タイミング図である。
水平クロック３の立ち下りエツジからφ、１．２と順番
に入力信号１に入力されたデータは、次の水平クロック
５の立ち下りで、それぞれ水平表示データ５のＸφ、Ｘ
ｌ、Ｘ２に出力される。
該水平表示データ５はデコーダ６でデコードされセレク
ト信号７に出力し、これにより１ハイ”又は１／２パル
ス１ｏ又は１０つ“をセレクタ１１より列選択信号１２
に、Ｘｌには“ロウ”、Ｘ２にハ、１／２パルス１ｏを
、Ｘ３には１ハイ”を出力する。
列液晶駆動手段１８は該列選択信号１２を入力し、ｖｘ
、にＶ、を、Ｖｘ２１ニー　１水平期間ニＶ、Ｌを、後
半にｖｂを、ｖｘ５にＶ、を出力する。
一方垂直シフトレジスタ１４には、入力信号１にφ、１
．２が入力された水平期間に立ち上り、次の水平期間に
立ち下るライン先頭クロックが入力され、水平クロック
３の立ち下りエツジでラッチされ、行選択信号１５のＹ
ｌに１ハイ”が出力され行液晶駆動手段２０により、行
駆動信号２１のｖｌ、に−ｖ１が、その他の行駆動信号
２１ζ；はｖｂが出力される。
第１Ｓ図は第１２図のタイミング動作時の液晶パネル２
２に印加される電圧タイミング図である。
液晶パネル２２は第１４図のような構成をしており行駆
動信号２１と列駆動信号１９の電位差が大きいと（ここ
ではＶ、　−Ｖ、より大きいと）光を通し、小さいと（
ここではＶ、−Ｖｂ以下）、光を通さない。この液晶は
電気的には第１５図のように、コンデンサの特性を持っ
ている。これにより、第１３図におけるＶＸ！１−ＶＹ
Ｉの時は第１６図のように１水平期間充電される。一方
第１３図におけるｖｘ２−ｖＹｌの時は１水平期間の１
／２のみ充電されるので、第１７図のように、完全に充
電されず、液晶は光を少しだけ通し、中間調の表示を行
なう。
このようにして中間調の表示を行なっていた。
〔発明が解決しようとする課題〕
上記従来技術は中間調表示をするため署＝、ノくルス幅
を変えることでこれを実現していたが、同一中間調表示
の点が増加した時、同時毫；変化するノくルスのエツジ
によるノイズを配慮しておらず、輝度低下の問題があっ
た。
以下、第１８図〜第２０図を用いて、輝度低下について
説明する。
第１８図は液晶パネル２２の広面積に中間調表示した時
の波形である。
第１９図は液晶パネル２２の広面積；二中間調表示した
時の現実の波形である。
第２０図は液晶パネル２２の広面積１：中間調表示した
時の充電波形である。
以下、第２図：二おいて、液晶ノ（ネル２２の広面積に
中間調表示をした時に輝度低下することを説明する。
第１Ｂ図のよ引：、表示データ１に、連続的に１を入力
する。これＩ：より、列駆動信号１９のｖｘｌ〜Ｖゎに
、１水平期間の前半にＶ、が、後半にｖｂが出力される
。一方１装置シフトレジスタ１４：；は、ライン先頭ク
ロック１３が入力され、以後水平クロック３の立ち下り
で順次、行駆動信号２１の”！１〜ｖＹｌｌｌに−Ｖ、
がシフトして出力される。
上記の動作により液晶パネル２２の１行目、１列目の点
には第１８図のｖｘ、−ｖＹｌの電圧が印加される。
しかし液晶パネル２２は実際には第１５図のような構成
となっているため、列駆動信号１９における、電圧の切
り換点に発生する交流会が行駆動信号２１にノイズとし
て発生、このノイズが列駆動信号１９全てから発生する
ため第１９図のようになる。
これにより、第２０図のように、液晶パネル２２への電
圧の立ち上りがなまるために、液晶パネル２２への実効
電圧が低下して、輝度が低下する。
本発明は、上記問題点を解決することを目的とする。
〔課題を解決するための手段〕
上記目的は、中間調表示駆動回路直−おいて、中間調表
示用パルスの位相変調手段により、パルスの位相を変え
ることシーより達成される。
〔作用〕
中間調表示駆動回路では、中間調表示用パルスが位相変
調手段（−より変調され、隣接する列が位相のそれぞれ
異ったパルスにより液晶パネルが駆動される０例えば、
隣接する列で立ち上りエツジと立ち下りエツジを同じタ
イミング；：することで、立ち上りによるノイズと立ち
下るノイズを打ち消し合せ、輝度低下を無くす。
〔実施例〕
以下、本発明の一実施例を第１図、第２１図から第２５
図を用いて説明する。
第１図は液晶マトリックス・パネルの中間調表示駆動回
路における本発明の一実施例である。
１〜１０．１２〜２２は従来の技術で第２図で用いたも
のと同じである。
３５は１／２パルス１０の位相を変調する位相変調手段
で、３６は、位相変調手段３５により１／２パルス１０
の位相を変えた１／！′パルスである。
３７はセレクト信号７を入力し、′ハイ”又は１／２パ
ルス１０又は１／２パルス３２又は１０つ”を選択して
列選択信号１２：：出力するセレクタである。
第２１図は位相変調手段３１の内部回路であり、３８は
Ｎ０７回路、３９は一段目のＤフリップフロップ、４０
は、二段目のＤフリップフロップである。
第２２図は位相変調手段３１のタイミング図である。
第２５図はセレクタ３７の内部回路であり、４１〜４３
はＡＮＤ回路、４４はＯＲ回路である。
第２４図は第１図のタイミング図であり、第２５図は、
第２４図のタイミングで動作した時の液晶パネル２２に
印加される電圧波形である。
第１図の液晶マトリックス・パネルの中間調表示駆動回
路の動作を、第２４図を用いて説明する。
表示データ１１＝１が連続的に入力され、表示データシ
フトレジスタ４に取り込まれた表示データ１は次の水平
期間（：水平表示データ５に出力される。位相変調手段
３５は、第２１図の回路から構成され、第２２図のよう
に、ＧＣＬＫ８と１／２パルス１０を入力し、Ｄ７リツ
プフロツプ３９で９０゜位相のずれた信号人を発生し、
Ｄフリップ７０ツブ４０で１８０°位相のずれた１／２
パルスを発生する。
セレクタ３７は第２３図のようにＡＮＤ回路４１〜４３
とＯＲ回路４４から成るセレクタ、ｎ個から構成されて
いる。このセレクタ３７はＡＮＤ回路４１のセレクト信
号７に１が入力された時１ハイ”を、ＡＮＤ回路４２の
セレクト信号７に１が入力された時は、奇数列の時は１
／２パルス１０を、偶数列の時は、１／２パルス３６を
、またＡＮＤ回路４３のセレクト信号７に１が入力され
た時１０つ”をＯＲ回路４４の出力列選択信号１２に出
力する。
このセレクタ３７に、該セレクト信号７が入力され、列
選択信号の奇数列Ｘ１　＊　ｘＳ　ｒ　Ｘ５　＋・・・
Ｘｎ−１に１／２パルス１０が、偶数列ｘ２　＊　Ｘ４
　＊　Ｘ６　＋”・ｘｎに１／２パルス５６が出力され
る。
これにより列液晶駆動手段１８の出力、列駆動信号１９
の奇数列ｖｘ１．ｖｘｓ、ｖ工５．・・・ｖＩｎ−１に
は１水平期間の前半“Ｖ、”が、後半“ｖｂ″が出力さ
れ、偶数列ｖＸ２　＊　ｖｙ４　＋　ｖｙ６　＊・・・
ｖｙユには１水平期間の前半＠Ｖ、′が、後半＠Ｖ、′
が出力される。
一方垂直シフトレジスタ１４には、ライン先頭クロック
１３が入力され、以後水平クロック３の立ち下りで順次
、行駆動信号２１のｖｙ、〜Ｖ、に−Ｖ、がシフトして
出力され、その他の行駆動信号２１にはｖｂが出力され
る。
第２５図は上記第２４図の動作の時、液晶パネル２２に
印加される電圧波形である。
このように、隣り合う列の電圧変化エツジが、立ち上り
と立ち下りとなることで、行駆動信号に液晶を通して発
生するノイズを打ち消し合い、輝度の低下を無くす、又
は少なくすることが出来る効果がある。
以上説明した液晶マトリックス・パネルの中間調表示駆
動回路は、１／２のパルス幅変調の例であったが、これ
は１／／ｎのパルス幅変調においても同様（：できる、
以下に１／３パルス幅変調の例を第２６図〜第３２図を
用いて説明する。
第２６図は上記列の液晶マトリックス・パネルの中間調
表示駆動回路の一実施例のブロック図である。
１〜５，１２〜２２は従来の技術で第２図で用いたもの
と同じである。
４５は１水平期間に３周期のクロック、Ｇ　ＣＬ　Ｋ。
４６は、１水平期間の第１の１／３周期中、”ハイ″と
なり、その他は１０つ“となるパルスを発生する、１／
３階調発生手段、４７は該１７３階調発生手段が発生す
る、１／３パルスである。４８は１Ａパルスの位相を変
調して出力する位相変調手段であり、４９は位相変調手
段により１Ａパルス４７を変調し、第２の１／３周期中
１ハイ”となる１／３パルスである。５０は１７３′パ
ルス４９と同様に処理され、第３の１／３周期中１ハイ
”となる１／３パルスである。
５１はセレクト信号７により列選択信号１２に１ハイ”
又は１１５ハルス４７又は１／３’ハルス４９又はノＩ
。
１／３ハルス５０又は”ロウ”を選択して出力するセレ
クタである。
＠２７図は１Ａ階調発生手段４８の内部回路であり、５
２，５３はＮＯＴ回路、５４．５５はＤフリップフロッ
プである。
第２８図は１／３階調発生手段４６の動作タイミング図
である。
第２９図は位相変調手段４８の内部回路で、５６はＮＯ
Ｔ回路、５７〜５９はＤ　７　Ｉ）ツブ７０ツブである
。
第３０図は位相変調手段４８のタイミング図である。
第５１図は、セレクタ５１の内部回路であり、６０〜６
２はＡＮＤ回路、６３はＯＲ回路である。
第３２図は第２６図の動作タイミング図である。
以下第２６図を第３２図を用いて説明する。
表示信号１からセレクト信号７までの信号の流れ、及び
動作は第１図と同様に動作し、ここでは表示データ１：
；１が連続的Ｉ：大入力れるので、セレクト信号７のＸ
１□＊　ｘ２２　ｒ・・・Ｘｎ２に１が出力され、その
他は０となる。
１７３階調発生手段４６は第２７図のようにＮＯＴ回路
５２，５３　、Ｄ７リツプ７０ッグ５４．５５から構成
されており、第２８図のように、ＧＣＬＫ４５と水平ク
ロック６より１１５パルス４７を発生する。
位相変調手段４８は第２９図のように、ＮＯＴ回路５６
．Ｄ７Ｉ）ツブ７μツブ５７〜５９により構成されてお
り、第３０図のように、Ｄフリップ７０ツブ５７で６０
°位相をずらし、Ｄフリップフロッグ５８で１２０°ず
らして１１５′パルス４９に、Ｄクリップフロップ５９
で２４０°位相をずらして１／３”パルス５０に出力す
る。
セレクタ５１は、第３１図のようにＡＮＤ回路６０〜６
２．ＯＲ回路６３から構成されるセレクタ、１個から成
る。このセレクタ５１は、ＡＮＤ回路６０のセレクト信
号７が１の時１ハイ”を、ＡＮＤ回路６１のセレクト信
号７が１の時は、列１，４゜７、・・・は１／３パルス
４７、列２，５，８．・・・は１／３パルス４９、列５
，６，９．・・・は１／３パルス５０を、またＡＮＤ回
路６２のセレクト信号７が１の時は６０つ”をＯＲ回路
６１の出力列選択信号１２へ出力する。
このセレクタ５１に該セレクト信号７が入力され、 列選択信号１２のＸｌ、Ｘ４．Ｘ７・・・　には１／３
パルス４７が、Ｘ２．Ｘ５．Ｘ８・・・には１／３′パ
ルス４９が、ｌ、Ｘ６．Ｘ９・・・には１／３パルス５
０が出力される。
これ：：より列液晶駆動手段１Ｂの出力、列駆動信号１
９のｖｘｌ、ｖｘ４．ｖｘ７・・・（：は１水平期間の
第１の１／３周期にＶ、が出力され、その他の期間はＶ
。
が出力され、Ｖ工２　＋　ｖＸ５　＋　ｖＸＢ・・・に
は１水平期間の第２の１／３周期にｖｌがその他はｖｂ
が出力され、Ｖｘ３．　Ｖ工４　＋　ｖＸ９・・・には
水平期間の第３の１／３周期にｖ８がその他にはｖｂが
出力される。
一方、行の駆動信号は第１図と同様に動作する。
このように、列駆動信号１９の隣り合う電圧の変化エツ
ジが、立ち上りと立ち下りとなり、行駆動線へのノイズ
が打ちけし合い、輝度の低下を無くす、又は少なくする
。このよう１ユ１／３パルス時でも１Ａパルス時と同様
にでき、これはｉ／ｎの時も同様にできる。
以上説明した第１図及び第２６図は列駆動信号１９の隣
り合う電圧変化のエツジを立ち上りと立ち下りとするこ
とにより、行駆動信号２１：二発生するノイズを打ち消
すことにより輝度の低下を無くす、又は少なくする方法
の例であったが、これはパルスの位相を１列の列駆動線
上で変化させること鑑：よって、電圧変化エツジを少な
くすることでも可能である。以下第３３図〜第３６図を
用いて説明する。
第３３図は上記例の液晶マトリックス・パネルの中間調
表示駆動回路の一実施例のブロック図である。
１〜２２は従来の技術で第２図で用いたものと同じであ
る。
’ｓ５，５６は第１図のものと同じである。
６４は１／２パルス１０と１／２′パルス３６を切り換
えるチャネル、６５はチャネル６４の出力で、階調パル
スである。
第３４図はチャネル６４の内部回路で、６６はＮＯＴ回
路、６７はＤ７リツプフロツグ、６８．６９はＡＮＤ回
路、７０はＯＲ回路である。
第３５図はチャネル６４のタイミング図、第３６図は第
３３図のタイミング図である。
以下第３３を第３６図を用いて説明する。
第１図の説明と同様に、表示データ１（；１が連続的に
入力され、セレクト信号７に出力される。
また、１／２パルス１０及び１／２′パルス５６が第１
図と同様に作られ、出力される。
チャネル６４は、第３４図の様な構成をしており、第３
５図のように、水平クロック３の立ち下１１二より、階
調パルス６５１：出力する信号を１／２パルス１０又は
１／２パルス３６を切り換える。
これにより、該セレクト信号７を入力したセレクタ５７
は、列選択信号にＸ、〜Ｘｆｉに、１水平期間の中間で
立ち上り、又次の１水平期間で立ち下りをくりかえす信
号を出力する。
これにより列駆動信号１９：二は、１水平期間の中間で
Ｖ、になり、次の水平期間の中間でｖｂとなることをく
りかえす電圧波形が出力される。
一方行駆動信号２１の動作は第１図と同じである。
以上：二より、列駆動信号１９における電圧変化エツジ
が少なくなり、行駆動信号１９：；発生するノイズが少
なくなり、輝度低下が少なくなる。
以上説明した第３３図は、１Ａパルス使用時の例であっ
たが、これは、１／Ｌハルスの時であっても可能であり
、以下に１／３パルス時の例を第３７図〜第４０図を用
いて説明する。
第５７図は、１／３パルスを用いた時のパルスの位相を
１列の列駆動線上で変化させる回路である。
１〜７．１１〜２２は従来の技術で第２図で用いたもの
と同じである。
４５〜５０は第２６図で用いたものと同じである。
７１は１Ａパルス４７　、１７５パルス４９　、１／３
”パルス５０から１つを選び出力するチャネル。
７２はチャネル７１の出力階調パルスである。
第３８図はチャネル７１の内部回路で７３はＮＯＴ回路
、７４．７５はＤ７リツプフロツプ、７６ＮＯＲ回路、
７７〜７９はＡＮＤ回路、８ｏはＯＲ回路である。
第３９図はチャネル７１のタイミング図である。
第４０図は第５７図のタイミング図である。
以下、第３７図を第４０図を用いて説明する。
第１図と同様に、表示データ１ニー１が連続的に入力さ
れ、セレクト信号７に出力される。
また、１１５パルス４７，１／／：パルス４９　、１／
３”パルス５０は第２６図と同様（−シて作られる。
チャネル７１は第５８図のような構成をしており、第３
９図のように、水平クロック３の立ち下りにより、階調
パルス７２には、１／３パルス４７゜１／３パルス４９
　、　ｉ／３パルスｓｏ、！−順１１ＱＩ、ｌえられ、
くりかえして出力される。
これにより該セレクト信号７を入力したセレクタ１１は
、階調パルス７２を列選択信号１２のｘ１〜ｘｎに出力
し、列駆動信号１９は第４０図のように、電圧変化エツ
ジが少くなる。
これ：二より行駆動信号のノイズが少なくなり、輝度の
低下が少なくなる。
以上、説明した例では、パルスエツジの立ち上りと立ち
下りによりノイズを打ち消し合わせる方式と、パルスエ
ツジを少なくする方式を別々４１行なった。以下にこの
２つの列を同時に行なうことニーより、より輝度の低下
をおさえる方式を第４１図〜第４４図を用いて説明する
。
第４１図は上記例の実現例である。
１〜１０．１２〜２２は従来の技術で第２図で用いたも
のと同じである。
３７は第１図のものと同じである。
８１は１／２パルス１０と１／２′パルス３６を出力す
る線を切り換えるチャネルである。
８２は階調１パルス、８３は階調２パルス、それぞれチ
ャネル８１の出力である。
第４２図はチャネル８１の内部回路図で、８４はＮＯ’
ｌ’回路、８５はＤフリップ７０ツブ、８６〜８９はＡ
ＮＤ回路、９０．９１はＯＲ回路である。
第４３図はチャネル８１のタイミング図である。
第４４図は第４１図のタイミング図である。
以下、第４１図を第４４図を用いて説明する。
第１図と同様に、表示データ１に１が連続的に入力され
、セレクト信号７に出力される。
また１／２パルス１０及び１／２′パルス３６が第１図
と同様に作られ、出力される。
チャネル８１は第４２図の様：二構成されており、第４
３図のように、水平クロック３の立ち下りで、階調１パ
ルス８２と階調２パルス８３書：出力する信号を交互Ｅ
　１／２パルス１０と１／２′パルス３６を切り換えて
出力する。
これにより該セレクト信号７を入力したセレクタ３７は
、列選択信号１２の奇数列と偶数列に位相が１８０°ず
れ、しかも、パルスエツジの少ない信号を第４４図のよ
うに出力し、列駆動信号にも第４４図のように、列の隣
り合う電圧変化エツジが立ち上りと立ち下りとなり、し
かもエツジ数が少ない、電圧波形が出力される。
以上１＝より、行駆動信号へのノイズが少なくなり、輝
度低下を無くす、又は少なくすることが可能である。
〔発明の効果〕
本発明によれば、行駆動信号（：発生するノイズを少な
くすること、又は無くすことができるので、広面積を中
間調表示をすることによる、液晶画面の輝度低下を少な
くする。又は無くす効果がある。
【図面の簡単な説明】
第１図は本発明の一実施例の液晶マトリックスパネルの
中間調表示駆動回路のブロック図、第２図は従来の液晶
マトリックスパネルの中間調表示駆動回路のブロック図
、第３図は表示データシフトレジスタ４のタイミング図
、第４図はデコーダ６の内部ブロック図、第５図はデコ
ーダ２３の真理値を示す説明図、第６図は１／２パルス
発生手段９のブロック図、第７図は１／２パルス発生手
段９のタイミング図、第８図はセレクタ１１のブロック
図、第９図は重置シフトレジスタ１４の動作タイミング
図、第１０図は列液晶駆動手段１８のブロック図、第１
１図は列液晶駆動手段１８のタイミング図、第１２図は
第２図のタイミング図、第１３図は第２図の液晶パネル
２２に段加される電圧波形を示す波形図、第１４図は液
晶パネル２２の動作原理図、第１５図は第１４図の等価
回路を示す回路図、第１６図は液晶パネル２２の通常の
充電波形を示す波形図、第１７図は液晶パネル２２の中
間調表示した時の充電波形を示す波形図、第１８図は液
晶パネル２２の広面積に中間調表示した時の波形を示す
波形図、第１９図は第１８図の現実の波形を示す波形図
、第２０図は第１８図及び第１９図の充電波形を示す波
形図、第２１図は位相変調手段３１のブロック図、第２
２図は位相変調手段３１のタイミング図、第２３図はセ
レクタ３７のブロック図、第２４図は第１図のタイミン
グ図、第２５図は第２４図のタイミングで第１図が動作
した時の液晶パネル２２に段加される電圧の波形図、第
２６図は本発明を用いた別の液晶マトリックス・パネル
の中間調表示駆動回路の一実施例のブロック図、第２７
図は１／３階調発生手段４８のブロック図、第２８図は
１／３階調発生手段４６の動作タイミング図、第２９図
は位相変調手段４Ｂのブロック図、第３０図は位相変調
手段４８のタイミング図、第３１図はセレクタ５１のブ
ロック図、第３２図は第２６図のタイミング図、第３３
図は本発明を用いた別の液晶マトリックス・パネルの中
間調表示駆動回路の一実施例のブロック図、第３４図は
チャネル６４のブロック図、第３５図はチャネル６４の
タイはング図、第３６図は第３３図のタイミング図、第
３７図は本発明を用いた別の液晶マ）　ＩＪソックスパ
ネルの中間調表示駆動回路の一実施例のブロック図、第
３８図はチャネル７１のブロック図、第３９図はチャネ
ル７１のタイミング図、第４０図は第３７図のタイミン
グ図、第４１図は本発明を用いた別の液晶マトリックス
・パネルの中間調表示駆動回路の一図である。 １・・・表示データ、２・・・シフトクロック、３・・
・水平クロック、４・・・表示データシフトレジスタ、
５・・・水平表示データ、６・・・デコーダ、７・・・
セレクト信号、８・・・ＧＣＬＫ、？・・・１／２パル
ス発生手段、１゜、・・１／２パルス、１１・・・セレ
クタ、１２・・・列選択信号、１３・・・ライン先頭ク
ロック、１４・・・垂直シフトレジスタ、１５・・・行
選択信号、１６・・・電圧Ｖい１７・・・電圧Ｖ１．１
８・・・列液晶駆動手段、１９・・・列駆動信号、２０
・・・行液晶駆動手段、２１・・・行駆動信号、２２・
・・液晶パネル、２３・・・デコーダ、２４・・・８０
７回路、２５・・・ＮＯ’ｌ’回路、２６・・・リセッ
ト付Ｄ７リツプフロツプ、２７・・・Ｄ７リツプフロツ
プ、２８・・・ＡＮＤ回路、２９・・・ＡＮＤ回路、３
０・・・ＡＮＤ回路、３１・・・ＯＲ回路、３２・・・
スイッチングトランジスタ、３３・・・スイッチングト
ランジスタ、３４・・・ＮＯＴ回路、３５・・・位相変
調手段、３６・・・１７２′パルス、３７・・・セレク
タ、５８・・・Ｎ０７回路、３９・・・Ｄクリップフロ
ップ、４０・・・Ｄクリップ７０ツブ、４１・・・ＡＮ
Ｄ回路、４２・・・ＡＮＤ回路、４３・・・ＡＮＤ回路
、４４・・・ＯＲ回路、４５・・・ＧＣＬＫ、４６・・
・１／３階調発生手段、４７・・・１／３ハルス、４８
・・・位相変調手段、４９・・・１／３′パルス、５０
・・・１／３パルス、５１・・・セレクタ、５２・・・
ＮＯＴ回路、５３・・・８０７回路、５４・・・Ｄフリ
ップフロップ、５５・・・Ｄ７リツグフロツプ、５６・
・・ＮＯＴ回路、５７・・・Ｄフリップ７０ッグ、５８
・・・Ｄ７リツグフロツプ、５９・・・Ｄフリップフロ
ップ、６０・・・ＡＮＤ回路、６１・・・ＡＮＤ回路、
６２・・・ＡＮＤ回路、６５・・・ＯＲ回路、６４・・
・チャネル、６５・・・ｌｓｉ調パルス、６６・・・Ｎ
Ｏ’ｌ’回路、６７、・・Ｄフリップフロップ、６Ｂ・
・・ＡＮＤ回路、６９．・・ＡＮＤ回路、７０・・・Ｏ
Ｒ回路、７１・・・チャネル、７２・・・階調パルス、
７３・・・ＮＯ’ｌ’回路、７４・・・Ｄフリップ７０
ツブ、７５・・・Ｄクリップフロップ、７６・・・ＮＯ
Ｒ回路、７７・・・ＡＮＤ回路、７８・・・ＡＮＤ回路
、７９・・・・ＡＮＤ回路、８０・・・ＯＲ回路、８１
・・・チャネル、８２・・・階調１パルス、８３・・・
階調２パルス、８４・・・Ｎ０７回路、８５・・・Ｄフ
リップフロップ、８６・・・ＡＮＤ回路、８７・・・Ａ
ＮＤ回路、８８・・・ＡＮＤ回路、８９・・・ＡＮＤ回
路、９０・・・ＯＲ回路、９１・・・ＯＲ回路。 第　１図 第２図 第 ３図 第 ６Ｉ￥１ 篤７０ 第４図 第 第１０口 第 ９図 列、！１区動信号１ｑ 第１１図 ７、　　　　−ｍニー 第１３０ 第１２０ Ｄに二ニニニニニニニ　　　　０Ｉ Ｄ２：：ニニ：：ニニ：７２ Ｄ３二二ニニニニニニニ　　　　２０ ｅｃＬに８ ×１ニニニニニニ：二： Ｘ２ニニ：：ニニニニニ Ｘ３＝ニニニニ：：＝＝ “−ゝ“や−−−−Ｌ−−−−−一−−−−−第１４［
￥１ 光。 第１５図 第１’７［２１ 第１ｑ図 第２０口 ａ！ を 明 を 第１８［￥１ 第２１０ ′１Ａ２２図 ユ′ハ０ルス３６ 第２４０ 表取デーク１１ シフトフΩッ７２　ｆＬｆｌｆＬｎｆ−二二：二二二二
二二二二二二：ニニ：暮１０麹先豆員りＯっ７１３ Ｍ　２５図 第２６０ 第２９図 ダｑ 第３０口 ｉ′錆０ルス５０ ′Ｍ２７図 第２８０ ｇ　ｔ、＠ルス　４７ 第３Ｚ口 奎遺見諏７Ｃ！ｙ７１３ 第３３図 第３４図 第３５図 円奇言周ハ・ルス６５ 第３７図 第３６図 表爪デー７１１ シフト７Ｏ−ｔ７ｚＶ’Ｊ’Ｌロ月ニー−ＴＥ二二一−
−−−一−−二二二ニ垂直先シフ１１１−シフ１３ 第３８１３ 第４０図 表示デ゛−り１ シフト７０・ツク２ ０」］Ｊ１ｆＬ「−ＩＥ二＝＝１−−−−−−−−−−
−第３９図 階調ハ１ルス７２ 第４１ＥＺｌ 東４ｚ図 第４３図 円直調２／ｌ°ルスε３

Claims (3)

    【特許請求の範囲】
  1. （１）１水平期間の表示データを取り込み次の１水平期
    間に１度に１水平期間分の表示データを出力する表示デ
    ータシフトレジスタと、該１水平期間分の表示データを
    入力し、デコードして出力するデコーダと、１／ｎパル
    ス発生手段と、該デコーダの出力が入力され、該１／ｎ
    パルス発生手段の出力と１又は０の３つの信号から１つ
    をセレクトして出力するセレクタと、該セレクタの出力
    が入力され列駆動信号を出力する列液晶駆動手段と、垂
    直先頭クロックが入力され、該垂直先頭クロックを１行
    ごとにシフトして出力する垂直シフトレジスタと、該シ
    フトレジスタの出力が入力され行駆動信号を出力する行
    液晶駆動手段と、該列液晶駆動手段と該行液晶駆動手段
    の出力により駆動される液晶パネルより成る液晶マトリ
    ックス・パネルの中間調表示駆動回路において、１／ｎ
    パルス発生手段の出力の１／ｎパルスが入力され、該１
    ／ｎパルスの位相をそれぞれ１×３６０／ｎ度から（ｎ
    −１）×３６０／ｎ度ずらしたｎ−１個の信号を出力す
    る位相変調手段と、該位相変調手段のｎ−１個の出力と
    該１／ｎパルスと１と０を入力とし出力が１列目から順
    番に割り付けられたセレクタを設けたことを特徴とする
    液晶マトリックス・パネルの中間調表示駆動回路。
  2. （２）請求項４において、該１／ｎパルス発生手段の出
    力１／ｎパルスと該位相変調手段のｎ−１個の出力が入
    力され、１水平期間に順番に切り換えて出力するチャネ
    ルと、１／（１／ｎ）パルスと１又は０の３つの入力の
    内、１つをセレクトして出力するセレクタを設けたこと
    を特徴とする液晶マトリックスの中間調表示駆動回路。
  3. （３）請求項１において、該１／ｎパルス発生手段の出
    力１／ｎパルスと該位相変調手段のｎ−１個の出力が入
    力され、ｎ個の出力に、それぞれの信号を順番にローテ
    ーションして出力するチャネルを設けたことを特徴とす
    る液晶マトリックスの中間調表示駆動回路。
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