JPH0260099B2 - - Google Patents

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JPH0260099B2
JPH0260099B2 JP59046582A JP4658284A JPH0260099B2 JP H0260099 B2 JPH0260099 B2 JP H0260099B2 JP 59046582 A JP59046582 A JP 59046582A JP 4658284 A JP4658284 A JP 4658284A JP H0260099 B2 JPH0260099 B2 JP H0260099B2
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signal
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Masahiro Matai
Koji Ooyagi
Yasuhiro Mori
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NEC Corp
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Nippon Electric Co Ltd
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Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は、表示機能を備えた無線選択呼出受信
機に関するもので、さらに詳しくいえば、個別選
択呼出番号と少なくとも１個以上の共通選択呼出
番号を有する表示機能付選択呼出受信機に関する
ものである。
〔従来技術〕
情報化社会が進むにつれて、情報のもつ価値が
急激に高まつている。
そして、これらの価値ある情報を受信する情報
受信機においても、情報量の増加に伴い、呼出し
だけの機能のものから、数字および文字などで構
成される一連のメツセージまでも受信できるも
の、さらには、マルチアドレスを備えたものとそ
の受信機能の向上を図つたものが実現されてい
る。
ところで、上記マルチアドレスを備えた個別選
択情報受信機のアドレスとしては、従来のページ
ングサービスに対応するアドレス（以下、個別ア
ドレスと呼称する）と情報サービスに対応する共
通アドレス（以下、共通アドレスと呼称する）に
分類することができる。
ここで、前者の個別アドレスを用いて受信でき
る情報（以下、個別アドレス情報と呼称する）と
しては、取り引き先の住所や電話番号など受信頻
度としては少ないが、新ためて確認したい情報が
あげられる。すなわち、記憶としておきたい情報
である。一方、後者の共通アドレスを用いて受信
される情報（以下、共通アドレス情報と呼称す
る）としては、株価情報、商品取り引き情報など
があげられる。そして、これらの情報は時々刻々
と変化する情報であるため、古い情報の価値とい
うものはかなり低いものと考えられる。また、受
信頻度という面では、ある決まつた単位時間ごと
に受信される情報なのでかなりの頻度になるもの
と考えられる。
しかしながら、上記のような特徴を有する個別
アドレス情報と共通アドレス情報を、従来のよう
な各アドレスに対応したメモリーエリアをもたな
い情報受信機で処理していく場合においては、個
別アドレス情報の保護ができなくなる。
すなわち、受信された個別アドレス情報は、メ
モリーエリアに格納されるが、ある決まつた単位
時間ごとに受信される受信頻度の高い共通アドレ
ス情報の蓄積により、有限なメモリーエリアから
追い出される。そして、このようなことが生じた
場合には、個別アドレス情報に対しては実質的に
メモリー機能がないとみなすことができ、情報の
保護という面では、大きな欠点となる。
また、保護される情報としては、大多数が情報
価値の低い共通アドレス情報のみとなるため有限
なメモリーエリアの有効な利用がなされないとい
う欠点もある。
このように、マルチアドレスを備えた情報受信
機においては、各アドレスに対してどのように情
報を格納するかが課題となる。
〔発明の目的および構成〕
本発明は以上の点に鑑み、このような問題を解
決すると共にかかる欠点を除去すべくなされたも
ので、その目的は予め各アドレスに対応のメモリ
ーエリアを設けることで個別アドレス情報の保護
を図ることができ、また、複数の共通アドレスを
持ち、各共通対応のメモリーエリアをもつ情報受
信機において、利用者が特定の共通アドレス情報
を必要としない場合には、その特定の共通アドレ
スを格納できるメモリーエリアを、個別アドレス
情報を格納できるメモリーエリアとすることでメ
モリーエリアの効率化を図ることができる表示機
能付無線選択呼出受信機を提供することにある。
このような目的を達成するため、本発明は、個
別選択呼出番号に続くメツセージ信号を少なくと
も１個以上格納する個別用エリアと少なくとも１
個以上の共通選択呼出番号に続くメツセージ信号
を格納する既設特定エリアから構成される第１の
記憶手段を備えるようにしたものであり、また、
上記共通選択呼出番号によるサービスを受けるか
否かの情報を格納する第２の記憶手段と、この第
２の記憶手段の内容に応じてサービスを受けない
選択呼出番号に対応する上記特定エリアを上記個
別用エリアとして処理する制御手段とを備えるよ
うにしたものであり、また、共通選択呼出番号に
よるサービスを受けるか否かの情報を上記メツセ
ージ信号から復号する手段を備えるようにしたも
のであり、また、上記共通選択呼出番号によるサ
ービスを受けるか否かの情報をその共通選択呼出
番号に対応する制御端子を論理“０”または論理
“１”とすることで実現する手段を備えるように
したものである。
〔実施例〕
以下、図面に基づき本発明の実施例を詳細に説
明する。
第１図は本発明に用いられる受信信号の一例を
示す構成図である。本発明の理解を容易にするた
め、これについて説明する。
第１図ａにおいて、Ｆはフレーム同期信号、Ａ
はアドレス信号、Ｍはメツセージ信号であり、ま
た、Ｅはアドレス信号の特定パターンでエンド信
号を構成する。そして、このメツセージ信号Ｍは
メツセージ長により必要に応じて複数並べる。
第１図ｂはアドレス信号またはメツセージ信号
として、BCH３１，２１に１パリテイビツトを
付加した信号を使用した場合の構成を示したもの
である。そして、この信号は21ビツトの情報エリ
アIA，10ベツトのチエツクエリア、および１ビ
ツトのイーブンパリテイビツトEPからなり、１
ワード32ベツト構成である。まず、情報エリアの
最上位ビツト（MSB）を識別ビツトとし、その
論理が“０”のときはアドレス情報として処理
し、また、その論理が“１”のときにはメツセー
ジ情報として処理する。そして、残りの20ビツト
をアドレス情報またはメツセージ情報として用い
る。
第１図ｃは、アドレス信号のつぎに受信される
メツセージ信号のメツセージ情報の構成を示した
ものである。このｃにおいて、最上位ビツト（情
報エリアでは第２ビツト目）を処理ビツトとし、
その論理が“０”のときは残りの19ビツトをメツ
セージ処理情報として処理し、その論理が“１”
のときには残りの19ビツトをメツセージ情報とし
て処理する。また、メツセージ信号に引き続き受
信されるメツセージ信号においては、情報エリア
の識別ビツトを除く20ビツトをメツセージ情報と
して処理する。
第２図は本発明による表示機能付無線選択呼出
受信機の一実施例を示すブロツク図である。
図において、ANはアンテナ、RECはアンテ
ANによつて捕捉した無線信号を受信し復調する
無線部、WSは無線部RECの出力信号の波形を整
形する波形整形部、ADRはアドレスデコーダ、
MEMは複数の選択呼出番号が書き込まれている
メモリ（Ｐ−ROM）、MDIはメツセージデータ
処理部、BUFはアドレスデコーダADRの出力を
入力とするバツフア、SPはこのバツフアBUFの
出力側に接続されスピーカ、DPはメツセージデ
ータ処理部MDIの出力を表示する表示器、XLは
アドレスデコーダADRのタイミングクロツクを
つくるためのクロツク発生用水晶振動子である。
そして、SW0はアドレスデコーダADRに接続さ
れたスイツチで、このスイツチSW0はアドレスデ
コーダADRを介してその変化情報および状態信
号をメツセージデータ処理部MDIへ送り、鳴音
の停止などを行うように構成されている。また、
SW1〜SW3はそれぞれメツセージデータ処理部
MDIに接続され、情報受信機の操作に使用され
るスイツチである。
つぎにこの第２図に示す実施例の動作を説明す
る。
まず、アンテナANを介して無線部RECで所望
の無線信号が受信され復調される。そして、この
復調された信号は波形整形部WSで、後に続くア
ドレスデコーダADRで読み取り可能なデイジタ
ル信号に変換される。
つぎに、アドレスデコーダADRは予め複数の
選択呼出番号が書き込まれているメモリ（Ｐ−
ROM）MEMからアドレスデータ信号ｅをアド
レスデコーダADRに読み込み、また、波形整形
部WSからの入力データ信号ａとの比較を１ビツ
ト毎に行ない、呼出番号の一致が確認されると信
号ｂによつてメツセージ処理部MDIに起動をか
ける。そして、このメツセージデータ処理部
MDIはアドレスデコーダADRからの信号ｂによ
りメツセージ信号“Ｍ”（第１図参照）の受信、
復号を行ない、メツセージの終了を示すエンド信
号（ストツプ信号）Ｅ（第１図参照）が検出され
ると、アドレスデコーダADRに信号ｂに送る。
この信号ｂによりアドレスデコーダADRはバツ
フアBUFに鳴音信号ｄを送出し、スピーカSPを
駆動させ、機器所持者に呼び出しがなされたこと
を知らせる。また、メツセージデータ処理部
MDIは上記メツセージ信号“Ｍ”の復号信号を
内部RAM（図示せず）に格納すると共に、表示
器DPに信号ｃを送り、可視情報を提供させる。
第３図は第２図におけるメツセージデータ処理
部MDIに係る部分を抽出して示したブロツク図
である。
この第３図において第２図と同一符号のものは
相当部分を示し、CPUは第２図に示すアドレス
デコーダADRからの信号ｂとスイツチSW1〜
SW3からの情報を入力とする１チツプCPU，
RAM1はこの１チツプCPUとの間において信号
b1の授受を行うランダム・アクセス・メモリで、
このランダム・アクセス・メモリRAM1は個別選
択呼出番号に続くメツセージ信号を少なくとも１
個以上格納する個別用エリアと共通選択呼出番号
に続くメツセージ信号を格納する既設特定エリア
から構成される第１の記憶手段を構成している。
DVは１チツプCPUからの信号b2を入力とする
LCDドライバー、Ｄはダイオード、Ｃはコンデ
ンサである。なお、VDDは電源を示す。
第４図は第２図におけるアドレスデコーダ
ADR内のアドレス検出回路（選択呼出信号検出
回路）に係る部分を抽出して示した回路図で、ア
ドレス４個の場合を示すものである。
この第４図において、EX・NOR1〜EX・
NOR4はそれぞれ第２図に示すメモリ（Ｐ−
ROMメモリ）MEMからのアドレスデータ信号
ｅと入力データａとを入力する排他的ノアゲー
ト、CNT1〜CNT4はそれぞれ排他的ノアゲート
EX・NOR1〜EX・NOR4の出力とクロツクCK
を入力とし端子Ｒからの信号によつて32ビツト毎
にクリアされるカウンタ、ORはこのカウンタ
CNT1〜CNT4の出力を入力とするオアゲート、
CONVはカウンタCNT1〜CNT4の出力を入力と
し２ビツト（I1，I2）に変換して出力する変換回
路である。なお、eA，eB，eC，eDは、それぞ
れ排他的ノアゲートEX・NOR1〜EX・NOR4に
入力されるアドレスデータ信号である。
このように構成された回路において、入力デー
タａとメモリ（Ｐ−ROM）MEMからのアドレ
スデータｅを１ビツト毎に排他的ノアゲート
EX・NOR1〜EX・NOR4とカウンタCNT1〜
CNT4で比較を行ない、端子Ｒからの信号により
32ビツト毎にクリアされるが、クリアされる前に
29個以上の一致によりカウンタCNT（ｉ）より信
号DET（ｉ）が出力される。ただし、ｉは１〜４
である。
ここで、各カウンタCNT1〜CNT4の出力端は
オアゲートORに接続されているので、信号DET
（ｉ）を出力するカウンタがあれば、オアゲート
ORよりDET信号が出力される。また、この第４
図に示すアドレス４個の場合の実施例において
は、変換回路CONVでアドレスを２ビツトの受
信アドレス情報I1，I2に変換して出力する。
第５図は第３図における１チツプCPUに係る
部分を抽出して示したブロツク図で、具体的な構
成例を示すものである。
この第５図において、IP1，IP2，IP3はそれぞ
れスイツチSW3，SW2，SW1の出力を入力とする
入力ポート、IP4，IP5，IP6，IP7およびIP8はそ
れぞれ第２図に示アドレスデコーダADRからの
信号ｂのアドレスを示すデータ（受信アドレス情
報）I1，I2、タイミング用周波数fT、伝送速度に
対応するクロツクCLおよびメツセージ信号Ｄを
入力とする入力ポートである。そして、OP1，
OP2はそれぞれ第２図に示すアドレスデコーダ
ADRにメツセージが終了したことを知らせる信
号ME、鳴音制御信号ACを出力する出力ポート、
OP3，OP4，OP5はそれぞれ第３図に示すランダ
ム・アクセス・メモリRAM1に制御信号，
Ａ／，Ｒ／を出力する出力ポート、OP6，
OP7はそれぞれ第３図に示すLCDドライバDVに
制御信号，Ｃ／を出力する出力ポート、
INTPは第２図に示すアドレスデコーダADRか
らの信号ｂのアドレスが一致したことを知らせる
信号DETおよびスイツチSW1などのアクセス信
号Ｒを入力とする割り込みポート、IFは第３図
に示すランダム・アクセス・メモリRAM1と
LCDドライバーの間でシリアルにデータのやり
とりを行うシリアルインターフエース、DBはデ
ータバスである。
PRO・CNTは番地の内容を指定するプログラ
ムカウンタ、PRO・MEMは実行すべき命令のシ
ーケンスがストアされ、プログラムカウンタ
PRO・CNTで指定された番地の内容を読み出す
プログラム用メモリ、ALLは算術演算・論理演
算など各種の演算を行う演算部、INS・DRはプ
ログラム用メモリPRO・MEMからの情報をデコ
ードし、各部へその命令に対応する制御信号を供
給するインストラクシヨン・デコーダ、RAM2は
各種データの記憶、サブルーチン、割り込みにお
けるプログラムカウント、プログラムステータス
の退避に用いられるランダム・アクセス・メモリ
である。このランダム・アクセス・メモリRAM2
には、個別選択呼出番号に続くメツセージ信号を
少なくとも１個以上格納する個別用エリアと共通
選択呼出番号に続くメツセージ信号を格納する既
設エリアから構成される前述のランダム・アクセ
ス・メモリRAM1に設けた第１の記憶手段を設け
てもよい。ACCはこのランダム・アクセス・メ
モリRAM2および各ポート間のデータの送受に用
いられるアキユームレータである。CKGは実行
命令サイクル時間を決定するシステムクロツク発
生回路である。
そして、第２図に示すアドレスデコーダADR
との間ではアドレスを示すデータ（受信アドレス
情報）I1，I2、伝送速度に対応するクロツクCL，
タイミング用周波数fT、アドレスが一致したこと
を知らせる信号DET、スイツチSW1などのアク
セス信号Ｒ、メツセージ信号Ｄ、メツセージが終
了したことをアドレスデコーダADRに知らせる
信号MEおよび鳴音制御信号ACの各信号の受け
渡しが行なわれる。また、第３図に示す記憶手段
を構成するランダム・アクセス・メモリRAM1と
の間ではシステムクロツク信号、出力信号
SO、入力信号SIおよび制御信号，Ａ／，
Ｒ／の各信号の受け渡しが行なわれ、第３図に
示すLCDドライバDVとの間ではシステムクロツ
ク、出力信号SOおよび制御信号，Ｃ／
の各信号の受け渡しが行なわれる。
第６図は本発明の主眼であるメツセージ格納処
理を行なうために用いるレジスタおよび記憶エリ
アの一例を示す構成図である。
各レジスタおよび記憶エリアについて以下、説
明する。
まず、第６図ａはメモリエリアの構成例を示
し、M1〜Moは個別アドレス情報および共通アド
レス情報に対応するメツセージフアイル番号Fjを
記憶すると共に、個別アドレスにおいては情報の
新旧を示す。そして、M1〜Moのデータの初期値
は全て“０”であり、メツセージが記憶されてい
ないことを意味する。なお、ここで、Miのデー
タであることを示す表記法として（Mi）を用い
る。これを用いるこの実施例である。第６図ａで
は（M3）はF2を示す。
また、第６図ｂ，ｃはフアイルエリアおよびセ
クタエリアの構成例を示し、F1〜Fnは各メツセ
ージフアイル番号に対応して割り当てられてお
り、ここにはメツセージ情報を構成するセクタ名
を順に記憶していく。なお、第６図ａに示すMi
と同様に第６図ｂに示すFjのデータを（Fj）で表
わす。すなわち、この第６図ｂに示す実施例で
は、（F1）はS0，S1，S3の３つのセクタで構成さ
れ、メツセージ情報がこれらのセクタ内に格納さ
れていることを示す。
そして、SO〜SKも各セクタ番号に対応して割
り当てられており、このエリアにメツセージ情報
が格納される。また、SKのデータも（SK）を用
いて示し、この実施例である第６図ｂでは、（SO）
は“PLEASE”という６キヤラクタが格納され
いることを示している。そして、このセクタ内で
は、メツセージ情報はシーケンシヤルに順次格納
される。前記のことより、受信されたメツセージ
情報はF1の場合には、S0，S1，S3の３つのセク
タにより構成されており、“PLEASE GO TO
HOME”であることがわかる。
ところで、前記エリアが設けられる場所につい
ては、第６図ａのメモリーエリアの場合は第５図
に示すRAM2であり、第６図ｂのフアイルエリア
および第６図ｃのセクタエリアの場合は第３図に
示すランダム・アクセス・メモリRAM1である。
つぎに、第６図ｄ，ｅ，ｆにそれぞれ示すレジ
スタMST（MSTATUCS），FST
（FSTATUCS），SST（SSTATUCS）について
説明する。
第６図ｅに示すレジスタFSTおよび第６図ｆ
に示すレジスタSSTはそれぞれフアイルおよび
セクタの使用状況を記憶しているレジスタであ
り、未使用時“０”、使用時“１”が各フアイル
および各セクタ毎に格納されている。したがつ
て、これらのレジスタを使用することにより、空
フアイルや空セクタを知ることができる。なお、
レジスタFST、レジスタSSTの各データはFLST
（Fj），SCST（SK）を用いて表わす。すなわち、
FLST（F3）はレジスタFSTのF3のデータが
“０”か“１”かということで、この実施例では
“１”というデータである。同様に、SCST（S2）
は“１”というデータである。
また、第６図ｄに示す共通アドレス情報のメモ
リーエリアを指定するレジスタMSTの場合は、
メモリーエリアの固定状況を記憶しておくレジス
タとして用いられる。すなわち、共通アドレス情
報のメモリーエリアとして使用するか、または、
個別アドレス情報のメモリーエリアとして使用す
るかを記憶しておくレジスタである。この実施例
においては、共通アドレス情報のメモリーエリア
として使用する場合には“１”、個別アドレス情
報のメモリーエリアとして使用する場合には
“０”としている。ここで、メモリーエリアの処
理形態を示すレジスタMSTの各ビツトと各アド
レスとは１対１の対応になつている。この結果、
たとえば、Ａ，Ｂ，Ｃ，Ｄの４個のアドレスを持
ち、Ａが個別アドレス、Ｂ，Ｃ，Ｄが共通アドレ
スとして使用可能であるが、Ｄの共通アドレスを
必要としない場合には、共通アドレスＤと１対１
の対応になつている第６図ｄに示すレジスタ
MSTを“０”とすることで共通アドレスに対応
したメモリーエリアを個別アドレス情報に使用す
ることができる。なお、このレジスタMSTのデ
ータはMST（Mi）を用いて表わす。すなわち、
MST（M3）は“１”というデータである。
ところで、上記第６図ｄ，ｅ，ｆに示各レジス
タMAT，FST，SSTは、第５図に示すランダ
ム・アクセス・メモリRAM2に格納される。
つぎに、第６図ｇ，ｈ，ｉ，ｊ，ｋ，ｌについ
ては、それぞれ次に示すような動作を行なう。な
お、これらのレジスタも第５図に示すランダム・
アクセス・メモリRAM2に格納される。
まず、第６図ｇに示すADは受信アドレス情報
I1，I2（第４図、第５図参照）が格納されるレジ
スタであり、ｈに示すIFNは空フアイルが存在す
る場合には空フアイルの番号が格納され、空フア
イルが存在しない場合には“０”となつているレ
ジスタである。また、ｉに示すISNはレジスタ
IFNと同様に、空セクタが存在する場合には空セ
クタの番号が格納され、空フアイルが存在しない
場合には、“０”となつているレジスタである。
つぎに、ｊに示すSCは１フアイル中のセクタ
の使用個数を格納するレジスタであり、ｋに示す
STADはメツセージ情報を格納するアドレス番
地を記憶しておくレジスタである。また、ｌに示
すFIはフアイルを構成するセクタ番号が記憶さ
れるレジスタであり、１フアイル分のセクタ番号
の記憶が終了すると、このデータは第３図に示す
ランダム・アクセス・メモリRAM1のフアイルエ
リアに送られる。
以上、受信信号、各回路および記憶手段を構成
するレジスタの構成ならびにその機能について説
明したが、つぎに、第７図、第８図、第９図およ
び第１０図のフローチヤートに基いて、受信信号
の処理動作について説明する。ここで、この第７
図は受信信号処理の実施例を示すフローチヤート
であり、第８図、第９図および第１０図はそれぞ
れ第７図で示したステツプSTP−１３，STP−
２２，STP−２４の詳細なフローチヤートであ
る。
まず、第７図において、受信機は初期状態とし
て同期信号の待ち受け状態となつており、ステツ
プSTP−１において、同期信号を検出すると、
自己の受信機のメモリMEM（Ｐ−ROM）（第２
図参照）内に格納されている呼出番号の待受け状
態となる。そして、同期信号を受信した後、規定
時間経過しても、第４図に示す回路において、第
２図に示すメモリMEM（Ｐ−ROM）に格納され
ている自己の受信機の呼出番号を検出できない場
合（ステツプSTP−２およびステツプSTP−３
参照）には初期状態に戻る。
ここで、第４図に示す選択呼出信号検出回路に
おいて、第２図のメモリMEM（Ｐ−ROM）に格
納されている自己の受信機の呼出信号を検出した
場合には、第４図に示す回路において、オアゲー
トORから信号DETが出力され、第３図に示す１
チツプCPUが起動されると共に、受信されたア
ドレスが変換回路CONVで２ビツトの受信アド
レス情報I1，I2に変換され、出力される。（ステ
ツプSTP−４参照）そして、上記１チツプCPU
に第２図に示すアドレスデコーダADRより受信
され受信アドレス情報I1，I2および受信信号であ
る第５図のメツセージ信号“Ｄ”が供給され、信
号処理され、第５図のランダム・アクセス・メモ
リRAM2に格納される（ステツプSTP−５，
STP−６参照）。そして、受信信号は第５図に示
す演算部ALLにおいて識別ビツトをチエツクし
てアドレス信号かメツセージ信号かの判定（ステ
ツプSTP−７参照）を行う。
ここで、受信信号がアドレス信号の場合には、
このアドレス信号の前にメツセージ信号があつた
かを判定（ステツプSTP−８参照）する。すな
わち、第６図ｊに示すレジスタSCを判定し、メ
ツセージ情報としてセクタを使用した場合には、
ステツプSTP−９においてセクタエリアに終了
のコードを書き込み、以下で説明するメツセージ
情報の格納および通報・表示を行なう。
しかし、メツセージ情報としてセクタを使用し
ない場合には、自己の受信機の呼出番号を用いて
送られるメツセージ情報は“ない”とみなし、初
期情態に戻る。
また、ステツプSTP−７において、メツセー
ジ信号と判断された受信信号においては、第３図
に示す１チツプCPUの起動後、最初のメツセー
ジ信号かを判定（ステツプSTP−１０参照）し、
最初のメツセージ信号の場合には、処理ビツトの
判定（ステツプSTP−１１参照）を行なう。こ
こで、処理ビツトが“０”の場合には、受信信号
はメツセージ処理情報として第６図ｄに示すレジ
スタMSTのデータの格納（ステツプSTP−１２
参照）を行なう。ここで、このステツプSTP−
１２は共通選択呼出番号によるサービスを受ける
か否かの情報をメツセージ信号から復号するステ
ツプである。
なお、この実施例においては、メツセージ処理
情報としてレジスタMSTのデータのみを考えた
が、他に以下で説明するβの値を示すデータを
も、含めてかまわない。また、格納が完了する
と、この実施例では初期状態に戻るが、必要に応
じてはレジスタMSTの設定完了の通報および表
示が考えられる。また、ステツプSTP−１１に
おいてメツセージ情報と判定された場合には、新
規エリアの設定（ステツプSTP−１３）が行な
われる。
この新規エリアの設定について第８図を用いて
説明する。
まず、メツセージ情報と判定されると、第６図
ｇに示すレジスタADより受信アドレス情報I1，
I2を読み出すと共に、その受信アドレス情報I1，
I2と１対１の対応になつている第６図ｄに示すレ
ジスタMSTの内容を読み出し（ステツプSTP−
３０参照）て、個別アドレス情報に応じた新規エ
リアの設定を行なうか、共通アドレス情報に応じ
た新規エリアの設定を行なうかを判断（ステツプ
STP−３１参照）する。ここで、次のステツプ
STP−３２，STP−３７で用いるβについて説
明する。このβは、１フアイル中に使用できるセ
クタの個数を示すものであり、β1，β2はそれぞれ
共通アドレス情報および個別アドレス情報に対応
する値である。ところで、例えば、32キヤラクタ
格納可能なセクタが36個あり、βの値が９の場合
には、最悪４フアイル分のメツセージの格納が可
能になる。ここで、３つの共通アドレスを使用し
た場合には、最悪１個の個別アドレス情報の格納
しかできなくなる。そこで、例えばβ1＝６，β2＝
９とした場合には、３つの共通アドレス使用にお
いて、最悪２個の個別アドレス情報の格納が可能
で、古い個別アドレスの確認が可能になる。ま
た、このことは、個別アドレス情報が行動の指示
等の長いメツセージが多いのに対し、共通アドレ
ス情報は株価等の短いメツセージが多いという面
から見ても適当と考えられる。このようにして各
β1，β2は選ばれる。
ところで、共通選択呼出番号によるサービスを
受けるか否かの情報を格納するメモリ、例えば、
第５図のランダム・アクセス・メモリRAM2の内
容に応じてサービスを受けない選択呼出番号に対
応する特定エリアを個別用エリアとして処理する
制御手段をアクセスするステツプSTP−３１に
より共通アドレス情報と判定された場合には、ス
テツプSTP−３２で前記βの設定を行ない、今
までその共通アドレスの情報として使用されてい
たフアイルおよびセクタの消去を行なう。すなわ
ち、ステツプSTP−３３において受信された共
通アドレス情報に対応したメモリーエリアにフア
イル番号Fjが入つているかどうか判定する。フア
イル番号Fjが入つている場合には、ステツプ
STP−３４，STP−３５，STP−３６において、
受信された共通アドレスの古い情報の消去を行な
うと共に、古い情報で使用されていた第６図ｅお
よびｆに示すレジスタRST，SSTを“０”にし
それらのフアイルおよびセクタを使用可能にす
る。また、受信された共通アドレス情報に対応し
たメモリーエリアにフアイル番号Fjに入つていな
い場合、すなわち、その共通アドレスで初めてサ
ービスを受ける場合には、ステツプSTP−３８
において、空フアイル、および空セクタがあるか
の判定を行なう。そして、空フアイルおよび空セ
クタがない場合には、この実施例にあつては初期
状態に戻るが、必要に応じ通報・表示を行ない使
用者に空フアイル及び空セクタのないことを知ら
せることもできる。
さて、ステツプSTP−３１において、個別ア
ドレス情報と判定された場合は、ステツプSTP
−３７において、個別アドレス情報に適した前記
βが設定され、前記ステツプSTP−３８におい
て、空フアイル、空セクタの有無の判定を行な
う。
前記のCPU起動後の最初のメツセージ情報は
すべてステツプSTP−３９に進み、新規エリア
に必要なフアイルおよびセクタの設定を行なう。
すなわち、第６ｈに示すレジスタIFNに格納され
ている空フアイルの第６図ｅに示すレジスタ
FSTのデータを“１”にセツトする。これと同
様に、第６図ｉに示すレジスタISNに格納されて
いる空セクタの第６図ｅに示すレジスタSSTの
データを“１”にセツトし、そのフアイルおよび
セクタが使用されることを示す。さらに、セクタ
を１個使用するので第６図ｊに示すレジスタSC
のデータを“１”とする。
そして、ステツプSTP−４０においては、使
用するセクタの最初のアドレス番地の設定を行な
う。ここで、αは１セクタ内で記憶可能なキヤラ
クタ数である。例えば、第６図ｃに示すセクタエ
リアにおいては、１セクタ内で記憶可能なキヤラ
クタは６キヤラクタであるのでα＝６となる。そ
して、第６図ｉに示すレジスタISNに格納されて
いる空セクタ番号がＫの値に対応しているものと
すると、セクタのセクタ番号S0は“０”となり、
このセクタ番号S0の最初のアドレス番地は“０”
で、最後にアドレス番地は“５”となる。また、
セクタ番号S1は“１”となるので、このセクタ番
地S1の最初のアドレス番地は次のアドレス番地
“６”になる。このように使用するセクタの最初
のアドレス番地はα×ISNの式で設定され、新規
エリアの設定が終了する。
第７図で新規エリアの設定（ステツプSTP−
１３参照）が行なわれた最初のメツセージ情報あ
るいは継続のメツセージ情報は、ステツプSTP
−１４において１キヤラクタ分のデータをもつて
いるか判定される。そこで、１キヤラクタ分のデ
ータをもつていない場合には、引き続くメツセー
ジ信号に前記処理を加え、１キヤラクタ以上のデ
ータを得る。そして、１キヤラクタ分以上のデー
タをもつている場合には、ステツプSTP−１５，
STP−１６，STP−１７において１キヤラクタ
分のデータを第６図ｋに示すレジスタSTADで
指定されるアドレス番地に格納すると共にこのレ
ジスタSTADで指定されるアドレス番地を次の
アドレス番地に設定する。次にステツプSTP−
１８において、１セクタが満たされたかの判定を
行ない、、満たされない場合には、ステツプSTP
−２３に進む。ここで、情報エリアのデータの処
理が終了したかを判定し、終了しなければステツ
プSTP−１４に進み、さらに情報エリアの残り
のデータの処理を行なう。しかし、情報エリアの
データ処理が終了した場合には、ステツプSTP
−６に進み、次の受信信号の処理に移る。
また、ステツプSTP−１８において１セクタ
が満たされた場合には、第６図ｌに示すレジスタ
FIのSC番目の番地に、第６図ｉに示すレジスタ
ISNに格納されたセクタ番号を格納（ステツプ
STP−１９参照）すると共に、セクタの使用個
数を１個増やす（ステツプSTP−２０参照）。そ
して、次のステツプSTP−２１において１フア
イル中で使用されるセクタ数の管理を行なう。こ
こで、１フアイル中のセクタの使用個数が前記β
より大きければ、メツセージ情報の格納を打ち切
り、ステツプSTP−２４に進む。また、前記β
以下の場合には、ステツプSTP−２２の空セク
タの管理に移行する。
つぎに、空セクタ管理について第９図を用いて
説明する。
まず、１フアイル中のセクタが前記β以下と判
定されると、次に使用できるセクタが有るかの判
定（ステツプSTP−５０参照）を行なう。ここ
で、空セクタが有る場合にはその空セクタのセク
タ番号を第６図ｉに示すレジスタISNにセツト
（ステツプSTP−５１参照）し、そのセクタの最
初のアドレス番号の設定（ステツプSTP−５２
参照）を行なうが、空セクタが無い場合には、空
セクタを作る処理を行なう。この処理では、ま
ず、第６図ａに示すメモリーエリアのMoより順
にMiにフアイル番号Fjが格納されているかの判
定（ステツプSTP−５３，STP−５４，STP−
５５参照）を行ない、フアイル番号Fjが格納され
ている場合には、そのメモリーエリアが個別アド
レス対応のものか共通アドレス対応のものかの判
定（ステツプSTP−５６，STP−５７参照）を
行なう。ここで、個別アドレス対応のものであれ
ば、そこに格納されている情報の消去を行なうと
共に、その情報で使用されていた第６図ｅに示す
レジスタFSTおよび第６図ｆに示すレジスタ
SSTを“０”にし、それらのフアイルおよびセ
クタを使用可能にする（ステツプSTP−５８，
STP−５９，STP−６０参照）。このようにして
空セクタ作りが行なわれ、次の前記処理ステツプ
STP−５０，STP−５１，STP−５２に進む。
このような前記過程が空セクタ管理である。
第７図でステツプSTP−２２の空セクタの管
理を通過した情報はステツプSTP−２３に進み、
前記処理が行なわれる。そして、前記過程を繰り
返しセクタエリアに格納され続けた情報は、メツ
セージ情報の終了（ステツプSTP−９参照）、ま
たは、１フアイル中のセクタのオーバー（ステツ
プSTP−２１参照）によりセクタエリアおよび
第６図ｌに示すレジスタFIへの格納が終了し、
ステツプSTP−２４のフアイルエリアおよびメ
モリーエリアへの格納にうつる。
つぎに、第６図ｂおよびａに示すフアイルエリ
アおよびメモリーエリアへの格納動作について第
１０図を用いて説明する。
まず、第３図に示す１チツプCPU内の第５図
のランダム・アクセス・メモリRAM2にある第６
図ｌに示すレジスタFIに格納された１フアイル
分のセクタ番号のデータを第３図に示すRAM1の
レジスタIFN（第６図ｈ参照）で示されるフアイ
ルＦ（IFN）に送り、１フアイル分のセクタ番号
をフアイルＦ（IFN）に格納（ステツプSTP−７
０参照）する。次に、第６図ｇに示すレジスタ
ADより受信アドレス情報I1，I2を読み出すと共
に、対応する第６図ｄに示すレジスタMSTの内
容を読み出し、個別アドレス情報に応じたメモリ
ーエリアへの格納を行なうか、共通アドレス情報
に応じたメモリーエリアへの格納を行なうかの判
定（ステツプSTP−７１，STP７２参照）を行
なう。そしたて、共通アドレス情報の場合には、
受信された共通アドレスに対応したメモリーエリ
アにフアイルＦ（IFN）という番号を格納（ステ
ツプSTP−７３参照）する。また、個別アドレ
スの場合には、個別アドレス情報を格納している
第６図ａに示すメモリーエリア内で既受信個別ア
ドレス情報の移動を行ない、メモリーエリアの
M1を空にする（ステツプSTP−７４〜STP−８
２参照）。すなわち、ステツプSTP−７４では、
ｉをｎに設定し、ステツプSTP−７５〜STP−
７７では、Mo-1から順に個別アドレス情報が格
納されている第６図ａに示すメモリーエリアの番
号Miを捜し出す。そして、ステツプSTP−７８
においてｉの値をｘに与えることで、個別アドレ
ス情報が格納されているMiを保存する。
この新たな変数ｘを用いて、個別アドレス情報
の格納ができ、かつ、Miの次に大きいメモリー
エリアの番号Mxを捜し出し（ステツプSTP−７
９，STP−８０参照）、さらに、Miの個別アドレ
ス情報（Mi）をMxに移す（ステツプSTP−８１
参照）。そして、前記の個別アドレス情報の移動
をMo-1からM1までステツプSTP−８２の判定に
より行なう。これが終了すると、第６図ａに示す
メモリーエリアのM1は空のメモリーエリアとな
るのでM1にフアイル（IFN）という番号を格納
（ステツプSTP−８３参照）し、第６図ｂに示す
フアイルエリアおよび第６図ａに示すメモリーエ
リアへの格納を終了する。そして、第７図に示す
ステツプSTP−２４の通報表示の起動を行ない、
初期状態に戻る。この通報は第５図に示す鳴音制
御信号“AC”の信号で第２図に示すアドレスデ
コーダADを制御し、バツフアBUFを介して、ス
ピーカSPを駆動することにより行なわれる。ま
た、表示は、第５図のシリアルインターフエース
IFからのシステムクロツク信号、出力信号
“SO”および出力ボートOP7，OP8からの制御信
号（，Ｃ／）で第３図に示すLCDドライバ
DVを制御し、第２図に示す表示器DP上に行な
われる。
以上、本発明をMSTATUCSの設定を受信信
号のメツセージ処理情報によりソフトウエア的に
行う場合を例にとつて説明したが、本発明はこれ
に限定されるものではなく、予めハードウエア的
に設定することもできる。すなわち、第３図に示
す１チツプCPUにおいて、各受信アドレスに対
応する入力ポートを設け、それぞれの入力端子を
“High”または“LOW”にすることで、
MSTATUCSの設定を行うことができる。
前述したところから明らかなように、第３図に
示す１チツプCPUの第５図に示すRAM2にアド
レスを格納することができる第６図ｇに示すレジ
スタADおよび共通アドレス情報のメモリーエリ
アを指定する第６図ｄに示すレジスタMSTを設
け、それらの情報により個別アドレス情報および
共通アドレス情報を、それぞれ特徴に合つたメモ
リーエリアへの格納ができると共に、利用者が全
部の共通アドレスを使用しない場合においても、
メモリーエリアの有効利用がなされるという利点
がある。
〔発明の効果〕
以上説明したように、本発明によれば、複雑な
手段を用いることなく簡単な構成によつて、レジ
スタからの情報により個別アドレス情報および共
通アドレス情報を、それぞれの特徴に合つたメモ
リーエリアへの格納ができると共に利用者が全部
の共通アドレスを使用しない場合においても、メ
モリーエリアの有効利用がなされるので、実用上
の効果は極めて大である。また、予め各アドレス
対応のメモリーエリアを設けることで個別アドレ
ス情報の保護を図ることができると共に、複数の
共通アドレスを持ち各共通アドレス対応のメモリ
ーエリアをもつ情報受信機において、利用者が特
定の共通アドレス情報を必要としない場合には、
その特定の共通アドレスを格納できるメモリーエ
リアを、個別アドレス情報を格納できるメモリー
エリアとすることで、メモリーエリアの効率化を
図ることができるという点において極めて有効で
ある。
【図面の簡単な説明】
第１図は本発明に用いる受信信号の例を示す説
明図、第２図は本発明による表示機能付無線選択
呼出受信機の一実施例を示すブロツク図、第３図
は第２図の実施例におけるメツセージ処理部の具
体的構成の一例を示すブロツク図、第４図は本発
明に用いる選択呼出信号検出回路の一例を示す回
路図、第５図は第３図における１チツプCPUに
係る部分を抽出して示したブロツク図、第６図は
メツセージ格納処理を行うために用いるレジスタ
および記憶エリアの一例を示す構成図、第７図、
第８図、第９図および第１０図は本発明の動作説
明に供するフローチヤートである。 XL……水晶振動子、MEM……メモリ（Ｐ−
ROM）、ADR……アドレスデコーダ、MDI……
メツセージデータ処理部、DP……表示器、CPU
……１チツプCPU、RAM1，RAM2……ランダ
ム・アクセス・メモリ、EX・NOR1〜EX・
NOR4……排他的ノアゲート、CNT1〜CNT4…
…カウンタ、CONV……変換回路、OR……オア
ゲート、PRO−MEM……プログラム用メモリ、
MST，FST，SST，AD，IFN，ISN，SC，
STAD，FI……レジスタ。

Claims (1)

  1. 【特許請求の範囲】 １ 個別選択呼出番号と少なくとも１個以上の共
    通選択呼出番号を有する選択呼出受信機におい
    て、前記個別選択呼出番号に続くメツセージ信号
    を少なくとも１個以上格納する個別用エリアと前
    記共通選択呼出番号に続くメツセージ信号を格納
    する既設特定エリアから構成される第１の記憶手
    段を備えたことを特徴とする表示機能付無線選択
    呼出受信機。 ２ 個別選択呼出番号と少なくとも１個以上の共
    通選択呼出番号を有する選択呼出受信機におい
    て、前記個別選択呼出番号に続くメツセージ信号
    を少なくとも１個以上格納する個別用エリアと前
    記共通選択呼出番号に続くメツセージ信号を格納
    する既設特定エリアから構成される第１の記憶手
    段と、前記共通選択呼出番号によるサービスを受
    けるか否かの情報を格納する第２の記憶手段と、
    この第２の記憶手段の内容に応じてサービスを受
    けない選択呼出番号に対応する前記特定エリアを
    前記個別用エリアとして処理する制御手段とを備
    えたことを特徴とする表示機能付無線選択呼出受
    信機。 ３ 個別選択呼出番号と少なくとも１個以上の共
    通選択呼出番号を有する選択呼出受信機におい
    て、前記個別選択呼出番号に続くメツセージ信号
    を少なくとも１個以上格納する個別用エリアと前
    記共通選択呼出番号に続くメツセージ信号を格納
    する既設特定エリアから構成される第１の記憶手
    段と、前記共通選択呼出番号によるサービスを受
    けるか否かの情報を格納する第２の記憶手段と、
    この第２の記憶手段の内容に応じてサービスを受
    けない選択呼出番号に対応する前記特定エリアを
    前記個別用エリアとして処理する制御手段と、前
    記共通選択呼出番号によるサービスを受けるか否
    かの情報を前記メツセージ信号から復号する手段
    とを備えたことを特徴とする表示機能付無線選択
    呼出受信機。 ４ 個別選択呼出番号と少なくとも１個以上の共
    通選択呼出番号を有する選択呼出受信機におい
    て、前記個別選択呼出番号に続くメツセージ信号
    を少なくとも１個以上格納する個別用エリアと前
    記共通選択呼出番号に続くメツセージ信号を格納
    する既設特定エリアから構成される第１の記憶手
    段と、前記共通選択呼出番号によるサービスを受
    けるか否かの情報を格納する第２の記憶手段と、
    この第２の記憶手段の内容に応じてサービスを受
    けない選択呼出番号に対応する前記特定エリアを
    前記個別用エリアとして処理する制御手段と、前
    記共通選択呼出番号によるサービスを受けるか否
    かの情報を該共通選択呼出番号に対応する制御端
    子を論理“０”または論理“１”とすることで実
    現する手段とを備えたことを特徴とする表示機能
    付無線選択呼出受信機。
JP59046582A 1984-03-13 1984-03-13 表示機能付無線選択呼出受信機 Granted JPS60191531A (ja)

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AU39737/85A AU592053B2 (en) 1984-03-13 1985-03-12 Paging receivers
CA000476276A CA1278345C (en) 1984-03-13 1985-03-12 Paging receivers
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US07/173,766 US4873519A (en) 1984-03-13 1988-03-28 Paging receiver having independent memory areas for common and individual addresses
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