JPH02138456A - スパツタリング方法と装置および応用製品 - Google Patents
スパツタリング方法と装置および応用製品Info
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- JPH02138456A JPH02138456A JP63060421A JP6042188A JPH02138456A JP H02138456 A JPH02138456 A JP H02138456A JP 63060421 A JP63060421 A JP 63060421A JP 6042188 A JP6042188 A JP 6042188A JP H02138456 A JPH02138456 A JP H02138456A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、イオン衝撃による薄膜形成方法と薄膜形成装
置およびその応用製品に係る。本発明は特にラージ・ス
ケール・インテグレーテッド・サーキットのバリヤ層或
いは配線膜に適用するのに好適である。
置およびその応用製品に係る。本発明は特にラージ・ス
ケール・インテグレーテッド・サーキットのバリヤ層或
いは配線膜に適用するのに好適である。
ラージ・スケール・インテグレーテッド・サーキット(
LSI)或いはベーリ・ラージ・スケール・インテグレ
ーテッド・サーキット(VLSI)の集積度が進むと、
シリコン基板上アルミニウム配線間のコンタクトホール
やアルミニウム配線間のスルーホール径が小さくなり、
第21図に示すアスペクト比が大きくなってくる。一般
に用いられているマグネトロンスパッタ法では、アスペ
クト比が1に近づいてくると配線材料のスパッタ付着時
のシャドーイング効果により、第21図に示すステップ
カバレッジが悪くなり、配線抵抗の増大やエレクトロマ
イグレーションなどによる断線が発生しやすくなる。こ
れを改善するため、特開昭61−261472号公報に
示すように、ターゲットと基板に負の電圧を印加しなが
ら膜形成するバイアススパッタ法が開発された。第16
図はその一例で直流マグネトロンバイアススパッタ法の
原理を示している。ターゲット6にスパッタ用直流電源
12、基板8にはバイアス(逆スパッタ)用直流電源1
1が接続されている。これらの電極には第17図の波形
の模式図が示すように模形成時には常時負の電圧が印加
されているため、基板8はArイオン衝撃(逆スパッタ
)を受けながら膜が形成されていく。このため、バイア
スなしのスパッタ法に比ベステップ力バレツジを改善で
きる。
LSI)或いはベーリ・ラージ・スケール・インテグレ
ーテッド・サーキット(VLSI)の集積度が進むと、
シリコン基板上アルミニウム配線間のコンタクトホール
やアルミニウム配線間のスルーホール径が小さくなり、
第21図に示すアスペクト比が大きくなってくる。一般
に用いられているマグネトロンスパッタ法では、アスペ
クト比が1に近づいてくると配線材料のスパッタ付着時
のシャドーイング効果により、第21図に示すステップ
カバレッジが悪くなり、配線抵抗の増大やエレクトロマ
イグレーションなどによる断線が発生しやすくなる。こ
れを改善するため、特開昭61−261472号公報に
示すように、ターゲットと基板に負の電圧を印加しなが
ら膜形成するバイアススパッタ法が開発された。第16
図はその一例で直流マグネトロンバイアススパッタ法の
原理を示している。ターゲット6にスパッタ用直流電源
12、基板8にはバイアス(逆スパッタ)用直流電源1
1が接続されている。これらの電極には第17図の波形
の模式図が示すように模形成時には常時負の電圧が印加
されているため、基板8はArイオン衝撃(逆スパッタ
)を受けながら膜が形成されていく。このため、バイア
スなしのスパッタ法に比ベステップ力バレツジを改善で
きる。
なお符号7はマグネット、10は絶縁物、17は真空容
器を示している。
器を示している。
しかし、このようなバイアススパッタ法では。
結晶(111)配向性が著しく低下することが明らかと
なってきた。結晶粒の配向性とエレクトロマイグレーシ
ョン、ストレスマイグレーションとは関連があり、配向
性が良い程、エレク1へロマイグレーション、ストレス
マイグレーションの耐性が同士することが知られている
。そこで、本発明の目的は、膜質とステップカバレッジ
の両方を満足できる膜形成方法および装置を提供するに
ある。
なってきた。結晶粒の配向性とエレクトロマイグレーシ
ョン、ストレスマイグレーションとは関連があり、配向
性が良い程、エレク1へロマイグレーション、ストレス
マイグレーションの耐性が同士することが知られている
。そこで、本発明の目的は、膜質とステップカバレッジ
の両方を満足できる膜形成方法および装置を提供するに
ある。
本発明の他の目的は、かかる方法によって形成された膜
を具備する集積回路装置を提供するにある。
を具備する集積回路装置を提供するにある。
上記の目的を達成するために、本発明による膜形成方法
は、ターゲットと基板の両方に負の電圧を印加してスイ
ッチングし、膜形成と逆スパッタを交互に行うことにあ
る。
は、ターゲットと基板の両方に負の電圧を印加してスイ
ッチングし、膜形成と逆スパッタを交互に行うことにあ
る。
又、ターゲットと基板の両方にいずれもベース電圧を含
む負のパルス電圧を印加してスイッチングすることにあ
る。
む負のパルス電圧を印加してスイッチングすることにあ
る。
結晶粒の配向に及ぼす因子として、真空容器内に残留す
る02.N2.N20などの不純ガスがある。これらが
スパッタ粒子に混入すると、結晶方位の異なる結晶核を
発生させることと、成長過程に堆積欠陥を成長させるた
め膜質が低下する。
る02.N2.N20などの不純ガスがある。これらが
スパッタ粒子に混入すると、結晶方位の異なる結晶核を
発生させることと、成長過程に堆積欠陥を成長させるた
め膜質が低下する。
第18図は従来法のDCマグネトロンバイアススパッタ
法の膜形成メカニズムを模式的に示したものである。第
16図、第17図に示すように基板8とターゲット6に
負の電圧が常に印加されているため、基板に付着したA
Qと不純物の一部が逆スパッタされる。逆スパッタされ
た不純物は原子状に解離され活性化している。これがタ
ーゲットから飛来してくるAl1のスパッタ粒子に再混
入するため、さらに膜質が低下する。そこで、本発明で
は第2図に示す波形の模式図のように、ターゲットと基
板に印加する電圧を交互にスイッチングすることにより
、上記の問題点を解決した。第4図、第5図に本発明の
膜形成メカニズムを示す。
法の膜形成メカニズムを模式的に示したものである。第
16図、第17図に示すように基板8とターゲット6に
負の電圧が常に印加されているため、基板に付着したA
Qと不純物の一部が逆スパッタされる。逆スパッタされ
た不純物は原子状に解離され活性化している。これがタ
ーゲットから飛来してくるAl1のスパッタ粒子に再混
入するため、さらに膜質が低下する。そこで、本発明で
は第2図に示す波形の模式図のように、ターゲットと基
板に印加する電圧を交互にスイッチングすることにより
、上記の問題点を解決した。第4図、第5図に本発明の
膜形成メカニズムを示す。
ターゲットに負の電圧を印加しAQのスパッタ粒子を基
板に付着させる。このとき、真空容器内の残留不純ガス
も基板表面の膜内部に混入する。次にターゲットに印加
されている電圧をOFFにし、基板に負の電圧を印加す
ると基板に付着したAQと不純物の一部はArイオン衝
撃により逆スパッタされ、膜は清浄化され且つ整形され
る。この動作を連続してくり返して膜を形成して行くた
め配向性とステップカバレッジの良い膜が形成される。
板に付着させる。このとき、真空容器内の残留不純ガス
も基板表面の膜内部に混入する。次にターゲットに印加
されている電圧をOFFにし、基板に負の電圧を印加す
ると基板に付着したAQと不純物の一部はArイオン衝
撃により逆スパッタされ、膜は清浄化され且つ整形され
る。この動作を連続してくり返して膜を形成して行くた
め配向性とステップカバレッジの良い膜が形成される。
これが本発明の基本的な考えである。しかし、スパッタ
とバイアス電圧を交互にスイッチングし、完全に電圧を
0にすると、成膜放電範囲が限定される。なぜなら、第
】−図の本発明の装置が示すようにターゲットにはマグ
ネット7が設置されており、これがプラズマを集束させ
l O−3Torr台でスパッタ放電を可能にしている
。しかし、基板8にはマグネットは設置されていないた
め、基板に負の電圧を印加しても放電できない。したが
って基板は逆スパッタされない。しかし、本発明ではタ
ーゲット6と基板8の間にコイル5を設置し、これに高
周波を印加しプラズマを発生させることにより、高真空
域での放電を安定に持続できるようにしである。本発明
によればAr雰囲気圧力を10−3Torrよりも低く
することができる。そのため、ターゲット6とアースさ
れた真空容器17間の放電が完全にOになっても、基板
に電圧が印加されれば、基板上真空容器アース間で放電
することができる。しかし、成膜条件によっては、まだ
放電(バイアス電流)が不十分な場合もある。そこで、
本発明は第3図の波形の模式図が示すように5電圧をタ
ーゲットから基板に切り換えるとき、スパッタ電圧(電
力)を完全にOにしないで、スパッタ(膜形成時)の時
より電圧(fl!力)を低くしてスパッタ放電を持続さ
せておく。これにより、Arイオンの一部は基板に流れ
込み基板は逆スパッタされる。しかし、この電圧を高く
すると不純物の再混入が多くなるため適正値を設定しな
ければならない、また、上記の因子の他に、スイッチン
グ周期、バイアスとスパッタの通電比などの因子を適切
に選ぶことにより、膜特性とステップカバレッジを大幅
に改善できる。
とバイアス電圧を交互にスイッチングし、完全に電圧を
0にすると、成膜放電範囲が限定される。なぜなら、第
】−図の本発明の装置が示すようにターゲットにはマグ
ネット7が設置されており、これがプラズマを集束させ
l O−3Torr台でスパッタ放電を可能にしている
。しかし、基板8にはマグネットは設置されていないた
め、基板に負の電圧を印加しても放電できない。したが
って基板は逆スパッタされない。しかし、本発明ではタ
ーゲット6と基板8の間にコイル5を設置し、これに高
周波を印加しプラズマを発生させることにより、高真空
域での放電を安定に持続できるようにしである。本発明
によればAr雰囲気圧力を10−3Torrよりも低く
することができる。そのため、ターゲット6とアースさ
れた真空容器17間の放電が完全にOになっても、基板
に電圧が印加されれば、基板上真空容器アース間で放電
することができる。しかし、成膜条件によっては、まだ
放電(バイアス電流)が不十分な場合もある。そこで、
本発明は第3図の波形の模式図が示すように5電圧をタ
ーゲットから基板に切り換えるとき、スパッタ電圧(電
力)を完全にOにしないで、スパッタ(膜形成時)の時
より電圧(fl!力)を低くしてスパッタ放電を持続さ
せておく。これにより、Arイオンの一部は基板に流れ
込み基板は逆スパッタされる。しかし、この電圧を高く
すると不純物の再混入が多くなるため適正値を設定しな
ければならない、また、上記の因子の他に、スイッチン
グ周期、バイアスとスパッタの通電比などの因子を適切
に選ぶことにより、膜特性とステップカバレッジを大幅
に改善できる。
「実施例1」
第1図、第3図を参照して、本発明による膜厚形成装置
の実施例を示す6第3図は本発明の波形の模式図である
。ここで、PWはスパッタピーク電力、BWはスパッタ
ベース電力、Pvはバイアスピーク電圧、BVはバイア
スベース電圧、BW/PWはスパッタベース電力比、T
2/(T1+T2)はバイアス比、(T1+T2)はス
イッチング周期とする。第1図において、2はスパッタ
電力波形制御電源、1は逆スパッタ定電圧波形制御電源
、4はバイアス電流検出センサー、5はプラズマを発生
するための高周波コイル、3はバイアス電流制御と高真
空域で安定に放電できるようにするためのバイアス電流
制御高周波電源、17は膜形成を行う真空容器、8は基
板(たとえばSi基板)、6はターゲット、10は絶縁
物、9はCPUなどから構成されている任意波形発生器
でスパッタ、バイアス、バイアス電流の波形の設定とプ
ログラム制御を行うものである。このように構成された
薄膜形成装置において、まず、任意波形発生器9で、ス
パッタ電力波形およびバイアス電圧波形(逆スパッタ)
とバイアス電流を設定する。設定されたそれぞれの信号
は、スパッタ電力波形制御型源2.逆スパッタ定電圧波
形制御世源l、バイアス電流制御高周波電源3に供給さ
れる。これらの電源は負荷などが変動しても、常に設定
された波形になるようにフィードバックされている。こ
のため設定値を独立に変えても他の因子には影響を及ぼ
さない。本発明の特徴の一つであるバイアス電流の制御
方式について詳細に説明する。バイアス電流は、バイア
ス電圧Pvを例えば150Vに設定しても、スパッタ電
力などを変えれば大きく変動する。これを防止するため
バイアス電流検出センサー4でバイアス電流を検出し、
任意波形発生器9からの設定信号と比較し常に設定され
た値になるように高周波コイル5に供給する高周波電力
をバイアス電流制御高周波電源3により制御し一定に保
持している。また、これらの動作は高真空域で安定に放
電を持続させるのにも役だっている。以下、第1図に示
した薄膜形成装置による薄膜形成について第6図〜第1
0図を用いて説明する。以下の説明で共通条件としてタ
ーゲットにはAQ−1重量%Si合金、基板にはSiウ
ェハーを用い、真空到達圧力は3 X 10−7Tor
r、放電圧力はArガス雰囲気で5 X 10−’To
rrとした。まず、スパッタ放電持続に及ぼす高周波電
力(コイルに印加する)とAr雰囲気圧力との関係を第
6図に示す。スパッタ電力を500Wの一定にし、コイ
ルに印加する高周波電力をO〜200Wに変えた場合で
ある。高周波電力がOWの時、放電限界圧力は9 X
I O−’Torrであるが、高周波電力が増加するに
したがって放電限界圧力は低下して行く。しかし、高周
波電力が100W付近になると低下は少なくほぼ一定と
なり、これ以上高周波電力をコイルに供給しても放電限
界圧力は8X 10−3Torrである。このように本
発明は、従来法のDCマグネトロンスパッタ法に比べ1
桁以上高真空域で放電できるため膜質の向上に役だって
いる。第7図はスイッチング周期(T1+T2) を1
秒、バイアスピーク電圧Pvを150v、バイアスベー
ス電圧B’Vを50V、バイアス電流を0.3Aにし、
スパッタベース電力比(BW/PW)を0〜1に変えX
線回折強度(111)に及ぼすスパッタベース電力比の
影響を調べたものである。
の実施例を示す6第3図は本発明の波形の模式図である
。ここで、PWはスパッタピーク電力、BWはスパッタ
ベース電力、Pvはバイアスピーク電圧、BVはバイア
スベース電圧、BW/PWはスパッタベース電力比、T
2/(T1+T2)はバイアス比、(T1+T2)はス
イッチング周期とする。第1図において、2はスパッタ
電力波形制御電源、1は逆スパッタ定電圧波形制御電源
、4はバイアス電流検出センサー、5はプラズマを発生
するための高周波コイル、3はバイアス電流制御と高真
空域で安定に放電できるようにするためのバイアス電流
制御高周波電源、17は膜形成を行う真空容器、8は基
板(たとえばSi基板)、6はターゲット、10は絶縁
物、9はCPUなどから構成されている任意波形発生器
でスパッタ、バイアス、バイアス電流の波形の設定とプ
ログラム制御を行うものである。このように構成された
薄膜形成装置において、まず、任意波形発生器9で、ス
パッタ電力波形およびバイアス電圧波形(逆スパッタ)
とバイアス電流を設定する。設定されたそれぞれの信号
は、スパッタ電力波形制御型源2.逆スパッタ定電圧波
形制御世源l、バイアス電流制御高周波電源3に供給さ
れる。これらの電源は負荷などが変動しても、常に設定
された波形になるようにフィードバックされている。こ
のため設定値を独立に変えても他の因子には影響を及ぼ
さない。本発明の特徴の一つであるバイアス電流の制御
方式について詳細に説明する。バイアス電流は、バイア
ス電圧Pvを例えば150Vに設定しても、スパッタ電
力などを変えれば大きく変動する。これを防止するため
バイアス電流検出センサー4でバイアス電流を検出し、
任意波形発生器9からの設定信号と比較し常に設定され
た値になるように高周波コイル5に供給する高周波電力
をバイアス電流制御高周波電源3により制御し一定に保
持している。また、これらの動作は高真空域で安定に放
電を持続させるのにも役だっている。以下、第1図に示
した薄膜形成装置による薄膜形成について第6図〜第1
0図を用いて説明する。以下の説明で共通条件としてタ
ーゲットにはAQ−1重量%Si合金、基板にはSiウ
ェハーを用い、真空到達圧力は3 X 10−7Tor
r、放電圧力はArガス雰囲気で5 X 10−’To
rrとした。まず、スパッタ放電持続に及ぼす高周波電
力(コイルに印加する)とAr雰囲気圧力との関係を第
6図に示す。スパッタ電力を500Wの一定にし、コイ
ルに印加する高周波電力をO〜200Wに変えた場合で
ある。高周波電力がOWの時、放電限界圧力は9 X
I O−’Torrであるが、高周波電力が増加するに
したがって放電限界圧力は低下して行く。しかし、高周
波電力が100W付近になると低下は少なくほぼ一定と
なり、これ以上高周波電力をコイルに供給しても放電限
界圧力は8X 10−3Torrである。このように本
発明は、従来法のDCマグネトロンスパッタ法に比べ1
桁以上高真空域で放電できるため膜質の向上に役だって
いる。第7図はスイッチング周期(T1+T2) を1
秒、バイアスピーク電圧Pvを150v、バイアスベー
ス電圧B’Vを50V、バイアス電流を0.3Aにし、
スパッタベース電力比(BW/PW)を0〜1に変えX
線回折強度(111)に及ぼすスパッタベース電力比の
影響を調べたものである。
スパッタベース電力比がO〜0.3付近で370K c
psの最大値を示しているが、これ以上、スパッタベー
ス電力比が大きくなると回折強度は大きく低下し、スパ
ッタベース電力比1で130Kcpsになる。すなわち
、スパッタベース電力比が1に近づくにしたがってX線
回折強度が低下するのはスパッタ電力が従来法と同じく
連続放電に近づくため真空容器内の不純物ガス (Nz、02.HzO)が膜内に混入して行くためであ
る。
psの最大値を示しているが、これ以上、スパッタベー
ス電力比が大きくなると回折強度は大きく低下し、スパ
ッタベース電力比1で130Kcpsになる。すなわち
、スパッタベース電力比が1に近づくにしたがってX線
回折強度が低下するのはスパッタ電力が従来法と同じく
連続放電に近づくため真空容器内の不純物ガス (Nz、02.HzO)が膜内に混入して行くためであ
る。
なお、同一条件における従来法の回折強度は8 Kcp
sであった。本発明は従来法の約50倍の回折強度があ
り、いかに、結晶粒の配向性が優れているかがわかる。
sであった。本発明は従来法の約50倍の回折強度があ
り、いかに、結晶粒の配向性が優れているかがわかる。
第8図は第7図で最大の回折強度が得られたスノ(ツタ
ベース電力比を0.3 にし、スイッチング周期(T
1+T2)を0.1〜100秒に変え、回折強度に及ぼ
すスイッチング周期の影響を調べたものである。スイッ
チング周期が0.1 〜10秒の範囲では、はぼ一定で
あるが、100秒になると大幅に低下する。このように
、スイッチング周期も重要な因子であり、材料や使用目
的によってスイッチング周期を変える必要がある。第9
図は(111)配向面のX線回折強度とエレクトロマイ
グレーションによる配線寿命との関係を調べたものであ
る。Si基板上に厚さ0.5 μm成膜後、幅0,8
μm、長さ2mのストライプパターンを加工し、4
50℃X60分の熱処理をした。これに保護膜として厚
さ1μmの5iOz膜をCVD法で形成した。試験温度
は150℃、電流密度は2X10’A/c!llで行な
い配線が判断するまでの時間を測定した。第9図におい
てX線回折強度が8Kcps〜70 Kcpsに増加す
ると断線時間も40〜510時間と大幅に伸びX線回折
強度(配向性)と耐マイグレーション性は相関関係があ
ることがわかる。また、従来法のDCマグネトロンバイ
アススパッタ法で成膜したものは同図に示しであるよう
に回折強度は8Kcpsである。このときの断線時間は
40時間、本発明の最大回折強度37 Kcpsでは5
10時間であるから、本発明は従来法に比べ約14倍耐
マイグレーシヨン性が向上した。第10図はステップカ
バレッジに及ぼすバイアス比(T 2/(T l +T
2))の影響を示す。
ベース電力比を0.3 にし、スイッチング周期(T
1+T2)を0.1〜100秒に変え、回折強度に及ぼ
すスイッチング周期の影響を調べたものである。スイッ
チング周期が0.1 〜10秒の範囲では、はぼ一定で
あるが、100秒になると大幅に低下する。このように
、スイッチング周期も重要な因子であり、材料や使用目
的によってスイッチング周期を変える必要がある。第9
図は(111)配向面のX線回折強度とエレクトロマイ
グレーションによる配線寿命との関係を調べたものであ
る。Si基板上に厚さ0.5 μm成膜後、幅0,8
μm、長さ2mのストライプパターンを加工し、4
50℃X60分の熱処理をした。これに保護膜として厚
さ1μmの5iOz膜をCVD法で形成した。試験温度
は150℃、電流密度は2X10’A/c!llで行な
い配線が判断するまでの時間を測定した。第9図におい
てX線回折強度が8Kcps〜70 Kcpsに増加す
ると断線時間も40〜510時間と大幅に伸びX線回折
強度(配向性)と耐マイグレーション性は相関関係があ
ることがわかる。また、従来法のDCマグネトロンバイ
アススパッタ法で成膜したものは同図に示しであるよう
に回折強度は8Kcpsである。このときの断線時間は
40時間、本発明の最大回折強度37 Kcpsでは5
10時間であるから、本発明は従来法に比べ約14倍耐
マイグレーシヨン性が向上した。第10図はステップカ
バレッジに及ぼすバイアス比(T 2/(T l +T
2))の影響を示す。
スイッチング周期(T1+T2)は1sec、スパッタ
ベース電力比(BW/PW)は0.3、バイアスピーク
電圧(pv)は150vの成膜条件にし、スルーホール
径が0.8 μm、アスペクト比が1のパターンをSi
基板に形成し、これに膜形成してステップカバ(フッソ
の状況をSEMII!で調べた。ステップカバレッジは
バイアス比が0.3で60%の最大値を示すが、これよ
りも、バイアス比が増減してもステップカバレッジは低
下する。
ベース電力比(BW/PW)は0.3、バイアスピーク
電圧(pv)は150vの成膜条件にし、スルーホール
径が0.8 μm、アスペクト比が1のパターンをSi
基板に形成し、これに膜形成してステップカバ(フッソ
の状況をSEMII!で調べた。ステップカバレッジは
バイアス比が0.3で60%の最大値を示すが、これよ
りも、バイアス比が増減してもステップカバレッジは低
下する。
また、同図に示しであるスルーホール断面の膜形状が示
すようにバイアス比を変えることにより膜形状を制御す
ることができる。例えば成膜初期にはバイアス比を大き
くし時間と共にバイアス比を小さくして行けば、より一
層ステップカバレッジを向上させることが可能である。
すようにバイアス比を変えることにより膜形状を制御す
ることができる。例えば成膜初期にはバイアス比を大き
くし時間と共にバイアス比を小さくして行けば、より一
層ステップカバレッジを向上させることが可能である。
また、本発明と同じバイアス電圧150Vで成膜した、
従来法DCマグネトロンバイアススパッタ法のステップ
カバレッジは22%であった。本発明はバイアス比を変
えることにより膜形状を変えることができるが、従来法
はバイアス電圧を固定してしまえば変える因子がないた
めステップカバレッジは向上しない。なお、従来法でバ
イアス電圧を高くするとイオンの運動エネルギーが大き
くなるため、ステップカバレッジは多少改善できる。し
かし、イオン衝撃により基板の損傷が生じ膜質はさらに
低下する。
従来法DCマグネトロンバイアススパッタ法のステップ
カバレッジは22%であった。本発明はバイアス比を変
えることにより膜形状を変えることができるが、従来法
はバイアス電圧を固定してしまえば変える因子がないた
めステップカバレッジは向上しない。なお、従来法でバ
イアス電圧を高くするとイオンの運動エネルギーが大き
くなるため、ステップカバレッジは多少改善できる。し
かし、イオン衝撃により基板の損傷が生じ膜質はさらに
低下する。
第22図は、第1図に示す膜形成装置を用いて本発明の
方法によりSi基板上にAQ膜を形成したときの(11
1)配向性に及ぼすAr雰囲気圧力の影響を、従来の各
種の方法と比較して示したものである。
方法によりSi基板上にAQ膜を形成したときの(11
1)配向性に及ぼすAr雰囲気圧力の影響を、従来の各
種の方法と比較して示したものである。
本発明のAQ膜形成条件は、スパッタリングと逆スパッ
タリングのスイッチング周期を1秒、バイアスピーク電
圧を150■、バイアス比を0.3、スパッタベース電
力比をO63とした。
タリングのスイッチング周期を1秒、バイアスピーク電
圧を150■、バイアス比を0.3、スパッタベース電
力比をO63とした。
従来法においてスパッタ法とは逆スパッタを行なわない
方法であり、バイアススパッタ法とは基板に負の電圧を
印加しながらスパッタする方法であり、波形制御交流ス
パッタ法とは交流を用いてスパッタし且つ電圧の波形を
制御した方法(特願昭61−169590号に記載の方
法)である。本発明によれば10−’Torrよりも低
い圧力で膜形成できるようになりX線回折強度を従来法
にくらべて著しく高くすることができる。
方法であり、バイアススパッタ法とは基板に負の電圧を
印加しながらスパッタする方法であり、波形制御交流ス
パッタ法とは交流を用いてスパッタし且つ電圧の波形を
制御した方法(特願昭61−169590号に記載の方
法)である。本発明によれば10−’Torrよりも低
い圧力で膜形成できるようになりX線回折強度を従来法
にくらべて著しく高くすることができる。
これに対して、従来法ではAr雰囲気圧力を10−aよ
りも低くすることはできずX線回折強度も100 Xc
psが限界である。本発明はAM膜の(111)面のX
線回折強度を150 Xcps以上にできる唯一の方法
である。
りも低くすることはできずX線回折強度も100 Xc
psが限界である。本発明はAM膜の(111)面のX
線回折強度を150 Xcps以上にできる唯一の方法
である。
「実施例2」
実施例1はターゲットが導電性のものには有効であるが
、ターゲットが絶縁物では放電することができない、そ
こで第1図のスパッタ電力波形制御室′g2.逆スパッ
タ定電圧波形制御電g1を13.5MHz程度の高周波
電源にし、第11図の波形の模式図のようにすることに
よりターゲットが絶縁物でも放電ができるようにしたも
のである。実施例1の方法でAfiを成形しパターニン
グ後、多層配線の層間絶縁膜としてSiO2,を成膜し
たが、段差部の密着も良く、また、表面の段差がなくな
り平坦化できた。
、ターゲットが絶縁物では放電することができない、そ
こで第1図のスパッタ電力波形制御室′g2.逆スパッ
タ定電圧波形制御電g1を13.5MHz程度の高周波
電源にし、第11図の波形の模式図のようにすることに
よりターゲットが絶縁物でも放電ができるようにしたも
のである。実施例1の方法でAfiを成形しパターニン
グ後、多層配線の層間絶縁膜としてSiO2,を成膜し
たが、段差部の密着も良く、また、表面の段差がなくな
り平坦化できた。
[実施例3ノ
コンタクトホールが1μm以下になるとコンタクト抵抗
は急激に増加する。これはSi基板からAQ配線部に析
出してくるSiの粒径が1μmを超すものがあるからで
ある。これを防止する一つの方式としてバリヤメタルが
ある6バリヤメタルには種々のものがあるが、TiNは
AρとSiの反応をおさえる点で最も優れているといわ
れている。しかし、TiNはDCマグネトロンスパッタ
法で、ターゲットにTiを用いAr+Nx+Ox雰囲気
で膜形成すると、第20図の膜断面が示すように結晶は
柱状晶に成長する。この膜特性は膜に残留する応力は少
なく、亀裂などの欠陥は生じずバリヤ効果が大きい、し
かし、比抵抗は1000〜2000μΩ・備と大きい欠
点がある。一方、基板に負のバイアス(逆スパッタ)を
与えながら膜形成したものは第19図に示すように結晶
は微細化し粒状化している。この膜の比抵抗は上記のも
のに比べ50〜200μΩ・lとなり大幅に低下する。
は急激に増加する。これはSi基板からAQ配線部に析
出してくるSiの粒径が1μmを超すものがあるからで
ある。これを防止する一つの方式としてバリヤメタルが
ある6バリヤメタルには種々のものがあるが、TiNは
AρとSiの反応をおさえる点で最も優れているといわ
れている。しかし、TiNはDCマグネトロンスパッタ
法で、ターゲットにTiを用いAr+Nx+Ox雰囲気
で膜形成すると、第20図の膜断面が示すように結晶は
柱状晶に成長する。この膜特性は膜に残留する応力は少
なく、亀裂などの欠陥は生じずバリヤ効果が大きい、し
かし、比抵抗は1000〜2000μΩ・備と大きい欠
点がある。一方、基板に負のバイアス(逆スパッタ)を
与えながら膜形成したものは第19図に示すように結晶
は微細化し粒状化している。この膜の比抵抗は上記のも
のに比べ50〜200μΩ・lとなり大幅に低下する。
しかし膜の残留応力が大きく亀裂が発生しやすく、また
、バリヤ効果が少ない欠点がある。
、バリヤ効果が少ない欠点がある。
バリヤ材としては比抵抗ができるだけ小さくバリヤ効果
の大きいものが良い、しかし、いずれの方法も相反する
ものであり、実用化の障害になっている。すなわち、ス
パッタと逆スパッタを交互にスイッチングして膜形成す
れば第12図のように柱状晶と粒状晶の層状膜となり、
それぞれの特長がいかされた膜が形成できるものと考え
た。そこでスイッチング周期を10sec、バイアス比
を0.5.スパッタベース電力比を0.3、ターゲット
をTiとし、Ar (7,5) 十Nz (2)+0x
(0,5)の雰囲気で膜形成した。その結果、比抵抗は
180〜250μΩ・国が得られ、450℃の熱処理を
行なってもバリヤ層を破壊しAQ配線部にSiが析出し
たり、膜に亀裂が発生することはなかった。このように
、本発明は反応性スパッタに応用し複合膜を形成するこ
とができる。
の大きいものが良い、しかし、いずれの方法も相反する
ものであり、実用化の障害になっている。すなわち、ス
パッタと逆スパッタを交互にスイッチングして膜形成す
れば第12図のように柱状晶と粒状晶の層状膜となり、
それぞれの特長がいかされた膜が形成できるものと考え
た。そこでスイッチング周期を10sec、バイアス比
を0.5.スパッタベース電力比を0.3、ターゲット
をTiとし、Ar (7,5) 十Nz (2)+0x
(0,5)の雰囲気で膜形成した。その結果、比抵抗は
180〜250μΩ・国が得られ、450℃の熱処理を
行なってもバリヤ層を破壊しAQ配線部にSiが析出し
たり、膜に亀裂が発生することはなかった。このように
、本発明は反応性スパッタに応用し複合膜を形成するこ
とができる。
なお第23図は、集積回路を有するSi基板上に上記方
法によってTiN膜を形成し、その上にAQ配線膜を形
成し、更にその上を5iOzよりなる保護膜で被った構
造を示している。保護膜はS i Oxに限るものでは
ない。
法によってTiN膜を形成し、その上にAQ配線膜を形
成し、更にその上を5iOzよりなる保護膜で被った構
造を示している。保護膜はS i Oxに限るものでは
ない。
「実施例4ノ
実施例1では第1図の装置構成図が示すようにターゲッ
トを用い真空容器のアースとターゲット間に発生するイ
オンによりスパッタで膜形成をしていたが、この蒸発源
を電子ビーム蒸着、抵抗加熱蒸着、高周波加熱蒸着とし
ても良い。第13図は蒸発源を電子ビーム蒸発源とした
実施例である。
トを用い真空容器のアースとターゲット間に発生するイ
オンによりスパッタで膜形成をしていたが、この蒸発源
を電子ビーム蒸着、抵抗加熱蒸着、高周波加熱蒸着とし
ても良い。第13図は蒸発源を電子ビーム蒸発源とした
実施例である。
フィラメント13で熱電子を発生させ、熱電子加速電圧
波形制御電源11で熱電子を加速し、その熱電子を偏向
コイル16で蒸発物質14に集中するように制御して蒸
発させている。符号12はフィラメント加熱電源、符号
15はるつぼである。
波形制御電源11で熱電子を加速し、その熱電子を偏向
コイル16で蒸発物質14に集中するように制御して蒸
発させている。符号12はフィラメント加熱電源、符号
15はるつぼである。
この動作と基板8に印加する電圧を交互にスイッチング
することにより膜形成することを基本としている。しか
し、電子ビームをパルス的に蒸発物質14に与えても熱
慣性があるためすぐには蒸発しない。これを防止するた
め、第14図の各部の波形の模式図が示すように、基板
8に負の電圧が印加され逆スパッタされている期間は電
子ビーム(熱電子加速電圧)を完全にOFFすることな
く、ベースの電子ビームを流しておく。このベースの電
子ビームにより蒸発物質は予熱されているので蒸発物質
14の蒸発の応答性と制御性が改善される。また、電子
ビームの出力を変化させる熱電子加速電圧波形制御電源
の波形出力を変えると電子ビームの集点がずれてしまう
。これを防止するため偏向コイル16に印加する電圧を
熱電子波形出力(電圧)に同期させて集点ずれを防止し
ている。
することにより膜形成することを基本としている。しか
し、電子ビームをパルス的に蒸発物質14に与えても熱
慣性があるためすぐには蒸発しない。これを防止するた
め、第14図の各部の波形の模式図が示すように、基板
8に負の電圧が印加され逆スパッタされている期間は電
子ビーム(熱電子加速電圧)を完全にOFFすることな
く、ベースの電子ビームを流しておく。このベースの電
子ビームにより蒸発物質は予熱されているので蒸発物質
14の蒸発の応答性と制御性が改善される。また、電子
ビームの出力を変化させる熱電子加速電圧波形制御電源
の波形出力を変えると電子ビームの集点がずれてしまう
。これを防止するため偏向コイル16に印加する電圧を
熱電子波形出力(電圧)に同期させて集点ずれを防止し
ている。
次に本装置を用い種々の実験を行なった結果、AQ膜の
結晶粒配向性(111)は実施例1に比べX線回折強度
で30%減、膜形成速度は3倍となった。
結晶粒配向性(111)は実施例1に比べX線回折強度
で30%減、膜形成速度は3倍となった。
「実施例5」
第15図の実施例は、ターゲット6を衝撃するイオン源
と基板を衝撃するイオン源を独立に持ち。
と基板を衝撃するイオン源を独立に持ち。
それぞれのイオン源を交互にスイッチングすることによ
り膜形成と逆スパッタを行う方法である。
り膜形成と逆スパッタを行う方法である。
イオン源はマイクロ波方式、高周波方式、熱電子方式と
することができる。第15図の実施例はマイクロ波方式
の例である。任意波形発生器9からの信号によりそれぞ
れ波形制御されたクイクロ波を波形制御マイクロ波′W
3.g19で発生させ導波管22でプラズマ発生室24
に導き、プラズマを発生させる。それぞれのプラズマ発
生室にはメツシュ電極でできたイオン引き出し電極21
がついている。これに波形制御イオン引き出し電源20
で負の電圧を印加することにより、真空容器17内にイ
オンを引き出し、それぞれのイオン源により、ターゲッ
トと基板を交互にスイッチングして膜形成と逆スパッタ
を行なう方法である。この方式の特長はマイクロ波出力
、あるいはイオン引き出し電圧を変えることによりイオ
ンエネルギーを任意に可変できる。また、イオン源が独
立しているため互いに干渉することはない。また、膜形
成室とイオン源がメツシュ電極でしきられているので、
イオン源より1〜2桁高真空域で膜形成することができ
る。したがって適正範囲が広く膜質も実施例1に比べ優
れている。しかし、実施例1に比べ膜形成速度は40%
減となる。
することができる。第15図の実施例はマイクロ波方式
の例である。任意波形発生器9からの信号によりそれぞ
れ波形制御されたクイクロ波を波形制御マイクロ波′W
3.g19で発生させ導波管22でプラズマ発生室24
に導き、プラズマを発生させる。それぞれのプラズマ発
生室にはメツシュ電極でできたイオン引き出し電極21
がついている。これに波形制御イオン引き出し電源20
で負の電圧を印加することにより、真空容器17内にイ
オンを引き出し、それぞれのイオン源により、ターゲッ
トと基板を交互にスイッチングして膜形成と逆スパッタ
を行なう方法である。この方式の特長はマイクロ波出力
、あるいはイオン引き出し電圧を変えることによりイオ
ンエネルギーを任意に可変できる。また、イオン源が独
立しているため互いに干渉することはない。また、膜形
成室とイオン源がメツシュ電極でしきられているので、
イオン源より1〜2桁高真空域で膜形成することができ
る。したがって適正範囲が広く膜質も実施例1に比べ優
れている。しかし、実施例1に比べ膜形成速度は40%
減となる。
以上のように、膜形成イオン衝撃(逆スパッタ)を交互
にスイッチングして膜形成することにより、結晶粒の配
向性とステップカバレッジを大幅に向上させることがで
きる6また、配向性が良いことは耐エレクトロマイグレ
ーション性を高め、vl、SlのAu又はAQ合金配線
の寿命を伸ばし信頼性を著しく向上させる。ステップカ
バレッジの改善は、ますます微細化して行<VLS I
の配線プロセスに対応できるばかりでなく、現有VLS
Iに対しては、より信頼性を向上させることができる。
にスイッチングして膜形成することにより、結晶粒の配
向性とステップカバレッジを大幅に向上させることがで
きる6また、配向性が良いことは耐エレクトロマイグレ
ーション性を高め、vl、SlのAu又はAQ合金配線
の寿命を伸ばし信頼性を著しく向上させる。ステップカ
バレッジの改善は、ますます微細化して行<VLS I
の配線プロセスに対応できるばかりでなく、現有VLS
Iに対しては、より信頼性を向上させることができる。
また、反応性ガス雰囲気で膜形成することによりスパッ
タ法、従来のバイアススパッタ法では得られないすぐれ
た特性の複合膜を合成することができる。
タ法、従来のバイアススパッタ法では得られないすぐれ
た特性の複合膜を合成することができる。
第1図は本発明による薄膜形成装置の一実施例の構成図
、第2図及び第3図はその作動の例示図。 第4図及び第5図は本発明の膜形成のメカニズムを示す
説明図、第6図は放電限界圧力を示す特性図、第7図及
び第8図はスイッチング因子と、X線回折強度との関係
を示す特性図、第9図はAQ配線の破断寿命とX線回折
強度との関係を示す特性図、第10図はバイアス比とス
テップカバレッジとの関係を示す特性図、第11図はス
パッタとバイアスに高周波を用いた場合の波形の模式図
、第12図は本発明によるTiN膜の組織の模式図、第
13図は本発明による薄膜形成装置の他の実施例の構成
図、第14図はその作動の例示図。第15図は本発明に
よる薄膜形成装置の更に他の実施例の構成図、第16図
は従来法のDCマグネトロンバイアススパッタ装置の構
成図、第17図はその作動を示す例示図、第18図は第
]−6図および第17図における膜形成メカニズムを示
す説明図、第19図は従来法のDCマグネトロンバイア
ススパッタ法におけるTiN膜組織の模式図、第20図
はバイアスなしのDCマグネトロンスパッタ法における
TiN膜組織の模式図、第21図はアスペクト比とステ
ップカバレッジの説明図、第22図はAQ膜形成におし
づるArn囲気圧力とX線回折強度との関係を示す特性
図、第23図は本発明の一つの応用例を示す集積回路装
置の一部の断面図である。 1・・・逆スパッタ定電圧波形制御電源、2・・・スパ
ッタ電力波形制御電源、3・・・バイアス電流制御高周
波電源、4・・・バイアス電流検出センサー、5・・コ
イル、6・・・ターゲット、7・・・マグネット、8・
・・基板、10・・・絶縁物、11・・・熱電子加速電
圧波形制御電源、12・・・フィラメント加熱電源、1
3・・・フィラメント、14・・・蒸発物質、15・・
・るつぼ、16・・・偏向コイル、17・・・真空容器
、18・・・偏向電圧波形制御電源、19・・・波形制
御マイクロ波電源、 20・・・波形制御イオン引き出し電源、21・・・ イオン引き出し電極、 22・・・導波管、 23・・・コイ 第 幻 O・室を較←精なに一奸統物 スIマソタ 逆スハ0ンク ス/Yンタ 逆スパッタ 第 ■ 第 凹 第 阻 スノV/り公 スt、力r乙<F3W/FW) 第 δ 凹 スイツナング岡閂 (Se(J X線回折強度 (kcF3−) 第 /3 第 /4 第 口 /VイアスFヒ (T2/ (丁ttlz)つ 第 第 ■ 22・・・導浅賃 第 ステップ°gt\゛ pyジ: (L2/L+)x 1
0(K5)アスNりFLt:Sz/S。 第 23図 O2保咥膜 \
、第2図及び第3図はその作動の例示図。 第4図及び第5図は本発明の膜形成のメカニズムを示す
説明図、第6図は放電限界圧力を示す特性図、第7図及
び第8図はスイッチング因子と、X線回折強度との関係
を示す特性図、第9図はAQ配線の破断寿命とX線回折
強度との関係を示す特性図、第10図はバイアス比とス
テップカバレッジとの関係を示す特性図、第11図はス
パッタとバイアスに高周波を用いた場合の波形の模式図
、第12図は本発明によるTiN膜の組織の模式図、第
13図は本発明による薄膜形成装置の他の実施例の構成
図、第14図はその作動の例示図。第15図は本発明に
よる薄膜形成装置の更に他の実施例の構成図、第16図
は従来法のDCマグネトロンバイアススパッタ装置の構
成図、第17図はその作動を示す例示図、第18図は第
]−6図および第17図における膜形成メカニズムを示
す説明図、第19図は従来法のDCマグネトロンバイア
ススパッタ法におけるTiN膜組織の模式図、第20図
はバイアスなしのDCマグネトロンスパッタ法における
TiN膜組織の模式図、第21図はアスペクト比とステ
ップカバレッジの説明図、第22図はAQ膜形成におし
づるArn囲気圧力とX線回折強度との関係を示す特性
図、第23図は本発明の一つの応用例を示す集積回路装
置の一部の断面図である。 1・・・逆スパッタ定電圧波形制御電源、2・・・スパ
ッタ電力波形制御電源、3・・・バイアス電流制御高周
波電源、4・・・バイアス電流検出センサー、5・・コ
イル、6・・・ターゲット、7・・・マグネット、8・
・・基板、10・・・絶縁物、11・・・熱電子加速電
圧波形制御電源、12・・・フィラメント加熱電源、1
3・・・フィラメント、14・・・蒸発物質、15・・
・るつぼ、16・・・偏向コイル、17・・・真空容器
、18・・・偏向電圧波形制御電源、19・・・波形制
御マイクロ波電源、 20・・・波形制御イオン引き出し電源、21・・・ イオン引き出し電極、 22・・・導波管、 23・・・コイ 第 幻 O・室を較←精なに一奸統物 スIマソタ 逆スハ0ンク ス/Yンタ 逆スパッタ 第 ■ 第 凹 第 阻 スノV/り公 スt、力r乙<F3W/FW) 第 δ 凹 スイツナング岡閂 (Se(J X線回折強度 (kcF3−) 第 /3 第 /4 第 口 /VイアスFヒ (T2/ (丁ttlz)つ 第 第 ■ 22・・・導浅賃 第 ステップ°gt\゛ pyジ: (L2/L+)x 1
0(K5)アスNりFLt:Sz/S。 第 23図 O2保咥膜 \
Claims (1)
- 【特許請求の範囲】 1、真空容器内に対向して配置されたスパッタ用ターゲ
ットと基板との間でスパッタリングと逆スパッタリング
を交互にくり返して基板上にターゲット物質を堆積する
方法において、前記ターゲットと前記基板の両方に負の
電圧を印加してスイッチングすることを特徴とするスパ
ッタリング方法。 2、真空容器内の基板とスパッタ用ターゲットとに交互
にイオンを衝撃してスパッタリングと逆スパッタリング
をくり返すことにより基板上にターゲット物質を堆積す
る方法において、前記真空容器をアースとし、前記基板
と前記ターゲットの両方に負の電圧を印加してスイッチ
ングすることを特徴とするスパッタリング方法。 3、真空容器内に導入したアルゴンガス又はヘリウムガ
スをイオン化してターゲットと基板に交互に衝撃させる
ことによりスパッタリングと逆スパッタリングをくり返
して基板上にターゲット物質を堆積する方法において、
前記ターゲットと前記基板の両方に負の電圧を印加して
スイッチングすることを特徴とするスパッタリング方法
。 4、真空容器内の基板に負の電圧を印加した状態でター
ゲットをイオンによりスパッタして基板上に堆積させる
バイアススパッタリング方法において、前記基板と前記
ターゲットの両方に交互にパルス電圧を印加してスパッ
タリングと逆スパッタリングをくり返すことを特徴とす
るバイアススパッタリング方法。 5、真空容器内の基板に負の電圧を印加した状態でター
ゲットをイオンによりスパッタして基板上に堆積させる
バイアススパッタリング方法において、前記基板と前記
ターゲットの両方に交互にパルス電圧を印加すると共に
該パルス電圧の印加中に他方に該パルス電圧よりも小さ
い負のベース電圧を印加しておくことを特徴とするバイ
アススパッタリング方法。 6、真空容器内に対向して配置したスパッタ用ターゲッ
トと基板との間でスパッタリングと逆スパッタリングを
交互にくり返して基板上にターゲット物質を堆積する方
法において、前記真空容器をアースとし、前記基板と前
記ターゲットの両方にパルスのピーク値よりも低いベー
ス電圧を含む負のパルス電圧を印加してスイッチングす
ることを特徴とするバイアススパッタリング方法。 7、請求項1において、前記真空容器をアースとし、タ
ーゲットと前記基板の両方に負のパルス電圧を印加して
スイッチングすることを特徴とするスパッタリング方法
。 8、請求項7において、前記ターゲットに印加するパル
スのピーク値を前記基板に印加するパルスのピーク値よ
りも高くしたことを特徴とするスパッタリング方法。 9、請求項7において前記ターゲットに負のパルス電圧
を印加する時間を前記基板に負のパルス電圧を印加する
時間よりも長くしたことを特徴とするスパッタリング方
法。 10、請求項5において、前記ターゲットのベース電圧
を前記基板のベース電圧よりも高くしたことを特徴とす
るバイアススパッタリング方法。 11、請求項4において、前記ターゲットに印加するパ
ルスのピーク値を前記基板に印加するパルスのピーク値
よりも高くしたことを特徴とするバイアススパッタリン
グ方法。 12、請求項4において前記ターゲットのパルス電圧印
加時間を前記基板のパルス電圧印加時間よりも長くした
ことを特徴とするバイアススパッタリング方法。 13、チャンバー内にターゲットと基板を対向させて配
置し、スパッタおよび逆スパッタにより基板上にターゲ
ット物質の薄膜を形成する薄膜形成方法において、スパ
ッタ電力と逆スパッタ電力を脈流にし、少なくともスパ
ッタ電力の脈流は電力値の差の大きい波形となし、且つ
スパッタ電力の脈流と逆スパッタ電力の脈流の位相を互
いにずらせてスパッタと逆スパッタとを交互に行うこと
を特徴とする薄膜形成方法。 14、真空容器内のスパッタ用ターゲットと基板との間
でスパッタリングと逆スパッタリングを交互にくり返し
て基板上にターゲット物質を堆積する方法において、前
記ターゲットと前記基板の両方に負のパルス電圧を印加
してスイッチングすると共に、前記ターゲットと前記基
板との間にコイルを設置し高周波電圧を印加してプラズ
マを発生させることを特徴とするスパッタリング方法。 15、請求項14において、前記真空容器内にアルゴン
ガスを導入してイオン化してスパッタリングを行うと共
に、該真空容器の雰囲気圧力を10^−^3Torrよ
りも低くしたことを特徴とするスパッタリング方法。 16、真空容器内の基板に負の電圧を印加した状態でタ
ーゲットをイオンによりスパッタして基板上に堆積させ
るバイアススパッタリング方法において、前記基板と前
記ターゲットの両方に交互にパルス電圧を印加してスパ
ッタリングと逆スパッタリングをくり返すと共に、前記
ターゲットと前記基板との間にコイルを設置して高周波
電圧を印加しプラズマを発生させることを特徴とするバ
イアススパッタリング方法。 17、請求項16において、前記真空容器内にアルゴン
ガスを導入してイオン化してスパッタリングを行うと共
に、該真空容器の雰囲気圧力を10^−^3Torrよ
りも低くしたことを特徴とするバイアススパッタリング
方法。 18、請求項16において、コイルに印加する高周波電
圧(電力)を変えることにより、バイアス電流を可変で
きるようにしたことを特徴とするバイアススパッタリン
グ方法。 19、請求項16において、コイルに印加する高周波電
圧(電力)、ターゲット電圧(電力)、バイアス電圧を
独立に変えても互いに干渉されず、常に設定された値に
なるように自己制御することを特徴とするバイアススパ
ッタリング方法。 20、請求項1において、ターゲットと基板に印加する
電圧を直流と直流、直流と高周波、高周波と直流、高周
波と高周波のいずれか一つとすることを特徴とするスパ
ッタリング方法。 21、請求項4において、ターゲットと基板に印加する
電圧を直流と直流、直流と高周波、高周波と直流、高周
波と高周波のいずれか一つとすることを特徴とするバイ
アススパッタリング方法。 22、真空容器内の蒸発物質を蒸発させて基板に堆積す
る蒸着方法において、前記蒸着と前記基板に負の電圧を
印加してイオン衝撃により逆スパッタリングすることと
を交互にくり返して基板上に蒸発物質を堆積することを
特徴とする蒸着方法。 23、請求項22において、前記基板に負のパルス電圧
を印加することを特徴とする蒸着方法。 24、請求項22において、前記基板に負の電圧を印加
して逆スパッタリングを行っている間に、前記蒸発物質
を予熱しておくことを特徴とする蒸着方法。 25、請求項22において、前記蒸発物質を電子ビーム
により加熱して蒸発させ、この際、熱電子加速電圧に同
期して熱電子偏向コイルの出力を変化させて電子ビーム
の集点ずれを防止することを特徴とする蒸着方法。 26、スパッタリングを発生させるイオンをイオン源で
つくり、そこからイオンをとり出し、加速して、別のチ
ャンバー内におかれたターゲットに衝突させて、ターゲ
ット物質を基板に堆積させるイオンビームスパッタリン
グ方法において、前記基板をイオン衝撃する別個のイオ
ン源を設け、ターゲットの衝撃と基板の衝撃を交互にス
イッチングすることを特徴とするイオンビームスパッタ
リング方法。 27、請求項1において、反応性ガス雰囲気でスパッタ
リングと逆スパッタリングを交互にくり返すことにより
、層状或いは混合組織の膜を形成することを特徴とする
膜形成方法。 28、請求項4において、反応性ガス雰囲気でスパッタ
リングと逆スパッタリングを交互にくり返すことにより
、層状或いは混合組織の膜を形成することを特徴とする
膜形成方法。 29、請求項4において、アルゴンと窒素と酸素を含む
反応性ガス雰囲気中で、ターゲットにチタンを用いてス
パッタリングと逆スパッタリングを交互にくり返して窒
化チタン膜を形成することを特徴とする窒化チタン膜の
形成方法。 30、請求項29において、スパッタリングと逆スパッ
タリングのスイッチング周期と通電比の少なくとも一方
を変えることにより、粒状晶と柱状晶の層状組織或いは
混合組織を有する窒化チタン膜を形成することを特徴と
する窒化チタン膜の形成方法。 31、集積回路を有するシリコン基板上にバリヤ層を介
してアルミウム配線膜を具備する集積回路装置において
、前記バリヤ層が粒状晶と柱状晶の層状組織或いは混合
組織を有する窒化チタン膜からなることを特徴とする集
積回路装置。 32、請求項31において、前記アルミニウム配線膜の
(111)面のX線回折強度のピーク値が150Xcp
s以上であることを特徴とする集積回路装置。 33、(111)面のX線回折強度のピーク値が150
Xcps以上よりなることを特徴とするアルミニウム膜
。 34、凹みを有する基板表面にスパッタリング又は蒸着
によって形成された薄膜を有する物品において、前記基
板の表面に形成された膜厚(Li)と前記基板の凹みの
エッヂ部分に形成された膜厚(L2)との比(L2/L
1)が0.3以上よりなることを特徴とする薄膜を具備
する物品。 35、請求項34において、前記凹みの底面及び側壁面
に位置する膜面が該底面及び側壁面に対してほぼ平行で
あり、前記凹みのエッヂ部分に位置する膜面が上拡がり
の傾斜を有し、前記基板表面に位置する膜面が該表面に
対してほぼ平行であることを特徴とする薄膜を具備する
物品。 36、真空容器内にターゲットと基板を対向させて配置
し、スパッタと逆スパッタとを交互に行ない、基板上に
ターゲット物質の薄膜を形成する薄膜形成方法において
、任意の二つの波形信号を発生する任意波形発生器と、
この任意波形発生器からの夫々の波形信号を受けて該夫
々の波形信号に対応する波形のスパッタ電力、バイアス
電力を独立に夫々発生する波形制御電源を備え、上記ス
パッタ電力、バイアス電圧を、夫々ターゲット、基板に
印加するようにしたことを特徴とする薄膜形成装置。 37、請求項36において、基板とターゲットの間にコ
イルを配置し、これに高周波を印加しプラズマを発生さ
せる高周波電源とバイアス電流を検出するセンサーを備
え、任意波形発生器からの信号とバイアス電流センサー
からの信号とを比較し、常に設定されたバイアス電流に
なるようコイルに印加する高周波電力を制御することを
特徴とする薄膜形成装置。 38、真空容器内に基板と電子ビーム蒸発源を対向させ
て配置し、基板に負の電圧を印加し、蒸着と逆スパッタ
を交互にスイッチングして膜形成する薄膜形成装置にお
いて、任意の三つの波形を発生する任意波形発生器と、
この任意波形発生器からの夫々の波形信号を受けて、該
夫々の波形に対応する波形のバイアス電圧、電子ビーム
蒸発源の熱電子加速電圧、電子ビームを偏向する電圧を
夫々独立に発生する波形制御電源を備え、上記バイアス
電圧、熱電子加速電圧、偏向電圧を、夫々基板、熱電子
発生フィラメント、偏向コイルに印加するようにしたこ
とを特徴とする薄膜形成装置。 39、真空容器内にターゲットと基板を対向させて配置
し、スパッタおよび逆スパッタにより基板上にターゲッ
ト物質の薄膜を形成する薄膜形成装置において、任意の
二つの波形信号を発生する任意波形信号発生器と、この
任意波形信号発生器からの夫々の波形信号を受けて該夫
々の波形信号に対応する波形のスパッタ電力および逆ス
パッタ電力を独立に夫々発生するアナログ波形制御電源
とを備え、上記スパッタ電力および逆スパッタ電力を夫
々ターゲットおよび基板に印加するようにしたことを特
徴とする薄膜形成装置。 40、基板上に粒状晶と柱状晶の層状組織のスパッタ膜
或いは蒸着膜を有することを特徴とする薄膜を具備する
物品。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63060421A JP2602276B2 (ja) | 1987-06-30 | 1988-03-16 | スパツタリング方法とその装置 |
DE3852912T DE3852912T2 (de) | 1987-06-30 | 1988-06-28 | Verfahren und Gerät zur Kathodenzerstäubung. |
EP88110281A EP0297502B1 (en) | 1987-06-30 | 1988-06-28 | Method of and apparatus for sputtering |
US07/213,136 US4999096A (en) | 1987-06-30 | 1988-06-29 | Method of and apparatus for sputtering |
KR1019880007995A KR970009212B1 (ko) | 1987-06-30 | 1988-06-30 | 스퍼터링 방법과 장치 및 집적회로장치 |
US07/574,770 US5175608A (en) | 1987-06-30 | 1990-08-30 | Method of and apparatus for sputtering, and integrated circuit device |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62-163092 | 1987-06-30 | ||
JP16309287 | 1987-06-30 | ||
JP63060421A JP2602276B2 (ja) | 1987-06-30 | 1988-03-16 | スパツタリング方法とその装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH02138456A true JPH02138456A (ja) | 1990-05-28 |
JP2602276B2 JP2602276B2 (ja) | 1997-04-23 |
Family
ID=26401494
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63060421A Expired - Fee Related JP2602276B2 (ja) | 1987-06-30 | 1988-03-16 | スパツタリング方法とその装置 |
Country Status (5)
Country | Link |
---|---|
US (1) | US4999096A (ja) |
EP (1) | EP0297502B1 (ja) |
JP (1) | JP2602276B2 (ja) |
KR (1) | KR970009212B1 (ja) |
DE (1) | DE3852912T2 (ja) |
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JPH1129865A (ja) * | 1997-04-23 | 1999-02-02 | Applied Materials Inc | スパッタリングチャンバのマグネット |
US6348238B1 (en) | 1999-03-12 | 2002-02-19 | Anelva Corporation | Thin film fabrication method and thin film fabrication apparatus |
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JP2010065240A (ja) * | 2008-09-08 | 2010-03-25 | Kobe Steel Ltd | スパッタ装置 |
US8227323B2 (en) | 2009-06-18 | 2012-07-24 | Fuji Electric Co., Ltd. | Method for manufacturing semiconductor device |
JP2012209483A (ja) * | 2011-03-30 | 2012-10-25 | Tokyo Electron Ltd | 成膜方法およびリスパッタ方法、ならびに成膜装置 |
JP2023516865A (ja) * | 2020-06-16 | 2023-04-21 | アプライド マテリアルズ インコーポレイテッド | パルスバイアスを使用したオーバーハングの低減 |
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