JPH01260845A - 半導体装置 - Google Patents
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、一般に、半導体装置に関し、更に詳細には耐
層間剥離用位相幾何学的構成を備えた角部(corne
r)設計を有する半導体ダイに関する。
層間剥離用位相幾何学的構成を備えた角部(corne
r)設計を有する半導体ダイに関する。
(従来の技術)
本発明を典型、的に利用できる半導体装置には不活性化
ガラスで覆われている金属相互接続線を有するシリコン
半導体ダイかある。ダイはリードフレームのフラッグに
取付けられ、ダイの付いたーフラッグは次に高温でプラ
スチックに封入される。
ガラスで覆われている金属相互接続線を有するシリコン
半導体ダイかある。ダイはリードフレームのフラッグに
取付けられ、ダイの付いたーフラッグは次に高温でプラ
スチックに封入される。
プラスチック封人材の膨脹係数はシリコン・ダイの膨脹
係数よりはるかに大きく、従ってプラスチック封人材は
冷却するにつれて完全には収縮することができない。大
きなパッケージでは、この熱膨脹の不一致の有害な結果
は温度の極点が一65〜150℃の範囲になることがし
ばしばある温度サイクル試験中に特に明らかである。
係数よりはるかに大きく、従ってプラスチック封人材は
冷却するにつれて完全には収縮することができない。大
きなパッケージでは、この熱膨脹の不一致の有害な結果
は温度の極点が一65〜150℃の範囲になることがし
ばしばある温度サイクル試験中に特に明らかである。
プラスチック封人材が収縮すると、大きな応力がシリコ
ン半導体ダイに作用する。この応力はダイの縁辺(ed
ges)や角部(corners)で最も高い。
ン半導体ダイに作用する。この応力はダイの縁辺(ed
ges)や角部(corners)で最も高い。
応力は半導体ダイの角部に隣接してプラスチック対人材
に割れを発生させる。これによりプラスチック封人材と
半導体ダイとの間に相対運動が生じ、このため半導体ダ
イの不活性化ガラスに割れや破壊を生じ、更に特に高応
力角部に層間剥離(delaIiinatlon)を生
ずる。この層間剥離は金属相互接続線を通って進み、こ
れらを別個の板に切り離すのが普通である。この結果半
導体装置の寿命が減少する。
に割れを発生させる。これによりプラスチック封人材と
半導体ダイとの間に相対運動が生じ、このため半導体ダ
イの不活性化ガラスに割れや破壊を生じ、更に特に高応
力角部に層間剥離(delaIiinatlon)を生
ずる。この層間剥離は金属相互接続線を通って進み、こ
れらを別個の板に切り離すのが普通である。この結果半
導体装置の寿命が減少する。
(発明が解決しようとする課題)
従来は層間剥離の問題を解決しようとして回路、相互接
続部、およびワイヤボンドの半導体ダイのダイ角部に空
所を設けていた。こうしても層間剥離は止まらないが、
動作回路が角部領域から更に遠ざかり、最初の層間剥離
に影響されなくなるので、半導体装置の寿命が増大する
。本発明は従来の技術を基礎とし、層間剥離の速さを大
幅に減らし、これにより半導体装置の寿命を増大させよ
うとするものである。
続部、およびワイヤボンドの半導体ダイのダイ角部に空
所を設けていた。こうしても層間剥離は止まらないが、
動作回路が角部領域から更に遠ざかり、最初の層間剥離
に影響されなくなるので、半導体装置の寿命が増大する
。本発明は従来の技術を基礎とし、層間剥離の速さを大
幅に減らし、これにより半導体装置の寿命を増大させよ
うとするものである。
従って、動作回路に働く応力を減らす位相幾何学的構成
(topological conl’1guratl
ons)を有するダイ角部設計を提供するのが本発明の
目的である。
(topological conl’1guratl
ons)を有するダイ角部設計を提供するのが本発明の
目的である。
本発明の他の目的は、層間剥離に耐える位相幾何学的構
成を有するダイ角部設計を提供することである。
成を有するダイ角部設計を提供することである。
本発明の別の目的は、半導体装置の寿命を増大させるこ
とを考慮した位相幾何学的構成を有するダイ角部設計を
提供することである。
とを考慮した位相幾何学的構成を有するダイ角部設計を
提供することである。
(課題を解決するための手段および作用)前述のおよび
他の目的および利点は半導体ダイの角部に位相幾何学的
構成を施すことによる本発明により達成される。この構
成は層間剥離が半導体ダイの動作回路に到達する前に通
過しなければならない障害物の数を多くすることにより
対人材と半導体ダイとの間の層間剥離の進行を減速させ
る。
他の目的および利点は半導体ダイの角部に位相幾何学的
構成を施すことによる本発明により達成される。この構
成は層間剥離が半導体ダイの動作回路に到達する前に通
過しなければならない障害物の数を多くすることにより
対人材と半導体ダイとの間の層間剥離の進行を減速させ
る。
(実施例)
第1図は本発明を利用することができる形式のプラスチ
ック封入半導体装置の非常に拡大した上面図である。装
置はフラッグ12を有するリードフレーム10を備えて
いる。半導体ダイ14はリードフレーム10のフラッグ
12に取付けられている。フラッグ12を備えているリ
ードフレーム10の部分はプラスチック封入部16に封
入されているが、この図ではこの封入部を一部切り取っ
である。
ック封入半導体装置の非常に拡大した上面図である。装
置はフラッグ12を有するリードフレーム10を備えて
いる。半導体ダイ14はリードフレーム10のフラッグ
12に取付けられている。フラッグ12を備えているリ
ードフレーム10の部分はプラスチック封入部16に封
入されているが、この図ではこの封入部を一部切り取っ
である。
第2図は、半導体ダイ14の非常に拡大した上面図であ
る。半導体ダイ14は回路域18を備えており、ここに
は半導体ダイ14の動作回路がすべて入っている。動作
回路は複数の結合パッド20と相互接続線22とを備え
ている。結合パッド20と相互接続線22とは共に金属
から構成されている。当業者は既知の多数の金属を採用
することができることを理解するであろう。半導体ダイ
14は更に回路域角部24を備えており、これは動作回
路およびダイ角部25の欠除部(vold)である。回
路域角部24は動作回路の空所となっていることにより
装置の寿命を長くしている。何故ならそこでの層間剥離
は半導体ダイ14の動作回路に影響しないからである。
る。半導体ダイ14は回路域18を備えており、ここに
は半導体ダイ14の動作回路がすべて入っている。動作
回路は複数の結合パッド20と相互接続線22とを備え
ている。結合パッド20と相互接続線22とは共に金属
から構成されている。当業者は既知の多数の金属を採用
することができることを理解するであろう。半導体ダイ
14は更に回路域角部24を備えており、これは動作回
路およびダイ角部25の欠除部(vold)である。回
路域角部24は動作回路の空所となっていることにより
装置の寿命を長くしている。何故ならそこでの層間剥離
は半導体ダイ14の動作回路に影響しないからである。
スクライブ域26は回路域18と回路域角部24との境
界を成している。スクライブ域26は回路の空所であり
、単に半導体ダイ14を以下の処理で他の半導体ダイか
ら分離することができる領域として働くだけである。回
路域18は更に不活性化ガラス28で覆われているが、
これはこの図では部分的に取除いである。この実施例で
は、不活性化ガラス28はリンがドープされている二酸
化シリコンである。不活性化ガラス28は水分や不純物
を被覆されないままになっている結合パッド20を除く
回路域18から遠ざけている。これにより腐蝕が減少し
、装置の寿命が増大する。
界を成している。スクライブ域26は回路の空所であり
、単に半導体ダイ14を以下の処理で他の半導体ダイか
ら分離することができる領域として働くだけである。回
路域18は更に不活性化ガラス28で覆われているが、
これはこの図では部分的に取除いである。この実施例で
は、不活性化ガラス28はリンがドープされている二酸
化シリコンである。不活性化ガラス28は水分や不純物
を被覆されないままになっている結合パッド20を除く
回路域18から遠ざけている。これにより腐蝕が減少し
、装置の寿命が増大する。
この種の半導体装置に関して頻繁に起る問題はプラスチ
ック封入部16カぐ半導体ダイ14から層間剥離すると
いうことである。更に、回路18のある周辺領域に存在
する相互接続線22がこの層間剥離の結果破壊すること
が普通である。層間剥離はプラスチック封入部16と一
般にシリコンから作られる半導体ダイ14との膨脂係数
が異なるために生ずる。それ故、プラスチック封入部1
6が冷却中に収縮すると、半導体ダイ14のダイ角部2
5に隣接して割れを生ずる。この割れによりプラスチッ
ク封入部16と半導体ダイ14との間に相対運動が起り
、これが層間剥離を発生させる。
ック封入部16カぐ半導体ダイ14から層間剥離すると
いうことである。更に、回路18のある周辺領域に存在
する相互接続線22がこの層間剥離の結果破壊すること
が普通である。層間剥離はプラスチック封入部16と一
般にシリコンから作られる半導体ダイ14との膨脂係数
が異なるために生ずる。それ故、プラスチック封入部1
6が冷却中に収縮すると、半導体ダイ14のダイ角部2
5に隣接して割れを生ずる。この割れによりプラスチッ
ク封入部16と半導体ダイ14との間に相対運動が起り
、これが層間剥離を発生させる。
第3図〜第8図は半導体ダイ14の回路域角部24の非
常に拡大した上面図である。これらの図は各種位相幾何
学的(topological)構成30八〜30Dを
示している。回路の空所である半導体ダイ14の領域に
位相幾何学的構成30を形成すると層間剥離の過程が減
速する。位相幾何学的構成30は層間剥離に対する障壁
として作用する。
常に拡大した上面図である。これらの図は各種位相幾何
学的(topological)構成30八〜30Dを
示している。回路の空所である半導体ダイ14の領域に
位相幾何学的構成30を形成すると層間剥離の過程が減
速する。位相幾何学的構成30は層間剥離に対する障壁
として作用する。
第3図〜第8図の位相幾何学的構成30は金属から成り
、不活性化ガラス28のような保護被膜で覆われている
。位相幾何学的構成30に使用される金属は相互接続線
22に使用されるものと同じであり、同じ処理ステップ
で半導体ダイ14に配設することができるということを
理解すべきである。更に、金属は相互接続線22を覆う
のに行ったと同じ処理ステップにより不活性化ガラス2
8で覆うことができる。
、不活性化ガラス28のような保護被膜で覆われている
。位相幾何学的構成30に使用される金属は相互接続線
22に使用されるものと同じであり、同じ処理ステップ
で半導体ダイ14に配設することができるということを
理解すべきである。更に、金属は相互接続線22を覆う
のに行ったと同じ処理ステップにより不活性化ガラス2
8で覆うことができる。
第3図は、ハネカム構成を成す位相幾何学的構成30A
を示す。第4図は内部シェブロン(山形)構成を成す位
相幾何学的構成30Bを示す。第5図は外部シェブロン
構成を成す位相幾何学的構成30Cを示すが、第6図は
防壁(dike)構成を成す位相幾何学的構成30Dを
示している。どんな数の位相幾何学的構成30をも採用
することができることを理解すべきである。
を示す。第4図は内部シェブロン(山形)構成を成す位
相幾何学的構成30Bを示す。第5図は外部シェブロン
構成を成す位相幾何学的構成30Cを示すが、第6図は
防壁(dike)構成を成す位相幾何学的構成30Dを
示している。どんな数の位相幾何学的構成30をも採用
することができることを理解すべきである。
第7図は、回路域角部24を越えてスクライブ域26に
延びている位相幾何学的構成30を示す。
延びている位相幾何学的構成30を示す。
位相幾何学的構成30はスクライブ域26にわたって延
び、半導体ダイ14の回路域18の完全な境界となるこ
とができることを更に理解すべきである。位相幾何学的
構成30をスクライブ域26の中に延ばすことにより、
層間剥離が半導体ダイ14の回路域18に到達すること
ができる前に打勝たなければならない障壁の数を多くす
る。障壁を増せば半導体装置の有効寿命が延びる。
び、半導体ダイ14の回路域18の完全な境界となるこ
とができることを更に理解すべきである。位相幾何学的
構成30をスクライブ域26の中に延ばすことにより、
層間剥離が半導体ダイ14の回路域18に到達すること
ができる前に打勝たなければならない障壁の数を多くす
る。障壁を増せば半導体装置の有効寿命が延びる。
第8図は本発明の一実施例を示すもので、これでは不活
性化ガラス28がスクライブ域26の下層金属線にみぞ
掘りされている。スロット32は本質的に不活性化ガラ
ス28の領域を分離して層間剥離の進行に対する別の障
害物となっている。
性化ガラス28がスクライブ域26の下層金属線にみぞ
掘りされている。スロット32は本質的に不活性化ガラ
ス28の領域を分離して層間剥離の進行に対する別の障
害物となっている。
層間剥離を1ステツプ過程で継続できるようにするので
はなく、不活性化ガラス28の中のスロット32では層
間剥離は一部スロット32に到達して全体として新しく
始まる必要がある。不活性化ガラス28には多数の列お
よび構成から成るスロット32を使用することができる
ことを理解すべきである。
はなく、不活性化ガラス28の中のスロット32では層
間剥離は一部スロット32に到達して全体として新しく
始まる必要がある。不活性化ガラス28には多数の列お
よび構成から成るスロット32を使用することができる
ことを理解すべきである。
第9図はダミーワイヤボンドを有する半導体装置の一部
の大きく拡大した上面図を開示している。
の大きく拡大した上面図を開示している。
この実施例では、半導体ダイ34はリードフレーム38
のフラッグ36に取付けられている。リードフレーム3
8はフラッグ36を支持する複数の角部リード40を備
えている。複数のダミー結合パッド42が半導体ダイ3
4の回路域角部44で処理されてきている。再び、回路
域角部44は回路の空所である。ダミーワイヤボンド4
6はダミー結合パッド42に接合されている。擬似ワイ
ヤボンド46は能動パッドにワイヤボンドする場合に行
うと同じワイヤボンディングを行っている。
のフラッグ36に取付けられている。リードフレーム3
8はフラッグ36を支持する複数の角部リード40を備
えている。複数のダミー結合パッド42が半導体ダイ3
4の回路域角部44で処理されてきている。再び、回路
域角部44は回路の空所である。ダミーワイヤボンド4
6はダミー結合パッド42に接合されている。擬似ワイ
ヤボンド46は能動パッドにワイヤボンドする場合に行
うと同じワイヤボンディングを行っている。
最良の結果は層間剥離が大きな障壁に打勝たなければな
らないようにするためボールボンドまたは他の大きなダ
ミーワイヤボンド46を使用することにより得られ不こ
とを理解すべきである。ボールボンドの質量は角部から
内側に向うプラスチックの運動を更に妨げるように働き
、故障を生ずるのに充分な質量の運動を生ずるに必要な
温度サイクルの数が多くなる。更に各ダイ角部44には
二つ以上の擬似結合パッド42を使用することができる
ことを理解すべきである。
らないようにするためボールボンドまたは他の大きなダ
ミーワイヤボンド46を使用することにより得られ不こ
とを理解すべきである。ボールボンドの質量は角部から
内側に向うプラスチックの運動を更に妨げるように働き
、故障を生ずるのに充分な質量の運動を生ずるに必要な
温度サイクルの数が多くなる。更に各ダイ角部44には
二つ以上の擬似結合パッド42を使用することができる
ことを理解すべきである。
第1図は、プラスチック封入部の一部を切除したプラス
チック封入半導体装置の非常に拡大した上面図である。 第2図は、第1図の装置に含まれている半導体ダイの非
常に拡大した上面図である。 第3図から第8図までは、各種位相幾何学的構成を有す
る半導体ダイの回路域角部の非常に拡大した上面図であ
る。 第9図は、擬似ワイヤボンドを有する半導体装置の一部
の非常に拡大した上面図である。 10.38:リードフレーム、 12.36:フラッグ、 14.34:半導体ダイ、 20.42:結合パッド、 22:相互接続線、 24.44:回路域角部、 26:スクライブ域、 28:不活性化ガラス、 30:位相幾何学的構成。 特許出願人 モトローラ・インコーホレーテッド代 理
人 弁理士 池 内 義 明F”IC!−7 FIC,3F’IC!、 4 F”IC,6F’IC!、 6 F”IC,9
チック封入半導体装置の非常に拡大した上面図である。 第2図は、第1図の装置に含まれている半導体ダイの非
常に拡大した上面図である。 第3図から第8図までは、各種位相幾何学的構成を有す
る半導体ダイの回路域角部の非常に拡大した上面図であ
る。 第9図は、擬似ワイヤボンドを有する半導体装置の一部
の非常に拡大した上面図である。 10.38:リードフレーム、 12.36:フラッグ、 14.34:半導体ダイ、 20.42:結合パッド、 22:相互接続線、 24.44:回路域角部、 26:スクライブ域、 28:不活性化ガラス、 30:位相幾何学的構成。 特許出願人 モトローラ・インコーホレーテッド代 理
人 弁理士 池 内 義 明F”IC!−7 FIC,3F’IC!、 4 F”IC,6F’IC!、 6 F”IC,9
Claims (1)
- 【特許請求の範囲】 1、フラッグを備えたリードフレームと、 前記リードフレームの前記フラッグに配設され、回路の
空所である複数の回路領域の角部を有する半導体ダイと
、 前記半導体ダイの前記各回路領域角部に少なくとも一つ
の位相幾何学的構成と、 を備えていることを特徴とするプラスチック封入半導体
装置。 2、位相幾何学的構成は不活性化ガラスで覆われた金属
から構成されている特許請求の範囲第1項に記載の装置
。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US158,486 | 1988-02-22 | ||
US07/158,486 US4928162A (en) | 1988-02-22 | 1988-02-22 | Die corner design having topological configurations |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01260845A true JPH01260845A (ja) | 1989-10-18 |
Family
ID=22568348
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1032908A Pending JPH01260845A (ja) | 1988-02-22 | 1989-02-14 | 半導体装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4928162A (ja) |
JP (1) | JPH01260845A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2014181766A1 (ja) * | 2013-05-07 | 2014-11-13 | ピーエスフォー ルクスコ エスエイアールエル | 半導体装置及び半導体装置の製造方法 |
Families Citing this family (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US5572067A (en) * | 1994-10-06 | 1996-11-05 | Altera Corporation | Sacrificial corner structures |
US5650666A (en) * | 1995-11-22 | 1997-07-22 | Cypress Semiconductor Corp. | Method and apparatus for preventing cracks in semiconductor die |
JPH1012790A (ja) * | 1996-06-24 | 1998-01-16 | Mitsubishi Electric Corp | 半導体集積回路装置 |
US5880529A (en) * | 1996-10-22 | 1999-03-09 | Intel Corporation | Silicon metal-pillar conductors under stagger bond pads |
US5780772A (en) * | 1997-01-24 | 1998-07-14 | National Semiconductor Corporation | Solution to mold wire sweep in fine pitch devices |
KR100265461B1 (ko) * | 1997-11-21 | 2000-09-15 | 윤종용 | 더미본딩와이어를포함하는반도체집적회로소자 |
US6297078B1 (en) * | 1997-12-31 | 2001-10-02 | Intel Corporation | Integrated circuit package with bond wires at the corners of an integrated circuit |
US20020030257A1 (en) * | 1999-06-18 | 2002-03-14 | Joseph M. Brand | Semiconductor device utiling an encapsulant for locking a semiconductor die to circuit substrate |
DE10345247B4 (de) | 2003-09-29 | 2007-10-04 | Infineon Technologies Ag | Verwendung von Leiterbahnen als Krallkörper |
US7314811B2 (en) * | 2004-03-04 | 2008-01-01 | Chartered Semiconductor Manufacturing Ltd. | Method to make corner cross-grid structures in copper metallization |
US7301229B2 (en) * | 2004-06-25 | 2007-11-27 | Taiwan Semiconductor Manufacturing Company | Electrostatic discharge (ESD) protection for integrated circuit packages |
US7223630B2 (en) * | 2004-12-03 | 2007-05-29 | Taiwan Semiconductor Manufacturing Company, Ltd. | Low stress semiconductor device coating and method of forming thereof |
US7821104B2 (en) * | 2008-08-29 | 2010-10-26 | Freescale Semiconductor, Inc. | Package device having crack arrest feature and method of forming |
US8300335B2 (en) * | 2009-06-11 | 2012-10-30 | United Microelectronics Corp. | Image device having color filter array |
US8466000B2 (en) | 2011-04-14 | 2013-06-18 | United Microelectronics Corp. | Backside-illuminated image sensor and fabricating method thereof |
DE102014114973B4 (de) * | 2014-10-15 | 2020-10-01 | Infineon Technologies Ag | Einpress-Package mit Chipkontakt auf aktiver Fläche mit Beanspruchsschutz und Verfahren zur Herstellung desselben |
KR102611982B1 (ko) * | 2016-05-25 | 2023-12-08 | 삼성전자주식회사 | 반도체 장치 |
Citations (4)
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JPS62213267A (ja) * | 1986-03-14 | 1987-09-19 | Olympus Optical Co Ltd | 固体撮像素子 |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JPS6235545A (ja) * | 1985-08-08 | 1987-02-16 | Mitsubishi Electric Corp | 樹脂封止半導体装置 |
-
1988
- 1988-02-22 US US07/158,486 patent/US4928162A/en not_active Expired - Fee Related
-
1989
- 1989-02-14 JP JP1032908A patent/JPH01260845A/ja active Pending
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
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Also Published As
Publication number | Publication date |
---|---|
US4928162A (en) | 1990-05-22 |
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