JPH01220839A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPH01220839A JPH01220839A JP63046900A JP4690088A JPH01220839A JP H01220839 A JPH01220839 A JP H01220839A JP 63046900 A JP63046900 A JP 63046900A JP 4690088 A JP4690088 A JP 4690088A JP H01220839 A JPH01220839 A JP H01220839A
- Authority
- JP
- Japan
- Prior art keywords
- film
- silicon
- chip
- semiconductor device
- silicon oxide
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 title claims description 27
- 239000000463 material Substances 0.000 claims abstract description 27
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims abstract description 26
- 229910052814 silicon oxide Inorganic materials 0.000 claims abstract description 24
- 229910052581 Si3N4 Inorganic materials 0.000 claims abstract description 23
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims abstract description 23
- 239000000758 substrate Substances 0.000 claims abstract description 23
- 239000010703 silicon Substances 0.000 claims abstract description 10
- 229910052710 silicon Inorganic materials 0.000 claims abstract description 10
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims abstract description 4
- -1 silicon oxy nitride Chemical class 0.000 claims description 6
- 239000010408 film Substances 0.000 abstract description 49
- 239000002184 metal Substances 0.000 abstract description 30
- 229910052751 metal Inorganic materials 0.000 abstract description 30
- 239000010409 thin film Substances 0.000 abstract description 13
- 229910001218 Gallium arsenide Inorganic materials 0.000 abstract description 10
- 238000004519 manufacturing process Methods 0.000 abstract description 4
- 239000004020 conductor Substances 0.000 abstract description 2
- 229910020286 SiOxNy Inorganic materials 0.000 abstract 2
- 238000004299 exfoliation Methods 0.000 abstract 1
- 238000000034 method Methods 0.000 description 14
- 239000010410 layer Substances 0.000 description 8
- 239000010931 gold Substances 0.000 description 5
- 150000002739 metals Chemical class 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 4
- 239000010936 titanium Substances 0.000 description 4
- 229910052737 gold Inorganic materials 0.000 description 2
- 238000002844 melting Methods 0.000 description 2
- 230000008018 melting Effects 0.000 description 2
- 229910052697 platinum Inorganic materials 0.000 description 2
- LIVNPJMFVYWSIS-UHFFFAOYSA-N silicon monoxide Chemical compound [Si-]#[O+] LIVNPJMFVYWSIS-UHFFFAOYSA-N 0.000 description 2
- 229910052719 titanium Inorganic materials 0.000 description 2
- 229910002710 Au-Pd Inorganic materials 0.000 description 1
- GPXJNWSHGFTCBW-UHFFFAOYSA-N Indium phosphide Chemical compound [In]#P GPXJNWSHGFTCBW-UHFFFAOYSA-N 0.000 description 1
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 230000032798 delamination Effects 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 239000007772 electrode material Substances 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 229910000765 intermetallic Inorganic materials 0.000 description 1
- 238000007747 plating Methods 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 239000002356 single layer Substances 0.000 description 1
- WQJQOUPTWCFRMM-UHFFFAOYSA-N tungsten disilicide Chemical compound [Si]#[W]#[Si] WQJQOUPTWCFRMM-UHFFFAOYSA-N 0.000 description 1
- 229910021342 tungsten silicide Inorganic materials 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/04042—Bonding areas specifically adapted for wire connectors, e.g. wirebond pads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/0555—Shape
- H01L2224/05556—Shape in side view
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/48463—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/48463—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
- H01L2224/48465—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/4847—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a wedge bond
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/4847—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a wedge bond
- H01L2224/48472—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a wedge bond the other connecting portion not on the bonding area also being a wedge bond, i.e. wedge-to-wedge
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
- H01L2224/78—Apparatus for connecting with wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
- H01L2224/78—Apparatus for connecting with wire connectors
- H01L2224/7825—Means for applying energy, e.g. heating means
- H01L2224/783—Means for applying energy, e.g. heating means by means of pressure
- H01L2224/78301—Capillary
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
- H01L2224/78—Apparatus for connecting with wire connectors
- H01L2224/7825—Means for applying energy, e.g. heating means
- H01L2224/783—Means for applying energy, e.g. heating means by means of pressure
- H01L2224/78313—Wedge
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/8512—Aligning
- H01L2224/85148—Aligning involving movement of a part of the bonding apparatus
- H01L2224/85169—Aligning involving movement of a part of the bonding apparatus being the upper part of the bonding apparatus, i.e. bonding head, e.g. capillary or wedge
- H01L2224/8518—Translational movements
- H01L2224/85181—Translational movements connecting first on the semiconductor or solid-state body, i.e. on-chip, regular stitch
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01014—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/102—Material of the semiconductor or solid state bodies
- H01L2924/1025—Semiconducting materials
- H01L2924/1026—Compound semiconductors
- H01L2924/1032—III-V
- H01L2924/10329—Gallium arsenide [GaAs]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/1515—Shape
- H01L2924/15153—Shape the die mounting substrate comprising a recess for hosting the device
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/15165—Monolayer substrate
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、シリコン酸化膜と密着性の高い材料から成
る基板で構成された半導体装置または前記基板上に形成
されたエピタキシャル層に構成された半導体装置に関す
るものである。
る基板で構成された半導体装置または前記基板上に形成
されたエピタキシャル層に構成された半導体装置に関す
るものである。
チップの電極とパッケージの電極を接続する方法として
、ワイヤボンディング法がある。このワイヤボンディン
グ法には、熱圧着法と超音波法とがある。
、ワイヤボンディング法がある。このワイヤボンディン
グ法には、熱圧着法と超音波法とがある。
熱圧着法は、第3図で示すように、金属の融点以下の温
度で、双方の金属の清浄面を加圧接触し、溶融すること
なく金属の拡散によって接合させるものである。チップ
1やパッケージ2あるいは金属ワイヤ3を約300℃に
加熱した後、チップ1のAIパッド4およびパッケージ
の電極パッド5を形成しているAuSAgのめっき層や
Au−Pdの厚膜に、それぞれ金属ワイヤ3(Au線)
を加圧接触させて接合する。この方法は、ボンディング
の方向性がないため作業性がよい。
度で、双方の金属の清浄面を加圧接触し、溶融すること
なく金属の拡散によって接合させるものである。チップ
1やパッケージ2あるいは金属ワイヤ3を約300℃に
加熱した後、チップ1のAIパッド4およびパッケージ
の電極パッド5を形成しているAuSAgのめっき層や
Au−Pdの厚膜に、それぞれ金属ワイヤ3(Au線)
を加圧接触させて接合する。この方法は、ボンディング
の方向性がないため作業性がよい。
超音波法は、第4図で示すように、超音波の振動を接続
する金属ワイヤ6(AI線)に伝えて、チップ1上のA
Iパッド4と金属ワイヤ6間との摩擦によりA1表面の
酸化膜を除去し双方を接触させる。その後、金属ワイヤ
6とボンディングツールとの間に生ずる摩擦熱によって
、接合をより強固なものにする。この方法は、A1線を
常温においてボンディングするので、熱圧着法のような
ボンディング時の熱的な影響がなく、A I −A 1
接続なので強度的に弱い金属間化合物等をつくらず、接
合方法としては信頼性が高い。
する金属ワイヤ6(AI線)に伝えて、チップ1上のA
Iパッド4と金属ワイヤ6間との摩擦によりA1表面の
酸化膜を除去し双方を接触させる。その後、金属ワイヤ
6とボンディングツールとの間に生ずる摩擦熱によって
、接合をより強固なものにする。この方法は、A1線を
常温においてボンディングするので、熱圧着法のような
ボンディング時の熱的な影響がなく、A I −A 1
接続なので強度的に弱い金属間化合物等をつくらず、接
合方法としては信頼性が高い。
いずれの方法による場合でも、半導体から成るチップ1
上に、ワイヤボンディング用電極として金属(AI)パ
ッド4を形成しており、この金属(AI)パッド4に金
属ワイヤ3.6が接続されている。
上に、ワイヤボンディング用電極として金属(AI)パ
ッド4を形成しており、この金属(AI)パッド4に金
属ワイヤ3.6が接続されている。
しかしながら、半導体と金属は一般的に密着性が悪いの
で、両者と密着性の良い薄膜を介在しなければならない
。
で、両者と密着性の良い薄膜を介在しなければならない
。
第5図は、従来の半導体装置の構成を示すものである。
同図(a)は、GaAs基板から成るチップ1上に直接
金属パッド4を形成した構成を示すものである。この場
合、ワイヤボンディング時のストレスにより、チップ1
と金属パッド4の界面から剥離したり、チップ1に損傷
を与え金属パッド4が剥離するという問題がある。
金属パッド4を形成した構成を示すものである。この場
合、ワイヤボンディング時のストレスにより、チップ1
と金属パッド4の界面から剥離したり、チップ1に損傷
を与え金属パッド4が剥離するという問題がある。
そのため、同図(b)ではチップ1上にGaAsと密着
性の良いシリコン酸化膜(S iO2)または金属と密
着性の良いシリコン窒化膜(SiN)7を形成し、その
上に金属パッド4を形成している。しかし、シリコン酸
化膜を使用したときにはシリコン酸化膜と金属との密着
不良が生じ、シリコン窒化膜を使用したときにはシリコ
ン窒化膜とGaAsとの密着不良が生じるので、界面剥
離が発生する。
性の良いシリコン酸化膜(S iO2)または金属と密
着性の良いシリコン窒化膜(SiN)7を形成し、その
上に金属パッド4を形成している。しかし、シリコン酸
化膜を使用したときにはシリコン酸化膜と金属との密着
不良が生じ、シリコン窒化膜を使用したときにはシリコ
ン窒化膜とGaAsとの密着不良が生じるので、界面剥
離が発生する。
そこで、第5図(C)で示すように、チップ1上にシリ
コン酸化膜8およびシリコン窒化膜9を2層構造として
形成し、その上に金属パッド4を構成したものがある。
コン酸化膜8およびシリコン窒化膜9を2層構造として
形成し、その上に金属パッド4を構成したものがある。
この場合、界面剥離は抑止できるがプロセスが複雑にな
り、さらにシリコン窒化膜9の大きな応力によりチップ
1の電気特性が変動する。このように、従来技術では界
面剥離あるいは複雑なプロセスの為、信頼性及び生産歩
留まりが悪いという欠点があった。
り、さらにシリコン窒化膜9の大きな応力によりチップ
1の電気特性が変動する。このように、従来技術では界
面剥離あるいは複雑なプロセスの為、信頼性及び生産歩
留まりが悪いという欠点があった。
そこでこの発明は、信頼性及び生産歩留まりの向上を目
的とする。
的とする。
上記課題を達成するため、この発明はシリコン酸化膜と
密着性の高い材料から成る基板で構成された半導体装置
または前記基板上に形成されたエピタキシャル層に構成
された半導体装置において、基板またはエピタキシャル
層上にシリコン酸化膜を形成し、シリコン酸化膜上にシ
リコン・オキシ・ナイトライド(SiON )膜を形
成し、シ y リコン・オキシ−ナイトライド膜上にシリコン窒化膜と
密着性の高い材料から成るボンディング用電極を形成す
ることを特徴とする。
密着性の高い材料から成る基板で構成された半導体装置
または前記基板上に形成されたエピタキシャル層に構成
された半導体装置において、基板またはエピタキシャル
層上にシリコン酸化膜を形成し、シリコン酸化膜上にシ
リコン・オキシ・ナイトライド(SiON )膜を形
成し、シ y リコン・オキシ−ナイトライド膜上にシリコン窒化膜と
密着性の高い材料から成るボンディング用電極を形成す
ることを特徴とする。
また、シリコン酸化膜と密着性の高い材料から成る基板
で構成された半導体装置または前記基板上に形成された
エピタキシャル層に構成された半導体装置において、基
板またはエピタキシャル層上にシリコン・オキシ・ナイ
トライド膜を形成し、シリコン・オキシ・ナイトライド
膜上にシリコン窒化膜を形成し、シリコン窒化膜上にシ
リコン窒化膜と密着性の高い材料から成るボンディング
用電極を形成することを特徴とする。
で構成された半導体装置または前記基板上に形成された
エピタキシャル層に構成された半導体装置において、基
板またはエピタキシャル層上にシリコン・オキシ・ナイ
トライド膜を形成し、シリコン・オキシ・ナイトライド
膜上にシリコン窒化膜を形成し、シリコン窒化膜上にシ
リコン窒化膜と密着性の高い材料から成るボンディング
用電極を形成することを特徴とする。
この発明は、以上のように構成されているので、チップ
及び金属パッドとの界面剥離を防止することができる。
及び金属パッドとの界面剥離を防止することができる。
以下、この発明の一実施例に係る半導体装置を添付図面
に基づき説明する。なお、説明において同一要素には同
一符号を用い、重複する説明は省略する。
に基づき説明する。なお、説明において同一要素には同
一符号を用い、重複する説明は省略する。
第1図は、この発明の第1の実施例に係る半導体装置を
示すものである。チップ10は、たとえばGaAsで形
成されている。このチップ10上には、チップ10を形
成する材質(G a A s )と密着性の良い材質、
たとえばシリコン酸化膜(S L 02 ) 8が形成
されている。さらに、このシリコン酸化膜8上には、シ
リコン酸化膜とシリコン窒化膜との中間的性質を有する
材質(SiON )で構成された薄膜11が形成さx
y れている。この薄膜11上に電極パッド12が構成され
ている。この電極パッド12は、導電体であればよく、
特に金属に限定されるものではない。
示すものである。チップ10は、たとえばGaAsで形
成されている。このチップ10上には、チップ10を形
成する材質(G a A s )と密着性の良い材質、
たとえばシリコン酸化膜(S L 02 ) 8が形成
されている。さらに、このシリコン酸化膜8上には、シ
リコン酸化膜とシリコン窒化膜との中間的性質を有する
材質(SiON )で構成された薄膜11が形成さx
y れている。この薄膜11上に電極パッド12が構成され
ている。この電極パッド12は、導電体であればよく、
特に金属に限定されるものではない。
この薄膜11は、電極を形成する材質、たとえば金属と
密着性の良いシリコン窒化膜に近い性質を有するため、
電極パッド12の界面剥離を防止することができる。そ
の為、チップ10との密着強度を十分に確保できると共
に、電極パッド12との界面剥離を防止することができ
る。
密着性の良いシリコン窒化膜に近い性質を有するため、
電極パッド12の界面剥離を防止することができる。そ
の為、チップ10との密着強度を十分に確保できると共
に、電極パッド12との界面剥離を防止することができ
る。
第2図は、この発明の第2の実施例に係る半導体装置を
示すものである。チップ10は、たとえばGaAsで形
成されている。このチップ10上には、シリコン酸化膜
とシリコン窒化膜との中間的性質を有する材質(SiO
N )で構成されxy た薄膜11が形成されている。さらに、この薄膜11上
には、電極を形成する金属と密着性の良いシリコン窒化
膜9が形成されている。このシリコン窒化膜9上に電極
パッド12が構成されている。
示すものである。チップ10は、たとえばGaAsで形
成されている。このチップ10上には、シリコン酸化膜
とシリコン窒化膜との中間的性質を有する材質(SiO
N )で構成されxy た薄膜11が形成されている。さらに、この薄膜11上
には、電極を形成する金属と密着性の良いシリコン窒化
膜9が形成されている。このシリコン窒化膜9上に電極
パッド12が構成されている。
前述した薄膜11は、基板を形成する半導体(GaAs
)と密着性の良いシリコン酸化膜に近い性質を有するた
め、チップ10との界面剥離を防止することができる。
)と密着性の良いシリコン酸化膜に近い性質を有するた
め、チップ10との界面剥離を防止することができる。
その為、チップ10との密着強度を十分に確保できると
共に、電極パッド12の界面剥離を防止することができ
る。
共に、電極パッド12の界面剥離を防止することができ
る。
なお、この実施例のようにGaAs基板に対してSiO
N を使用した場合、SiON のxy
xy組成
比を変化させることにより、薄膜の性質をSiO2膜あ
るいはSiN膜に近付けることができ、基板材料あるい
は電極材料が変わっても密着強度をコントロールするこ
とができる。
N を使用した場合、SiON のxy
xy組成
比を変化させることにより、薄膜の性質をSiO2膜あ
るいはSiN膜に近付けることができ、基板材料あるい
は電極材料が変わっても密着強度をコントロールするこ
とができる。
この実施例では、チップの材質としてGaAs基板で説
明しているが、特にGaAsに限定されるものではない
。重要なことは、基板を形成する半導体と、電極を形成
する金属との中間的密着性を有する材質を、基板と電極
の間に含んで半導体装置を構成している点である。した
がって、基板材料としては、シリコン(St)やインジ
ウムリン(InP)などでもよい。この場合でも、Si
ON を使用することにより密着強度が十y 分に確保することができる。
明しているが、特にGaAsに限定されるものではない
。重要なことは、基板を形成する半導体と、電極を形成
する金属との中間的密着性を有する材質を、基板と電極
の間に含んで半導体装置を構成している点である。した
がって、基板材料としては、シリコン(St)やインジ
ウムリン(InP)などでもよい。この場合でも、Si
ON を使用することにより密着強度が十y 分に確保することができる。
さらに、基板(たとえば、GaAs)上に成長させたエ
ピタキシャル層(AIGaAs層)上にSiON を
構成しても、同等の効果が得られxy る。
ピタキシャル層(AIGaAs層)上にSiON を
構成しても、同等の効果が得られxy る。
また、ボンディング用電極として単層金属で説明したが
、特にこの実施例に限定されるものではない。たとえば
、チタン(Ti)、白金(pt)、金(Au)を含んで
構成される多層金属でもよい。
、特にこの実施例に限定されるものではない。たとえば
、チタン(Ti)、白金(pt)、金(Au)を含んで
構成される多層金属でもよい。
この場合、Auを配線電極としてTiをS t OxN
との密着強化のために使用する。ptは、AuとTi
との反応防止に使用する。このように、Ti−Pt−A
uの多層配線構造とすることにより、エレクトロマイグ
レーションが強くなる。
との密着強化のために使用する。ptは、AuとTi
との反応防止に使用する。このように、Ti−Pt−A
uの多層配線構造とすることにより、エレクトロマイグ
レーションが強くなる。
さらに、上述した材料の他にタングステンシリサイドの
ようなものでもよい。
ようなものでもよい。
この発明は、以上説明したように構成されているので、
電極と基板間の界面剥離を防止でき、半導体装置の信頼
性および生産歩留まりが向上する。
電極と基板間の界面剥離を防止でき、半導体装置の信頼
性および生産歩留まりが向上する。
特に、薄膜(たとえば、SiON 膜)の組y
成比を変更することにより、各種絶縁膜および電極との
密着強度を制御することができ、さらに応力の大きさも
制御できる。
密着強度を制御することができ、さらに応力の大きさも
制御できる。
第1図は、この発明の第1の実施例に係る半導体装置の
基本構成を示す図、第2図は、この発明の第2の実施例
に係る半導体装置の基本構成を示す図、第3図及び第4
図は、ワイヤボンディング法を説明するための図、第5
図は、従来技術の基本構成を示す図である。 1.10・・・チップ 2・・・パッケージ 3.6・・・金属ワイヤ 4・・・AIパッド 5・・・電極パッド 7・・・シリコン酸化膜またはシリコン窒化膜8・・・
シリコン酸化膜 9・・・シリコン窒化膜 11・・・薄膜 12・・・電極パッド 半導体装置(第1の実施例) 第1図 第2の実施例 第2図 従来技術 第5図
基本構成を示す図、第2図は、この発明の第2の実施例
に係る半導体装置の基本構成を示す図、第3図及び第4
図は、ワイヤボンディング法を説明するための図、第5
図は、従来技術の基本構成を示す図である。 1.10・・・チップ 2・・・パッケージ 3.6・・・金属ワイヤ 4・・・AIパッド 5・・・電極パッド 7・・・シリコン酸化膜またはシリコン窒化膜8・・・
シリコン酸化膜 9・・・シリコン窒化膜 11・・・薄膜 12・・・電極パッド 半導体装置(第1の実施例) 第1図 第2の実施例 第2図 従来技術 第5図
Claims (1)
- 【特許請求の範囲】 1、シリコン酸化膜(SiO_2)と密着性の高い材料
から成る基板で構成された半導体装置または前記基板上
に形成されたエピタキシャル層に構成された半導体装置
において、 前記基板または前記エピタキシャル層上にシリコン酸化
膜を形成し、 前記シリコン酸化膜上にシリコン・オキシ・ナイトライ
ド(SiO_xN_y)膜を形成し、前記シリコン・オ
キシ・ナイトライド膜上にシリコン窒化膜(SiN)と
密着性の高い材料から成るボンディング用電極を形成す
ることを特徴とする半導体装置。 2、シリコン酸化膜(SiO_2)と密着性の高い材料
から成る基板で構成された半導体装置または前記基板上
に形成されたエピタキシャル層に構成された半導体装置
において、 前記基板または前記エピタキシャル層上にシリコン・オ
キシ・ナイトライド膜を形成し、 前記シリコン・オキシ・ナイトライド膜上にシリコン窒
化膜(SiN)を形成し、 前記シリコン窒化膜上にシリコン窒化膜と密着性の高い
材料から成るボンディング用電極を形成することを特徴
とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63046900A JPH01220839A (ja) | 1988-02-29 | 1988-02-29 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63046900A JPH01220839A (ja) | 1988-02-29 | 1988-02-29 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01220839A true JPH01220839A (ja) | 1989-09-04 |
Family
ID=12760241
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63046900A Pending JPH01220839A (ja) | 1988-02-29 | 1988-02-29 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01220839A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7202568B2 (en) * | 1998-06-26 | 2007-04-10 | Intel Corporation | Semiconductor passivation deposition process for interfacial adhesion |
-
1988
- 1988-02-29 JP JP63046900A patent/JPH01220839A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7202568B2 (en) * | 1998-06-26 | 2007-04-10 | Intel Corporation | Semiconductor passivation deposition process for interfacial adhesion |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP0253691B1 (en) | Silicon die bonding process | |
US5661081A (en) | Method of bonding an aluminum wire to an intergrated circuit bond pad | |
US5654586A (en) | Power semiconductor component having a buffer layer | |
JPH02123685A (ja) | 金を含むワイヤを半田に接着する方法 | |
US5851852A (en) | Die attached process for SiC | |
JPH03127843A (ja) | 半導体集積回路装置 | |
JPS59210656A (ja) | 半導体装置 | |
JPH118264A (ja) | 半導体装置及びその製造方法 | |
JPH01220839A (ja) | 半導体装置 | |
JP3211749B2 (ja) | 半導体装置のボンディングパッド及びその製造方法 | |
JPH01220838A (ja) | 半導体装置 | |
JP3410655B2 (ja) | 半導体レーザ装置の製造方法 | |
JPH01244625A (ja) | 半導体装置 | |
JPH0653271A (ja) | 半導体装置のワイヤーボンディング方法 | |
JPS63293930A (ja) | 半導体装置における電極 | |
JPS615561A (ja) | 半導体装置 | |
JPH02168640A (ja) | 異なる基板間の接続構造 | |
JPH07249657A (ja) | 半導体集積回路装置 | |
JPS61181136A (ja) | ダイボンデイング方法 | |
JPS6054462A (ja) | 半導体装置 | |
JP3267422B2 (ja) | バンプ転写体および半導体集積回路装置の製造方法 | |
JPS5928049B2 (ja) | 半導体装置のリ−ド接続方法 | |
JP2987905B2 (ja) | 半導体装置 | |
KR960011854B1 (ko) | 다이 본딩 공정 방법 | |
JPS62169350A (ja) | 半導体装置とその製造方法 |