JPH01187660A - 周辺装置のインタフェース診断方式 - Google Patents
周辺装置のインタフェース診断方式Info
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- JPH01187660A JPH01187660A JP63010872A JP1087288A JPH01187660A JP H01187660 A JPH01187660 A JP H01187660A JP 63010872 A JP63010872 A JP 63010872A JP 1087288 A JP1087288 A JP 1087288A JP H01187660 A JPH01187660 A JP H01187660A
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- Japan
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- data
- command
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- Pending
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- 230000002093 peripheral effect Effects 0.000 title claims description 19
- 238000000034 method Methods 0.000 claims description 7
- 238000003745 diagnosis Methods 0.000 abstract description 10
- 238000013500 data storage Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 238000002405 diagnostic procedure Methods 0.000 description 2
- 230000004913 activation Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
Landscapes
- Test And Diagnosis Of Digital Computers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は周辺装置とチャネル装置が工／Ｏインタフェ
ースで接続された周辺装置はおけるインタフェースの診
断釦関し、特にデータの折返し診断を行ガう周辺装置の
インタフェース診断方式に関するものである。
ースで接続された周辺装置はおけるインタフェースの診
断釦関し、特にデータの折返し診断を行ガう周辺装置の
インタフェース診断方式に関するものである。
従来、この種のインタフェース診断方式は、ただ単に共
通制御部からアドレス／コマンドレジスタおよび入出力
データレジスタへの書込み、読出しを行ないそのデータ
の比較チエツクを行なうだけでらυ、データの折返し診
断は行なっていなかった。
通制御部からアドレス／コマンドレジスタおよび入出力
データレジスタへの書込み、読出しを行ないそのデータ
の比較チエツクを行なうだけでらυ、データの折返し診
断は行なっていなかった。
上述した従来のインタフェース診断方式は、共通制御部
からアドレス／コマンドレジスタおよび入出力データレ
ジスタへの書込み、読出しくよるデータの比較チエツク
を行々っているので、通常動作のインタフェースシーケ
ンスであるアドレス／コマンドサイクルとデータサイク
ル時におけるＩ／Ｏインタフェースへの出力データが正
常かどうか実際にチャネル装置を接続しかいとわからな
いという欠点がある。
からアドレス／コマンドレジスタおよび入出力データレ
ジスタへの書込み、読出しくよるデータの比較チエツク
を行々っているので、通常動作のインタフェースシーケ
ンスであるアドレス／コマンドサイクルとデータサイク
ル時におけるＩ／Ｏインタフェースへの出力データが正
常かどうか実際にチャネル装置を接続しかいとわからな
いという欠点がある。
この発明に係る周辺装置のインタフェース診断方式ハ、
アドレス／コマンドをアドレス／コマンドレジスタに設
定する手段と、設定されたアドレスを１転送サイクル毎
に更新する手段と、設定されたアドレス／コマンドと出
力データをＩ／Ｏインタフェースで折り返して再び入出
力データレジスタに与え取込む手段と、前記アドレス／
コマンドレジスタに設定された内容と前記入出力データ
レジスタに取込まれた内容を比較する手段と、比較した
結果が不一致のとき共通制御部へ割込む手段と、チャネ
ル装置とインタフェース制御を打力うインタフェース制
御部からチャネル装置の入力信号を擬似生成する手段と
を有している。
アドレス／コマンドをアドレス／コマンドレジスタに設
定する手段と、設定されたアドレスを１転送サイクル毎
に更新する手段と、設定されたアドレス／コマンドと出
力データをＩ／Ｏインタフェースで折り返して再び入出
力データレジスタに与え取込む手段と、前記アドレス／
コマンドレジスタに設定された内容と前記入出力データ
レジスタに取込まれた内容を比較する手段と、比較した
結果が不一致のとき共通制御部へ割込む手段と、チャネ
ル装置とインタフェース制御を打力うインタフェース制
御部からチャネル装置の入力信号を擬似生成する手段と
を有している。
この発明はチャネル装置を接続せずにダイレクトチャネ
ルアダプタのアドレス／コマンドパスおよびデータバス
を完全に診断することができる。
ルアダプタのアドレス／コマンドパスおよびデータバス
を完全に診断することができる。
第１図はこの発明に係る周辺装置のインタフェース診断
方式の一実施例を示すブロック図である。
方式の一実施例を示すブロック図である。
同図において、１は周辺装置、２はチャネル装置、３は
この周辺装置１とチャネル装置２を接続する工／Ｏイン
タフェース、４はデータ格納メモリ、５はデータ転送制
御部、６は共通制御部、Ｔはその詳細な構成を第２図に
示すダイレクトチャネルアダプタである。
この周辺装置１とチャネル装置２を接続する工／Ｏイン
タフェース、４はデータ格納メモリ、５はデータ転送制
御部、６は共通制御部、Ｔはその詳細な構成を第２図に
示すダイレクトチャネルアダプタである。
々お、第２図に示すダイレクトチャネルアダブｐｒｖｃ
おいて、８は共通制御部６からのアドレス／＝ｆｆ ｆ
ｆ ７ トーＩｔ格納−ｊ−ルアドレス／コマンドレジ
スタ、９はアドレス部を更新する更新回路、１ｏは選択
回路、１１はＩ／Ｏインタフェース３からの入力データ
をレシーバ回路１２ｂおよび選択回路１゜を通して格納
し、データ転送制御部５からの出力データを選択回路／
Ｏを通して格納し、また、格納されたデータを下記の選
択回路およびドライバ回路１３ｂを通してＩ／Ｏインタ
フェース３へ出カスる入出力データレジスタ、１４はア
ドレス／コマンドレジスタＢに設定されたコマンドに従
ってＩ／Ｏインタフェースでのインタフェース制御を行
ないドライバ回路１３１あるいはレシーバ回路１２＆を
通して工／Ｏインタフェース３に接続されたダイアログ
制御回路、１５はアドレス／コマンドレジスタ８に設定
されたコマンドとダイアログ制御回路１４の出力信号を
基にチャネル装置２からの入力信号ＤＣ−ＤＴＡを擬似
生成する入力信号擬似生成回路、１６は比較回路、１１
はこの比較回路１６から出力される一致信号によってセ
ットされるエラーＦ’／Ｆ、１８は選択回路である。ま
た、第３図（イ）〜第３図に）および第４図（イ）〜第
４図に）はＩ／Ｏインタフェースのダイアログ制御を示
すタイムチャートであシ、特に第３図（イ）〜第３図に
）は周辺装置１からチャネル装置２へのデータ転送のＣ
Ｓライト時を示し、第４図（イ）〜第４図に）はチャネ
ル装ｅ２から周辺装（ｉｉｌへのデータ転送のＣ８１Ｊ
−ド時を示す。また、第３図（イ）および第４図（イ）
に示すＤＡ−ＤＴＡ信号、第３図（ハ）および第４図（
→に示すＤＴＡ−ＥＮＡ信号および第３図に）および第
４図に）に示すＲＦ、ＱＵＥＳＴ信号はチャネル装ｆｔ
、２への出力制御信号を示し、第３図仲）および第４図
←）に示すＤＣ−ＤＴＡ信号はチャネル装置２からの入
力制御信号を示す。また、１転送サイクルは周辺装置１
からアドレス／コマンドを送出するアドレス／コマンド
サイクル１９と周辺装置１からまたは周辺装置へデータ
を送信または受信するデータサイクル２０とからなる。
おいて、８は共通制御部６からのアドレス／＝ｆｆ ｆ
ｆ ７ トーＩｔ格納−ｊ−ルアドレス／コマンドレジ
スタ、９はアドレス部を更新する更新回路、１ｏは選択
回路、１１はＩ／Ｏインタフェース３からの入力データ
をレシーバ回路１２ｂおよび選択回路１゜を通して格納
し、データ転送制御部５からの出力データを選択回路／
Ｏを通して格納し、また、格納されたデータを下記の選
択回路およびドライバ回路１３ｂを通してＩ／Ｏインタ
フェース３へ出カスる入出力データレジスタ、１４はア
ドレス／コマンドレジスタＢに設定されたコマンドに従
ってＩ／Ｏインタフェースでのインタフェース制御を行
ないドライバ回路１３１あるいはレシーバ回路１２＆を
通して工／Ｏインタフェース３に接続されたダイアログ
制御回路、１５はアドレス／コマンドレジスタ８に設定
されたコマンドとダイアログ制御回路１４の出力信号を
基にチャネル装置２からの入力信号ＤＣ−ＤＴＡを擬似
生成する入力信号擬似生成回路、１６は比較回路、１１
はこの比較回路１６から出力される一致信号によってセ
ットされるエラーＦ’／Ｆ、１８は選択回路である。ま
た、第３図（イ）〜第３図に）および第４図（イ）〜第
４図に）はＩ／Ｏインタフェースのダイアログ制御を示
すタイムチャートであシ、特に第３図（イ）〜第３図に
）は周辺装置１からチャネル装置２へのデータ転送のＣ
Ｓライト時を示し、第４図（イ）〜第４図に）はチャネ
ル装ｅ２から周辺装（ｉｉｌへのデータ転送のＣ８１Ｊ
−ド時を示す。また、第３図（イ）および第４図（イ）
に示すＤＡ−ＤＴＡ信号、第３図（ハ）および第４図（
→に示すＤＴＡ−ＥＮＡ信号および第３図に）および第
４図に）に示すＲＦ、ＱＵＥＳＴ信号はチャネル装ｆｔ
、２への出力制御信号を示し、第３図仲）および第４図
←）に示すＤＣ−ＤＴＡ信号はチャネル装置２からの入
力制御信号を示す。また、１転送サイクルは周辺装置１
からアドレス／コマンドを送出するアドレス／コマンド
サイクル１９と周辺装置１からまたは周辺装置へデータ
を送信または受信するデータサイクル２０とからなる。
次に上記構成による周辺装置のインタフェース診断方式
、特に周辺装置のＩ／Ｏインタフェースでのデータ折返
し診断動作についてｇ３図０）〜第３図に）および第４
図０）〜第４図に）を参照して説明する。まず、周辺装
ｅ１のデータ格納メモリ４とチャネル装ｅ２とのデータ
転送は共通制御部６の制御の下にデータ転送制御部５と
ダイレクトチャネルアダプタγを介して行なわれる。そ
して、この共通制御部６の起動制御によりダイレクトチ
ャネルアダプタＴにてＩ／Ｏインタフェース３でのデ−
タの折シ返し試験が行なわれる。そこで、共通制御部６
からアドレス／コマンドレジスタ８へ初期アドレスとＣ
Ｓライトコマンドがセットされると、このＣＳライトコ
マンドによシダイアログ制御回路１４および入力信号線
擬似生成回路１５によシｇＫ３図（イ）〜第３図に）の
ＣＳライト時のタイムチャートで示すＩ／Ｏインタフェ
ース制御ダイアログが行なわれる。すなわち、まずアド
レス／コマンドサイクル１９が実行され、アドレス／コ
マンドレジスタ８の内容は選択回路１８−ドライバ回路
１３ｂ−レシーバ回路１２ｂ−選択回路／Ｏを通して入
出力データレジスタ１１にタイミングＡでセットされる
。そして、比較回路１６はこの入出力データレジスタ１
１の内容ドアドレス／コマンドレジスタ８の内容とをタ
イミングＢで比較チエツクし不一致であれば不一致信号
を出力する。このため、工２− Ｆ／Ｆ １γはこの不
一致信号の入力によシセットされて共通制御部６へ割込
み、インタフェースダイアログを停止する。また、比較
回路１６で一致がとれれば次のデータサイクルが実行さ
れ、入出力データレジスタ１１の内容は選択回路１８−
ドライバ回路１３ｂ−レシーバ回路１２ｂ−選択回路／
Ｏを通して入出力データレジスタ１１へ再びタイミング
Ｃでセットされる。そして、比較回路１６はこの入出力
データレジスタ１１の内容とアドレス／コマンドレジス
タ８の内容とをタイミングＤで比較チエツクし、不一致
であれば不一致信号がエラーＦＦ１７に出力される。
、特に周辺装置のＩ／Ｏインタフェースでのデータ折返
し診断動作についてｇ３図０）〜第３図に）および第４
図０）〜第４図に）を参照して説明する。まず、周辺装
ｅ１のデータ格納メモリ４とチャネル装ｅ２とのデータ
転送は共通制御部６の制御の下にデータ転送制御部５と
ダイレクトチャネルアダプタγを介して行なわれる。そ
して、この共通制御部６の起動制御によりダイレクトチ
ャネルアダプタＴにてＩ／Ｏインタフェース３でのデ−
タの折シ返し試験が行なわれる。そこで、共通制御部６
からアドレス／コマンドレジスタ８へ初期アドレスとＣ
Ｓライトコマンドがセットされると、このＣＳライトコ
マンドによシダイアログ制御回路１４および入力信号線
擬似生成回路１５によシｇＫ３図（イ）〜第３図に）の
ＣＳライト時のタイムチャートで示すＩ／Ｏインタフェ
ース制御ダイアログが行なわれる。すなわち、まずアド
レス／コマンドサイクル１９が実行され、アドレス／コ
マンドレジスタ８の内容は選択回路１８−ドライバ回路
１３ｂ−レシーバ回路１２ｂ−選択回路／Ｏを通して入
出力データレジスタ１１にタイミングＡでセットされる
。そして、比較回路１６はこの入出力データレジスタ１
１の内容ドアドレス／コマンドレジスタ８の内容とをタ
イミングＢで比較チエツクし不一致であれば不一致信号
を出力する。このため、工２− Ｆ／Ｆ １γはこの不
一致信号の入力によシセットされて共通制御部６へ割込
み、インタフェースダイアログを停止する。また、比較
回路１６で一致がとれれば次のデータサイクルが実行さ
れ、入出力データレジスタ１１の内容は選択回路１８−
ドライバ回路１３ｂ−レシーバ回路１２ｂ−選択回路／
Ｏを通して入出力データレジスタ１１へ再びタイミング
Ｃでセットされる。そして、比較回路１６はこの入出力
データレジスタ１１の内容とアドレス／コマンドレジス
タ８の内容とをタイミングＤで比較チエツクし、不一致
であれば不一致信号がエラーＦＦ１７に出力される。
したがって、このエラーＦＦ１７のセットによシ共通制
御部６へ割込み、インタフェースダイヤログを停止する
。一方、比較回路１６で一致がとれれば更新回路９で更
新されアドレスがタイミングＥでアドレス／コマンドレ
ジスタ８のアドレス部へセットされ、１転送サイクルは
終了し次の転送サイクルが引続き実行される。そして、
第４図（イ）〜第４図に）に示すように１アドレス／コ
マンドレジスタ８にセットされたコマンドがＣＳリード
の場合もＣＳライト時と同様にタイミングＡでアドレス
／コマンドレジスタ８の内容が入出力データレジスタ１
１にセットされ、タイミングＢで比較チエツクされ、タ
イミングＣで入出力データレジスタ１１の内容が再びセ
ットされ、タイミングＤで比較チエツクされ、タイミン
グＥでアドレスが更新され、１転送サイクルが終了し次
の転送サイクルが引続き実行される。
御部６へ割込み、インタフェースダイヤログを停止する
。一方、比較回路１６で一致がとれれば更新回路９で更
新されアドレスがタイミングＥでアドレス／コマンドレ
ジスタ８のアドレス部へセットされ、１転送サイクルは
終了し次の転送サイクルが引続き実行される。そして、
第４図（イ）〜第４図に）に示すように１アドレス／コ
マンドレジスタ８にセットされたコマンドがＣＳリード
の場合もＣＳライト時と同様にタイミングＡでアドレス
／コマンドレジスタ８の内容が入出力データレジスタ１
１にセットされ、タイミングＢで比較チエツクされ、タ
イミングＣで入出力データレジスタ１１の内容が再びセ
ットされ、タイミングＤで比較チエツクされ、タイミン
グＥでアドレスが更新され、１転送サイクルが終了し次
の転送サイクルが引続き実行される。
以上詳細に説明したように、この発明に係る周辺装置の
インタフェース診断方式によれば、折返しデータとして
アドレス／コマンドレジスタにセットされた値を転送毎
にアドレス更新回路で更新したデータを使用することに
依シデータをメモリ上に用意する必要がなく、また、比
較回路を設けて折返しデータのチエツクを自動的に行わ
せ、入力信号を擬似的に生成することによシ、チャネル
装置を接続することなしに実転送に近い形でアドレス／
コマンドパスとデータバスの両パスを完全に診断するこ
とができる効果がある。
インタフェース診断方式によれば、折返しデータとして
アドレス／コマンドレジスタにセットされた値を転送毎
にアドレス更新回路で更新したデータを使用することに
依シデータをメモリ上に用意する必要がなく、また、比
較回路を設けて折返しデータのチエツクを自動的に行わ
せ、入力信号を擬似的に生成することによシ、チャネル
装置を接続することなしに実転送に近い形でアドレス／
コマンドパスとデータバスの両パスを完全に診断するこ
とができる効果がある。
第１図はこの発明に係る周辺装置のインタフェース診断
方式の一実施例を示すブロック図、第２図は第１図のダ
イレクトチャネルアダプタの詳細を示すブロック図、第
３図および第４図は第１図の動作を説明するためのＩ／
Ｏインタフェースツタイアログを示すタイムチャートで
おる。 １・ｍ−・周辺装置、２・・・・チャネル装置、３・・
―・■／Ｏインタフェース、４・−・・データ格納メモ
ＩＪ、５＠＠・・データ転送制御部、６・・・・共通制
御部、Ｔ・・・・ダイレクトチャネルアダプタ、８・・
＠−アドレス／コマンドレジスタ、９・・・・更新回路
、／Ｏ・・・・選択回路、１１・Φ・・入出力データレ
ジスタ、１２凰および１２ｂ・・φ・レシーバ回路、１
３＆および１３ｂ 拳・・・ドライバ回路、１４・・・
・ダイヤログ制御回路、１５・―・・入力信号擬似生成
回路、１６・Ｓ・・比較回路、１Ｔ−・拳・エラーＦ／
Ｆ１ａ−・・・選択回路、１９会・・・アドレス／コマ
ンドサイクル、２０・・・・データサイクル。 。
方式の一実施例を示すブロック図、第２図は第１図のダ
イレクトチャネルアダプタの詳細を示すブロック図、第
３図および第４図は第１図の動作を説明するためのＩ／
Ｏインタフェースツタイアログを示すタイムチャートで
おる。 １・ｍ−・周辺装置、２・・・・チャネル装置、３・・
―・■／Ｏインタフェース、４・−・・データ格納メモ
ＩＪ、５＠＠・・データ転送制御部、６・・・・共通制
御部、Ｔ・・・・ダイレクトチャネルアダプタ、８・・
＠−アドレス／コマンドレジスタ、９・・・・更新回路
、／Ｏ・・・・選択回路、１１・Φ・・入出力データレ
ジスタ、１２凰および１２ｂ・・φ・レシーバ回路、１
３＆および１３ｂ 拳・・・ドライバ回路、１４・・・
・ダイヤログ制御回路、１５・―・・入力信号擬似生成
回路、１６・Ｓ・・比較回路、１Ｔ−・拳・エラーＦ／
Ｆ１ａ−・・・選択回路、１９会・・・アドレス／コマ
ンドサイクル、２０・・・・データサイクル。 。
Claims (1)
- 周辺装置とチャネル装置がＩ／Ｏインタフェースで接続
され、アドレス／コマンドとデータを分離してチャネル
装置に送るダイレクトチヤネルアダプタにおいて、アド
レス／コマンドをアドレス／コマンドレジスタに設定す
る手段と、設定されたアドレスを１転送サイクル毎に更
新する手段と、設定されたアドレス／コマンドと出力デ
ータをＩ／Ｏインタフェースで折り返して再び入出力デ
ータレジスタに与え取込む手段と、前記アドレス／コマ
ンドレジスタに設定された内容と前記入出力データレジ
スタに取込まれた内容を比較する手段と、比較した結果
が不一致のとき共通制御部へ割込む手段と、チャネル装
置とインタフェース制御を行なうインタフェース制御部
からチャネル装置の入力信号を擬似生成する手段とを備
えたことを特徴とする周辺装置のインタフェース診断方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63010872A JPH01187660A (ja) | 1988-01-22 | 1988-01-22 | 周辺装置のインタフェース診断方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63010872A JPH01187660A (ja) | 1988-01-22 | 1988-01-22 | 周辺装置のインタフェース診断方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01187660A true JPH01187660A (ja) | 1989-07-27 |
Family
ID=11762430
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63010872A Pending JPH01187660A (ja) | 1988-01-22 | 1988-01-22 | 周辺装置のインタフェース診断方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01187660A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012113481A (ja) * | 2010-11-24 | 2012-06-14 | Mitsubishi Electric Corp | バスモジュール及びバスシステム |
-
1988
- 1988-01-22 JP JP63010872A patent/JPH01187660A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012113481A (ja) * | 2010-11-24 | 2012-06-14 | Mitsubishi Electric Corp | バスモジュール及びバスシステム |
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